JPH053796B2 - - Google Patents
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- JPH053796B2 JPH053796B2 JP59082162A JP8216284A JPH053796B2 JP H053796 B2 JPH053796 B2 JP H053796B2 JP 59082162 A JP59082162 A JP 59082162A JP 8216284 A JP8216284 A JP 8216284A JP H053796 B2 JPH053796 B2 JP H053796B2
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-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04N—PICTORIAL COMMUNICATION, e.g. TELEVISION
- H04N5/00—Details of television systems
- H04N5/76—Television signal recording
- H04N5/91—Television signal processing therefor
- H04N5/93—Regeneration of the television signal or of selected parts thereof
- H04N5/95—Time-base error compensation
- H04N5/956—Time-base error compensation by using a digital memory with independent write-in and read-out clock generators
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- Engineering & Computer Science (AREA)
- Multimedia (AREA)
- Signal Processing (AREA)
- Television Signal Processing For Recording (AREA)
- Signal Processing Not Specific To The Method Of Recording And Reproducing (AREA)
Description
【発明の詳細な説明】
産業上の利用分野
本発明は、スローモーシヨン再生可能なビデオ
テープレコーダ(VTR)における時間軸補正装
置に関する。DETAILED DESCRIPTION OF THE INVENTION Field of the Invention The present invention relates to a time axis correction device in a video tape recorder (VTR) capable of slow motion playback.
従来例の構成とその問題点
放送局等においては、VTRからの再生映像信
号を局内の基準同期信号に一致せしめて送出する
必要上、第1図に示す時間軸補正装置が、必要不
可欠である。Conventional configuration and its problems In broadcasting stations, etc., the time axis correction device shown in Figure 1 is indispensable because it is necessary to match the reproduced video signal from the VTR to the station's standard synchronization signal before sending it out. .
第1図において、VTR等の再生映像信号1は
アナログ−デイジタル変換器(A/D)2と同期
分離回路3に供給される。同期分離回路3は、水
平同期信号4を書込クロツク発生回路6に、垂直
同期信号(テープV信号)5をラツチ回路7に供
給する。書込クロツク発生回路6は、水平同期信
号にロツクしたクロツクをA/D2とメモリ回路
8に供給するとともに、書込ラインアドレスカウ
ンタ9に水平同期周期の信号H10を供給する。ま
た、読出クロツク発生回路11は外部基準同期信
号12を元に、クロツクをメモリ回路8とデイジタ
ル−アナログ変換器(D/A)13に印加し、読
出ラインアドレスカウンタ14に、外部基準同期
信号に含まれる水平同期信号FH15と、垂直同期
信号(VP信号)16を加えている。書込ラインア
ドレスカウンタ9と読出ラインアドレスカウンタ
14はそれぞれH10とFH15をカウントしてライン
アドレスを作成し、混合回路(MIX)17では
これらのラインアドレスが混合された後、メモリ
8に加えられている。ラツチ回路7では、テープ
V信号5時に書込ラインアドレスを取り込み、
VP信号16時に読出ラインアドレスカウンタ14
にロードし、テープV信号5時の書込ラインアド
レスとVP信号16時の読出ラインアドレスを一致
せしめる。 In FIG. 1, a reproduced video signal 1 from a VTR or the like is supplied to an analog-to-digital converter (A/D) 2 and a sync separation circuit 3. The synchronization separation circuit 3 supplies a horizontal synchronization signal 4 to a write clock generation circuit 6 and a vertical synchronization signal (tape V signal) 5 to a latch circuit 7. The write clock generation circuit 6 supplies a clock locked to the horizontal synchronization signal to the A/D 2 and the memory circuit 8, and also supplies the write line address counter 9 with a signal H10 of the horizontal synchronization period. Further, the read clock generation circuit 11 applies a clock to the memory circuit 8 and the digital-to-analog converter (D/A) 13 based on the external reference synchronization signal 12, and applies the clock to the read line address counter 14 based on the external reference synchronization signal 12. The included horizontal synchronization signal F H 15 and vertical synchronization signal (VP signal) 16 are added. The write line address counter 9 and the read line address counter 14 count H 10 and F H 15 respectively to create line addresses, and after these line addresses are mixed in the mixing circuit (MIX) 17, they are stored in the memory 8. has been added. The latch circuit 7 takes in the write line address at the tape V signal 5, and
Read line address counter 14 when VP signal 16
The write line address when the tape V signal is 5 and the read line address when the VP signal is 16 are made to match.
しかし、VTRからの再生映像信号1は、ドロ
ツプアウト等によりテープV信号5が欠落する場
合が発生する。この場合には、ラツチ回路7で行
われていた動作が安定に行われなくなるため、結
果として時間軸補正器の出力映像信号がモニタ上
で、上下ゆれを発生する。また、ノイズレススロ
ーモーシヨン再生を目的として可動ヘツドが取り
付けられたVTRでは、後記する様に、テープV
信号5が1フイールドに2個続いて出て来たり、
全く出なかつたりする。この様な場合にも安定な
画像を得る事は出来ない。 However, in the reproduced video signal 1 from the VTR, the tape V signal 5 may be missing due to dropout or the like. In this case, the operation performed by the latch circuit 7 is no longer performed stably, and as a result, the output video signal of the time axis corrector causes vertical fluctuations on the monitor. In addition, in a VTR equipped with a movable head for the purpose of noiseless slow motion playback, the tape V
Two signals of signal 5 appear in one field,
Sometimes it doesn't come out at all. Even in such a case, a stable image cannot be obtained.
ドロツプアウト等によるテープV信号の欠落に
よる誤動作をさけるためには、前のフイールドの
テープV信号より1フイールド分遅延させて予測
V信号を作つておき、テープV信号の欠落時に置
き換える様な事が必要である。しかし、可動ヘツ
ドを用いてノイズレススロー再生を行うVTRに
おいては、隣りあうV信号の時間間隔が一定でな
く、場合によつては、V信号が2個続いて出てき
たりし、非常に変則的なV信号を発生する。次
に、第2図、第3図を用いて変則的なV信号の発
生過程を説明する。 In order to avoid malfunctions caused by missing tape V signals due to dropouts, etc., it is necessary to create a predicted V signal delayed by one field from the tape V signal of the previous field, and to replace it when the tape V signal is missing. It is. However, in VTRs that perform noiseless slow playback using a movable head, the time intervals between adjacent V signals are not constant, and in some cases, two V signals may appear in succession, resulting in very irregular playback. Generates a V signal. Next, the process of generating an irregular V signal will be explained using FIGS. 2 and 3.
第2図は、2ヘツドヘリカルスキヤンVTRの
テープおよびビデオヘツドの走行を示す概略図で
ある。ふたつのヘツドであるAヘツド18とBヘ
ツド19は回転シリンダ20の円周上の180°対向
する位置に取り付けられており、矢印21の向き
に回転している。また磁気テープ22は回転シリ
ンダ20に180°以上巻き付けられており、矢印2
3の方向に走行する。 FIG. 2 is a schematic diagram showing the running of the tape and video head of a two-head helical scan VTR. Two heads, an A head 18 and a B head 19, are mounted at 180° opposing positions on the circumference of a rotary cylinder 20 and rotate in the direction of an arrow 21. Further, the magnetic tape 22 is wrapped around the rotating cylinder 20 by more than 180 degrees, and the magnetic tape 22 is
Run in direction 3.
第3図は、第2図のヘツドによるテープ上の記
録パターンを示している。磁気テープ22は矢印
23の方向に走行するとともに、Aヘツド18、
Bヘツド19が、交互に矢印21の向きに走行
し、磁気テープ22上に、記録トラツク24,2
5,26の順にかいてゆく。図中で破線で示した
24′,25′,26′,24″,25″,26″はオ
ーバーラツプ記録領域である。再生時に、Aヘツ
ド18とBヘツド19からの再生映像信号のつな
ぎ目で、映像信号の欠落をなくするために、通
常、回転シリンダ20に磁気テープ22を180°以
上に巻き付けるので、オーバーラツプ領域が発生
する。図中においてハツチング部は、垂直同期信
号(V信号)の記録領域である。 FIG. 3 shows the pattern recorded on the tape by the head of FIG. The magnetic tape 22 runs in the direction of the arrow 23, and the A head 18,
The B heads 19 alternately run in the direction of the arrow 21 and write recording tracks 24, 2 on the magnetic tape 22.
Write numbers 5 and 26 in that order. The areas 24', 25', 26', 24'', 25'', and 26'' indicated by broken lines in the figure are overlap recording areas. In order to eliminate video signal dropouts, the magnetic tape 22 is usually wound around the rotary cylinder 20 at an angle of 180° or more, so an overlap area occurs. It is.
通常再生においては、Aヘツド18がP−Q線
分を走査する。Aヘツド18がQ点に達した時
は、Bヘツド19が、P′点に位置しており、次は
Bヘツド19がP′−Q′線分を走査し、続いてAヘ
ツド18が、P″−Q″線分を走査する。 During normal reproduction, the A head 18 scans the P-Q line segment. When the A head 18 reaches the Q point, the B head 19 is located at the P' point. Next, the B head 19 scans the P'-Q' line segment, and then the A head 18 scans the P'-Q' line segment. Scan the P″-Q″ line segment.
ところが、ノイズレススローモーシヨン再生時
は、様子が異なる。例えば、テープが静止時を例
にとつて説明する。 However, the situation is different during noiseless slow motion playback. For example, a case will be explained in which the tape is at rest.
静止モードにおいては、Aヘツド18とBヘツ
ド19の軌跡が一致しており、例えば、線分P′−
Q等の軌跡となる。ところが、軌跡の途中で、記
録トラツク25から記録トラツク24への移動が
発生するため、モニタ画面上で、ノイズバンドが
発生する。 In the stationary mode, the trajectories of the A head 18 and the B head 19 match, for example, the line segment P'-
It becomes a trajectory such as Q. However, since movement from recording track 25 to recording track 24 occurs during the trajectory, noise bands occur on the monitor screen.
このため、Aヘツド18、Bヘツド19として
トラツク走査に対して垂直に可動するヘツドを取
り付け、この可動ヘツドをくさび状に動かし、静
止モードにおいて、線分P′−R上にヘツドA1
8、ヘツドB19の軌跡がくる様に制御する。こ
の様にすれば、1フイールド内は、常に一本の記
録トラツクを走査する様になりノイズバンドの発
生がさけられる。 For this purpose, heads movable perpendicularly to the track scanning are installed as the A head 18 and B head 19, and these movable heads are moved in a wedge shape. In the stationary mode, the head A1 is placed on the line segment P'-R.
8. Control so that the trajectory of head B19 follows. In this way, one recording track is always scanned within one field, and the generation of noise bands can be avoided.
さらに、ヘリカルスキヤンVTRの記録トラツ
クには、第3図の27に示す様に、水平同期信号
位置のずれ(αH)が存在する。ここでαH=25Hと
して説明する。 Furthermore, in the recording track of a helical scan VTR, there is a shift (α H ) in the horizontal synchronizing signal position, as shown at 27 in FIG. Here, the explanation will be made assuming α H =25H.
線分P−Qに含まれる水平走査期間(H)の数
はNTSC方式の場合、1フイールド分の262.5H
である。前記した線分P′−Rは、αH分加算され
て、1フイールドが265Hで構成される様になる。 In the case of NTSC system, the number of horizontal scanning periods (H) included in line segment P-Q is 262.5H for one field.
It is. The aforementioned line segment P'-R is added by αH , so that one field is made up of 265H.
第3図中の線分P′−R上には、1フイールド内
に2個のV信号が現われている。しかし、図中下
側にハツチングで示した本来のV信号にだけ注目
すれば、Aヘツド18でV信号を再生してから、
Bヘツドが同じV信号を再生するまでに含まれる
水平走査期間数(H)は265Hと定まつている。 Two V signals appear within one field on the line segment P'-R in FIG. However, if you pay attention only to the original V signal shown by hatching at the bottom of the figure, after reproducing the V signal at the A head 18,
The number of horizontal scanning periods (H) included until the B head reproduces the same V signal is determined to be 265H.
ここで1/2倍速のスローモーシヨン再生を想定
すると、Aヘツド18とBヘツド19でP′−R線
分を走査した後、Aヘツド18とBヘツド19が
P″−R′線分を走査する。この場合Aヘツド18
がP′−R線分上のV信号を再生してからBヘツド
19が同じトラツク上のV信号を再生するまでは
265H存在し、次に、Bヘツド19がP′−R線分
上のV信号を再生してからAヘツド18がP″−
R′線分上のV信号を再生するまでは262.5H存在
する。これは、図中において点P″が点P′よりαH
分先行する位置から明らかである。結局、1/2ス
ローモーシヨン再生時のV信号間隔は、265Hと
262.5Hと交互に現われる事になる。静止モード
からノーマル再生モードまでの他のスローモーシ
ヨン再生でも、V信号間隔は262.5Hと265Hの組
合わせになる。すなわち、同一トラツクを再生す
る時は265H、次のトラツクを再生する時は、
262.5Hとなる。さらに、1倍速から2倍速にお
いては、ノーマル走行と同様に次のトラツクを再
生する場合と、1トラツクジヤンプして再生する
場合の組み合わせとなり、V信号間隔は、
262.5Hと260Hの組み合わせとなる。リバース1
倍速までのスローモーシヨン再生時では、同一ト
ラツクを再生する場合と、逆方向のトラツクに飛
ぶ場合で構成される。すなわち、リバース再生時
には、V信号間隔は、265Hと267.5Hの組み合わ
せになる。 Assuming slow motion playback at 1/2 speed, after the A head 18 and B head 19 scan the P'-R line segment, the A head 18 and B head 19
Scan the P″-R′ line segment. In this case, A head 18
from the time when the B head 19 reproduces the V signal on the same track until the B head 19 reproduces the V signal on the P'-R line segment.
265H exists, then the B head 19 reproduces the V signal on the P'-R line segment, and then the A head 18 reproduces the P''-
There are 262.5H until the V signal on the R' line segment is reproduced. This means that in the figure, point P″ is more α H than point P′.
It is clear from the preceding position. In the end, the V signal interval during 1/2 slow motion playback is 265H.
It will appear alternately with 262.5H. In other slow motion playbacks from the static mode to the normal playback mode, the V signal interval is a combination of 262.5H and 265H. In other words, when playing the same track, 265H, when playing the next track,
It becomes 262.5H. Furthermore, from 1x speed to 2x speed, there is a combination of playing the next track as in normal driving and playing with a 1 track jump, and the V signal interval is:
It is a combination of 262.5H and 260H. Reverse 1
During slow motion playback up to double speed, the same track is played back, and the track jumps to a track in the opposite direction. That is, during reverse playback, the V signal interval is a combination of 265H and 267.5H.
第3図中には、ヘツド切換位置P,P′,P″を
あらかじめ、V信号の直前に位置する様に配置し
ている。この様にする事によつて前述の特殊再生
モードにおいても、V信号とこれに後続する映像
信号の位置関係が一定になる。すなわち例えば、
1フイールドが265Hで構成されている時には、
ヘツド切換位置より前に2.5H分二重に再生され
るだけであつて、V信号と後続の映像信号の位置
関係は一定である。ところが、ヘツド切換位置を
V信号より後に設定していると、上記の特殊再生
モードでは、ヘツド切換時に、再生信号のαH単位
の伸び縮みが発生し、V信号と映像信号の位置関
係が一定しない。よつてV信号と映像信号の位置
関係が定まらないV信号を第1図のテープV5と
して利用すると、特殊再生時にはαH単位の画像の
上下動がモニタ画面上で発生する。 In FIG. 3, the head switching positions P, P', and P'' are arranged in advance so that they are located just before the V signal.By doing this, even in the special playback mode mentioned above, The positional relationship between the V signal and the video signal that follows it becomes constant.For example,
When one field consists of 265H,
Before the head switching position, only 2.5H of data is reproduced in duplicate, and the positional relationship between the V signal and the subsequent video signal is constant. However, if the head switching position is set after the V signal, in the above special playback mode, the playback signal will expand or shrink by αH units when switching the head, and the positional relationship between the V signal and the video signal will not be constant. do not. Therefore, if a V signal in which the positional relationship between the V signal and the video signal is not determined is used as tape V5 in FIG. 1, vertical movement of the image in units of α H will occur on the monitor screen during special playback.
発明の目的
本発明は上記点に鑑み、モニタ画面上で画像の
上下動が生じない時間軸補正装置を提供すること
を目的とする。OBJECTS OF THE INVENTION In view of the above points, an object of the present invention is to provide a time axis correction device that does not cause vertical movement of an image on a monitor screen.
発明の構成
本発明は、ビデオテープレコーダにより再生さ
れた再生映像信号を記憶するメモリと、このメモ
リへのライン毎の書込みおよび読出しのアドレス
を発生する書込読出アドレス発生回路と、ビデオ
ヘツドの走査開始位置付近に記録された垂直同期
信号より前の垂直ブランキング期間にその切換位
置を有するビデオヘツドスイツチ信号を基に作成
された信号をゲートパルスとし、再生映像信号の
垂直同期信号から前記ビデオヘツドの切換位置の
直後の信号をテープV信号として導出するゲート
回路と、再生水平同期信号に同期した信号を所定
数カウントし前記テープV信号の次のフイルドの
テープV位置を予測して予測V信号を発生するV
予測回路と、前記テープV信号と予測V信号を入
力とし通常はテープV信号を出力しテープV信号
欠落時予測V信号を出力するV信号競合回路とを
備え、スローモーシヨン再生時、再生トラツク飛
び情報をもとに前記V予測回路のカウントする所
定数を変更し、前記V信号競合回路の出力で前記
メモリの書込ラインアドレスをラツチし、外部基
準同期信号の垂直同期信号位置で前記ラツチされ
たデータを前記書込読出アドレス発生回路に読出
ラインアドレスとしてロードするようにしたこと
を特徴とする時間軸補正装置である。Structure of the Invention The present invention provides a memory that stores a reproduced video signal reproduced by a video tape recorder, a write/read address generation circuit that generates write and read addresses for each line to the memory, and a video head scanning A signal created based on a video head switch signal whose switching position is in the vertical blanking period before the vertical synchronization signal recorded near the start position is used as a gate pulse, and the video head is switched from the vertical synchronization signal of the reproduced video signal to the video head switch signal. A gate circuit derives the signal immediately after the switching position as the tape V signal, and a gate circuit that counts a predetermined number of signals synchronized with the reproduction horizontal synchronizing signal to predict the tape V position of the next field of the tape V signal to generate a predicted V signal. V that generates
It includes a prediction circuit and a V signal competition circuit which receives the tape V signal and the predicted V signal as input, normally outputs the tape V signal, and outputs the predicted V signal when the tape V signal is missing, and prevents playback track skipping during slow motion playback. The predetermined number counted by the V prediction circuit is changed based on the information, the write line address of the memory is latched at the output of the V signal competition circuit, and the latched address is latched at the vertical synchronization signal position of the external reference synchronization signal. The time axis correction device is characterized in that the read data is loaded into the write/read address generation circuit as a read line address.
実施例の説明
第4図に本発明における一実施例の時間軸補正
装置を示す。第4図中、従来例と同じ構成要素に
ついては同一の番号を付している。本実施例にお
いては第1図に示した従来例の構成に再生垂直同
期信号発生回路28が付加されている。この再生
垂直同期信号発生回路28の構成を第5図に示
す。DESCRIPTION OF EMBODIMENTS FIG. 4 shows a time axis correction device according to an embodiment of the present invention. In FIG. 4, the same components as in the conventional example are given the same numbers. In this embodiment, a reproduction vertical synchronization signal generation circuit 28 is added to the conventional configuration shown in FIG. The configuration of this reproduction vertical synchronization signal generation circuit 28 is shown in FIG.
第4図、第5図において、29はビデオヘツド
スイツチ信号(ヘツドSW信号)が加えられる端
子で、このヘツドSW信号はビデオヘツドの走査
開始位置付近に記録された垂直同期信号より前の
垂直ブランキング期間に切換位置を有している。
30はジヤンプ信号で、再生トラツク飛び情報を示
す信号である。31は単安定マルチバイブレータ
(M.M)でヘツドSW信号の切換位置でトリガさ
れたパルスを出力する。このパルスはゲート回路
32のゲートパルスとして用いられる。33は逓
倍回路で、水平同期信号の2倍の周波数の信号
2Hを発生し、V予測回路34にクロツクとして
供給する。V予測回路34はカウンタで構成さ
れ、所定数のクロツクをカウントした後、予測V
信号を出力する。V予測回路34のカウントする
前記所定数は、ジヤンプ信号における再生トラツ
ク飛び情報を示す信号により変更される。35は
V信号競合回路で、ゲート回路32の出力である
テープV信号とV予測回路34の出力である予測
V信号とを入力とし、通常はテープV信号を出力
し、テープV信号が欠落したとき、予測V信号を
出力する。 In Figures 4 and 5, 29 is a terminal to which a video head switch signal (head SW signal) is applied. It has a switching position during the ranking period.
30 is a jump signal, which is a signal indicating playback track jump information. 31 is a monostable multivibrator (MM) which outputs a pulse triggered at the switching position of the head SW signal. This pulse is used as a gate pulse for the gate circuit 32. 33 is a multiplier circuit, which generates a signal with twice the frequency of the horizontal synchronization signal.
2H is generated and supplied to the V prediction circuit 34 as a clock. The V prediction circuit 34 is composed of a counter, and after counting a predetermined number of clocks, calculates the predicted V
Output a signal. The predetermined number counted by the V prediction circuit 34 is changed by a signal indicating reproduction track jump information in the jump signal. 35 is a V signal competition circuit which inputs the tape V signal which is the output of the gate circuit 32 and the predicted V signal which is the output of the V prediction circuit 34, and normally outputs the tape V signal, but when the tape V signal is missing. At this time, a predicted V signal is output.
第6図に示す様に、特殊再生時に同期分離回路
3にて36の同期信号が得られたとする。同期分離
回路3中の垂直同期抽出回路(図示せず)では37
の様な信号が得られ、ヘツド切換位置38をはさ
んで、2個のV信号が発生する。 As shown in FIG. 6, it is assumed that 36 synchronization signals are obtained in the synchronization separation circuit 3 during special reproduction. 37 in the vertical synchronization extraction circuit (not shown) in the synchronization separation circuit 3.
A signal like this is obtained, and two V signals are generated across the head switching position 38.
しかし、本発明によれば、ヘツド切換位置38
をビデオヘツドの走査開始位置付近に記録された
垂直同期信号より前の垂直ブランキング期間に位
置させているため、ヘツド切換位置38の前のV
信号は重要ではない。誤動作を防止するため、本
実施例では、ヘツド切換位置38よりM.M31
により39に示す様なゲートパルスを作り、ゲー
ト回路32のゲート信号としている。ところで、
ヘツド切換信号とV信号の位置ずれは、時間軸補
正器の補正範囲(コレクシヨンウインドウ)まで
は、予定する必要があるため、ゲートパルス39
の幅を補正範囲以上にしておく必要がある。この
ゲートパルス39によつて、同期分離回路3の出
力であるテープV信号5(37)から不必要なV信
号がすてられ、40のごときテープV信号が得られ
る。ところで41,42,43は、1フイールド前から
トラツク飛び情報を元に導出した各種の予測V信
号であり、本実施例では、V信号間隔が262.5H
の予測V信号41が導出されている。V予測回路3
4は、1フイールド前のテープV信号または、予
測V信号によりリセツトされ、水平同期周波数H
の2逓倍クロツク2Hをカウントして、V予測す
るものである。スローモーシヨン再生時には、前
記した様にV信号間隔が、トラツク飛びによりαH
単位の増減があり、トラツク飛び情報を元に予測
V信号の位置をαH単位でシフトする。 However, according to the present invention, head switching position 38
Since V is located in the vertical blanking period before the vertical synchronization signal recorded near the scanning start position of the video head, the V before the head switching position 38
The signal is not important. In order to prevent malfunction, in this embodiment, M.M31 is
Thus, a gate pulse as shown in 39 is generated and used as a gate signal for the gate circuit 32. by the way,
The positional deviation between the head switching signal and the V signal must be planned for up to the correction range (correction window) of the time axis corrector, so the gate pulse 39
It is necessary to keep the width of the correction range larger than the correction range. By this gate pulse 39, unnecessary V signals are discarded from the tape V signal 5 (37) which is the output of the synchronization separation circuit 3, and a tape V signal such as 40 is obtained. By the way, 41, 42, and 43 are various predicted V signals derived based on track jump information from one field before, and in this example, the V signal interval is 262.5H.
A predicted V signal 41 has been derived. V prediction circuit 3
4 is reset by the tape V signal one field before or the predicted V signal, and the horizontal synchronization frequency H
This is to predict V by counting the double clock 2H . During slow motion playback, as mentioned above, the V signal interval may change due to track skipping.
There is an increase/decrease in units, and the position of the predicted V signal is shifted in units of α H based on the track jump information.
この様にして得られた予測V信号41とテープV
信号40がV信号競合回路に加えられる。通常、テ
ープV信号40は、予測V信号41の内側に位置して
いる。もし、テープV信号40が予測V信号41の外
側にはみ出すと、V信号競合回路35では、はみ
出したテープV信号が優先される様に働らく。 The predicted V signal 41 obtained in this way and the tape V
Signal 40 is applied to the V signal contention circuit. Typically, the tape V signal 40 is located inside the predicted V signal 41. If the tape V signal 40 protrudes outside the predicted V signal 41, the V signal competition circuit 35 operates so that the tape V signal that protrudes takes priority.
発明の効果
以上によつて、ノイズレススローモーシヨン等
の変則再生時にも、再生映像信号に常に一致した
垂直同期信号の抽出が安定にでき、モニタ画面上
で上下動のない安定な画像が再生できる。Effects of the Invention As described above, even during irregular reproduction such as noiseless slow motion, it is possible to stably extract a vertical synchronization signal that always matches the reproduced video signal, and it is possible to reproduce a stable image without vertical movement on the monitor screen.
第1図は従来の時間軸補正装置のブロツク図、
第2図は2ヘツドヘリカルスキヤンVTRのテー
プおよびビデオヘツドの走行を示す平面図、第3
図は特殊再生時のヘツド軌跡の説明図、第4図は
本発明における一実施例の時間軸補正装置のブロ
ツク図、第5図は同実施例の要部の構成を示すブ
ロツク図、第6図は同実施例の動作を説明するた
めの波形図である。
3……同期分離回路、7……ラツチ回路、8…
…メモリ、9……書込ラインアドレスカウンタ、
14……読出ラインアドレスカウンタ、31……
単安定マルチバイブレータ、32……ゲート回
路、33……逓倍回路、34……V予測回路、3
5……V信号競合回路。
Figure 1 is a block diagram of a conventional time axis correction device.
Figure 2 is a plan view showing the running of the tape and video head of a two-head helical scan VTR;
4 is a block diagram of a time axis correction device according to an embodiment of the present invention. FIG. 5 is a block diagram showing the configuration of the main part of the embodiment. The figure is a waveform diagram for explaining the operation of the same embodiment. 3...Synchronization separation circuit, 7...Latch circuit, 8...
...Memory, 9...Write line address counter,
14...Read line address counter, 31...
Monostable multivibrator, 32...gate circuit, 33...multiplier circuit, 34...V prediction circuit, 3
5...V signal competition circuit.
Claims (1)
映像信号を記憶するメモリと、このメモリへのラ
イン毎の書込みおよび読出しのアドレスを発生す
る書込読出アドレス発生回路と、ビデオヘツドの
走査開始位置付近に記録された垂直同期信号より
前の垂直ブランキング期間にその切換位置を有す
るビデオヘツドスイツチ信号を基に作成された信
号をゲートパルスとし、再生映像信号の垂直同期
信号から前記ビデオヘツドの切換位置の直後の信
号をテープV信号として導出するゲート回路と、
再生水平同期信号に同期した信号を所定数カウン
トし前記テープV信号の次のフイルドのテープV
位置を予測して予測V信号を発生するV予測回路
と、前記テープV信号と予測V信号を入力とし通
常はテープV信号を出力しテープV信号欠落時予
測V信号を出力するV信号競合回路とを備え、ス
ローモーシヨン再生時、再生トラツク飛び情報を
もとに前記V予測回路のカウントする所定数を変
更し、前記V信号競合回路の出力で前記メモリの
書込ラインアドレスをラツチし、外部基準同期信
号の垂直同期信号位置で前記ラツチされたデータ
を前記書込読出アドレス発生回路に読出ラインア
ドレスとしてロードするようにしたことを特徴と
する時間軸補正装置。1 A memory that stores the reproduced video signal reproduced by the video tape recorder, a write/read address generation circuit that generates the write and read addresses for each line to this memory, and a memory that stores the reproduced video signal reproduced by the video tape recorder, and The gate pulse is a signal created based on a video head switch signal whose switching position is during the vertical blanking period before the vertical synchronizing signal, and the switching position immediately after the switching position of the video head from the vertical synchronizing signal of the reproduced video signal is used as a gate pulse. a gate circuit that derives the signal as a tape V signal;
A predetermined number of signals synchronized with the reproduction horizontal synchronization signal are counted and the tape V of the next field of the tape V signal is
A V prediction circuit that predicts the position and generates a predicted V signal, and a V signal competition circuit that receives the tape V signal and the predicted V signal as input, normally outputs the tape V signal, and outputs the predicted V signal when the tape V signal is missing. At the time of slow motion reproduction, the predetermined number counted by the V prediction circuit is changed based on reproduction track jump information, the write line address of the memory is latched by the output of the V signal competition circuit, and an external A time axis correction device characterized in that the latched data is loaded into the write/read address generation circuit as a read line address at a vertical synchronization signal position of a reference synchronization signal.
Priority Applications (3)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP59082162A JPS60226288A (en) | 1984-04-24 | 1984-04-24 | Time base correcting device |
PCT/JP1985/000223 WO1985005001A1 (en) | 1984-04-24 | 1985-04-22 | Device for correcting time axis |
US06/819,508 US4733312A (en) | 1984-04-24 | 1985-04-22 | Time-base corrector |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP59082162A JPS60226288A (en) | 1984-04-24 | 1984-04-24 | Time base correcting device |
Publications (2)
Publication Number | Publication Date |
---|---|
JPS60226288A JPS60226288A (en) | 1985-11-11 |
JPH053796B2 true JPH053796B2 (en) | 1993-01-18 |
Family
ID=13766731
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP59082162A Granted JPS60226288A (en) | 1984-04-24 | 1984-04-24 | Time base correcting device |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS60226288A (en) |
-
1984
- 1984-04-24 JP JP59082162A patent/JPS60226288A/en active Granted
Also Published As
Publication number | Publication date |
---|---|
JPS60226288A (en) | 1985-11-11 |
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