JPH0528788B2 - - Google Patents
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- JPH0528788B2 JPH0528788B2 JP60233890A JP23389085A JPH0528788B2 JP H0528788 B2 JPH0528788 B2 JP H0528788B2 JP 60233890 A JP60233890 A JP 60233890A JP 23389085 A JP23389085 A JP 23389085A JP H0528788 B2 JPH0528788 B2 JP H0528788B2
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Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明は、停電や欠相時、瞬時信号と限時信号
を出力する低電圧検出回路に関する。DETAILED DESCRIPTION OF THE INVENTION [Field of Industrial Application] The present invention relates to a low voltage detection circuit that outputs an instantaneous signal and a timed signal during a power outage or phase failure.
サイリスタレオナードなど、コンバータ制御に
サイリスタを使用する回路は、多くの機器に使用
されている。そしてその点弧角制御回路は、電源
電圧位相に同期したランプ信号と、点弧角指令を
コンパレータで比較し、信号がクロスする時に点
弧パルスを出力する方式が一般的であつた。
Circuits that use thyristors to control converters, such as Thyristor Leonard, are used in many devices. The firing angle control circuit generally compares a lamp signal synchronized with the power supply voltage phase with a firing angle command using a comparator, and outputs a firing pulse when the signals cross.
しかし、最近では、回路の無調整化と信頼性向
上のために、CPUなどを用いてデイジタル化が
図られている。この結果、信号発生回路も、1相
の同期信号を用いて、演算あるいはROMテーブ
ルからの読み出しにより、3相分の点弧角信号を
出力できるようになつた。 However, recently, in order to eliminate the need for circuit adjustments and improve reliability, digitalization has been attempted using CPUs and other devices. As a result, the signal generation circuit can now output firing angle signals for three phases by calculation or reading from a ROM table using a one-phase synchronization signal.
一方、同期信号になる基準相に欠相、瞬停など
が生じた場合、その影響が、3相すべての点弧角
信号に及ぶため、該点弧によるサイリスタ破壊
や、ヒユーズ溶断故障を生じる可能性がある。 On the other hand, if a phase loss or instantaneous power failure occurs in the reference phase that becomes the synchronization signal, this will affect the firing angle signals of all three phases, which may cause thyristor destruction or fuse blowout failure. There is sex.
これに対し、従来使用されてきた低電圧検出方
法は、第4図に示すように制御電源トランス1の
2次電圧をダイオードブリツジ2で整流し、その
電圧値をコンパレータ3で基準値と比較して、低
電圧信号としていた。フイルタ4は、動作時間を
設定するためのものである。 In contrast, the conventional low voltage detection method, as shown in Fig. 4, rectifies the secondary voltage of the control power transformer 1 with a diode bridge 2, and compares the voltage value with a reference value with a comparator 3. It was used as a low voltage signal. The filter 4 is for setting the operating time.
また、実開昭55−1706号公報には、電源の電圧
が所定値以下になつたことを検知する検知回路
と、この検知回路の検知信号によりその検知期間
だけ動作するパルス発生回路と、このパルス発生
回路から出力されるパルスをカウントしそのカウ
ント内容が所定値になると信号を出力するカウン
タとを備えた電源の電圧変動検出回路が記載され
ている。 In addition, Utility Model Application Publication No. 55-1706 discloses a detection circuit that detects when the voltage of a power supply falls below a predetermined value, a pulse generation circuit that operates only during the detection period based on the detection signal of this detection circuit, and A voltage fluctuation detection circuit for a power supply is described that includes a counter that counts pulses output from a pulse generation circuit and outputs a signal when the count reaches a predetermined value.
しかしながら、前記第4図に示した従来の方式
では、瞬停、全停、低電圧については検出できる
が、動作時間を決めるフイルタ4により、欠相状
態であつてもフイルタ4の出力はそれに応じて下
がらないため、欠相は十分に検出できない。
However, with the conventional method shown in FIG. 4, instantaneous power outages, total power outages, and low voltages can be detected, but the filter 4 determines the operating time, so even in an open phase state, the output of the filter 4 is adjusted accordingly. phase loss cannot be detected sufficiently.
また実開昭55−1706号公報に記載された回路で
は、パルスをカウントしている途中で欠相が発生
すると、カウントアツプ前にカウント値がリセツ
トされることがあり、欠相を十分に検出すること
ができないという問題があつた。 In addition, in the circuit described in Utility Model Application Publication No. 55-1706, if an open phase occurs while counting pulses, the count value may be reset before the count up, and the open phase cannot be detected sufficiently. The problem was that I couldn't do it.
従つて、デイジタル方式の点弧角制御回路を用
いる場合、これら従来の低電圧検出方式では、欠
相保護が十分にできない。 Therefore, when using a digital firing angle control circuit, these conventional low voltage detection methods cannot provide sufficient protection against phase loss.
本発明は、欠相保護に対して対策を有しない従
来の問題点を解決し、デイジタル化により検出信
号の時間精度を向上した低電圧検出方式を提供す
ることを目的とするものである。 SUMMARY OF THE INVENTION The present invention aims to solve the problem of the conventional method which does not have a measure against phase loss protection, and to provide a low voltage detection method that improves the time accuracy of a detection signal through digitization.
本発明の低電圧検出回路は、三相交流の電源電
圧の全波整流を行う整流回路と、この整流回路で
全波整流された電圧を直流の基準電圧と比較する
コンパレータと、このコンパレータの出力信号の
パルス幅に基づいて低電圧信号とノイズとを分別
する分別器と、この分別器の出力が発生してから
所定の周期のクロツクパルスをカウント開始する
カウンタと、このカウンタが予め設定されたタイ
マー時間T2に相当するカウント数をカウントア
ツプした後に前記分別器の出力信号が継続してい
ればその信号を出力する論理回路と、前記カウン
タが前記分別器の出力を発生してから、前記タイ
マー時間T2よりも長い、予め設定されたタイマ
ー時間T1に相当するカウント数をカウントアツ
プするまでの間オン信号を出力する論理回路と、
タイマー時間T1をカウント中は前記分別器の信
号をカウンタクリア信号として出力しない論理回
路とを備えたことを特徴とする。
The low voltage detection circuit of the present invention includes a rectifier circuit that performs full-wave rectification of a three-phase AC power supply voltage, a comparator that compares the full-wave rectified voltage in this rectifier circuit with a DC reference voltage, and an output of this comparator. A separator that separates low voltage signals from noise based on the pulse width of the signal, a counter that starts counting clock pulses of a predetermined period after the output of this separator is generated, and a timer in which this counter is preset. a logic circuit that outputs a signal if the output signal of the separator continues after counting up a count number corresponding to time T 2 ; a logic circuit that outputs an on signal until a count number corresponding to a preset timer time T1 , which is longer than time T2 , is counted up;
The present invention is characterized by comprising a logic circuit that does not output the signal of the separator as a counter clear signal while counting the timer time T1 .
本発明の低電圧回路は、次のように低電圧信号
が出力される。
The low voltage circuit of the present invention outputs a low voltage signal as follows.
整流回路により得た3相全波整流信号をコン
パレータに入力して、停電、電圧低下、欠相な
どによる停電圧を瞬時に検出する。 The three-phase full-wave rectified signal obtained by the rectifier circuit is input to a comparator to instantly detect voltage outages due to power outages, voltage drops, open phases, etc.
カウンタでは、サイリスタの点弧信号除去の
ため、パルス幅T1秒(例えば30ms)の信号
を出力する。 The counter outputs a signal with a pulse width T of 1 second (for example, 30 ms) in order to eliminate the thyristor firing signal.
カウンタと論理回路により、低電圧検出後、
T2秒(例えば15ms)後に低電圧状態が継続
していれば、低電圧信号、欠相信号を出力す
る。 After low voltage is detected by the counter and logic circuit,
T If the low voltage state continues after 2 seconds (for example, 15 ms), a low voltage signal and an open phase signal are output.
低電圧検出後、T2秒後に電圧が正常な値に
復帰していれば、T1秒後に、サイリスタ点弧
信号を正常に戻す。 After detecting low voltage, if the voltage returns to normal value after T 2 seconds, the thyristor firing signal returns to normal after T 1 second.
以下、本発明を図面に示す実施例に基づいて具
体的に説明する。
Hereinafter, the present invention will be specifically described based on embodiments shown in the drawings.
第1図は、本発明の一実施例を示すブロツク図
である。図中3は低電圧を遅れなく検出するコン
パレータ、5は低電圧検出レベルの設定器、6は
転流重なり角と低電圧を区別するためのパルス幅
分別器、7〜9はAND回路、10はNOT回路、
11はOR回路、12はタイマの役割を果たすカ
ウンタである。 FIG. 1 is a block diagram showing one embodiment of the present invention. In the figure, 3 is a comparator that detects low voltage without delay, 5 is a low voltage detection level setter, 6 is a pulse width separator for distinguishing commutation overlap angle and low voltage, 7 to 9 are AND circuits, and 10 is a NOT circuit,
11 is an OR circuit, and 12 is a counter that serves as a timer.
信号Aは、トランスで降圧した電源を3相全波
整流した信号である。低電圧や欠相などにより信
号Aが低電圧検出レベルの信号Bより低くなる
と、第2図のようにコンパレータ3はただちにこ
れを検出し、信号Cを出力する。信号Cは、主電
源の電源インピーダンスが高い場合の転流重なり
角によつても出力するので、パルス幅分別器6で
これを区別し、低電圧検出信号だけを信号C′とし
て出力する。 Signal A is a three-phase full-wave rectified signal from a power source whose voltage has been stepped down by a transformer. When the signal A becomes lower than the low voltage detection level of the signal B due to low voltage or open phase, the comparator 3 immediately detects this and outputs the signal C as shown in FIG. Since the signal C is also output depending on the commutation overlap angle when the power source impedance of the main power source is high, the pulse width separator 6 distinguishes these and outputs only the low voltage detection signal as the signal C'.
第3図は低電圧発生時の各部の動作を示すタイ
ムチヤートであり、正常時は、カウンタ12はカ
ウントアツプしているため、AND回路7は、信
号C′に遅れなく信号Eを出力し、これがカウンタ
12のクリア信号となる。 FIG. 3 is a time chart showing the operation of each part when a low voltage is generated. Under normal conditions, the counter 12 is counting up, so the AND circuit 7 outputs the signal E without delay to the signal C'. This becomes a clear signal for the counter 12.
ここで、T1=30ms、T2=15ms、T2を256
パルスのカウント時間とすると、クロツクDの周
波数は1.71KHzとなる。 Here, T 1 = 30ms, T 2 = 15ms, T 2 = 256
Assuming the pulse count time, the frequency of clock D is 1.71KHz.
信号Eがハイレベル(以下“H”と略称する)
になると同時に、カウンタ12の出力信号はロー
レベルになり、クロツクDを512パルスカウント
後、“H”に戻る。従つてこの信号Hを使用すれ
ば、T1秒の間、OR回路11は信号Jを出力し、
これがサイリスタの点弧信号除去信号となる。ま
た信号GはクロツクDを256パルスカウントし、
T2秒後に、T2秒幅のパルスとなる。信号Gが
“H”の期間に、信号C′が再び出力されれば、
AND回路9は、低電圧信号Iを出力する。 Signal E is high level (hereinafter abbreviated as "H")
At the same time, the output signal of the counter 12 becomes low level, and returns to "H" after counting 512 pulses of the clock D. Therefore, if this signal H is used, the OR circuit 11 outputs the signal J for T 1 second,
This becomes the firing signal removal signal for the thyristor. Also, signal G counts 256 pulses of clock D,
After T 2 seconds, the pulse becomes T 2 seconds wide. If signal C' is output again while signal G is "H",
AND circuit 9 outputs low voltage signal I.
また、信号Gが“H”の間に欠相が発生すれ
ば、論理回路9が低電圧信号としてこれを検出
し、T2秒経過後に、停電圧信号とは時間幅の異
なる欠相信号(第2図参照)を信号Iとして出力
する。 Furthermore, if an open phase occurs while the signal G is "H", the logic circuit 9 detects this as a low voltage signal, and after T 2 seconds have elapsed, an open phase signal ( (see FIG. 2) is output as signal I.
以上のように、本実施例では、T1=30ms、
T2=15ms、クロツクD=17.1KHzとしている
が、仕様に応じて、これらの値は変更することが
できる。 As mentioned above, in this example, T 1 =30ms,
Although T 2 =15 ms and clock D = 17.1 KHz, these values can be changed depending on the specifications.
上述したように本発明によれば、下記の効果を
奏する。
As described above, the present invention provides the following effects.
調整、設定を必要とする個所がなく、回路の
信頼性を向上することができる。 There are no parts that require adjustment or settings, and the reliability of the circuit can be improved.
クロツク信号を使用しているため、検出時間
精度が飛躍的に向上する。 Since a clock signal is used, detection time accuracy is dramatically improved.
欠相検出が確実に行えるようになり、その結
果、運転中の電源異常に対し、確実に保護でき
る。 Open phase detection can now be performed reliably, and as a result, protection against power supply abnormalities during operation can be ensured.
第1図は本発明の実施例のブロツク図、第2図
は欠相検出時の各部の波形を示すタイムチヤー
ト、第3図は正常動作時の各部の波形を示すタイ
ムチヤート、第4図は従来の例を示すブロツク図
である。
1:制御電源トランス、2:ダイオードブリツ
ジ、3:コンパレータ、5:低電圧検出レベル設
定器、6:パルス幅分別器、7〜9:AND回路、
10:NOT回路、11:OR回路、12:カウン
タ。
Fig. 1 is a block diagram of an embodiment of the present invention, Fig. 2 is a time chart showing the waveforms of each part during open phase detection, Fig. 3 is a time chart showing the waveforms of each part during normal operation, and Fig. 4 is a time chart showing the waveforms of each part during normal operation. FIG. 2 is a block diagram showing a conventional example. 1: Control power transformer, 2: Diode bridge, 3: Comparator, 5: Low voltage detection level setter, 6: Pulse width separator, 7 to 9: AND circuit,
10: NOT circuit, 11: OR circuit, 12: counter.
Claims (1)
路2と、この整流回路2で全波整流された電圧を
直流の基準電圧と比較するコンパレータ3と、こ
のコンパレータ3の出力信号のパルス幅に基づい
て低電圧信号とノイズとを分別する分別器6と、
この分別器6の出力が発生してから所定の周期の
クロツクパルスをカウント開始するカウンタ12
と、このカウンタ12が予め設定されたタイマー
時間T2に相当するカウント数をカウントアツプ
した後に前記分別器6の出力信号が継続していれ
ばその信号を出力する論理回路9と、前記カウン
タ12が前記分別器6の出力が発生してから、前
記タイマー時間T2よりも長い、予め設定された
タイマー時間T1に相当するカウント数をカウン
トアツプするまでの間オン信号を出力する論理回
路11と、タイマー時間T1をカウント中は前記
分別器6の信号をカウンタクリア信号として出力
しない論理回路7とを備えたことを特徴とする低
電圧検出回路。1. A rectifier circuit 2 that performs full-wave rectification of a three-phase AC power supply voltage, a comparator 3 that compares the full-wave rectified voltage in this rectifier circuit 2 with a DC reference voltage, and a pulse width of the output signal of this comparator 3. a separator 6 that separates low voltage signals and noise based on;
A counter 12 starts counting clock pulses of a predetermined period after the output of the separator 6 is generated.
and a logic circuit 9 that outputs the output signal of the separator 6 if it continues after the counter 12 has counted up a count corresponding to a preset timer time T2 , and the counter 12. a logic circuit 11 that outputs an on signal from the time when the output of the separator 6 is generated until the timer counts up a count corresponding to a preset timer time T1 , which is longer than the timer time T2 ; and a logic circuit 7 that does not output the signal from the separator 6 as a counter clear signal while counting the timer time T1 .
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP23389085A JPS6293671A (en) | 1985-10-18 | 1985-10-18 | Low voltage detection circuit |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP23389085A JPS6293671A (en) | 1985-10-18 | 1985-10-18 | Low voltage detection circuit |
Publications (2)
Publication Number | Publication Date |
---|---|
JPS6293671A JPS6293671A (en) | 1987-04-30 |
JPH0528788B2 true JPH0528788B2 (en) | 1993-04-27 |
Family
ID=16962167
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP23389085A Granted JPS6293671A (en) | 1985-10-18 | 1985-10-18 | Low voltage detection circuit |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS6293671A (en) |
Families Citing this family (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP4915982B2 (en) * | 2005-09-01 | 2012-04-11 | 株式会社リコー | Power supply control method and heater control device |
Citations (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS551706B2 (en) * | 1971-08-19 | 1980-01-16 | ||
JPS57192875A (en) * | 1981-05-22 | 1982-11-27 | Mitsubishi Electric Corp | Detecting device for quantity of electricity |
Family Cites Families (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS551706U (en) * | 1978-05-30 | 1980-01-08 |
-
1985
- 1985-10-18 JP JP23389085A patent/JPS6293671A/en active Granted
Patent Citations (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS551706B2 (en) * | 1971-08-19 | 1980-01-16 | ||
JPS57192875A (en) * | 1981-05-22 | 1982-11-27 | Mitsubishi Electric Corp | Detecting device for quantity of electricity |
Also Published As
Publication number | Publication date |
---|---|
JPS6293671A (en) | 1987-04-30 |
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