JPH05276078A - Space diversity receiver - Google Patents
Space diversity receiverInfo
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- JPH05276078A JPH05276078A JP4071844A JP7184492A JPH05276078A JP H05276078 A JPH05276078 A JP H05276078A JP 4071844 A JP4071844 A JP 4071844A JP 7184492 A JP7184492 A JP 7184492A JP H05276078 A JPH05276078 A JP H05276078A
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- circuit
- circuits
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- Input Circuits Of Receivers And Coupling Of Receivers And Audio Equipment (AREA)
- Radio Transmission System (AREA)
Abstract
Description
【0001】[0001]
【産業上の利用分野】本発明はスペースダイバーシティ
受信装置に関し、特に3面のアンテナによって受信する
n(nは2以上の整数)個のマルチキャリアを含む3つ
の受信信号を合成して各マルチキャリアをそれぞれ出力
するスペースダイバーシティ受信装置に関する。BACKGROUND OF THE INVENTION 1. Field of the Invention The present invention relates to a space diversity receiver, and in particular, it combines three reception signals including n (n is an integer of 2 or more) received by three-sided antennas into each multicarrier. The present invention relates to a space diversity receiving device that outputs each of.
【0002】[0002]
【従来の技術】従来のこの種のスペースダイバーシティ
受信装置は、図2に示すように、3面のアンテナ(図示
せず)により受信した信号Sa,Sb,Scにそれぞれ
含まれている複数(n個)のマルチキャリアSa1〜S
an,Sb1〜Sbn,Sc1〜Scnを抽出するマル
チキャリア分配回路1a,1b,1cと、2つの入力信
号を同期合成する第1の同期合成回路101〜10nお
よび第2の同期合成回路201〜20nとを備えてい
る。2. Description of the Related Art A conventional space diversity receiver of this type, as shown in FIG. 2, includes a plurality (n) of signals Sa, Sb, Sc respectively received by three-sided antennas (not shown). Individual) multi-carriers Sa1 to S
multicarrier distribution circuits 1a, 1b, 1c for extracting an, Sb1 to Sbn, Sc1 to Scn, first synchronous combining circuits 101 to 10n and second synchronous combining circuits 201 to 20n for synchronously combining two input signals. It has and.
【0003】ここで、第1の同期合成回路101〜10
nは、互いに対応するマルチキャリアSa1〜Sanと
Sb1〜Sbnとを同期合成する。すなわち、第1の同
期合成回路101はマルチキャリアSa1とSb1とを
合成し、同様に、第1の同期合成回路10nはマルチキ
ャリアSanとSbnとを合成する。Here, the first synchronous synthesis circuits 101 to 10
n synchronously combines multi-carriers Sa1 to San and Sb1 to Sbn corresponding to each other. That is, the first synchronous synthesizing circuit 101 synthesizes the multicarriers Sa1 and Sb1, and similarly, the first synchronous synthesizing circuit 10n synthesizes the multicarriers San and Sbn.
【0004】更に、第2の同期合成回路201〜20n
は、マルチキャリアSc1〜Scnと第1の同期合成回
路101〜10nの出力信号S101〜S10nとをそ
れぞれ合成して、マルチキャリア毎の合成出力信号S2
01〜S20nを送出する。Further, the second synchronous synthesis circuits 201 to 20n
Is a composite output signal S2 for each multicarrier by combining the multicarriers Sc1 to Scn and the output signals S101 to S10n of the first synchronous combining circuits 101 to 10n, respectively.
01 to S20n are transmitted.
【0005】ところで、各同期合成回路は、2つの入力
信号の内、一方の入力信号の位相を可変する移相回路9
1と、合成する2つの信号の位相差を検出する位相差検
出回路92と、位相差に応じて移相回路を制御する制御
回路93と、2つの信号を合成する合成回路94とを有
している。なお、第1の同期合成回路の同期合成動作が
第2の同期合成回路の動作よりも速くなるように設定
し、合成動作が収束するようにしている。By the way, each synchronous synthesizing circuit has a phase shift circuit 9 for varying the phase of one of the two input signals.
1, a phase difference detection circuit 92 that detects a phase difference between two signals to be combined, a control circuit 93 that controls a phase shift circuit according to the phase difference, and a combination circuit 94 that combines the two signals. ing. The synchronous synthesizing operation of the first synchronous synthesizing circuit is set to be faster than that of the second synchronous synthesizing circuit so that the synthesizing operation converges.
【0006】[0006]
【発明が解決しようとする課題】上述した従来のスペー
スダイバーシティ受信装置では、3面のアンテナにより
受信した信号のマルチキャリアをそれぞれ同期合成して
いるので、各マルチキャリアのS/Nは改善できる。し
かし、干渉性フェージング等によって波形歪が発生した
ときはこれを抑圧することはできない。In the conventional space diversity receiving apparatus described above, the multi-carriers of the signals received by the three-sided antennas are synchronously combined, so that the S / N of each multi-carrier can be improved. However, when waveform distortion occurs due to coherent fading or the like, it cannot be suppressed.
【0007】このような波形歪を抑圧して合成する手段
として、周波数スペクトル分布が中心周波数に対して平
坦になるように移相回路を制御して合成する最小振幅偏
差合成回路がある。しかし、このような最小振幅偏差合
成回路を3面アンテナのスペースダイバーシティ受信装
置に適用する場合は、マルチキャリア毎に最小振幅偏差
合成回路が必要となるので、回路構成が複雑化するとい
う問題点がある。As a means for suppressing and synthesizing such waveform distortion, there is a minimum amplitude deviation synthesizing circuit for synthesizing by controlling the phase shift circuit so that the frequency spectrum distribution becomes flat with respect to the center frequency. However, when such a minimum amplitude deviation synthesizing circuit is applied to a space diversity receiving device having a three-sided antenna, a minimum amplitude deviation synthesizing circuit is required for each multicarrier, which causes a problem that the circuit configuration becomes complicated. is there.
【0008】本発明の目的は、簡単な回路構成によっ
て、各マルチキャリアのS/Nおよび波形歪を改善でき
るスペースダイバーシティ受信装置を提供することにあ
る。An object of the present invention is to provide a space diversity receiver which can improve the S / N and waveform distortion of each multicarrier with a simple circuit configuration.
【0009】[0009]
【課題を解決するための手段】本発明のスペースダイバ
ーシティ受信装置は、3面のアンテナによって受信する
n(nは2以上の整数)個のマルチキャリアを含む3つ
の受信信号を合成して各マルチキャリアをそれぞれ出力
するスペースダイバーシティ受信装置であって、前記3
つの受信信号の内1つを2分岐する分岐回路と、この分
岐回路により分岐された信号の位相を第1および第2の
制御信号に応じてそれぞれ制御する第1および第2の移
相回路と、前記3つの受信信号の内他の2つの受信信号
と前記第1および第2の移相回路の出力信号とをそれぞ
れ合成する第1および第2の合成回路と、前記第1の合
成回路の出力信号を受けて前記n個のマルチキャリアを
分離してそれぞれ出力する第1のマルチキャリア分配回
路と、前記第2の合成回路の出力信号を受けて前記n個
のマルチキャリアを分離してそれぞれ出力する第2のマ
ルチキャリア分配回路と、前記第1および第2のマルチ
キャリア分配回路がそれぞれ出力するn個のマルチキャ
リアに対してマルチキャリア毎に同期合成するn個の同
期合成回路と、前記第1のマルチキャリア分配回路がそ
れぞれ出力するn個のマルチキャリアのそれぞれのレベ
ルを検出する第1のレベル検出手段と、前記第2のマル
チキャリア分配回路がそれぞれ出力するn個のマルチキ
ャリアのそれぞれのレベルを検出する第2のレベル検出
手段と、前記第1のレベル検出手段が検出したn個のマ
ルチキャリアのレベル偏差が最小となるように前記第1
の制御信号を生成する手段と、前記第2のレベル検出手
段が検出したn個のマルチキャリアのレベル偏差が最小
となるように前記第2の制御信号を生成する手段とを備
えて構成されている。A space diversity receiving apparatus of the present invention combines three reception signals including n (n is an integer of 2 or more) multi-carriers received by three-sided antennas to synthesize each multi-wave. A space diversity receiving device for outputting each carrier, comprising:
A branch circuit for branching one of the two received signals into two, and first and second phase shift circuits for controlling the phases of the signals branched by the branch circuit in accordance with the first and second control signals, respectively. Of the three received signals and the other two received signals and the output signals of the first and second phase shift circuits, respectively, the first and second combining circuits, and the first combining circuit. A first multi-carrier distribution circuit that receives an output signal and separates and outputs the n multi-carriers respectively, and an output signal of the second combining circuit that separates the n multi-carriers and separates the n multi-carriers, respectively. A second multi-carrier distribution circuit for outputting, and n synchronous synthesizing circuits for synchronously synthesizing each of the n multi-carriers output by the first and second multi-carrier distributing circuits for each multi-carrier, First level detecting means for detecting respective levels of n multi-carriers output by the first multi-carrier distribution circuit, and n multi-carriers respectively output by the second multi-carrier distribution circuit. The second level detecting means for detecting the level of the first multi-carrier and the first level detecting means for minimizing the level deviation of the n multi-carriers detected by the first level detecting means.
And a means for generating the second control signal so that the level deviation of the n multi-carriers detected by the second level detecting means is minimized. There is.
【0010】[0010]
【実施例】次に本発明について図面を参照して説明す
る。The present invention will be described below with reference to the drawings.
【0011】図1は本発明の一実施例を示すブロック図
であり、複数(n個)のマルチキャリアをそれぞれ含む
受信信号Sa,Sb,Scを同期合成して、n個のマル
チキャリアの合成出力信号S31〜S3nを得る場合を
示している。FIG. 1 is a block diagram showing an embodiment of the present invention, in which received signals Sa, Sb, Sc respectively including a plurality (n) of multicarriers are synchronously combined to synthesize n multicarriers. The case where the output signals S31 to S3n are obtained is shown.
【0012】さて、分岐回路1は、受信信号Sbを2分
岐して移相回路2および3へ送出する。合成回路4は、
移相回路2を通過した信号と受信信号Saとを合成し、
合成信号S1をマルチキャリア分配回路6へ送出する。
同様に、合成回路5は、移相回路3を通過した信号と受
信信号Scとを合成し、合成信号S2をマルチキャリア
分配回路7へ送出する。マルチキャリア分配回路6,7
は、合成信号S1,S2にそれぞれ含まれているn個の
マルチキャリアを抽出し、マルチキャリアS11〜S1
n,S21〜S2nとして出力する。The branch circuit 1 branches the received signal Sb into two and sends it to the phase shift circuits 2 and 3. The synthesis circuit 4 is
The signal that has passed through the phase shift circuit 2 and the received signal Sa are combined,
The composite signal S1 is sent to the multicarrier distribution circuit 6.
Similarly, the synthesizing circuit 5 synthesizes the signal passed through the phase shift circuit 3 and the received signal Sc, and sends the synthesized signal S2 to the multicarrier distribution circuit 7. Multi-carrier distribution circuit 6,7
Extracts n multi-carriers included in each of the combined signals S1 and S2, and multi-carriers S11 to S1 are extracted.
n, S21 to S2n.
【0013】同期合成回路11〜1nは、n個のマルチ
キャリアに対応して設けられおり、マルチキャリア分配
回路6,7によって抽出された対応するマルチキャリア
をそれぞれ受けて同期合成する。すなわち、同期合成回
路11は、マルチキャリアS11とS21とを受けて同
期合成して同期合成出力信号S31を送出する。同様
に、同期合成回路1nは、マルチキャリアS1nとS2
nとを受けて同期合成して同期合成出力信号S3nを送
出する。The synchronous synthesizing circuits 11 to 1n are provided corresponding to n multi-carriers, and receive the corresponding multi-carriers extracted by the multi-carrier distributing circuits 6 and 7, respectively, and perform synchronous synthesizing. That is, the synchronous synthesizing circuit 11 receives the multi-carriers S11 and S21, synchronously synthesizes them, and outputs the synchronous synthetic output signal S31. Similarly, the synchronous synthesizing circuit 1n includes multi-carriers S1n and S2.
When n is received, synchronous synthesis is performed and a synchronous synthesis output signal S3n is transmitted.
【0014】ここで、各同期合成回路11〜1nは、入
力する2つのマルチキャリアの内、一方のマルチキャリ
アS21〜S2nの位相を可変する移相回路41と、マ
ルチキャリアを分岐する分岐回路42,43と、狭帯域
フィルタ44,45と、AGC増幅回路46,47と、
位相差を検出する位相比較回路48と、位相差に応じて
移相回路41を制御する制御回路49と、同相となった
2つのマルチキャリアを合成する合成回路50とを有し
ている。Here, each of the synchronous synthesis circuits 11 to 1n has a phase shift circuit 41 for varying the phase of one of the input multicarriers S21 to S2n and a branch circuit 42 for branching the multicarriers. , 43, narrow band filters 44 and 45, AGC amplifier circuits 46 and 47,
It has a phase comparison circuit 48 for detecting a phase difference, a control circuit 49 for controlling the phase shift circuit 41 according to the phase difference, and a combining circuit 50 for combining two multicarriers in phase.
【0015】ところで、狭帯域フィルタ44,45は、
各マルチキャリアの帯域内のスペクトラム成分を抽出す
るために設けられたものであり、制御回路49は、抽出
されたスペクトラム成分によって移相回路41を制御す
る。By the way, the narrow band filters 44 and 45 are
The control circuit 49 is provided to extract the spectrum component in the band of each multicarrier, and the control circuit 49 controls the phase shift circuit 41 by the extracted spectrum component.
【0016】一方、レベル検知回路21〜2n,31〜
3nは、抽出されたスペクトラム成分のレベルをそれぞ
れ検出し、レベルを示す信号L21〜L2n,L31〜
L3nをスペクトラム偏差制御回路8,9へそれぞれ送
出する。ここで、レベル検知回路21〜2nが検出した
レベルの偏差状態は、合成信号S1のスペクトラム分布
状態を示しており、また、レベル検知回路31〜3nが
検出したレベルの偏差状態は、合成信号S2のスペクト
ラム分布状態を示している。On the other hand, the level detection circuits 21-2n, 31-
3n detects the level of each of the extracted spectrum components, and indicates the signals L21 to L2n and L31 to indicate the level.
L3n is sent to the spectrum deviation control circuits 8 and 9, respectively. Here, the deviation state of the levels detected by the level detection circuits 21 to 2n indicates the spectrum distribution state of the combined signal S1, and the deviation state of the levels detected by the level detection circuits 31 to 3n indicates the combined signal S2. Shows the spectrum distribution state of.
【0017】スペクトラム偏差制御回路8,9は、レベ
ルを示す信号L21〜L2n,L31〜L3nをそれぞ
れ受け、レベル偏差が最小となるように移相回路2,3
をそれぞれ制御する。このようにして合成回路4,5お
よび同期合成回路11〜1nにより同期合成することに
より、各マルチキャリアのS/Nを向上できると共に、
波形歪も低減できる。The spectrum deviation control circuits 8 and 9 receive the signals L21 to L2n and L31 to L3n indicating the levels, respectively, and the phase shift circuits 2 and 3 are designed to minimize the level deviation.
Control each. In this way, the S / N of each multicarrier can be improved by performing the synchronous synthesis by the synthetic circuits 4 and 5 and the synchronous synthesis circuits 11 to 1n.
Waveform distortion can also be reduced.
【0018】[0018]
【発明の効果】以上説明したように本発明によれば、3
つの受信信号の内1つを2分岐してそれぞれ移相回路を
通過させた後、3つの受信信号の内他の2つの受信信号
とそれぞれ合成して第1および第2の合成信号を生成
し、この合成信号を第1および第2のマルチキャリア分
配回路によってそれぞれn個のマルチキャリアを分離し
た後、n個の同期合成回路によりマルチキャリア毎に同
期合成している。この場合第1および第2のマルチキャ
リア分配回路によってそれぞれ分離されたn個のマルチ
キャリアのレベルを検出し、レベル偏差が最小となるよ
うに移相回路を制御することにより、第1および第2の
合成信号のスペクトラム分布の偏差が最小となる状態で
同期合成できるので、簡単な回路構成によって、各マル
チキャリアのS/Nおよび波形歪の両者を改善できると
いう効果を有している。As described above, according to the present invention, 3
One of the two received signals is branched into two and passed through the phase shift circuit, respectively, and then combined with the other two received signals of the three received signals to generate first and second combined signals. , N multicarriers are separated by the first and second multicarrier distribution circuits, respectively, and then synchronously synthesized for each multicarrier by the n synchronous synthesis circuits. In this case, the levels of n multi-carriers respectively separated by the first and second multi-carrier distribution circuits are detected, and the phase shift circuit is controlled so that the level deviation is minimized. Since synchronous synthesis can be performed in a state in which the deviation of the spectrum distribution of the synthesized signal is minimized, there is an effect that both the S / N and waveform distortion of each multicarrier can be improved with a simple circuit configuration.
【図1】本発明の一実施例を示すブロック図である。FIG. 1 is a block diagram showing an embodiment of the present invention.
【図2】従来のスペースダイバーシティ受信装置の一例
を示すブロック図である。FIG. 2 is a block diagram showing an example of a conventional space diversity receiver.
1,42,43 分岐回路 2,3,41 移相回路 4,5,50 合成回路 6,7 マルチキャリア分配回路 8,9 スペクトラム偏差制御回路 11〜1n 同期合成回路 21〜2n,31〜3n レベル検知回路 44,45 狭帯域フィルタ 48 位相比較回路 Sa,Sb,Sc 受信信号 S1,S2 合成信号 S11〜S1n,S21〜S2n マルチキャリア S31〜S3n マルチキャリア合成出力信号 L21〜L2n,L31〜L3n マルチキャリアの
レベルを示す信号1, 42, 43 Branch circuit 2, 3, 41 Phase shift circuit 4, 5, 50 Combiner circuit 6, 7 Multi-carrier distribution circuit 8, 9 Spectrum deviation control circuit 11-1n Synchronous combiner circuit 21-2n, 31-3n Level Detection circuit 44, 45 Narrow band filter 48 Phase comparison circuit Sa, Sb, Sc Received signal S1, S2 Combined signal S11 to S1n, S21 to S2n Multicarrier S31 to S3n Multicarrier combined output signal L21 to L2n, L31 to L3n Multicarrier Signal indicating the level of
Claims (1)
は2以上の整数)個のマルチキャリアを含む3つの受信
信号を合成して各マルチキャリアをそれぞれ出力するス
ペースダイバーシティ受信装置であって、 前記3つの受信信号の内1つを2分岐する分岐回路と、
この分岐回路により分岐された信号の位相を第1および
第2の制御信号に応じてそれぞれ制御する第1および第
2の移相回路と、前記3つの受信信号の内他の2つの受
信信号と前記第1および第2の移相回路の出力信号とを
それぞれ合成する第1および第2の合成回路と、前記第
1の合成回路の出力信号を受けて前記n個のマルチキャ
リアを分離してそれぞれ出力する第1のマルチキャリア
分配回路と、前記第2の合成回路の出力信号を受けて前
記n個のマルチキャリアを分離してそれぞれ出力する第
2のマルチキャリア分配回路と、前記第1および第2の
マルチキャリア分配回路がそれぞれ出力するn個のマル
チキャリアに対してマルチキャリア毎に同期合成するn
個の同期合成回路と、前記第1のマルチキャリア分配回
路がそれぞれ出力するn個のマルチキャリアのそれぞれ
のレベルを検出する第1のレベル検出手段と、前記第2
のマルチキャリア分配回路がそれぞれ出力するn個のマ
ルチキャリアのそれぞれのレベルを検出する第2のレベ
ル検出手段と、前記第1のレベル検出手段が検出したn
個のマルチキャリアのレベル偏差が最小となるように前
記第1の制御信号を生成する手段と、前記第2のレベル
検出手段が検出したn個のマルチキャリアのレベル偏差
が最小となるように前記第2の制御信号を生成する手段
とを備えることを特徴とするスペースダイバーシティ受
信装置。1. n (n) received by a three-sided antenna
Is a space diversity receiving apparatus that combines three reception signals including two or more multi-carriers and outputs each multi-carrier, and a branching circuit that branches one of the three reception signals into two. When,
First and second phase shift circuits that control the phases of the signals branched by the branch circuit in accordance with the first and second control signals, respectively, and two other received signals of the three received signals. First and second combining circuits for respectively combining the output signals of the first and second phase shift circuits, and for separating the n multi-carriers by receiving the output signals of the first combining circuit A first multi-carrier distribution circuit for outputting each, a second multi-carrier distribution circuit for receiving the output signals of the second combining circuit, separating the n multi-carriers, and outputting the separated multi-carriers, respectively. The n multi-carriers output from the second multi-carrier distribution circuit are synchronously synthesized for each multi-carrier n
Synchronization synthesizing circuits, first level detecting means for detecting respective levels of the n multicarriers respectively output from the first multicarrier distributing circuit, and the second level detecting means.
Second level detecting means for detecting the respective levels of the n multicarriers output by the multicarrier distributing circuit of n, and n detected by the first level detecting means.
Means for generating the first control signal so that the level deviation of the multi-carriers is minimized, and the level deviation of the n multi-carriers detected by the second level detecting means is minimized. And a means for generating a second control signal.
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP4071844A JPH05276078A (en) | 1992-03-30 | 1992-03-30 | Space diversity receiver |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP4071844A JPH05276078A (en) | 1992-03-30 | 1992-03-30 | Space diversity receiver |
Publications (1)
Publication Number | Publication Date |
---|---|
JPH05276078A true JPH05276078A (en) | 1993-10-22 |
Family
ID=13472259
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP4071844A Withdrawn JPH05276078A (en) | 1992-03-30 | 1992-03-30 | Space diversity receiver |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPH05276078A (en) |
-
1992
- 1992-03-30 JP JP4071844A patent/JPH05276078A/en not_active Withdrawn
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Legal Events
Date | Code | Title | Description |
---|---|---|---|
A300 | Withdrawal of application because of no request for examination |
Free format text: JAPANESE INTERMEDIATE CODE: A300 Effective date: 19990608 |