JPH05167448A - A/d converter - Google Patents

A/d converter

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JPH05167448A
JPH05167448A JP35379091A JP35379091A JPH05167448A JP H05167448 A JPH05167448 A JP H05167448A JP 35379091 A JP35379091 A JP 35379091A JP 35379091 A JP35379091 A JP 35379091A JP H05167448 A JPH05167448 A JP H05167448A
Authority
JP
Japan
Prior art keywords
resolution
reference voltage
conversion
voltage
register
Prior art date
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Pending
Application number
JP35379091A
Other languages
Japanese (ja)
Inventor
Toyozo Zaima
豊蔵 財満
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Mitsubishi Electric Corp
Original Assignee
Mitsubishi Electric Corp
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Filing date
Publication date
Application filed by Mitsubishi Electric Corp filed Critical Mitsubishi Electric Corp
Priority to JP35379091A priority Critical patent/JPH05167448A/en
Publication of JPH05167448A publication Critical patent/JPH05167448A/en
Pending legal-status Critical Current

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Abstract

PURPOSE:To allow the A/D converter to cope with a case that the conversion speed takes precedence over the resolution and the conversion processing is desired to be executed at a high speed or a case that the resolution takes precedence over the conversion speed and the conversion accuracy is enhanced by making the resolution for A/D conversion variable. CONSTITUTION:A control circuit 2 controls a ladder resistor 5 and a switch tree 4 based on data of a resolution register 1 representing the designated resolution. A reference voltage representing a change number of times in response to the resolution designated by a comparator 6 is given and compared with a voltage of an input analog signal and the result of comparison is stored in a register 3 as a converted digital signal. When the resolution is high, number of times of change in the reference voltage is large and the conversion accuracy is enhanced. When the resolution is low, number of times of change in the reference voltage is less, the conversion accuracy is low but the conversion processing time is reduced.

Description

【発明の詳細な説明】Detailed Description of the Invention

【0001】[0001]

【産業上の利用分野】この発明はマイクロコンピュータ
等に内蔵され、入力されたアナログ信号をデジタル信号
に変換するアナログデジタル変換装置に関し、特にアナ
ログデジタル変換の分解能の制御に関するものである。
BACKGROUND OF THE INVENTION 1. Field of the Invention The present invention relates to an analog-to-digital converter incorporated in a microcomputer or the like and converting an input analog signal into a digital signal, and more particularly to control of resolution of analog-to-digital conversion.

【0002】[0002]

【従来の技術】図2は従来のアナログデジタル変換装置
の構成を示すブロック図である。図2において、6は図
示しない入力ポート等から入力されたアナログ信号の電
圧と参照電圧との大小を比較するコンパレータ、3はコ
ンパレータ6の比較結果をデジタル信号として格納する
レジスタ、5は供給電圧(電源電圧と基準電圧との電位
差による電圧)を所定電圧に分割するラダー抵抗(分割
用抵抗)、4はラダー抵抗5により分割された分割電圧
をレジスタ3の出力に従ってコンパレータ6への参照電
圧として与えるスイッチツリー(参照電圧供給手段)、
2はレジスタ3及びコンパレータ6を制御する制御回路
である。なお、上記電源電圧は接地された場合は0Vと
なる。
2. Description of the Related Art FIG. 2 is a block diagram showing a configuration of a conventional analog-digital conversion device. In FIG. 2, 6 is a comparator for comparing the magnitude of an analog signal input from an input port (not shown) and the reference voltage, 3 is a register for storing the comparison result of the comparator 6 as a digital signal, and 5 is a supply voltage ( A ladder resistor (division resistor) 4 for dividing a voltage due to the potential difference between the power supply voltage and the reference voltage into a predetermined voltage gives a divided voltage divided by the ladder resistor 5 as a reference voltage to the comparator 6 according to the output of the register 3. Switch tree (reference voltage supply means),
A control circuit 2 controls the register 3 and the comparator 6. The power supply voltage is 0V when grounded.

【0003】次に動作について説明する。入力ポート等
から入力されたアナログ信号の電圧はコンパレータ6に
おいて参照電圧と大小が比較され、この比較結果はデジ
タル信号としてレジスタ3に格納される。その参照電圧
は入力されたアナログ信号の電圧を逐次比較するため、
電圧レベルが絶えず変化する。ラダー抵抗5は供給電圧
を所定電圧に分割しており、この分割電圧はレジスタ3
の出力によって制御されるスイッチツリー4によって選
択され参照電圧としてコンパレータ6に与えられる。供
給電圧は、所定の分解能のビット数(本アナログデジタ
ル変換装置の変換値に基づくビット数)に従って例えば
8ビットの場合256分割され、入力アナログ信号の電
圧値を256分割された電圧(参照電圧)と比較し、デ
ジタル値に変換するための電圧である。このような参照
電圧を用いて比較が行なわれるコンパレータ6に入力さ
れたアナログ信号はデジタル信号に変換される。
Next, the operation will be described. The voltage of the analog signal input from the input port or the like is compared in magnitude with the reference voltage in the comparator 6, and the comparison result is stored in the register 3 as a digital signal. Since the reference voltage successively compares the voltage of the input analog signal,
The voltage level changes constantly. The ladder resistor 5 divides the supply voltage into a predetermined voltage, and this divided voltage is applied to the register 3
Is selected by a switch tree 4 controlled by the output of the comparator and applied to a comparator 6 as a reference voltage. The supply voltage is divided into 256 according to the number of bits of a predetermined resolution (the number of bits based on the conversion value of the present analog-digital conversion device), for example, in the case of 8 bits, and the voltage value of the input analog signal is divided into 256 (reference voltage). Is a voltage for comparing with and converting to a digital value. The analog signal input to the comparator 6, which is compared using such a reference voltage, is converted into a digital signal.

【0004】[0004]

【発明が解決しようとする課題】従来のアナログデジタ
ル変換装置は以上説明したように供給電圧を例えば25
6分割してコンパレータに参照電圧として与え、入力ア
ナログ信号の電圧を比較してデジタル信号に変換してい
るので、アナログデジタル変換の分解能が一定で、アナ
ログデジタル変換時間がある一定時間必要となり、この
ためアナログデジタル変換の分解能よりも変換速度を優
先させ変換処理を高速に実行させたい場合や、変換速度
よりも分解能を優先させ変換精度を高めたい場合には対
処することができないという問題点があった。
In the conventional analog-digital converter, the supply voltage is, for example, 25 as described above.
Since it is divided into 6 and given to the comparator as a reference voltage, and the voltage of the input analog signal is compared and converted into a digital signal, the resolution of analog-digital conversion is constant and the analog-digital conversion time requires a certain time. Therefore, there is a problem that it cannot be dealt with when it is desired to prioritize the conversion speed over the resolution of the analog-digital conversion to execute the conversion process at a high speed, or to prioritize the resolution over the conversion speed to improve the conversion accuracy. It was

【0005】この発明は上記のような問題点を解決する
ためになされたもので、アナログデジタル変換の分解能
を可変できるアナログデジタル変換装置を提供すること
を目的とする。
The present invention has been made to solve the above problems, and an object of the present invention is to provide an analog-digital conversion device capable of varying the resolution of analog-digital conversion.

【0006】[0006]

【課題を解決するための手段】この発明に係るアナログ
デジタル変換装置は、アナログデジタル変換の指定した
分解能を示すデータを格納する分解能レジスタ1と、こ
の分解能レジスタ1のデータに基づいて分割用抵抗(ラ
ダー抵抗5)及び参照電圧供給手段(スイッチツリー
4)を制御しコンパレータ6への参照電圧を変化させる
制御回路2とを備えたものである。
An analog-to-digital converter according to the present invention includes a resolution register 1 for storing data indicating a specified resolution of analog-to-digital conversion, and a dividing resistor (based on the data in the resolution register 1 ( The control circuit 2 controls the ladder resistance 5) and the reference voltage supply means (switch tree 4) to change the reference voltage to the comparator 6.

【0007】[0007]

【作用】制御回路2は、指定された分解能を示す分解能
レジスタ1のデータに基づいて分割用抵抗(ラダー抵抗
5)及び参照電圧供給手段(スイッチツリー4)を制御
する。これにより、コンパレータ6には指定された分解
能に応じた変化回数の参照電圧が与えられる。即ち、分
解能が高ければ、参照電圧の変化回数も多くなり、入力
アナログ信号のデジタル変換精度が高くなり、また、分
解能が低ければ、参照電圧の変化回数が少なくなり、ア
ナログデジタル変換精度が低くなるが、変換処理時間が
短くなる。
The control circuit 2 controls the dividing resistor (ladder resistor 5) and the reference voltage supply means (switch tree 4) based on the data of the resolution register 1 indicating the designated resolution. As a result, the reference voltage having the number of changes according to the designated resolution is applied to the comparator 6. That is, if the resolution is high, the number of changes in the reference voltage is large and the digital conversion accuracy of the input analog signal is high, and if the resolution is low, the number of changes in the reference voltage is small and the analog-digital conversion accuracy is low. However, the conversion processing time becomes short.

【0008】[0008]

【実施例】図1はこの発明の一実施例に係るアナログデ
ジタル変換装置の構成を示すブロック図である。図1に
おいて、図2に示す構成要素に対応するものには同一の
符号を付し、その説明を省略する。図1において、1は
アナログデジタル変換の指定した分解能を示すデータを
格納する分解能レジスタである。この実施例の制御回路
2は、分解能レジスタ1のデータ(指定された分解能)
に従ってスイッチツリー4及びラダー抵抗5を制御しコ
ンパレータ6への参照電圧を変化させるものである。ま
た、この実施例におけるスイッチツリー4及びラダー抵
抗5は、分解能の変化に伴って参照電圧の変化回数が可
変できるような構成を有する可変型スイッチツリー及び
可変型ラダー抵抗になっている。
1 is a block diagram showing the configuration of an analog-to-digital converter according to an embodiment of the present invention. In FIG. 1, components corresponding to those shown in FIG. 2 are designated by the same reference numerals, and their description will be omitted. In FIG. 1, reference numeral 1 is a resolution register for storing data indicating the designated resolution of analog-digital conversion. The control circuit 2 of this embodiment uses the data of the resolution register 1 (specified resolution).
According to the above, the switch tree 4 and the ladder resistor 5 are controlled to change the reference voltage to the comparator 6. Further, the switch tree 4 and the ladder resistor 5 in this embodiment are a variable switch tree and a variable ladder resistor having a configuration in which the number of changes of the reference voltage can be changed with the change of the resolution.

【0009】次に動作について説明する。まず、分解能
レジスタ1に対し分解能を指定し、そのデータを格納し
ておく。図示しない入力ポート等から入力されたアナロ
グ信号の電圧はコンパレータ6において参照電圧と大小
が比較されるが、この参照電圧の設定は制御回路2の制
御により行なわれる。即ち、制御回路2は指定された分
解能を示す分解能レジスタ1のデータに従ってスイッチ
ツリー4及びラダー抵抗5を制御し、ラダー抵抗5に供
給される電圧(電源電圧と基準電圧との電位差による電
圧)を分割し、この分割電圧をコンパレータ6への参照
電圧としてコンパレータ6に与える。
Next, the operation will be described. First, the resolution is specified for the resolution register 1 and the data is stored. The voltage of the analog signal input from an input port or the like (not shown) is compared with the reference voltage in the comparator 6, and the reference voltage is set by the control of the control circuit 2. That is, the control circuit 2 controls the switch tree 4 and the ladder resistor 5 according to the data of the resolution register 1 indicating the designated resolution, and controls the voltage supplied to the ladder resistor 5 (the voltage due to the potential difference between the power supply voltage and the reference voltage). The voltage is divided, and this divided voltage is given to the comparator 6 as a reference voltage for the comparator 6.

【0010】ここで、アナログデジタル変換の分解能よ
りも変換速度を優先させ変換処理を高速に実行させたい
場合は、処理に悪影響を及ぼさない程度の低い分解能を
分解能レジスタ1に設定し、このときの分解能によって
制御回路2を動作させ、コンパレータ6へ参照電圧を与
える。コンパレータ6は入力されたアナログ信号の電圧
と参照電圧との大小の比較を行ない、この比較結果を変
換したデジタル信号としてレジスタ3に格納する。した
がって、この場合は参照電圧の変化数は少なく、アナロ
グデジタル変換の分解能は劣るが、変換速度が速くな
り、変換処理を高速に実行できる。
Here, when it is desired to prioritize the conversion speed over the resolution of the analog-digital conversion and execute the conversion processing at a high speed, a low resolution that does not adversely affect the processing is set in the resolution register 1 and at this time. The control circuit 2 is operated according to the resolution and a reference voltage is given to the comparator 6. The comparator 6 compares the input analog signal voltage with the reference voltage and stores the comparison result in the register 3 as a converted digital signal. Therefore, in this case, the number of changes in the reference voltage is small and the resolution of the analog-digital conversion is inferior, but the conversion speed is high and the conversion processing can be executed at high speed.

【0011】一方、変換速度よりも分解能を優先させ変
換精度を高めたい場合は、高い分解能を分解能レジスタ
1に設定し、このときの分解能によって制御回路2を動
作させ、コンパレータ6へ参照電圧を与え、入力アナロ
グ信号をデジタル信号に変換する。したがって、この場
合は変換速度は遅いが、参照電圧の変化回数が多く、分
解能が高いため、精度の高いデジタル信号を得ることが
できる。
On the other hand, when it is desired to prioritize the resolution over the conversion speed to improve the conversion accuracy, a high resolution is set in the resolution register 1, the control circuit 2 is operated by the resolution at this time, and the reference voltage is given to the comparator 6. , Converts input analog signal to digital signal. Therefore, in this case, the conversion speed is slow, but the number of changes in the reference voltage is large and the resolution is high, so that a highly accurate digital signal can be obtained.

【0012】ところで、上記実施例によれば、アナログ
デジタル変換の分解能を任意に指定でき、用途によって
は分解能を低くし、変換速度を高めたい場合は、参照電
圧の変化回数も少ないので、制御の数も減り、制御を行
なうためのソフトウエアの作成上で無駄な処理を省くこ
とができる。
By the way, according to the above embodiment, the resolution of the analog-digital conversion can be arbitrarily designated, and depending on the application, when it is desired to lower the resolution and increase the conversion speed, the number of changes in the reference voltage is small, so that the control The number is reduced, and unnecessary processing can be omitted when creating software for controlling.

【0013】[0013]

【発明の効果】以上のように本発明によれば、アナログ
デジタル変換の指定した分解能を示すデータを格納する
分解能レジスタと、この分解能レジスタのデータに基づ
いて分割用抵抗及び参照電圧供給手段を制御しコンパレ
ータへの参照電圧を変化させる制御回路とを設けて構成
したので、アナログデジタル変換の分解能を自由に設定
することが可能になり、これにより、分解能よりもアナ
ログデジタル変換速度を優先させ変換処理を高速に実行
させたい場合や、アナログデジタル変換速度よりも分解
能を優先させアナログデジタル変換精度を高めたい場合
にも対処することができるという効果が得られる。
As described above, according to the present invention, the resolution register for storing the data indicating the specified resolution of the analog-digital conversion and the dividing resistor and the reference voltage supply means are controlled based on the data of the resolution register. Since it is configured with a control circuit that changes the reference voltage to the comparator, it is possible to freely set the resolution of analog-digital conversion, which gives priority to analog-digital conversion speed over resolution and conversion processing. It is also possible to deal with the case where it is desired to execute at high speed or when it is desired to prioritize the resolution over the analog-digital conversion speed to improve the analog-digital conversion accuracy.

【図面の簡単な説明】[Brief description of drawings]

【図1】この発明の一実施例に係るアナログデジタル変
換装置の構成を示すブロック図である。
FIG. 1 is a block diagram showing a configuration of an analog-digital conversion device according to an embodiment of the present invention.

【図2】従来のアナログデジタル変換装置の構成を示す
ブロック図である。
FIG. 2 is a block diagram showing a configuration of a conventional analog-digital conversion device.

【符号の説明】[Explanation of symbols]

1 分解能レジスタ 2 制御回路 3 レジスタ 4 スイッチツリー(参照電圧供給手段) 5 ラダー抵抗(分割用抵抗) 6 コンパレータ 1 resolution register 2 control circuit 3 register 4 switch tree (reference voltage supply means) 5 ladder resistance (division resistance) 6 comparator

Claims (1)

【特許請求の範囲】[Claims] 【請求項1】 入力されたアナログ信号の電圧と参照電
圧との大小を比較するコンパレータと、このコンパレー
タの比較結果をデジタル信号として格納するレジスタ
と、供給電圧を所定電圧に分割する分割用抵抗と、この
分割用抵抗により分割された分割電圧を上記レジスタの
出力に従って上記コンパレータへの参照電圧として与え
る参照電圧供給手段とを備え、上記入力されたアナログ
信号をデジタル信号に変換するアナログデジタル変換装
置において、アナログデジタル変換の指定した分解能を
示すデータを格納する分解能レジスタと、この分解能レ
ジスタのデータに基づいて上記分割用抵抗及び上記参照
電圧供給手段を制御し上記コンパレータへの参照電圧を
変化させる制御回路とを設けたことを特徴とするアナロ
グデジタル変換装置。
1. A comparator for comparing the magnitude of a voltage of an input analog signal and a reference voltage, a register for storing the comparison result of this comparator as a digital signal, and a dividing resistor for dividing a supply voltage into a predetermined voltage. An analog-to-digital conversion device for converting the input analog signal into a digital signal, comprising a reference voltage supply means for applying a divided voltage divided by the dividing resistor as a reference voltage to the comparator according to the output of the register. , A resolution register for storing data indicating a specified resolution of analog-to-digital conversion, and a control circuit for controlling the dividing resistor and the reference voltage supply means based on the data of the resolution register to change the reference voltage to the comparator. An analog-to-digital conversion device characterized in that and are provided.
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Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2005218044A (en) * 2004-02-02 2005-08-11 Nec Electronics Corp A/d converter

Cited By (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2005218044A (en) * 2004-02-02 2005-08-11 Nec Electronics Corp A/d converter
JP4519475B2 (en) * 2004-02-02 2010-08-04 ルネサスエレクトロニクス株式会社 A / D converter

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