JPH0485831U - - Google Patents

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JPH0485831U
JPH0485831U JP12428490U JP12428490U JPH0485831U JP H0485831 U JPH0485831 U JP H0485831U JP 12428490 U JP12428490 U JP 12428490U JP 12428490 U JP12428490 U JP 12428490U JP H0485831 U JPH0485831 U JP H0485831U
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analog voltage
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Description

【図面の簡単な説明】
第1図は本考案の基本構成を示すブロツク回路
図、第2図は本考案に係るA/D変換装置の第1
の実施例を示すA/D変換器入力部の回路図、第
3図、第4図は第2図の回路動作を説明するフロ
ーチヤート、第5図は本考案に係るA/D変換装
置の第1の実施例を示すA/D変換器入力部の回
路図、第6図は第5図の回路動作を説明するフロ
ーチヤート、第7図は本考案が適用される内燃機
関の制御回路を示すブロツク回路図、第8図は従
来のA/D変換器入力部を示す回路図である。 符号の説明、VREF……基準電圧、+B……
バツテリ電圧、R,R……抵抗分圧回路の抵
抗。

Claims (1)

  1. 【実用新案登録請求の範囲】 基準電圧VREFを有するA/D変換器2を用
    いて該基準電圧より高いアナログ電圧+BをA/
    D変換するためのA/D変換装置において、 抵抗分圧回路R,Rと、 該抵抗分圧回路に前記基準電圧および前記アナ
    ログ電圧を選択的に印加するスイツチング手段S
    Wと、 該スイツチング手段によつて前記基準電圧が前
    記抵抗分圧回路に印加されたときに該基準電圧の
    分圧値を前記A/D変換器によりA/D変換して
    基準電圧デイジタル値xを取込む第1のA/D取
    込手段と、 前記スイツチング手段によつて前記アナログ電
    圧が前記抵抗分圧回路に印加されたときに該アナ
    ログ電圧の分圧値を前記A/D変換器によりA/
    D変換して前記アナログ電圧のデイジタル値yを
    取込む第2のA/D取込手段と、 前記アナログ電圧のデイジタル値を前記基準電
    圧デイジタル値により補正して前記アナログ電圧
    のデイジタル値(+B=256・y/xまたは2
    56・y/(256−x)を得る補正手段と、を
    具備することを特徴とするA/D変換装置。
JP12428490U 1990-11-28 1990-11-28 A/d変換装置 Expired - Lifetime JP2543446Y2 (ja)

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JPH0485831U true JPH0485831U (ja) 1992-07-27
JP2543446Y2 JP2543446Y2 (ja) 1997-08-06

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Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2020053752A (ja) * 2018-09-25 2020-04-02 ローム株式会社 アナログ/デジタル変換器

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* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2020053752A (ja) * 2018-09-25 2020-04-02 ローム株式会社 アナログ/デジタル変換器

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JP2543446Y2 (ja) 1997-08-06

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