JPH0453005Y2 - - Google Patents
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- JPH0453005Y2 JPH0453005Y2 JP1986005422U JP542286U JPH0453005Y2 JP H0453005 Y2 JPH0453005 Y2 JP H0453005Y2 JP 1986005422 U JP1986005422 U JP 1986005422U JP 542286 U JP542286 U JP 542286U JP H0453005 Y2 JPH0453005 Y2 JP H0453005Y2
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Description
【考案の詳細な説明】
〔産業上の利用分野〕
この考案は、駆動回路付LED（Ligbt Emitted
Diode）アレイすなわちLEDアレイヘツドの制御
回路に関するものである。[Detailed explanation of the invention] [Industrial application field] This invention is a LED with a drive circuit (Ligbt Emitted LED).
This relates to the control circuit for the LED array head.
電子写真方式のプリンタに用いられるLEDア
レイヘツドにおいて、LEDアレイの発光部の分
解能がそのまま印字の分解能となるが、電子写真
方式のプリンタの印字分解能が一般的に10ドツ
ト／mmと高いため、発光部の配列ピツチは0.1mm
という小さな値となる。その一方、LEDアレイ
駆動回路はICとして構成されているが、技術上
の問題から、LEDアレイと同一の材料で作るこ
とができず、両者をワイヤホンデイング等で接続
する必要があるが、これは、前記理由から非常に
高密度のものとなる。
In the LED array head used in electrophotographic printers, the resolution of the light emitting part of the LED array directly becomes the printing resolution, but since the printing resolution of electrophotographic printers is generally as high as 10 dots/mm, the light emitting part The array pitch is 0.1mm
This is a small value. On the other hand, the LED array drive circuit is configured as an IC, but due to technical issues, it cannot be made from the same material as the LED array, and it is necessary to connect the two using wire bonding, etc. has a very high density for the reasons mentioned above.
そこで、一般的には、第５図に示す様に、
LEDアレイの電極を一ドツトおきに両側に取出
して、配線の密度を半分にする方法がとられる。
第５図において４１ａ〜４１ｅは電極の一端で、
４２ａ〜４２ｅは発光部、４３はLEDアレイ本
体であり全発光部の共通電極としてGND等に接
続されている。 Therefore, generally, as shown in Figure 5,
One method is to take out every other dot of the LED array's electrodes on both sides, cutting the wiring density in half.
In FIG. 5, 41a to 41e are one ends of the electrodes,
42a to 42e are light emitting parts, and 43 is an LED array main body, which is connected to GND etc. as a common electrode for all the light emitting parts.
ところで、LEDアレイヘツドの発光部の数は
数千ドツトと非常に大きな値となるため、発光デ
ータはシリアルに入力されることになる。第６図
は、LEDアレイ駆動回路の構成を示したもので、
図において５１はシフトレジスタ、５２はシフト
レジスタの出力を保持するラツチ、５３はラツチ
の出力によりLEDをON、OFFするドライバ回路
である。入力データDIは、クロツク入力CKによ
りシフトレジスタ５１内に取り込まれ内部をシフ
トしていき、DOから出力される。ラツチ５２は
LS信号によりシフトレジスタ５１がデータで満
たされた時、その出力をラツチし、ドライバ回路
５３はDR信号によりラツチの出力に従い、LED
をON、OFFする。また、駆動回路は、一つで数
十ドツト程度分の大きさしかないため、LEDア
レイヘツドでは数十〜百数十個用いられており、
DO端子は、次の駆動回路のDI端子と接続される
ことになる。 By the way, since the number of light emitting parts in the LED array head is extremely large, several thousand dots, the light emitting data must be input serially. Figure 6 shows the configuration of the LED array drive circuit.
In the figure, 51 is a shift register, 52 is a latch that holds the output of the shift register, and 53 is a driver circuit that turns the LED on and off based on the output of the latch. The input data DI is taken into the shift register 51 by the clock input CK, shifted inside, and outputted from the DO. The latch 52
When the shift register 51 is filled with data by the LS signal, its output is latched, and the driver circuit 53 follows the output of the latch by the DR signal and outputs the LED.
Turn on and off. Furthermore, since a single drive circuit is only large enough to accommodate a few dozen dots, an LED array head uses several dozen to over a hundred.
The DO terminal will be connected to the DI terminal of the next drive circuit.
この、両者の構成より、LED駆動回路とLED
アレイを接続する際の方法により、LEDアレイ
ヘツドには以下の２つの構成が考えられる。 From these two configurations, the LED drive circuit and LED
Depending on the method used to connect the array, there are two possible configurations for the LED array head:
１ 駆動回路をLEDアレイの片側に配置し、両
者ののつている基板を多層構造とする。1. Place the drive circuit on one side of the LED array, and make the substrate on which both are mounted a multilayer structure.
２ 駆動回路をLEDアレイの両側に配置し、両
者ののつている基板は一層構造とする。駆動回
路はすべて同一構造とする。2. The drive circuits are placed on both sides of the LED array, and the substrate on which they are mounted has a single layer structure. All drive circuits have the same structure.
第７図は、特開昭57−74166号公報に示された、
1.の場合の例を示すものであり、図において６１
はLEDアレイ、６２及び６３は駆動回路、６４
は両者をのせた多層基板であり、６５は６４上に
形成された外部との接続のための配線である。第
８図は、第７図をＡ−Ａ線にて切断した断面図を
表わしており、図において、７１〜７３は基板上
にある一層めの配線、７４は第一層と第２層を分
ける絶縁層、７５〜７８は第２層の配線、７９〜
８４は６１〜６３を接続するワイヤである。 Figure 7 is shown in Japanese Patent Application Laid-Open No. 57-74166.
This shows an example of case 1. In the figure, 61
is an LED array, 62 and 63 are drive circuits, 64
is a multilayer board on which both are mounted, and 65 is a wiring formed on 64 for connection with the outside. FIG. 8 shows a cross-sectional view taken along the line A-A in FIG. Insulating layer to separate, 75-78 are second layer wiring, 79-
84 is a wire connecting 61 to 63.
駆動回路６２は第２層部の配線７６を用いて、
６１〜８０により一対一に接続されており、配線
７８を用いて他の駆動回路または外部と接続され
る。また、駆動回路６３は基板上に形成された配
線７１がLEDアレイ６１と駆動回路６２の下を
通つており、これによりワイヤ７９でLEDアレ
イ６１と一対一に接続される。この構成によつて
駆動回路６２は例えば発光部の偶数番を駆動し、
駆動回路６３は、それに対して奇数番の発光部を
駆動することになる。また、発光データは、いず
れの駆動回路に対しても、番号の若い方から入力
することになる。 The drive circuit 62 uses the wiring 76 in the second layer,
They are connected one-to-one through lines 61 to 80, and are connected to other drive circuits or the outside using wiring 78. Further, in the drive circuit 63, wiring 71 formed on the substrate passes under the LED array 61 and the drive circuit 62, so that the drive circuit 63 is connected one-to-one to the LED array 61 by wires 79. With this configuration, the drive circuit 62 drives, for example, even numbered light emitting parts,
The drive circuit 63 drives the odd-numbered light emitting sections. Furthermore, the light emission data is input to each drive circuit starting from the one with the smallest number.
以上のように、LEDアレイヘツドを方式１で
構成すると、発光データを若い順に入れられる利
点はあるが、LEDアレイヘツドが多量の熱を出
すため、LEDをのせた基板は、一般的な基板で
はなく、熱導電性の高い特殊基板でなければなら
ないことから、基板を多層構造にすることは、製
造工程を増しコスト及び信頼性を悪化させるとい
う問題点があつた。
As mentioned above, configuring the LED array head using method 1 has the advantage of allowing light emission data to be input in ascending order, but since the LED array head generates a large amount of heat, the board on which the LEDs are mounted is not a typical board. Since a special substrate with high thermal conductivity must be used, creating a multilayer structure for the substrate has the problem of increasing the manufacturing process and worsening cost and reliability.
この考案は上記のような問題点を解消するため
になされたもので、LEDアレイののつた基板を
一層構造とし、LEDアレイの両側に、同一の駆
動回路を配置したLEDアレイヘツドを駆動する
回路を得ることを目的とする。 This idea was made in order to solve the above problems.The board on which the LED array is mounted has a single-layer structure, and the same drive circuit is placed on both sides of the LED array to drive the LED array head. The purpose is to obtain.
この考案に係る制御回路は、発光データを一担
内部に蓄え、その順序を並び換え、LEDアレイ
ヘツドに発光データを書込むようにしたものであ
る。
The control circuit according to this invention stores light emission data internally, rearranges the order, and writes the light emission data to the LED array head.
この考案における制御回路は、発光データを読
出す際に、排他的論理和素子を用いて、読出し順
序を書込み順序と違え、LEDアレイの両側の
LEDアレイ駆動回路に異なるクロツクを与え、
発光データを両側の駆動回路に振り分けて入力す
る。
The control circuit in this invention uses an exclusive OR element to read out light-emission data, and makes the reading order different from the writing order.
Give different clocks to the LED array drive circuit,
Light emission data is distributed and input to both drive circuits.
以下、この考案の一実施例を図について説明す
る。第１図は、本考案の回路のブロツク図であ
り、図において１はRAMの読出しアドレスを指
定する順序回路であり、２はRAMへの書込みア
ドレスを指定する順序回路であり、３，４は
RAMへ送るアドレスを１によるものか２による
ものか切換えるセレクタ、５，６は発光データを
一担たくわえるRAMであり、７は１の信号より
LEDアレイヘツド用のクロツク信号を作る組合
わせ回路、８はセレクタ３，４の状能を切換える
1bitのフイリツプフロツプ、９は出力データを切
換えるセレクタである。第２図は第１図の読み出
しアドレス用順序回路１、書込みアドレス用順序
回路２、組合わせ回路７の詳細であり、第３図に
示すLEDアレイヘツドを制御するためのもので
ある。第２図において、１１，１２は4bitのバイ
ナリカウンタ、１３，１４は排他的論理和素子、
１５は否定素子、１６は論理積素子である。第３
図はLEDアレイヘツドの全ドツト数が8bitとした
本動作説明のための簡略モデルを示している。図
において、２１はLEDアレイ、２２，２３は
LEDアレイ駆動回路、２４，２５はLEDアレイ
と駆動回路とを接続するワイヤを示している。第
４図に、本回路の動作のタイムチヤートを示す。
An embodiment of this invention will be described below with reference to the drawings. FIG. 1 is a block diagram of the circuit of the present invention. In the figure, 1 is a sequential circuit that specifies a read address of RAM, 2 is a sequential circuit that specifies a write address to RAM, and 3 and 4 are sequential circuits that specify a write address to RAM.
The selector switches the address to be sent to RAM by 1 or 2, 5 and 6 are RAMs that store one part of the light emission data, and 7 is from the signal of 1.
Combination circuit that creates a clock signal for the LED array head; 8 switches the status of selectors 3 and 4.
A 1-bit flip-flop, 9 is a selector for switching output data. FIG. 2 shows details of the read address sequential circuit 1, write address sequential circuit 2, and combinational circuit 7 shown in FIG. 1, which are used to control the LED array head shown in FIG. 3. In Fig. 2, 11 and 12 are 4-bit binary counters, 13 and 14 are exclusive OR elements,
15 is a negation element, and 16 is an AND element. Third
The figure shows a simplified model for explaining this operation in which the total number of dots in the LED array head is 8 bits. In the figure, 21 is an LED array, 22 and 23 are
LED array drive circuit, 24 and 25 indicate wires connecting the LED array and the drive circuit. FIG. 4 shows a time chart of the operation of this circuit.
本回路に取り込まれた発光データは、フリツプ
フロツプ８の状態によりRAM５またはRAM６
に、書込みアドレス用順序回路２によつて決めら
れる順序すなわち、低アドレスより順に書込まれ
る。いまRAM５に書込まれるとすると、アドレ
ス・セレクタ３は書込みアドレス用順序回路２の
アドレスを選択しており、アドレス・セレクタ４
は読み出しアドレス用順序回路１のアドレスを選
択している。またデータセレクタ９はRAM５か
らの出力をDIとして出力しており、RAM５から
読出されたデータがLEDヘツドに入ることにな
る。この時の読出し順序は、第４図Ｒ０〜２に示
す様になつている。また組合せ回路７により作ら
れたCK１，CK２が第４図に示すタイミングで発
生することから、LEDアレイ駆動素子２３には
〔０，２，４，６〕
２２には
〔７，５，３，１〕
のアドレスのデータ、すなわちその番号に対応す
るデータがこの順序で書込まれ、LEDアレイは、
その発光部の番号と対応する、発光データにより
駆動されることになる。 The light emission data taken into this circuit is transferred to RAM5 or RAM6 depending on the state of flip-flop 8.
are written in the order determined by the write address sequential circuit 2, that is, in order from the lowest address. If the RAM 5 is to be written now, the address selector 3 has selected the address of the write address sequential circuit 2, and the address selector 4 has selected the address of the write address sequential circuit 2.
selects the address of sequential circuit 1 for read address. Further, the data selector 9 outputs the output from the RAM 5 as DI, and the data read from the RAM 5 enters the LED head. The reading order at this time is as shown in FIG. 4 R0-2. Furthermore, since CK1 and CK2 generated by the combinational circuit 7 are generated at the timing shown in FIG. 1] The data at the address, that is, the data corresponding to that number, is written in this order, and the LED array is
It is driven by light emission data corresponding to the number of the light emitting section.
以上では、LEDアレイヘツドは８ドツト構成
として説明したが、数千ドツトのLEDアレイヘ
ツドに対しても１〜６までのアドレス巾を広げれ
ば、同じことができる。 Although the LED array head has been described above as having an 8-dot configuration, the same effect can be achieved even for an LED array head of several thousand dots by widening the address width from 1 to 6.
なお、上記の制御回路は、LEDアレイヘツド
と同様な構成となるサーマルヘツドの制御回路と
しても適用できる。 Note that the above control circuit can also be applied as a control circuit for a thermal head having a configuration similar to that of an LED array head.
以上のように、本制御回路によれば、LEDア
レイヘツドの発光データの書込順序を入れ換える
ことにより、LEDアレイヘツドの構造を簡単に
でき、LEDアレイヘツドのコストを下げ、信頼
性を上げる効果がある。
As described above, according to the present control circuit, the structure of the LED array head can be simplified by changing the writing order of the light emission data of the LED array head, which has the effect of lowering the cost of the LED array head and increasing the reliability.
第１図は、この考案の一実施例のブロツク図で
あり、第２図は、その詳細図である。第３図は、
簡略化したLEDアレイヘツドのモデルであり、
第４図は、本回路の動作のタイムチヤートであ
る。第５図は、LEDアレイの構成を、第６図は
LEDアレイ駆動回路の構成を示している。第７
図は、従来のLEDアレイヘツドの構成を、第８
図は第７図の断面図を示している。
１は読出しアドレス用順序回路、２は書込みア
ドレス用順序回路、３，４はアドレス・セレク
タ、５，６はRAM、７は組合わせ回路、８は１
ビツトのフイリツプフロツプ、９はデータセレク
タ、１１，１２は４ビツトバイナリカウンタ、１
３，１４は排他的論理和素子、１５は否定素子、
１６，１７は論理積素子、２１はLEDアレイ、
２２，２３はLEDアレイ駆動素子、２４，２５
はワイヤ、４１ａ，４１ｅはLEDの電極、４２
ａ〜４２ｅはLEDアレイの発光部、４３はLED
アレイ本体、５１はシフトレジスタ、５２はラツ
チ、５３はドライブ回路、６１はLEDアレイ、
６２，６３はLED駆動回路、６４はLEDアレイ
ヘツド基板、６５は基板上の配線、７１〜７３は
基板上の第一層配線、７４は絶縁層、７５，７８
は第二層配線、７９〜８４はワイヤである。
FIG. 1 is a block diagram of an embodiment of this invention, and FIG. 2 is a detailed diagram thereof. Figure 3 shows
This is a simplified model of an LED array head.
FIG. 4 is a time chart of the operation of this circuit. Figure 5 shows the configuration of the LED array, and Figure 6 shows the configuration of the LED array.
The configuration of the LED array drive circuit is shown. 7th
The figure shows the configuration of a conventional LED array head.
The figure shows a sectional view of FIG. 1 is a sequential circuit for read addresses, 2 is a sequential circuit for write addresses, 3 and 4 are address selectors, 5 and 6 are RAMs, 7 is a combinational circuit, and 8 is 1
Bit flip-flop, 9 is a data selector, 11 and 12 are 4-bit binary counters, 1
3 and 14 are exclusive OR elements, 15 is a negation element,
16 and 17 are AND elements, 21 is an LED array,
22, 23 are LED array driving elements, 24, 25
is a wire, 41a and 41e are LED electrodes, 42
a to 42e are the light emitting parts of the LED array, and 43 is the LED
The array body, 51 is a shift register, 52 is a latch, 53 is a drive circuit, 61 is an LED array,
62 and 63 are LED drive circuits, 64 is an LED array head board, 65 is wiring on the board, 71 to 73 are first layer wirings on the board, 74 is an insulating layer, 75, 78
is a second layer wiring, and 79 to 84 are wires.
Claims (1)
子を発光部列の両側に交互に取出したLEDアレ
イと、その両側に、LEDアレイを駆動する回路
とを配置したLEDアレイヘツドに対して、LED
アレイヘツドに書き込むデータを一旦メモリへ書
き込み、その読み出しの順序を書き込み順序と違
えて、LEDアレイヘツドの書込みデータの並び
換えを行なうとともに、LEDアレイの両側の
LED駆動回路に異なるクロツク信号を与えるこ
とにより、LEDアレイの一方の側の駆動回路に
偶数番めの発光データを昇順（または降順）に、
LEDアレイの反対側の駆動回路に奇数番めの発
光データを前記偶数番めの発光データが昇順の場
合には降順に前記偶数番めの発光データが降順の
場合には昇順に書き込むことを特徴とするLED
アレイヘツド制御回路。 For an LED array head that has a plurality of light emitting parts in a row, an LED array with terminals on one electrode side taken out alternately on both sides of the row of light emitting parts, and a circuit for driving the LED array arranged on both sides of the LED array. ,LED
The data to be written to the array head is written to memory once, and the read order is different from the write order to rearrange the write data in the LED array head.
By applying different clock signals to the LED drive circuits, even-numbered light emission data is sent to the drive circuits on one side of the LED array in ascending (or descending) order.
The odd numbered light emission data is written to the drive circuit on the opposite side of the LED array in descending order if the even numbered light emission data is in ascending order, and in ascending order if the even numbered light emission data is in descending order. LED
Array head control circuit.
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1986005422U JPH0453005Y2 (en) | 1986-01-18 | 1986-01-18 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1986005422U JPH0453005Y2 (en) | 1986-01-18 | 1986-01-18 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS62118465U JPS62118465U (en) | 1987-07-28 |
| JPH0453005Y2 true JPH0453005Y2 (en) | 1992-12-14 |
Family
ID=30786993
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP1986005422U Expired JPH0453005Y2 (en) | 1986-01-18 | 1986-01-18 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0453005Y2 (en) |
-
1986
- 1986-01-18 JP JP1986005422U patent/JPH0453005Y2/ja not_active Expired
Also Published As
| Publication number | Publication date |
|---|---|
| JPS62118465U (en) | 1987-07-28 |
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