JPH0444855B2 - - Google Patents

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JPH0444855B2
JPH0444855B2 JP1387184A JP1387184A JPH0444855B2 JP H0444855 B2 JPH0444855 B2 JP H0444855B2 JP 1387184 A JP1387184 A JP 1387184A JP 1387184 A JP1387184 A JP 1387184A JP H0444855 B2 JPH0444855 B2 JP H0444855B2
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JP
Japan
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zero
signal
pcm
circuit
suppressed
Prior art date
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JP1387184A
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English (en)
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JPS60158745A (ja
Inventor
Hajime Nakajima
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Sharp Corp
Original Assignee
Sharp Corp
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Publication date
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Publication of JPS60158745A publication Critical patent/JPS60158745A/ja
Publication of JPH0444855B2 publication Critical patent/JPH0444855B2/ja
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Classifications

    • HELECTRICITY
    • H04ELECTRIC COMMUNICATION TECHNIQUE
    • H04BTRANSMISSION
    • H04B14/00Transmission systems not characterised by the medium used for transmission
    • H04B14/02Transmission systems not characterised by the medium used for transmission characterised by the use of pulse modulation
    • H04B14/04Transmission systems not characterised by the medium used for transmission characterised by the use of pulse modulation using pulse code modulation
    • H04B14/046Systems or methods for reducing noise or bandwidth

Landscapes

  • Engineering & Computer Science (AREA)
  • Computer Networks & Wireless Communication (AREA)
  • Signal Processing (AREA)
  • Transmission Systems Not Characterized By The Medium Used For Transmission (AREA)

Description

【発明の詳細な説明】
(産業上の利用分野) 本発明は複数チヤンネルの各信号を夫々パルス
コード変調(PCM)して時分割切換によりシリ
アルに送信するPCM信号送信機に関する。 (従来技術) 一般に、パルスコード変調を使用して情報の送
受信を行うシステムでは、送信側でアナログ情報
信号をサンプリングし、そのサンプル値をn(=
整数)ビツトのデジタル信号に変換(A/D変
換)してこのデジタル信号を送信し、受信側では
受信した上記デジタル信号をD/A変換して再び
アナログ情報信号に復調するようにしている。 ところで、上記のようなPCM方式による情報
の送受信システムにおいて、複数チヤンネルの各
信号を夫々パルスコード変調(PCM)して時分
割切換によりシリアルに送信すると、各チヤンネ
ルについて1つのサンプル値を送信するのに要す
る時間は一定であるから、チヤンネル変に比例し
て送信に要する時間は増加する。一方、受信側で
は、ある1つのチヤンネルに注目すると、上記チ
ヤンネル数に比例して新たなデータを受信するた
めの待ち時間が長くなる。このため、従来のこの
種のシステムでは、変化の速い信号を多チヤンネ
ルでシリアルに伝送するのが困難であるといつた
問題があつた。 (発明の目的) 本発明は上記問題を解消すべくなされたもので
あつて、その目的は、PCM方式による情報の送
受信システムにおいて、PCM信号のデータ圧縮
を行うことにより、実質的にPCM信号全体のビ
ツト数を削減し、多チヤンネルのPCM信号を効
率よくシリアルに送受信することである。 (発明の構成) このため、本発明は、複数チヤンネルの各信号
を夫々パルスコード変調(PCM)してこれらパ
ルスコード化されたPCM信号を時分割切換によ
りシリアルに送信するPCM信号送信機において、
各チヤンネル毎に設けられ、各々が前回の入力
PCM信号と今回の入力PCM信号との差分を計算
して差分PCM信号を出力する差分計算回路と、
各チヤンネル毎に設けられ、各々が上記差分計算
回路よりの差分PCM信号を入力と、この差分
PCM信号の最上位ビツトを含んで上位ビツトに
零が連続したときにこの零であるビツトを省略し
て零サプレスされた差分PCM信号を出力する第
1の零サプレス回路と、各チヤンネル毎に設けら
れ、各々が入力PCM信号の最上位ビツトを含ん
で上位ビツトに零が連続したときにこの零である
ビツトを省略して零サプレスされたPCM信号を
出力する第2の零サプレス回路と、各チヤンネル
毎に設けられ、各々が上記第1の零サプレス回路
からの零サプレスされた差分PCM信号と第2の
零サプレス回路からの零サプレスされたPCM信
号とを入力し、第1の零サプレス回路からの零サ
プレスされた差分PCM信号と第2の零サプレス
回路からの零サプレスされたPCM信号との通過
を切り換え、上記複数チヤンネルにわたる時分割
切換毎に第2の零サプレス回路からの零サプレス
されたPCM信号を通過させるチヤンネルが順次
選択される信号切換回路と、各チヤンネルの上記
信号切換回路の出力を入力とし、上記時分割切換
に対応して入力する零サプレスされたPCM信号
と零サプレスされた差分PCM信号との間および
差分PCM信号と差分PCM信号との間に信号休止
期間からなるチヤンネルスペースをおいてこれら
零サプレスされたPCM信号と零サプレスされた
差分PCM信号とを組み合わせてデータ圧縮され
たシリアルな時分割多重PCM信号に合成する信
号合成回路とを備えたことを特徴としている。 (実施例) 以下、添付図面を参照して本発明の実施例を具
体的に説明する。 第1図に本発明に係るPCM送信機の一実施例
のブロツク図を示す。 第1図のPCM送信機は、チヤンネル1からチ
ヤンネルmまでのm個のチヤンネルを有してお
り、これらm個のチヤンネルの各々について夫々
差分計算回路1、零サプレス回路2,3および信
号切換回路4を備えており、各入力端子P1,P2
…,Pmには夫々チヤンネル1,2,…,mのア
ナログ情報信号をA/D変換したPCM信号が
夫々入力している。 上記差分計算回路1は、各チヤンネルについ
て、前回送信したPCM信号と今回送信したPCM
信号との差分を計算し、この差分を零サプレス回
路2に出力している。上記差分は、正(プラス)
の場合には「1」および負(マイナス)の場合に
は「0」が符号桁として上記差分の最上位桁の上
に付加されて零サプレス回路2に出力される。 上記零サプレス回路2は、符号桁を除く上記差
分の上位桁の「0」が連続する場合、この上位桁
を省略(零サプレス)して、最初に「1」が現わ
れる桁から下の桁を出力する回路である。 一方、いま一つの零サプレス回路3は、たとえ
ばチヤンネル1の場合、入力端子P1から入力す
る上記PCM信号の上位桁に「0」が連続する場
合、この上位桁を省略(零サプレス)して、最初
に「1」が現われる桁から下の桁を出力する回路
である。 上記零サプレス回路2および3の出力はいずれ
も信号切換回路4に出力している。 この信号切換回路4は、上記零サプレス回路2
および3の出力を切り換えて出力する回路で、各
チヤンネルについて、零サプレス回路2からの零
サプレスされた差分が(m−1)回通過すると、
零サプレス回路3からの零サプレスされたPCM
信号を1回通過させる。このPCM信号の通過は、
m個の信号切換回路4について一つのフレーム毎
に順次切り換えられる。 m個の信号切換回路4の出力は信号合成回路5
に入力している。この信号合成回路5は、m個の
上記信号切換回路4から夫々入力する信号を組み
合せて、第2図に示すようなフレーム構成を有す
るシリアルな信号に合成する回路である。 上記第2図から分るように、一つのフレーム
は、新たなフレームの始まりを示すフレームスペ
ース,受信側で受信された時分割多重PCM信号
の誤り訂正の機能を使用するか否かを指定するフ
エールセーフのためのフエールセーフビツト、零
サプレス回路3の出力を通過させている信号切換
回路4が属しているチヤンネルxを示すモードコ
ードビツト,零サプレスされたチヤンネルCH
(x)の全ビツトおよびチヤンネル間のデータを
区分するために一定時間信号の出力が停止するチ
ヤンネルスペース(CH・SP)をおいて残るチヤ
ンネルCHk1,…,CHkn-1の(m−1)個の差
分データビツトを順次配置した構成を有する。第
3図にm=8の場合の8フレーム分の具体的な信
号構成例を示す。 なお、上記フエールセーフビツトに関し、受信
側で受信された時分割多重PCM信号の誤り訂正
については、本発明の理解に関係がないので、そ
の詳細な説明は省略する。 次に、上記フエールセーフビツト,m=8(8
チヤンネル)の場合のモードコードビツト,およ
び差分データビツトの構成を夫々次の第1表,第
2表および第3表を示す。
【表】
【表】
【表】 以上に説明した第2図のフレーム構成を有する
時分割多重されたPCM信号は、第4図に示すよ
うに、「1」および「0」が夫々Tおよび2Tに対
応してパルス巾が変化するパルスに変換し、この
パルスを送信回路6で搬送波に乗せて送信アンテ
ナ7から発射している。なお、第2図に示される
PCM信号のチヤンネルスペースは、上記Tや2T
よりも充分大きい。たとえば24Tに設定される。 上記Tの値は、たとえば、T=400μsecに設定
される。 第1図のPCM送信機から発射された信号は第
5図のPCM受信機に受信される。このPCM受信
機は、受信アンテナ11,受信回数12,信号分
配回路13,零サプレス復調回路14および復調
回路15からなり、上記零サプレス復調回路14
および復調回路15はチヤンネル1からチヤンネ
ルmの各チヤンネルに夫々1組ずつ設けられてい
る。 上記受信回路12は受信アンテナ11で受信さ
れた信号を検波し、PCM送信機から送信された
第4図のパルス信号を得る周知の構成を有する
AM受信回路もしくはFM受信回路等であつて、
この受信回路12から出力する第4図のパルス信
号は信号分配回路13に出力している。 上記信号分配回路13は、第4図のパルス信号
を第2図のフレーム構成を有する時分割多重
PCM信号に変換した後、この時分割多重PCM信
号からチヤンネル1,チヤンネル2,…,チヤン
ネルmの信号を分離し、各チヤンネルの零サプレ
ス復調回路14に夫々出力している。 各零サプレス復調回路14は、信号分配回路1
3から入力する零サプレスされた信号のビツトに
「0」を付け加える回路で、上記零サプレス復調
回路14からは、第1図の差分計算回路1から出
力する差分および入力端子P1,P2,…,Pmに入
力するPCM信号の全ビツトデータが出力される。
第2図のフレーム構成から各零サプレス復調回路
14は、1つの全ビツトデータを出力した後、
(m−1)個の差分を出力する。 上記全ビツトデータは、真値として第5図に示
す記憶装置16および差分復調回路17からなる
復調回路15の記憶装置16に記憶され、差分復
調回路17にて、後述するフレームの対応するチ
ヤンネルの差分と加算された後、出力端子P01
P02,…,P0mから出力されるとともに、記憶装
置16の内容がこの加算値に更新されるようにし
ている。また、各記憶装置16の内容は、(m)
フレームにつき1回、新しい全ビツトデータに更
新される(第3図参照)。 上記出力端子P01,P02,…,P0mから得られた
復調信号は図示しないD/A変換器に入力され、
アナログ信号として取り出される。 上記のような方式によるPCM信号の時分割多
重送受信システムでは、m個のチヤンネルのう
ち、変化のあるチヤンネル数が少ないほど1フレ
ーム当りの信号長は短くなる。逆に、m個のチヤ
ンネルが同時に大きく変化する場合や信号コード
中に「0」が多い場合には信号長は長くなるが、
この信号長は従来のPCM信号の送受信システム
の時分割多重送受信システムの信号長以下とな
る。従つて、全体として、第1図および第5図の
PCM信号の時分割多重送受信システムでは1フ
レーム当りの平均送受信時間は従来のシステムに
比較して大幅に短くなり、変化の速い信号を多チ
ヤンネルでシリアルに送信および受信することが
できる。 本発明は電波を使用して信号の伝達を行うシス
テムに限定されず、超音波やレーザ光等を信号の
伝達に利用するシステムにも広く適用することが
できる。 (発明の効果) 以上、詳述したことからも明らかなように、本
発明は、時分割多重によるPCM方式の情報の送
受信システムにおいて、データ圧縮により送信す
るPCM信号全体のビツト数を削減して情報の送
信を行うようにしたから、1フイード当りに要す
る平均送信時間が小さくなり、多チヤンネルの
PCM信号を効率よくシリアルに送信することが
できる。
【図面の簡単な説明】
第1図は本発明に係るPCM送信機の一実施例
の構成を示すブロツク図、第2図は本発明に係る
PCM信号送信機および受信機に使用される信号
のフレーム構成の説明図、第3図は第2図のより
具体的な説明図、第4図は送受信されるPCM信
号の波形図、第5図は本発明に係るPCM受信機
の一実施例の構成を示すブロツク図である。 1…差分計算回路、2,3…零サプレス回路、
4…信号切換回路、5…信号合成回路。

Claims (1)

  1. 【特許請求の範囲】 1 複数チヤンネルの各信号を夫々パルスコード
    変調(PCM)してこれらパルスコード化された
    PCM信号を時分割切換によりシリアルに送信す
    るPCM信号送信機において、 各チヤンネル毎に設けられ、各々が前回の入力
    PCM信号と今回の入力PCM信号との差分を計算
    して差分PCM信号を出力する差分計算回路1と、
    各チヤンネル毎に設けられ、各々が上記差分計算
    回路1よりの差分PCM信号を入力とし、この差
    分PCM信号の最上位ビツトを含んで上位ビツト
    に零が連続したときにこの零であるビツトを省略
    して零サプレスされた差分PCM信号を出力する
    第1の零サプレス回路2と、各チヤンネル毎に設
    けられ、各々が入力PCM信号の最上位ビツトを
    含んで上位ビツトに零が連続したときにこの零で
    あるビツトを省略して零サプレスされたPCM信
    号を出力する第2の零サプレス回路3と、各チヤ
    ンネル毎に設けられ、各々が上記第1の零サプレ
    ス回路2からの零サプレスされた差分PCM信号
    と第2の零サプレス回路3からの零サプレスされ
    たPCM信号とを入力とし、第1の零サプレス回
    路2から零サプレスされた差分PCM信号と第2
    のサプレス回路3からの零サプレスされたPCM
    信号との通過を切り換え、上記複数チヤンネルに
    わたる時分割切換毎に第2の零サプレス回路3か
    らの零サプレスされたPCM信号を通過させるチ
    ヤンネルが順次選択される信号切換回路4と、各
    チヤンネルの上記信号切換回路4の出力を入力と
    し、上記時分割切換に対応して入力する零サプレ
    スされたPCM信号と零サプレスされた差分PCM
    信号との間および差分PCM信号と差分PCM信号
    との間に信号休止期間からなるチヤンネルスペー
    スをおいてこれら零サプレスされたPCM信号と
    零サプレスされた差分PCM信号とを組み合わせ
    てデータ圧縮されたシリアルな時分割多重PCM
    信号に合成する信号合成回路5とを備えたことを
    特徴とするPCM信号送信機。
JP1387184A 1984-01-27 1984-01-27 Pcm信号送信機 Granted JPS60158745A (ja)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP1387184A JPS60158745A (ja) 1984-01-27 1984-01-27 Pcm信号送信機

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JP1387184A JPS60158745A (ja) 1984-01-27 1984-01-27 Pcm信号送信機

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JP11630792A Division JPH0738618B2 (ja) 1992-05-08 1992-05-08 Pcm信号受信機

Publications (2)

Publication Number Publication Date
JPS60158745A JPS60158745A (ja) 1985-08-20
JPH0444855B2 true JPH0444855B2 (ja) 1992-07-23

Family

ID=11845294

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JP1387184A Granted JPS60158745A (ja) 1984-01-27 1984-01-27 Pcm信号送信機

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JPS60158745A (ja) 1985-08-20

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