JPH0444781B2 - - Google Patents

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JPH0444781B2
JPH0444781B2 JP56150707A JP15070781A JPH0444781B2 JP H0444781 B2 JPH0444781 B2 JP H0444781B2 JP 56150707 A JP56150707 A JP 56150707A JP 15070781 A JP15070781 A JP 15070781A JP H0444781 B2 JPH0444781 B2 JP H0444781B2
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JP
Japan
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symbol
character
output
pattern
key
Prior art date
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JP56150707A
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JPS5852733A (en
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Kuniomi Kano
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Canon Inc
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Canon Inc
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Description

【発明の詳細な説明】 本発明はパターン出力方法装置に関するもので
あり、特に演算式を出力パターンと一体化して出
力するパターン出力方式に関するものである。
DETAILED DESCRIPTION OF THE INVENTION The present invention relates to a pattern output method and apparatus, and more particularly to a pattern output method in which an arithmetic expression is integrated with an output pattern and output.

従来、電卓等における演算式、例えば平方根の
パターン出力は、平方根の計算をしたい通常の計
算式をカツコで囲み、その後に、「√ 」キーを
押下することにより平方根の計算式すなわち「√
」のパターンを出力している。並びに出力パタ
ーンが一般的数式と異なり、見にくく、更に入力
時でのキー操作が増える不利益がある。
Conventionally, to output a pattern of an arithmetic expression, such as a square root, on a calculator, etc., you need to enclose the usual calculation formula for which you want to calculate the square root in brackets, and then press the "√" key to output the square root calculation formula, that is, "√
” pattern is output. In addition, the output pattern is different from general mathematical formulas, making it difficult to see, and furthermore, there are disadvantages in that key operations are increased during input.

本発明は従来の入力方式が上述したような不利
益を有することに鑑み提案されるものである。即
ち、本発明の目的は、一般に慣れている一般的数
式で近い形でパターンを出力し、かつ入力の時点
でのキー操作を簡略化できるパターン出力方式を
提案する所にある。
The present invention is proposed in view of the above-mentioned disadvantages of conventional input methods. That is, an object of the present invention is to propose a pattern output method that can output a pattern in a form similar to that of a commonly used mathematical formula and that can simplify key operations at the time of input.

以下、平方根の根記号(√ )内に計算式が入
る例を示す実施例に従つて詳細に説明する。
Hereinafter, a detailed explanation will be given according to an example showing an example in which a calculation formula is included in the root symbol (√) of the square root.

本発明の一実施例を示すブロツク図である第1
図において、K1〜K3は入力キーでそれぞれK1は
平方根計算キー、K2は平方根計算解除キー、K3
は演算キー群で、数値キー“0”〜“9”やフア
ンクシヨンキー等で構成される。
1 which is a block diagram showing one embodiment of the present invention.
In the figure, K1 to K3 are input keys, K1 is the square root calculation key, K2 is the square root calculation cancellation key, and K3 is the square root calculation key.
is a group of operation keys, which is composed of numerical keys "0" to "9", function keys, and the like.

これらK1〜K3の入力キーは演算のためすべて
中央処理装置CPUに接続されている。また平方
根計算に関するキーK1,K2は、それぞれセツ
ト・リセツトフリツプフロツプFFのセツト端子
S並びにリセツト端子Rに接続されている。セツ
ト・リセツトフリツプロツプFFの出力端子であ
るQ,はANDゲートG1,G2を介してそれぞれ
キヤラクタジエネレータCG1,CG2に接続されて
いる。キヤラクタジエネレータCG2は数字又は文
字のキヤラクタコードのアドレス信号を中央処理
装置CPUからANDゲートG2を介して入力される
と対応する数字又はパターンを5×7ドツトマト
リクスにて出力するための2進化コードに変換さ
れたパターンを発生する装置である。これに対し
て、キヤラクタジエネレータCG1は、キヤラクタ
ジエネレータCG2と同じ数字又は文字のキヤクタ
コードに対応するアドレスをもつが、相違する構
成は、それぞれのパターンは5×9ドツトマトリ
クス中の上方の5×2ドツトマトリクスから構成
されるトツプパー“-”を有し、2進化コードに
変換されたパターンの5×9ドツトマトリクスを
出力することである。(第3図参照)。また更にキ
ヤラクタジエネレータCG1は根記号のためのキヤ
ラクタ“〓”を有する(第2図参照)。
These input keys K1 to K3 are all connected to the central processing unit CPU for calculation. Keys K1 and K2 relating to square root calculation are connected to the set terminal S and reset terminal R of the set/reset flip-flop FF, respectively. The output terminals Q of the set/reset flip-flop FF are connected to character generators CG1 and CG2 via AND gates G1 and G2, respectively. The character generator CG2 receives an address signal of a numeric or character character code from the central processing unit CPU through an AND gate G2 and outputs a corresponding number or pattern in a 5x7 dot matrix. It is a device that generates patterns that are converted into evolutionary codes. On the other hand, the character generator CG1 has an address corresponding to the same numerical or letter character code as the character generator CG2, but the different configuration is that each pattern is located in the upper part of the 5x9 dot matrix. It has a topper " - " consisting of a 5x2 dot matrix, and outputs a 5x9 dot matrix of a pattern converted into a binary code. (See Figure 3). Furthermore, the character generator CG1 has a character "〓" for the radical symbol (see FIG. 2).

これらのキヤラクタジエネレータCG1,CG2に
より発生された2進化コードに変換されたパター
ンは、表示バツフアDRAM(ダイナミツクRAM)
に格納される。このDRAMの内容は、表示器
DISの表示と1対1に対応している。表示器DIS
は1キヤラクタ5×9ドツトマトリクスで表示が
可能な装置である。
The patterns converted into binary codes generated by these character generators CG1 and CG2 are displayed on the display buffer DRAM (dynamic RAM).
is stored in The contents of this DRAM are displayed on the display.
There is a one-to-one correspondence with the DIS display. Display device DIS
is a device capable of displaying a 5×9 dot matrix of one character.

第2図はキヤラクタジエネレータCG1,CG2の
アドレスとキラクタパターンの対応関係の1例を
示す。このようにキヤラクタジエネレータCG1と
CG2は、同一の番地に対して同一の文字(数値や
記号)パターンが対応しているが、CG1のパター
ンには、ドツプバー“-”がついている。
FIG. 2 shows an example of the correspondence between the addresses of character generators CG1 and CG2 and character patterns. In this way, with the character generator CG1
In CG2, the same character (number and symbol) pattern corresponds to the same address, but the pattern in CG1 has a dot bar " - ".

更に最終番地ENDには、キラクタジエネレー
タCG2は“空”であるのに対し、CG1は根号の記
号一部である“〓”が対応している。
Furthermore, the final address END is "empty" in the Kirakuta Generator CG2, while "〓", which is part of the radical symbol, corresponds to the CG1.

次に、第2図を前提として第1図の動作説明を
する。
Next, the operation of FIG. 1 will be explained based on FIG. 2.

計算入力の途中、又は最初に平方根計算キー
K1が押下されると、その記号がセツト・リセツ
トフリツプフロツプFFのセツト端子に入力され、
同出力端子QがON、がOFFとなる。同時に
K1からの信号は、中央処理装置CPUにも入力さ
れ、根号を表示するための第1番目のキヤラクタ
“〓”のアドレス(第2図ではEND番地)をCPU
のアドレス端子AからG1,G2の2つのANDゲー
トに入力する。
Square root calculation key during calculation input or at the beginning
When K1 is pressed, that symbol is input to the set terminal of the set/reset flip-flop FF,
The same output terminal Q is ON and OFF. at the same time
The signal from K1 is also input to the central processing unit CPU, and the address of the first character "〓" (END address in Figure 2) to display the radical sign is sent to the CPU.
Input from address terminal A to two AND gates G1 and G2.

セツト・リセツトフリツプフロツプFFのQ端
子がON、端子がOFFとなつているので、CPU
の出力Aからのアドレス信号はANDゲートG1を
介して、キヤラクタジエネレータCG1に入力され
る。すると、対応するパターンが出力され、OR
ゲートG3を介して、DRAMに書き込まれ、表示
器DISに第3図の1文字目の“〓”が表示され
る。以後演算キー群K3で入力される計算式は、
すべてキヤラクジエネレータCG1から生成される
トツプバー“-”がついた文字で構成される(第
3図の2文字目から第10文字目まで)。
Since the Q terminal of the set/reset flip-flop FF is ON and the terminal is OFF, the CPU
The address signal from the output A of is input to the character generator CG1 via the AND gate G1. Then, the corresponding pattern will be output and OR
The data is written to the DRAM via the gate G3, and the first character "〓" in FIG. 3 is displayed on the display DIS. From now on, the calculation formula entered using calculation key group K3 is:
All are composed of characters with a top bar " - " generated by the character generator CG1 (from the 2nd character to the 10th character in Figure 3).

次に根号解除キーK2を押下するとその信号が
セツト・リセツトフリツプフロツプFFの入力端
子Rに入力され、Q,が反転するので、以後の
計算式はCG2から生成された文字(通常の文字)
で構成される(第3図の11文字目〜13文字目)。
Next, when the radical cancel key K2 is pressed, the signal is input to the input terminal R of the set/reset flip-flop FF, and Q, is inverted. letter)
(11th to 13th characters in Figure 3).

以上のキー操作を整理すると、キーは、K1,
5,+,2,×,(,4,+,2,),K2,+,2,=
のキーの順序で操作されたことになる。ここで、
K1は平方根計算キー、K2は平方根計算解除キー
である。
Organizing the above key operations, the keys are K1,
5,+,2,×,(,4,+,2,),K2,+,2,=
This means that the keys were operated in this order. here,
K1 is the square root calculation key, and K2 is the square root calculation cancellation key.

ところで以上の説明では平方根計算のために
K1,K2の2つの入力キーを想定したが、フリツ
プフロツプFFに入力パルスがはいるたびに出力
端子Q,が反転する公知のToggle(Tタイプ)
−フリツプフロツプを用いると、第4図のように
K1,K2キーはK4キー1個にまとめられ回路図も
簡略化できる、即ち、K1,K2の機能を兼有する
K4キーの第1回目の押下げにより、フリツプフ
ロツプFFの出力QがONとなる。ANDゲートG2
はフリツプフロツプFFの出力が与えられてい
るため閉じられ、K3の押下に対応してCPUが発
生するアドレス信号はキヤラクタジエネレータ
CG1にのみ与えられる。次にK4キーが押下され
ると出力QがOFFとなり、がONとなるので、
キヤラクタジエネレータCG2のみがアクセスさ
れ、根号が解除される。
By the way, in the above explanation, for square root calculation
We assumed two input keys, K1 and K2, but there is a known Toggle (T type) in which the output terminal Q is inverted every time an input pulse enters the flip-flop FF.
- If you use a flip-flop, as shown in Figure 4.
The K1 and K2 keys are combined into one K4 key, which simplifies the circuit diagram.In other words, it has the functions of K1 and K2.
When the K4 key is pressed for the first time, the output Q of the flip-flop FF is turned ON. AND gate G2
is closed because the output of the flip-flop FF is given, and the address signal generated by the CPU in response to the press of K3 is the character generator.
Only given to CG1. Next, when the K4 key is pressed, output Q turns OFF and turns ON, so
Only the character generator CG2 is accessed and the radical is removed.

以上において説明した実施例では、演算式の一
部を数字又は記号パターンと一体に準えておく事
により、根号計算をしたい計算式を予め、カツコ
でくくつてから平方根キーを押下するというキー
操作上の煩雑さを回避できる。具体的に言えば、
計算キー並びに平方根計算解除キーの2回のキー
操作で根号計算が可能となる。更にカツコでくく
られた計算式の後に平方根記号がくるという表示
上の見にくさが回避でき、根号内に計算式を表示
することが可能となる。
In the embodiment described above, by preparing a part of the calculation formula as one with the number or symbol pattern, the key operation is to wrap the calculation formula for which you want to calculate the radical in brackets in advance and then press the square root key. You can avoid the above complications. Specifically speaking,
Radical calculation can be performed by pressing the calculation key and the square root calculation release key twice. Furthermore, it is possible to avoid the difficulty of displaying the square root symbol after the calculation formula enclosed in brackets, and to display the calculation formula within the radical symbol.

本発明は上述した実施例に限定されるものでな
くトツプバー“-”やアンダーバー“-”等のパタ
ーン出力が必要な演算式を操作数を少なくかつ一
般に親しまれている形式での出力を可能とする。
The present invention is not limited to the embodiments described above, but can output arithmetic expressions that require pattern output such as a top bar " - " or an underbar " - " with a small number of operations and in a format familiar to the general public. do.

例えば、3√26の如く、3の次に割算キーを押
下し、次に(2)、(6)のキーを押下することにより、
その出力パターンは2、6となり、前回の割算の
出力パターン「)と結合されて、完結した演算式
パターンの印字/表示出力を得ることができる。
For example, like 3√26, by pressing the division key after 3, then pressing the (2) and (6) keys,
The output pattern becomes 2, 6, which is combined with the previous division output pattern ")" to obtain the printed/displayed output of the completed arithmetic expression pattern.

本願発明によれば記号の出力を、対応すべき文
字列に応じて、見やすく理解しやすい形態で出力
することができ、しかも、この記号を出力するた
めの指示操作は、対応すべき文字列の入力に先立
つて行われるので、通常の手書き表記における順
序と一致するものであり、かつ、この記号の最終
的な出力形態によらず同一の手段であるので、操
作が理解しやすく簡単であるという作用効果を有
する。
According to the present invention, it is possible to output a symbol in a form that is easy to see and understand according to the character string to which it corresponds, and furthermore, the instruction operation for outputting this symbol is based on the character string to which it corresponds. Since it is performed prior to input, it matches the order in normal handwritten notation, and since it is the same method regardless of the final output form of this symbol, it is easy to understand and operate. It has an effect.

【図面の簡単な説明】[Brief explanation of the drawing]

第1図は本発明のパターン出力方式の一実施例
のブロツク図、第2図は同一番地内のキヤラクタ
ジエネレータCG1とCG2のパターンを示す対応
図、第3図は本発明の一実施例に従う表示出力を
示し、かつ演算式記号とそのドツト構成を示す
図、第4図は第1図に示すブロツク図の構成から
キーを一部省略したパターン出力方式の他例を示
すブロツク図である。 ここで、K1……平方根計算キー、K2……平方
根計算解除キー、K3……演算キー群である。
FIG. 1 is a block diagram of an embodiment of the pattern output method of the present invention, FIG. 2 is a correspondence diagram showing patterns of character generators CG1 and CG2 in the same area, and FIG. 3 is an embodiment of the present invention. FIG. 4 is a block diagram showing another example of a pattern output method in which some keys are omitted from the block diagram shown in FIG. 1. . Here, K1 is a square root calculation key, K2 is a square root calculation cancellation key, and K3 is a group of calculation keys.

Claims (1)

【特許請求の範囲】 1 種々の文字数の文字列に対応可能な性質を持
つ記号を出力するパターン出力方法であつて、当
該記号の出力を指示した後に、前記記号の対応す
べき文字を順次入力するごとに、前記記号を、前
記文字の文字数に対応する形態で形成し、当該文
字と共に出力することを特徴とするパターン出力
方法。 2 可変な文字数の文字列に対応可能な性質を持
つ記号を出力するパターン出力装置であつて、当
該記号の出力を指示する指示手段と、 該指示手段により指示された前記記号に対して
対応すべき文字を入力する入力手段と、 該入力手段より前記記号の対応すべき文字を順
次入力するごとに、当該記号を、前記文字の文字
数に対応する形態で形成し、当該文字と共に出力
する出力手段とを有することを特徴とするパター
ン出力装置。
[Scope of Claims] 1. A pattern output method for outputting symbols having properties that can correspond to character strings of various numbers of characters, the method comprising: instructing the output of the symbol, and then sequentially inputting characters to which the symbol corresponds. A pattern output method characterized in that each time the symbol is displayed, the symbol is formed in a form corresponding to the number of the characters, and is output together with the character. 2. A pattern output device that outputs a symbol that can correspond to a character string with a variable number of characters, including an instruction means for instructing the output of the symbol, and a device corresponding to the symbol instructed by the instruction means. an input means for inputting a character to which the symbol should correspond; and an output means for forming the symbol in a form corresponding to the number of characters and outputting it together with the character each time a character to which the symbol should correspond is inputted from the input means. A pattern output device comprising:
JP15070781A 1981-09-25 1981-09-25 Pattern output system Granted JPS5852733A (en)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP15070781A JPS5852733A (en) 1981-09-25 1981-09-25 Pattern output system

Applications Claiming Priority (1)

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JP15070781A JPS5852733A (en) 1981-09-25 1981-09-25 Pattern output system

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Publication Number Publication Date
JPS5852733A JPS5852733A (en) 1983-03-29
JPH0444781B2 true JPH0444781B2 (en) 1992-07-22

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ID=15502649

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JP15070781A Granted JPS5852733A (en) 1981-09-25 1981-09-25 Pattern output system

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Families Citing this family (2)

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JPH0692153B2 (en) * 1984-09-07 1994-11-16 株式会社日立製作所 Method for clearing mathematical formulas in document processing system
JPH0757391B2 (en) * 1985-10-22 1995-06-21 エヌティエヌ株式会社 Constant velocity universal joint outer ring ironing method

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JPS5080038A (en) * 1973-11-12 1975-06-28
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JPS5852733A (en) 1983-03-29

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