JPH0442753U - - Google Patents
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- Publication number
- JPH0442753U JPH0442753U JP8373290U JP8373290U JPH0442753U JP H0442753 U JPH0442753 U JP H0442753U JP 8373290 U JP8373290 U JP 8373290U JP 8373290 U JP8373290 U JP 8373290U JP H0442753 U JPH0442753 U JP H0442753U
- Authority
- JP
- Japan
- Prior art keywords
- signal transmission
- transmission terminal
- lsi
- signal
- terminal
- Prior art date
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- Pending
Links
- 230000008054 signal transmission Effects 0.000 claims 3
- 238000010586 diagram Methods 0.000 description 2
- 239000012212 insulator Substances 0.000 description 1
- 238000000034 method Methods 0.000 description 1
Landscapes
- Internal Circuitry In Semiconductor Integrated Circuit Devices (AREA)
- Lead Frames For Integrated Circuits (AREA)
Description
第1図は本考案の実施例によるLSIの概略構
成図、第2図は本考案の実施例によるLSIと印
刷配線板との接続方法を示す概略図である。 主要部分の符号の説明、1……LSI、2……
接地端子、3……信号又は電源端子、4……絶縁
体。
成図、第2図は本考案の実施例によるLSIと印
刷配線板との接続方法を示す概略図である。 主要部分の符号の説明、1……LSI、2……
接地端子、3……信号又は電源端子、4……絶縁
体。
Claims (1)
- 所定信号を外部に伝達する信号伝達端子と、前
記信号伝達端子をシールドすべく該信号伝達端子
の周囲に設けられた接地端子とを含むことを特徴
とするLSI。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP8373290U JPH0442753U (ja) | 1990-08-07 | 1990-08-07 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP8373290U JPH0442753U (ja) | 1990-08-07 | 1990-08-07 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPH0442753U true JPH0442753U (ja) | 1992-04-10 |
Family
ID=31631645
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP8373290U Pending JPH0442753U (ja) | 1990-08-07 | 1990-08-07 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPH0442753U (ja) |
-
1990
- 1990-08-07 JP JP8373290U patent/JPH0442753U/ja active Pending