JPH0434704U - - Google Patents

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JPH0434704U
JPH0434704U JP7596390U JP7596390U JPH0434704U JP H0434704 U JPH0434704 U JP H0434704U JP 7596390 U JP7596390 U JP 7596390U JP 7596390 U JP7596390 U JP 7596390U JP H0434704 U JPH0434704 U JP H0434704U
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【図面の簡単な説明】
第１図は本考案の第一実施例を示す縦断面図、
第２図は同上の実施例の平断面図、第３図は本考
案の第二実施例を示す縦断面図、第４図は同上の
実施例の平断面図、第５図は本考案の第三実施例
を示す縦断面図、第６図は本考案の第四実施例を
示す縦断面図、第７図は同上の実施例の平断面図
、第８図は本考案の第五実施例を示す縦断面図、
第９図は同上の実施例の平断面図、第１０図は本
考案の第六実施例を示す縦断面図、第１１図は同
上の実施例の平断面図、第１２図は本考案の第七
実施例を示す縦断面図、第１３図は同上の実施例
の平断面図、第１４図は本考案の第八実施例を示
す縦断面図、第１５図は同上の実施例の平断面図
、第１６図は第一の従来例を示す縦断面図、第１
７図は同上の従来例の平断面図、第１８図は第二
の従来例を示す縦断面図、第１９図は同上の従来
例の平断面図である。 １ａ〜１ｂ……ケース、２ａ〜２ｅ……バネ端
子板、３ａ〜３ｅ……突起部、４……共通端子板
、５，６……正特性サーミスタ素子。

Claims (1)

  1. 【実用新案登録請求の範囲】 ケース内に２本以上の端子板を納め、各端子板
    のリード足をケース外に突出させ、隣合う端子板
    間に正特性サーミスタ素子を挟持させた正特性サ
    ーミスタ装置において、 前記ケース内壁面に向き合つている端子板とケ
    ースの当該内壁面とのうち少なくとも一方に突起
    部を設け、この突起部を介してケース内壁面と向
    き合つている端子板とケース内壁面とを接触させ
    ることにより、当該端子板とケース内壁面との間
    に空間を形成したことを特徴とする正特性サーミ
    スタ装置。
JP1990075963U 1990-07-16 1990-07-16 正特性サーミスタ装置 Expired - Lifetime JP2522900Y2 (ja)

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Citations (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS5325366A (en) * 1976-08-23 1978-03-09 Hitachi Ltd Plasma treating method and apparat us

Patent Citations (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS5325366A (en) * 1976-08-23 1978-03-09 Hitachi Ltd Plasma treating method and apparat us

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