JPH0422274B2 - - Google Patents
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- JPH0422274B2 JPH0422274B2 JP58138800A JP13880083A JPH0422274B2 JP H0422274 B2 JPH0422274 B2 JP H0422274B2 JP 58138800 A JP58138800 A JP 58138800A JP 13880083 A JP13880083 A JP 13880083A JP H0422274 B2 JPH0422274 B2 JP H0422274B2
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Description
(1) 発明の技術分野
本発明は複数の鍵より少ない同時発音可能な楽
音発生器を有し、押鍵,離鍵に応じてキースイツ
チのオン,オフ状態を検出しチヤンネルに割当て
る鍵盤回路の割当方法に関するものである。
(2) 従来技術と問題点
近年電子楽器において、鍵スイツチ処理方式の
技術発展によつて複数の鍵より少ない楽音発生器
を有し、同時発音数を制限して押鍵された押鍵情
報を楽音発生器に転送して所望の楽音を得る方式
が多用されている。
従来、これらは同時発音数以上の押鍵をした場
合、つまり割当てチヤンネル数をnとしてn鍵分
全部使用されていて新たに1鍵が押された場合、
新たな押鍵は、以前押したn鍵の少なくとも
1鍵が離されない限り新たな割当てをしない。
新たな押鍵が、以前押したn鍵の最低音ある
いは最高音から数えてn鍵の中にあつたなら割
当てる。
新たな押鍵は、以前押したn鍵中の中間音を
消し割当てられる。
等の方式がとられている。
これらの一般形のエンベロープ波形に対する方
式に対し、パーカツシヨンタイプのエンベロープ
をもつ電子楽器に対しては、上記の方式を単純に
適用したのでは自然なパーカツシヨンタイプの楽
音が得られないという問題点がある。
つまり、パーカツシヨンタイプの楽音は押鍵か
ら振巾が経時的に減衰していくというところに特
徴があり、先に押された鍵は鍵が押されているに
もかかわらず、振巾が減衰状態に入つているか振
巾が“0”となつてすでは発音が終了している。
もし発音を終了していれば、発音していないにも
拘らずその楽音発生器を占有しているのは非常に
無駄なことである。そしてまた、先に離鍵された
ものが楽音の出力振巾が最も減衰しているので新
しい押鍵の方が重要度がある。しかしながらの
方式では最大発音数に制限が感じられるし、の
方式では所望した新たな押鍵がn鍵の中に入つて
いないと割当てられないし、の方式では所望し
た新たな押鍵がn鍵外の中間音だと割当てられな
い、という現象が起る。しかも、これらの場合奏
者が所望して実際に押している鍵と発音されてい
る楽音との間に違和感が起る。
これはどんな波形のエンベロープでも起るが、
とくにパーカツシヨンタイプの楽音ではこれが目
立つことになる。
(3) 発明の目的
本発明の目的は、複数の鍵より少ない同時発音
可能な楽音発生器を有し、押鍵,離鍵に応じてキ
ースイツチのオン,オフ状態を検出しチヤンネル
に割当てる鍵盤回路において、実際に押されてい
る鍵と発音されている楽音との間の違和感をでき
るだけ少なくした鍵盤回路の割当方法を提供する
ことである。
(4) 発明の構成
前記目的を達成するため、本発明の鍵盤回路の
割当方法は複数の鍵より少ない同時発音可能な楽
音発生器を有し、押鍵,離鍵に応じてキースイツ
チのオンオフ状態を検出しチヤンネルに割当てる
鍵盤回路の割当方法において、同時発音数以上の
新たな押鍵に対し、発音されている同時発音数の
鍵の中で最も先に離された鍵のチヤンネルに前記
新たな押鍵の鍵情報を新たに割当てる手段を有す
るとともに、押鍵されている同時発音数の鍵の中
で最も先に押された鍵のチヤンネルの鍵情報を別
に設けた待避メモリに待避しておき、該空チヤン
ネルに前記新たな押鍵の鍵情報を新たに割当て、
押鍵が同時発音数以下になつたとき前記待避メモ
リより前記待避された鍵情報を新たに割当てるよ
うにする手段を具えたことを特徴とするものであ
る。
(5) 発明の実施例
第1図は本発明を適用する電子楽器のシステム
ブロツク図である。
システム100は鍵盤回路14と鍵状態変化検出
割当装置10(以下アサイナという)と楽音発生
をつかさどる楽音周波数発生器31、楽音エンベ
ロープ発生器33−1,33−2,楽音波形発生
器35、アサイナと各種装置とのインターフエイ
スを行なう各種ポート30,32−1,32−
2,34よりなる。
アサイナ10は本発明においては中央演算装置
(以下CPUという)を使用した方式で述べている
が本発明を限定するものではない。アサイナ10
はCPU12とこれを駆動する主クロツク11と
プログラムメモリ16、イベントメモリ17、ア
サインメントメモリ18、カウントメモリ19、
待避メモリ20と出力ポート(1)13、入力ポート
(1)15より成る。
主クロツク11からの駆動クロツクを受けて
CPU12はプログラムメモリ16に格納されて
いるプログラムに従つて、内部レジスタ(以下
ODレジスタという)に鍵盤回路14を走査する
ための走査コードを作成し、そしてバス101上
を通して出力ポート(1)13に作成された走査コー
ドを送出し、出力ポート(1)13からの走査コード
に対応している鍵盤回路14のグループ中の鍵ス
イツチの開閉状態を入力ポート(1)15で受けて、
入力ポート(1)15の出力データ(鍵の開閉状態)
をバス101上に乗せる。CPU12はバス10
1上に乗せられたデータと、各鍵に対応した前回
の走査時の鍵情報を記憶したイベントメモリ17
内の走査コードに対応している場所(エリア)の
データと比較して変化(以下イベントという)の
有無を調べる。もしイベントが無ければ、CPU
12はODレジスタの内容をインクリメントして
走査コードを順次鍵盤回路14に送り、イベント
があるまで繰返し走査する。そしてイベントがあ
れば、その時点よりイベントがあつた鍵に対して
同時発音数だけ設けたチヤンネル数を有するアサ
インメントメモリ18への割当てあるいはアサイ
ンメントメモリ18からの解除等の動作(イベン
ト処理)を行なうプログラムへ入る。
イベントが発生すると、(a)その鍵がOFF(オ
フ)からON(オン)のイベントなのか、(b)ONか
らOFFのイベントなのか、さらに、(c)その鍵の
キー情報が既にアサインメントメモリ18か、あ
るいは同時発音数以上に押された場合に押鍵の新
旧を値(以下カウント値という)として格納して
いるカウントメモリ19のカウンタ値から新旧を
判断して、もつとも古いチヤンネルに対応するア
サインメントメモリ18のチヤンネルに強制的に
割当て、そこに以前入つていたキー情報を待避さ
せておく待避メモリ20の内容を調べてみること
により、アサインメントメモリ18への割当てあ
るいはアサインメントメモリ18からの解除を行
なう。
そしてアサインメントメモリ18の内容が変化
したなら、バス101を経由してアサインメント
メモリ18の内容のうち必要とされる情報を他の
ブロツクたとえば出力ポート(2)30を通して楽音
周波数発生器31、入出力ポート(1)32−1や入
出力ポート(2)32−2を通して楽音エンベロープ
発生器33−1,33−2,出力ポート(3)34を
通して楽音発生器35等に転送する。さらに詳細
な説明は第3図,第4図,第5図のフローチヤー
トを使用して後述する。
第2図は本発明の実施例の構成説明図であり、
第1図の鍵盤回路14の具体回路例を示す。
ブロツクに付された数字が第1図と同じである
出力ポート(1)13,入力ポート(1)15は第1図の
ものと同等である。CPU12のODレジスタから
送られる走査コードは出力ポート(1)13でラツチ
される。そして本図では走査コード6ビツトが入
つてきたとき、3−8デコーダ40−1〜40−
9を使用して、6−64デコーダを構成してU1
〜U10,L1〜L10,P1〜P4,T1〜
Tn(これに関してはタブレツトスイツチの走査も
同じバス上に乗せてもいいことを意味して付録的
に図示している)の複数のグループの一つに走査
パルス(本図では負論理パルス)を走査ライン上
に送出する。また、デコーダ40−2〜40−9
の各出力と入力ポート(1)15に連結されている8
本のバス(0〜7)の交点が丸111内に描かれ
ているように、スイツチとダイオードで構成され
ており、スイツチが開かれていると走査パルスが
きていても(“L”となる)接続されないので、
8本のバスはプルアツプ抵抗(R0〜R7)で引き
上げられ、入力ポート(1)15に“H”を入力しス
イツチが閉じていると、バス(0〜7)のスイツ
チ閉鎖のバスはダイオードとスイツチによつて走
査ラインに結合され、スイツチの閉鎖のバスは
“L”となる。そして、スイツチの開放→“H”、
スイツチの閉鎖→“L”の信号が入力ポート(1)1
5を通してCPU12内に読込まれ、スイツチの
開閉変化つまりイベントを判断する。
次に本発明で使用されているイベントメモリ1
7、アサインメントメモリ18、カウントメモリ
19、待避メモリ20の構成について述べる。そ
の前に本発明のシステムは実施例として上鍵盤61
鍵、下鍵盤61鍵、足鍵盤25鍵の3つの鍵盤を有し
ているとする。またCPU12としてもつともポ
ピユラーである8ビツトCPUの使用でもつてメ
モリが構成されているが、ここれは本発明を限定
するものではない。
第1表はイベントメモリ17の内容を示したも
のであり上,下,足鍵盤それぞれ6〜7鍵毎にグ
ループ化されており、上鍵盤はU1〜U10の10
グループ、下鍵盤はL1〜L10の10グループ、
足鍵盤はP1〜P4の4グループとなつている。
そして、表の左端にかかれている文字は、イベン
トメモリアドレス(以下EMAとも略す)を16進
表示したものであり、本発明では第2図よりわか
るように走査コードと同じものとしている。表の
中に示されているC2……C7が鍵と対応し、斜線
(/)の部分は未使用である。
第2表は上,下,足鍵盤の同時発音数を7,
7,2チヤンネルとした時のアサインメントメモ
リ18の構成を示している。そして各チヤンネル
は、鍵のONと同時にONになり、鍵のOFF後か
ら楽音発生終了時でOFFとなるUSE ON/OFF
ビツト、鍵のON/OFFに対応しているKEY
ON/OFFビツト、キー情報(音階)を表現する
ために鍵C2,C2#
……B6,C7に0〜60と番号を
付けたキーナンバを表現する6ビツトの計8ビツ
トで構成されるとする。表の左端のA0〜A15はア
サインメントメモリ18のアドレス(以下AMA
とも略す)を示す。そしてこの表では内容は初期
化された時のものを示している。
第3表はカウントメモリ19の構成を示したも
のであり、楽音発生器がすべて使用されていてか
つ押鍵があつた場合に、アサインメントメモリ1
8のどのチヤンネルに強制的に割当てたらいいか
を判断するカウンタ値を示し、アサインメントメ
モリ18のチヤンネルに対応した数のチヤンネル
数を有するものである。カウンタ値の初期値が
“0=OOH(16進)”にされるか、“255=FFH(16
進)にされるかは問題ではない。前者ならば加算
を行なつて最大値を見つけるようにするし、後者
ならば減算を行なつて最小値を見つけるようにす
る。そして加算あるいは減算していつてキヤリあ
るいはボローが出た場合は、本発明では“FFH”
以上あるいは“OOH”以下にならないようにす
るが、これは8ビツトで表わしているからであつ
て本発明を限定するものではない。
第4表は待避メモ20の構成を示したものであ
り、鍵が押されているにもかかわらず、同時発音
数以上の押鍵によつてその押鍵を割当てるため
に、強制的に除去されたキー情報を押鍵数が同時
発音数以下になつたときに復帰できるように貯わ
えておくものである。
待避メモリへの書込み(待避)、待避メモリか
らの読出し(復帰)はlast in−first out(最後に
入力したキー情報を最初に読み出す)の方式を実
行するとよい。そして待避メモリ20は押鍵より
同時発音数を引いた数を最大とした領域を確保す
る必要があろう。つまり上,下,足鍵盤について
各々
(1) Technical Field of the Invention The present invention has a musical tone generator capable of simultaneously producing fewer keys than a plurality of keys, and has a keyboard circuit that detects the on/off state of a key switch in response to key presses and key releases and assigns the keys to channels. It is about the method. (2) Prior art and problems In recent years, electronic musical instruments have had fewer musical tone generators than multiple keys due to the technological development of key switch processing methods, and it is now possible to limit the number of simultaneous polyphonic sounds and collect key press information. A method of obtaining a desired musical tone by transmitting it to a musical tone generator is often used. Conventionally, when these keys were pressed more than the number of simultaneous polyphony, that is, when the number of assigned channels was n, all n keys were used and a new key was pressed, the new key pressed was the same as the previously pressed n keys. No new assignments will be made unless at least one of the keys is released. If the new pressed key is among the n keys counted from the lowest or highest note of the previously pressed n keys, it is assigned. A new key is assigned by erasing the intermediate tones of the previously pressed n keys. The following methods are used. In contrast to these methods for general envelope waveforms, it is difficult to obtain natural percussion-type musical tones by simply applying the above methods to electronic instruments with percussion-type envelopes. There is a problem. In other words, the characteristic of percussion-type musical sounds is that the amplitude attenuates over time from the key pressed, and the amplitude of the first key pressed decreases even though the key is pressed. When the attenuation state is entered or the amplitude reaches "0", the sound generation ends.
If the musical tone generator has already finished generating sound, it would be extremely wasteful to occupy that musical tone generator even though it is not generating sound. Furthermore, since the output amplitude of the musical tone is attenuated the most for the key that was released first, the newly pressed key is more important. However, in the above method, there seems to be a limit to the maximum number of notes that can be produced, in the above method, the desired new key to be pressed cannot be assigned unless it is among the n keys; A phenomenon occurs in which external intermediate tones cannot be assigned. Furthermore, in these cases, a sense of incongruity occurs between the keys that the player desires and actually presses and the musical tones that are being produced. This happens with any waveform envelope, but
This is especially noticeable with percussion type musical tones. (3) Purpose of the Invention The purpose of the present invention is to provide a keyboard circuit which has a musical tone generator capable of simultaneously producing fewer keys than a plurality of keys, detects the on/off state of a key switch in response to a key press or release, and assigns it to a channel. To provide a keyboard circuit assignment method that minimizes the sense of incongruity between keys that are actually pressed and musical tones that are being sounded. (4) Structure of the Invention In order to achieve the above-mentioned object, the keyboard circuit assignment method of the present invention has a musical tone generator capable of simultaneously producing fewer keys than a plurality of keys, and changes the on/off state of a key switch according to key depression and key release. In the keyboard circuit assignment method that detects and assigns to channels, when a new key is pressed more than the number of simultaneous polyphony, the new key is assigned to the channel of the first key released among the keys that are being sounded simultaneously. It has a means for newly allocating key information for a pressed key, and also saves key information of the channel of the key pressed first among the keys of the simultaneous polyphony being pressed in a separately provided save memory. , newly assigning the key information of the new key press to the empty channel,
The present invention is characterized by comprising means for newly allocating the saved key information from the save memory when the number of pressed keys becomes equal to or less than the number of simultaneous pronunciations. (5) Embodiments of the Invention FIG. 1 is a system block diagram of an electronic musical instrument to which the present invention is applied. The system 100 includes a keyboard circuit 14, a key state change detection and assignment device 10 (hereinafter referred to as an assigner), a musical tone frequency generator 31 in charge of musical tone generation, musical tone envelope generators 33-1 and 33-2, a musical waveform generator 35, and an assigner. Various ports 30, 32-1, 32- for interfacing with various devices
Consists of 2,34. In the present invention, the assigner 10 is described as using a central processing unit (hereinafter referred to as CPU), but this does not limit the present invention. Assigner 10
includes a CPU 12, a main clock 11 that drives it, a program memory 16, an event memory 17, an assignment memory 18, a count memory 19,
Backup memory 20, output port (1) 13, input port
(1) Consists of 15 parts. Receiving the driving clock from the main clock 11
The CPU 12 operates according to the program stored in the program memory 16 in internal registers (hereinafter referred to as
A scan code for scanning the keyboard circuit 14 is created in the OD register), and the created scan code is sent to the output port (1) 13 through the bus 101, and the scan code from the output port (1) 13 is transmitted to the output port (1) 13. The input port (1) 15 receives the open/closed state of the key switch in the group of the keyboard circuit 14 corresponding to the
Output data of input port (1) 15 (key open/closed state)
on bus 101. CPU12 is bus 10
an event memory 17 that stores the data placed on 1 and the key information from the previous scan corresponding to each key;
The presence or absence of a change (hereinafter referred to as an event) is checked by comparing the data of the location (area) corresponding to the scan code within. If there is no event, the CPU
12 increments the contents of the OD register and sequentially sends the scanning code to the keyboard circuit 14, which repeatedly scans until an event occurs. If an event occurs, from that point on, operations such as allocation to or release from the assignment memory 18 having the same number of channels as the number of simultaneous polyphony for the key where the event occurred (event processing) are performed. Enter the program to be performed. When an event occurs, it determines (a) whether the key is an OFF-to-ON event, (b) an ON-to-OFF event, and (c) whether the key information for the key is already assigned. The newer and older channels are determined from the counter value of the memory 18, or the counter value of the count memory 19, which stores the newer and older keys as values (hereinafter referred to as count values) when keys are pressed more than the number of simultaneous polyphony, and corresponds to the oldest channel. By forcibly allocating the key information to the channel of the assignment memory 18 to be assigned and checking the contents of the save memory 20 in which the key information previously stored there is saved, the assignment to the assignment memory 18 or the assignment memory can be made. 18. If the contents of the assignment memory 18 change, the necessary information from the contents of the assignment memory 18 is transferred to another block, for example, the output port (2) 30, to the musical tone frequency generator 31 and input via the bus 101. It is transferred to musical tone envelope generators 33-1, 33-2 through output port (1) 32-1 and input/output port (2) 32-2, and to musical tone generator 35 etc. through output port (3) 34. A more detailed explanation will be given later using flowcharts shown in FIGS. 3, 4, and 5. FIG. 2 is a configuration explanatory diagram of an embodiment of the present invention,
A specific circuit example of the keyboard circuit 14 in FIG. 1 is shown. Output port (1) 13 and input port (1) 15 whose blocks have the same numbers as in FIG. 1 are the same as those in FIG. The scan code sent from the OD register of the CPU 12 is latched at the output port (1) 13. In this figure, when a 6-bit scanning code is input, 3-8 decoders 40-1 to 40-
9 to configure a 6-64 decoder to U1
~U10, L1~L10, P1~P4, T1~
A scan pulse (in this figure, a negative logic pulse) is applied to one of several groups of Tn (this is illustrated in the appendix, meaning that the tablet switch scan can also be placed on the same bus). is sent onto the scan line. In addition, decoders 40-2 to 40-9
8 connected to each output and input port (1) 15
As the intersection of the buses (0 to 7) in the book is drawn in the circle 111, it is composed of a switch and a diode, and if the switch is open, even if the scanning pulse is coming (it will go "L"). ) is not connected, so
The eight buses are pulled up by pull-up resistors (R 0 to R 7 ), and when "H" is input to the input port (1) 15 and the switch is closed, the buses (0 to 7) whose switches are closed are It is coupled to the scan line by a diode and a switch, and the bus on switch closure is "L". Then, open the switch → “H”,
Switch closed → “L” signal is input port (1) 1
5 and is read into the CPU 12 to determine whether the switch is open or closed, that is, an event. Next, event memory 1 used in the present invention
7. The configurations of the assignment memory 18, count memory 19, and save memory 20 will be described. Before that, the system of the present invention has an upper keyboard 61 as an embodiment.
Assume that the keyboard has three keys: a key, a lower keyboard with 61 keys, and a foot keyboard with 25 keys. Furthermore, although the memory is configured by using an 8-bit CPU, which is popular as the CPU 12, this does not limit the present invention. Table 1 shows the contents of the event memory 17. The upper, lower, and foot keyboards are grouped into groups of 6 to 7 keys each, and the upper keyboard has 10 keys, U1 to U10.
groups, the lower keyboard has 10 groups from L1 to L10,
The foot keyboard has four groups, P1 to P4.
The characters written at the left end of the table are hexadecimal representations of event memory addresses (hereinafter also abbreviated as EMA), which in the present invention are the same as scan codes, as can be seen from FIG. C 2 ... C 7 shown in the table correspond to the keys, and the diagonally shaded (/) parts are unused. Table 2 shows the number of simultaneous pronunciations for the upper, lower, and foot keyboards, 7,
7 shows the configuration of the assignment memory 18 when the channel is set to 7.2. Each channel is USE ON/OFF, which turns ON when the key is turned ON, and turns OFF after the key turns OFF and when musical tone generation ends.
KEY that supports ON/OFF of bits and keys
Consists of a total of 8 bits: ON/OFF bit, keys C 2 , C 2 # ...B 6 , C 7 to express key numbers numbered 0 to 60 to express key information (scale), and 6 bits to express key numbers. Suppose that it is done. A 0 to A 15 at the left end of the table are addresses of the assignment memory 18 (hereinafter AMA
(also abbreviated). This table shows the contents at the time of initialization. Table 3 shows the configuration of the count memory 19. When all tone generators are used and a key is pressed, the assignment memory 1
The number of channels corresponds to the number of channels in the assignment memory 18. The initial value of the counter value is set to “0=OOH (hexadecimal)” or “255=FFH (16
It doesn't matter whether it is done (in progress) or not. If the former, perform addition to find the maximum value, and if the latter, perform subtraction to find the minimum value. When adding or subtracting and there is a gain or borrow, in this invention, it is called “FFH”.
However, this is because it is expressed in 8 bits and does not limit the present invention. Table 4 shows the configuration of the evacuation memo 20, in which even though a key is pressed, it is forcibly removed because the pressed key is assigned to a key pressed more than the number of simultaneous polyphony. The key information is stored so that it can be restored when the number of pressed keys falls below the number of simultaneous polyphony. For writing (saving) to the save memory and reading (returning) from the save memory, it is preferable to execute the last in-first out method (the key information input last is read first). It is necessary to secure an area in the save memory 20 that is equal to the maximum number of keys pressed minus the number of simultaneous sounds. In other words, each of the upper, lower, and foot keyboards
【表】【table】
【表】 USE KEY 〓【table】 USE KEY 〓
Claims (1)
器を有し、押鍵,離鍵に応じてキースイツチのオ
ンオフ状態を検出しチヤンネルに割当てる鍵盤回
路の割当方法において、同時発音数以上の新たな
押鍵に対し、発音されている同時発音数の鍵の中
で最も先に離された鍵のチヤンネルに前記新たな
押鍵の鍵情報を新たに割当てる手段を有するとと
もに、押鍵されている同時発音数の鍵の中で最も
先に押された鍵のチヤンネルの鍵情報を別に設け
た待避メモリに待避しておき、該空チヤンネルに
前記新たな押鍵の鍵情報を新たに割当て、押鍵が
同時発音数以下になつたとき前記待避メモリより
前記待避された鍵情報を新たに割当るようにする
手段を具えたことを特徴とする鍵盤回路の割当方
法。1. In the keyboard circuit assignment method, which has a musical tone generator that can produce fewer simultaneous sounds than multiple keys, and which detects the on/off state of a key switch in response to key presses and key releases and assigns it to channels, The key includes means for newly assigning the key information of the newly pressed key to the channel of the key that is released first among the keys that are being sounded at the same time. The key information of the channel of the key pressed first among the keys is saved in a separately provided save memory, and the key information of the newly pressed key is newly assigned to the empty channel. 1. A method for allocating a keyboard circuit, comprising means for newly allocating the saved key information from the save memory when the number of simultaneous pronunciations falls below.
Priority Applications (1)
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JP58138800A JPS6029792A (en) | 1983-07-28 | 1983-07-28 | Allotment of keyboard circuit |
Applications Claiming Priority (1)
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JP58138800A JPS6029792A (en) | 1983-07-28 | 1983-07-28 | Allotment of keyboard circuit |
Publications (2)
Publication Number | Publication Date |
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JPS6029792A JPS6029792A (en) | 1985-02-15 |
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Family Applications (1)
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JP58138800A Granted JPS6029792A (en) | 1983-07-28 | 1983-07-28 | Allotment of keyboard circuit |
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Families Citing this family (1)
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JP2643405B2 (en) * | 1989-01-18 | 1997-08-20 | カシオ計算機株式会社 | Electronic musical instrument |
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1983
- 1983-07-28 JP JP58138800A patent/JPS6029792A/en active Granted
Also Published As
Publication number | Publication date |
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