JPH0397313A - Chip type piezoelectric filter - Google Patents

Chip type piezoelectric filter

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Publication number
JPH0397313A
JPH0397313A JP23404489A JP23404489A JPH0397313A JP H0397313 A JPH0397313 A JP H0397313A JP 23404489 A JP23404489 A JP 23404489A JP 23404489 A JP23404489 A JP 23404489A JP H0397313 A JPH0397313 A JP H0397313A
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JP
Japan
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filter
electrode
substrate
electrodes
capacitance
Prior art date
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Application number
JP23404489A
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Japanese (ja)
Inventor
Yasuhiro Tanaka
田中 康廣
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Murata Manufacturing Co Ltd
Original Assignee
Murata Manufacturing Co Ltd
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Filing date
Publication date
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Publication of JPH0397313A publication Critical patent/JPH0397313A/en
Pending legal-status Critical Current

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Abstract

PURPOSE:To save work and to miniaturize the component by forming at least one of capacitance electrodes of a coupling capacitor part to the surface of a sealing base toward an external side and connecting a vibration electrode of a vibration part and a capacitance electrode of the coupling capacitor part with an electric connection means. CONSTITUTION:A filter part F1 is formed with two input output vibration electrodes 4a, 4b formed to an upper face of the left side of a base 2 and with one common vibration electrode 5 formed to the lower side of the base 2 opposite to them. Similarly, a filter part F2 is formed with two input output vibration electrodes 6a, 6b formed to an upper face of the right side of the base 2 and with one common vibration electrode 7 formed to the lower side of the base 2 opposite to them. The vibration electrodes 4b, 6a of the filters F1, F2 are connected via a relay leadout electrode 8 and the vibration electrodes 5, 7 of the filters F1, F2 are connected via a relay leadout electrode 9. The coupling capacitor part C1 consists of capacitor electrodes 12a, 12b formed to lower and upper faces of the sealing base 11 and the required capacitance is obtained from a part where the electrodes 12a and 12b are opposite to each other. A dielectric material is used for the sealing bases 10, 11.

Description

【発明の詳細な説明】 産業上の利用分野 本発明は、静電容量が内蔵された圧電フィルタに関する
DETAILED DESCRIPTION OF THE INVENTION Field of the Invention The present invention relates to a piezoelectric filter with built-in capacitance.

虻象曵挟班支塁E この種のチップ型圧電フィルタとしては、例えば、第1
3図に示すエネルギー閉じ込め形の二段結合フィルタ7
0が知られている。圧電体基板71は2個の多重モード
◆・フィルタ部F11.F12と1個の結合容量部CI
Oを備えている。この基板71は圧電セラミックス基板
等が使用される。入出力引出し電極72. 73が基板
7l上面の左右端に形成され、共通引出し電極74が基
板71下面の下辺中央部に形成されている。
As this type of chip-type piezoelectric filter, for example,
Energy trapping type two-stage coupling filter 7 shown in Fig. 3
0 is known. The piezoelectric substrate 71 has two multimode ◆ filter sections F11. F12 and one coupling capacitor CI
It is equipped with O. As this substrate 71, a piezoelectric ceramic substrate or the like is used. Input/output extraction electrode 72. 73 are formed at the left and right ends of the upper surface of the substrate 7l, and a common extraction electrode 74 is formed at the center of the lower side of the lower surface of the substrate 71.

フィルタ部Filは基板71の左側上面に形成されてい
る二つの入出力振動電極75a. 75bとこれらに対
置して基板71の下面に形成されている一つの共通振動
電極76から構成されている。同様に、フィルタ部F1
2は基板71の右側上面の二つの入出力振動電極78a
. 78bとこれらに対置する一つの共通振動電極79
から構成されている。
The filter section Fil includes two input/output vibrating electrodes 75a. 75b and one common vibration electrode 76 formed on the lower surface of the substrate 71 opposite to these. Similarly, filter section F1
2 are two input/output vibration electrodes 78a on the upper right side of the substrate 71.
.. 78b and one common vibrating electrode 79 opposite to these
It consists of

結合容量部CIOは、フィルタ部FilとF12を結合
させるためのもので、フィルタ部FilとFIZの間に
位置し、基板71の上下面に対向して形成されている容
量電極77a. 77bから構成されている。これらフ
ィルタ部Fil,F12及び結合容量部CIOは、導体
線路によって電気的に接続されている。この基板71と
板厚方向に重ねられた封止基板とが接着剤によって固着
され、密閉された振動空間を形成している。封止基板に
は絶縁体材料が使用されている。
The coupling capacitance section CIO is for coupling the filter sections Fil and F12, and is located between the filter sections Fil and FIZ, and includes capacitance electrodes 77a. 77b. These filter sections Fil, F12 and coupling capacitance section CIO are electrically connected by a conductor line. This substrate 71 and a sealing substrate stacked in the thickness direction are fixed with an adhesive to form a sealed vibration space. An insulating material is used for the sealing substrate.

以上の構成からなるフィルタ70の等価電気回路を第1
415!0に示す。フィルタ部FilとF12が結合容
量部C10を間に置いて入出力信号線路と共通信号線路
との間に並列に挿入されている。
The first equivalent electric circuit of the filter 70 having the above configuration is
415!0. Filter sections Fil and F12 are inserted in parallel between the input/output signal line and the common signal line with the coupling capacitance section C10 interposed therebetween.

ところで、結合容量部CIOに要求される容量を確保す
るためには容量電極77a. 77bの形状をある程度
大きなものにする必要がある。そのため、圧電体基板7
1のサイズが大きくなり部品を小型化する上での障害に
なっている. また、基板71において、結合容量部CIOが形成され
ている領域が分極されていると、容量電極77a. 7
7bに信号電圧が印加された場合、電極77a一77b
間に挾まれた基板71部分が電歪によって機械的に励振
する。このため、結合容量部CIOが振動子として働い
てしまい、フィルタ70の電気特性を劣化させる。そこ
でこの対策として、■基板71において結合容量部CI
Oが形或される領域だけ分極処理を施さない方法 ■結合容量部CIOの容量電極77a. 77bの表面
上に半田を盛り上げたり、樹脂材を塗布したりしてダン
ピング処理を施す方法 等を採用している. しかし、これらの方法は、煩雑な作業を必要とするため
に生産性が悪化すると共にそれによる歩留の悪化が問題
となる。
By the way, in order to ensure the capacitance required for the coupling capacitance section CIO, the capacitance electrodes 77a. It is necessary to make the shape of 77b somewhat large. Therefore, the piezoelectric substrate 7
The size of 1 has become large, which has become an obstacle to miniaturizing parts. Further, if the region of the substrate 71 where the coupling capacitance portion CIO is formed is polarized, the capacitance electrode 77a. 7
When a signal voltage is applied to electrode 7b, electrodes 77a-77b
The portion of the substrate 71 sandwiched therebetween is mechanically excited by electrostriction. Therefore, the coupling capacitance section CIO acts as a vibrator, deteriorating the electrical characteristics of the filter 70. Therefore, as a countermeasure to this problem,
A method in which polarization is not applied only to the region where O is formed. ■ Capacitor electrode 77a of coupling capacitor section CIO. Methods such as applying damping treatment by mounding up solder or coating resin material on the surface of 77b are adopted. However, these methods require complicated operations, resulting in poor productivity and a resulting deterioration in yield.

そこで、本発明の課題は、分極処理やダンピング処理等
の煩雑な製造工程を必要とすることなく、しかも小型化
に対応できる静電容量内蔵形のチップ型圧電フィルタを
提供することにある.を 決するための手段 以上の課題を解決するために、本発明に係るチップ型圧
電フィルタは、複数個の振動部を設けた圧電体基板と、
該圧電体基板の板厚方向に重ねられた封止基板とが、密
閉された振動空間を形成していて、前記振動部間を結合
するための結合容量部が誘電体材料から成る前記封止基
板に設けられ、前記結合容量部の容量電極の少なくとも
一方が前記封止基板の外界側表面に形成され、前記振動
部の振動電極と前記結合容量部の容量電極とが電気的接
続手段で接続されていることを特徴とする.生一浬 以上の構成において、結合容量部の形成位置を圧電体基
板から封止基板に替えることによって、従来行なわれて
いた圧電体基板の分極処理やダンピング処理等の煩雑な
作業が不要となる.また、容量電極が形成されていた領
域を省くことができ、圧電体基板のサイズが小さくなり
、その結果、圧電フィルタのサイズも小さくなる.衷星
想 以下、本発明に係るチップ型圧電フィルタの実施例をそ
の製造方法と共に説明する。
Therefore, an object of the present invention is to provide a chip-type piezoelectric filter with built-in capacitance that does not require complicated manufacturing processes such as polarization processing and damping processing, and can be made smaller. In order to solve the problem that is more than a means for determining, the chip-type piezoelectric filter according to the present invention includes a piezoelectric substrate provided with a plurality of vibrating parts,
The sealing substrate stacked in the thickness direction of the piezoelectric substrate forms a sealed vibration space, and the coupling capacitor for coupling between the vibrating parts is made of a dielectric material. provided on a substrate, at least one of the capacitance electrodes of the coupling capacitance section is formed on the outer surface of the sealing substrate, and the vibrating electrode of the vibrating section and the capacitance electrode of the coupling capacitance section are connected by an electrical connection means. It is characterized by being In the above configuration, by changing the formation position of the coupling capacitance from the piezoelectric substrate to the sealing substrate, complicated operations such as polarization processing and damping processing of the piezoelectric substrate, which were conventionally performed, are no longer necessary. .. Furthermore, the area where the capacitive electrode was formed can be omitted, the size of the piezoelectric substrate is reduced, and as a result, the size of the piezoelectric filter is also reduced. Below, embodiments of the chip-type piezoelectric filter according to the present invention will be described along with a method for manufacturing the same.

[第1実施例] 第1図にエネルギー閉じ込め形の二段結合フィルタ1の
分解斜視図を示す.このフィルタ1は2個のフィルタ部
と1個の結合容量部を備えているチップ型フィルタであ
る.圧電体基板2は2個の多重モード・フィルタ部Fl
,F2を備えている.基板2は、Pb(ZrI’i)O
s , BaIiOsの圧電セラミックス基板等が使用
される。入出力引出し電極3a. 3bが基板2上面の
左右端に形成され、共通引出し電極9が基板2下面の下
辺中央部に形成されている。
[First Embodiment] Fig. 1 shows an exploded perspective view of an energy trapping type two-stage coupling filter 1. This filter 1 is a chip-type filter that includes two filter sections and one coupling capacitance section. The piezoelectric substrate 2 has two multimode filter sections Fl.
, F2. Substrate 2 is Pb(ZrI'i)O
A piezoelectric ceramic substrate such as BaIiOs or BaIiOs is used. Input/output extraction electrode 3a. 3b are formed at the left and right ends of the upper surface of the substrate 2, and a common extraction electrode 9 is formed at the center of the lower side of the lower surface of the substrate 2.

フィルタ部F1は基板2の左側上面に形成されている二
つの入出力振動電極4a, 4bとこれらに対置して基
板2の下面に形成されている一つの共通振動電極5から
構成されている。同様に、フィルタ部F2は基板2の右
側上面の二つの入出力振動電極6a * 6bとこれら
に対置する一つの共通振動電極7から構成されている。
The filter section F1 is composed of two input/output vibrating electrodes 4a and 4b formed on the upper left surface of the substrate 2, and one common vibrating electrode 5 formed on the lower surface of the substrate 2 in opposition to these electrodes. Similarly, the filter section F2 is composed of two input/output vibrating electrodes 6a*6b on the upper right side of the substrate 2 and one common vibrating electrode 7 opposed to these.

フィルタ部F1とF2は、振動電極4bと68が中継引
出し電極8を介して接続され、かつ振動電極5と7が共
通引出し電極9を介して接続されている. 結合容量部C1は、封止基板11の上下面に形成されて
いる容量電極12a.12bから構成され、必要とする
容量は電極12aと12bが対向している部分で得られ
る。封止基板10.11には誘電体材料が使用される.
但し、封止基板10は誘電体材料に限定されず、絶縁性
の材料であればよい。
In the filter parts F1 and F2, the vibrating electrodes 4b and 68 are connected via a relay lead-out electrode 8, and the vibrating electrodes 5 and 7 are connected via a common lead-out electrode 9. The coupling capacitance portion C1 includes capacitance electrodes 12a. 12b, and the required capacitance is obtained at the portion where electrodes 12a and 12b face each other. A dielectric material is used for the sealing substrate 10.11.
However, the sealing substrate 10 is not limited to a dielectric material, and may be any insulating material.

なお、これら基板2.10.11は、実際の量産工程で
は広面積のものを用い、接着後に所定寸法にカットする
In the actual mass production process, these substrates 2, 10, and 11 have a wide area, and are cut into predetermined dimensions after bonding.

こうして準備された基板2.10.11は接着剤によっ
て互いに直接接触しないように距離を保って固着され、
密閉された振動空間を形成する。
The thus prepared substrates 2.10.11 are fixed with adhesive at a distance so as not to come into direct contact with each other,
Forms a sealed vibration space.

第2図にフィルタ1の外観を示す。フィルタ1の手前側
の左右の端部及び中央部にそれぞれ外部入出力端子(A
).(B)並びに外部共通端子(C)が形成されている
。入出力端子(A)には入出力引出し電極3aが接続さ
れ、他方の入出力端子(B)には入出力引出し電極3b
が接続されている.共通端子(C)には共通引出し電極
9と容量電極12bが接続されている。さらに、フィル
タ1の奥側の端面に形成された外部中継端子(D)には
、中継引出し電極8と容量電極12aが接続されている
FIG. 2 shows the appearance of the filter 1. External input/output terminals (A
). (B) and an external common terminal (C) are formed. An input/output lead electrode 3a is connected to the input/output terminal (A), and an input/output lead electrode 3b is connected to the other input/output terminal (B).
is connected. A common lead electrode 9 and a capacitor electrode 12b are connected to the common terminal (C). Further, an external relay terminal (D) formed on the rear end face of the filter 1 is connected to a relay lead-out electrode 8 and a capacitor electrode 12a.

以上の構成をしたフィルタ1は第14図で示した電気等
価回路と同じ回路を有する.フィルタ部F1とF2が結
合容量部C1を間に置いて入出力信号線路と共通信号線
路との間に並列に挿入されている。
Filter 1 with the above configuration has the same electrical equivalent circuit as shown in FIG. Filter sections F1 and F2 are inserted in parallel between the input/output signal line and the common signal line with a coupling capacitance section C1 therebetween.

こうして得られたフィルタ1は、圧電体基板2に結合容
量部C1を設けなくてもよいので、分極処理やダンピン
グ舛理等の煩雑な作業が不要となり、生産性が向上する
と共に歩留も改善される。また、容量電極が形成されて
いた領域を省くことができ、圧電体基板2のサイズを小
さくすることができ、その結果、フィルタ1のサイズも
小さくなる。
The filter 1 obtained in this way does not require the coupling capacitance section C1 on the piezoelectric substrate 2, so complicated operations such as polarization treatment and damping process are not required, improving productivity and yield. be done. Further, the area where the capacitive electrode was formed can be omitted, the size of the piezoelectric substrate 2 can be reduced, and as a result, the size of the filter 1 can also be reduced.

[第2実施例] 第3図にエネルギー閉じ込め形の三段結合フィルタ15
の分解斜視図を示す。このフィルタ15は3個のフィル
タ部と2個の結合容量部を備えているチップ型フィルタ
である。圧電体基板16は3個の多重モード・フィルタ
部Fl ,F2, F3が形成されている。誘電体材料
から成る封止基板18は2個の結合容量部CI . C
2が形成されている。これらの基板16.18は、絶縁
体基板17と共に接着剤によって固着され、密閉された
振動杢間を形成する。第4図にフィルタ15の外観を示
す。フィルタ15の左右の端部にそれぞれ外部入出力端
子(A),(B)が形成されている。さらに、フィルタ
15の手前側の端面及び奥側の端面にそれぞれ外部共通
端子(C)、外部中継端子(Di ). (D2>が形
成されている。
[Second Embodiment] FIG. 3 shows an energy trapping three-stage coupling filter 15.
An exploded perspective view is shown. This filter 15 is a chip type filter including three filter sections and two coupling capacitance sections. The piezoelectric substrate 16 is formed with three multimode filter sections Fl, F2, and F3. The sealing substrate 18 made of a dielectric material has two coupling capacitors CI. C
2 is formed. These substrates 16, 18 are fixed together with the insulator substrate 17 with an adhesive to form a sealed vibrating space. FIG. 4 shows the appearance of the filter 15. External input/output terminals (A) and (B) are formed at the left and right ends of the filter 15, respectively. Further, an external common terminal (C), an external relay terminal (Di) . (D2> is formed.

[第3実施例] 第5図にエネルギー閉じ込め形の二段結合フィルタ20
の分解斜視図を示す。このフィルタ20は2個のフィル
タ部と2個の結合容量部を備えているチップ型フィルタ
である.圧電体基板21は2個の多重モード・フィルタ
部Fl , F2が形成されている.フィルタ部Fl 
. F2の間にはシールド導体24が形成され、フィル
タ部F1とF2とが電気的に結合をするのを防止してい
る。封止基板22. 23にはそれぞれ結合容量部Cl
,C2が形成されている.封止基板22,23には誘電
体材料が使用されている.第6図にフィルタ20の外観
を示す。フィルタ20の左右の端部にそれぞれ外部入出
力端子〈A),(B)が形或されている.さらに、フィ
ルタ20の手前側の端面及び奥側の端面にそれぞれ外部
共通端子(C)、外部中継端子(D)が形成されている
[Third Embodiment] FIG. 5 shows an energy trapping type two-stage coupling filter 20.
An exploded perspective view is shown. This filter 20 is a chip type filter that includes two filter sections and two coupling capacitance sections. The piezoelectric substrate 21 has two multimode filter sections Fl and F2 formed thereon. Filter part Fl
.. A shield conductor 24 is formed between F2 to prevent electrical coupling between filter parts F1 and F2. Sealing substrate 22. 23 each have a coupling capacitance portion Cl.
, C2 is formed. A dielectric material is used for the sealing substrates 22 and 23. FIG. 6 shows the appearance of the filter 20. External input/output terminals (A) and (B) are formed at the left and right ends of the filter 20, respectively. Furthermore, an external common terminal (C) and an external relay terminal (D) are formed on the front end surface and the rear end surface of the filter 20, respectively.

[第4実施例] 第7図にエネルギー閉じ込め形の二段結合フィルタ30
の分解斜視図を示す。このフィルタ30は2個のフィル
タ部と2個の結合容量部を備えているチップ型フィルタ
である.圧電体基板31は2個の多重モード・フィルタ
部F1.F2が形成されている。
[Fourth embodiment] FIG. 7 shows an energy trapping type two-stage coupling filter 30.
An exploded perspective view is shown. This filter 30 is a chip type filter including two filter sections and two coupling capacitance sections. The piezoelectric substrate 31 has two multimode filter sections F1. F2 is formed.

この圧電体基板3lと誘電体材料から成る封止基板32
. 33とが、接着剤によって固着され、密閉された振
動空間を形成する。
A sealing substrate 32 made of this piezoelectric substrate 3l and a dielectric material
.. 33 are fixed with adhesive to form a sealed vibration space.

第8図にフィルタ30の外観を示す。フィルタ30の手
前側の左右の端部にそれぞれ外部入出力端子(A),(
B)、並びにフィルタ30の奥側の左右の端部にそれぞ
れ外部共通端子(C)、外部中継端子(D)が形成され
ている。ここで、外部共通端子(C)と外部中継端子(
D)はプリント配線板等への取付け用電極として使用さ
れると共に、容量電極としての機能をも有している.即
ち、封止基板32のうち端子(C),(D)が対向する
部分に結合容量部C1が形成され、同様に封止基板33
のうち端子(C).(D)が対向する部分に結合容量部
c2が形成されている.従って、封止基板に特別に容量
電極を形成する必要がない。
FIG. 8 shows the appearance of the filter 30. External input/output terminals (A), (
B), and an external common terminal (C) and an external relay terminal (D) are formed at the left and right ends of the rear side of the filter 30, respectively. Here, connect the external common terminal (C) and the external relay terminal (
D) is used as an electrode for attachment to a printed wiring board, etc., and also functions as a capacitive electrode. That is, the coupling capacitance portion C1 is formed in the portion of the sealing substrate 32 where the terminals (C) and (D) face each other, and the sealing substrate 33
Of these, terminal (C). A coupling capacitance portion c2 is formed in the portion where (D) faces. Therefore, there is no need to specially form a capacitor electrode on the sealing substrate.

[第5実施例コ 第9図にエネルギー閉じ込め形の二段結合フィルタ40
の分解斜視図を示す。このフィルタ40は2個のフィル
タ部と1個の結合容量部を備えているチップ型フィルタ
である。圧電体基板41は2個の多重モード・フィルタ
部Fl . F2が形成されている。
[In the fifth embodiment, FIG. 9 shows an energy trapping type two-stage coupling filter 40.
An exploded perspective view is shown. This filter 40 is a chip type filter including two filter sections and one coupling capacitance section. The piezoelectric substrate 41 has two multimode filter sections Fl. F2 is formed.

フィルタ部F1.F2の間にはシールド導体44が形成
され、フィルタ部F1とF2とが電気的に結合するのを
防止している。この圧電体基板41と誘電体材料から成
る封止基板42と絶縁体材料から成る封止基板43とが
、接着剤によって固着され、密閉された振動空間を形成
する。第10図にフィルタ40の外観を示す。フィルタ
40の手前側の左右の端部及び中央部にそれぞれ外部入
出力端子(A),(B)、並びに外部共通端子(C)が
形成されている。外部共通端子(C)は延長されてフィ
ルタ40の奥側の端面にまで達している。この端子(C
)は外部中継端子(D)に接続された容量電極45との
間に結合容量部C1を形成している。容量電極45はA
gの導電性ぺ一スト等を印刷等の手段によってフィルタ
40の外表面に形成する。
Filter section F1. A shield conductor 44 is formed between F2 to prevent electrical coupling between filter parts F1 and F2. This piezoelectric substrate 41, a sealing substrate 42 made of a dielectric material, and a sealing substrate 43 made of an insulating material are fixed with an adhesive to form a sealed vibration space. FIG. 10 shows the appearance of the filter 40. External input/output terminals (A), (B) and an external common terminal (C) are formed at the left and right ends and the center of the filter 40 on the front side, respectively. The external common terminal (C) is extended to reach the inner end face of the filter 40. This terminal (C
) forms a coupling capacitance portion C1 between the capacitor electrode 45 connected to the external relay terminal (D). The capacitor electrode 45 is A
A conductive paste or the like of g is formed on the outer surface of the filter 40 by printing or other means.

[第6実施例コ 第11図にエネルギー閉じ込め形の二段結合フィルタ5
0の分解斜視図を示す。このフィルタ50は2個のフィ
ルタ部と1個の結合容量部を備えているチップ型フィル
タである。圧電体基板51は2個の多重モード・フィル
タ部Fl . F2が形成されている。フィルタ部F1
とF2の間を接続する導体路の中央部には導電体54が
設けられている。誘電体材料から成る封止基板52には
結合容量部C1の容量電極55a. 55bが形成され
ている。これらの基板51.52は絶縁体基板53と共
に接着剤によって固着され、密閉された振動空間を形成
する。このとき、導電体54は結合容量部C1を構成す
る容量電極55bに接触し、フィルタ部F1.F2と結
合容量部C1を電気的に接続する。
[Sixth Embodiment FIG. 11 shows an energy trapping type two-stage coupling filter 5]
0 is shown in an exploded perspective view. This filter 50 is a chip type filter including two filter sections and one coupling capacitance section. The piezoelectric substrate 51 has two multimode filter sections Fl. F2 is formed. Filter part F1
A conductor 54 is provided at the center of the conductor path connecting between F2 and F2. The sealing substrate 52 made of a dielectric material has capacitive electrodes 55a . 55b is formed. These substrates 51 and 52 are fixed together with an insulating substrate 53 using an adhesive to form a sealed vibration space. At this time, the conductor 54 contacts the capacitive electrode 55b forming the coupling capacitance section C1, and the filter section F1. F2 and the coupling capacitance section C1 are electrically connected.

第12図にフィルタ50の外観を示す。フィルタ50の
左右の端部にそれぞれ外部入出力端子(A),(B)が
形成されている。さらに、フィルタ50の中央部に帯状
に外部共通端子(C)が形成されている。
FIG. 12 shows the appearance of the filter 50. External input/output terminals (A) and (B) are formed at the left and right ends of the filter 50, respectively. Further, an external common terminal (C) is formed in a band shape in the center of the filter 50.

フィルタ50はフィルタ部Fl,F2と結合容量部C1
との間の電気的接続を導電体54を介して行なっている
ので外部中継端子は必要ない。
The filter 50 includes filter parts Fl and F2 and a coupling capacitance part C1.
Since electrical connection is made between the two via the conductor 54, no external relay terminal is required.

[他の実施例コ なお、本発明に係るチップ型圧電フィルタは前記実施例
に限定するものではなく、その要旨の範囲内で種々に変
形することができる。
[Other Embodiments] The chip-type piezoelectric filter according to the present invention is not limited to the embodiments described above, and can be modified in various ways within the scope of the gist.

圧電体基板は生産性、歩留からすると1枚で構成するの
が最も好ましいが、場合によっては多層にしてもよい。
From the viewpoint of productivity and yield, it is most preferable that the piezoelectric substrate be composed of a single piezoelectric substrate, but it may be composed of multiple layers depending on the case.

また、圧電体基板上に形成される振動電極、封止基板上
に形成される容量電極、及び外部端子の形状、レイアウ
トは実施例に限定するものではない。
Furthermore, the shapes and layouts of the vibrating electrodes formed on the piezoelectric substrate, the capacitive electrodes formed on the sealing substrate, and the external terminals are not limited to those in the embodiment.

さらに、外部端子間に補助コンデンサ及びその他の抵抗
素子、インダクタンス素子を追加して接続してもよい。
Furthermore, an auxiliary capacitor and other resistance elements and inductance elements may be additionally connected between the external terminals.

一方、封止基板に形成される結合容量部が有する容量だ
けでは必要な容量が得られない場合には、圧電体基板に
容量を形成してもよい。この場合、圧電体基板は分極処
理やダンピング処理等の煩雑な作業は必要であるが、部
品の小型化を図ることができる。
On the other hand, if the required capacitance cannot be obtained only with the capacitance of the coupling capacitance section formed on the sealing substrate, the capacitance may be formed on the piezoelectric substrate. In this case, although the piezoelectric substrate requires complicated operations such as polarization treatment and damping treatment, it is possible to reduce the size of the component.

発明の効果 本発明は、結合容量部の形成位置を圧電体基板から封止
基板に替えることによって、圧電体基板の分極処理やダ
ンピング処理等の煩雑な作業が不要となる。従って、生
産性が向上すると共に歩留も改善された静電容量内蔵形
のチップ型圧電フィルタが提供される。
Effects of the Invention In the present invention, by changing the formation position of the coupling capacitance portion from the piezoelectric substrate to the sealing substrate, complicated operations such as polarization treatment and damping treatment of the piezoelectric substrate are unnecessary. Therefore, a chip-type piezoelectric filter with a built-in capacitance is provided which improves productivity and yield.

そして、圧電体基板は容量電極が形成されていた領域を
省くことができ、そのため、部品サイズの小型化に対応
できる。
In addition, the piezoelectric substrate can omit the area where the capacitive electrode is formed, and therefore, it is possible to respond to miniaturization of the component size.

しかも、封止基板に形成される容量電極の形状、レイア
ウト等の設計の自由度も高く、電気特性の改善、安定化
が可能である。
Moreover, there is a high degree of freedom in designing the shape, layout, etc. of the capacitor electrode formed on the sealing substrate, and electrical characteristics can be improved and stabilized.

また、誘電体材料から成る封止基板の外界側表面に容量
電極が形成されているので、製品完成後に容量電極を削
るなどして容量調整ができる。
Furthermore, since the capacitor electrode is formed on the outer surface of the sealing substrate made of a dielectric material, the capacitance can be adjusted by cutting the capacitor electrode after the product is completed.

さらに、第4実施例の場合のように、封止基板に特別に
容量電極を形成することなくして、容量が得られ、製造
工程の簡略化が図れる。
Furthermore, as in the case of the fourth embodiment, capacitance can be obtained without specifically forming a capacitor electrode on the sealing substrate, and the manufacturing process can be simplified.

【図面の簡単な説明】[Brief explanation of drawings]

第1図は本発明の第1実施例であるチップ型圧電フィル
タの分解斜視図、第2図はその外観を示す斜視図である
。第3図、第4図は第2実施例を示し、第5図、第6図
は第3実施例を示し、第7図、第8図は第4実施例を示
し、第9図、第10図は第5実施例を示し、第11図、
第12図は第6実施例を示すもので、それぞれチップ型
圧電フィルタの分解斜視図、及びその外観の斜視図であ
る。第13図、第14図は従来のチップ型圧電フィルタ
を示し、第13図は圧電体基板の平面図、第14図はそ
の電気等価回路図である。 1・・・チップ型圧電フィルタ(エネルギー閉じ込め形
二段結合フィルタ)、2・・・圧電体基板、4a.4b
. 5 . 6a. 6b. 7 ・・・振動電極、1
1−・・封止基板、12a.12b・・・容量電極、1
5・・・チップ型圧電フィルタ(工ネルギー閉じ込め形
三段結合フィルタ)、16・・・圧電体基板、18・・
・封止基板、20・・・チップ型圧電フィルタ(エネル
ギー閉じ込め形二段結合フィルタ)、21・・・圧電体
基板、22. 23・・・封止基板、30・・・チップ
型圧電フィルタ(エネルギー閉じ込め形二段結合フィル
タ)、31・・・圧電体基板、32. 33・・・封止
基板、40・・・チップ型圧電フィルタ(エネルギー閉
じ込め形二段結合フィルタ)、41・・・圧電体基板、
42・・・封止基板、50・・・チップ型圧電フィルタ
(エネルギー閉じ込め形二段結合フィルタ)、51・・
・圧電体基板、52・・・封止基板、55a,55b 
・・・容量電極、(A).(B),(C).(D),(
DI).(D2>・・・外部端子、C1.C2・・・結
合容量部、Fl,F2,F3・・・振動部(フィルタ部
〉。
FIG. 1 is an exploded perspective view of a chip-type piezoelectric filter according to a first embodiment of the present invention, and FIG. 2 is a perspective view showing its appearance. 3 and 4 show the second embodiment, FIGS. 5 and 6 show the third embodiment, FIGS. 7 and 8 show the fourth embodiment, and FIGS. Figure 10 shows the fifth embodiment, Figure 11,
FIG. 12 shows a sixth embodiment, and is an exploded perspective view of a chip-type piezoelectric filter and a perspective view of its external appearance, respectively. 13 and 14 show a conventional chip-type piezoelectric filter, FIG. 13 is a plan view of a piezoelectric substrate, and FIG. 14 is an electrical equivalent circuit diagram thereof. 1... Chip type piezoelectric filter (energy trap type two-stage coupling filter), 2... Piezoelectric substrate, 4a. 4b
.. 5. 6a. 6b. 7... Vibrating electrode, 1
1-... Sealing substrate, 12a. 12b...capacitance electrode, 1
5... Chip type piezoelectric filter (energy confinement type three-stage coupling filter), 16... Piezoelectric substrate, 18...
- Sealing substrate, 20... Chip type piezoelectric filter (energy trap type two-stage coupling filter), 21... Piezoelectric substrate, 22. 23... Sealing substrate, 30... Chip type piezoelectric filter (energy trap type two-stage coupling filter), 31... Piezoelectric substrate, 32. 33... Sealing substrate, 40... Chip type piezoelectric filter (energy trap type two-stage coupling filter), 41... Piezoelectric substrate,
42... Sealing substrate, 50... Chip type piezoelectric filter (energy trap type two-stage coupling filter), 51...
・Piezoelectric substrate, 52... Sealing substrate, 55a, 55b
...Capacitive electrode, (A). (B), (C). (D), (
DI). (D2>...external terminal, C1.C2...coupling capacitance section, Fl, F2, F3...vibrating section (filter section).

Claims (1)

【特許請求の範囲】[Claims] 1.複数個の振動部を設けた圧電体基板と、該圧電体基
板の板厚方向に重ねられた封止基板とが、密閉された振
動空間を形成していて、前記振動部間を結合するための
結合容量部が誘電体材料から成る前記封止基板に設けら
れ、前記結合容量部の容量電極の少なくとも一方が前記
封止基板の外界側表面に形成され、前記振動部の振動電
極と前記結合容量部の容量電極とが電気的接続手段で接
続されていることを特徴とするチップ型圧電フィルタ。
1. A piezoelectric substrate provided with a plurality of vibrating parts and a sealing substrate stacked in the thickness direction of the piezoelectric substrate form a sealed vibration space to couple the vibrating parts. A coupling capacitance section is provided on the sealing substrate made of a dielectric material, at least one of the capacitance electrodes of the coupling capacitance section is formed on the outer surface of the sealing substrate, and the vibration electrode of the vibration section and the coupling A chip-type piezoelectric filter characterized in that a capacitor electrode of a capacitor part is connected to the capacitor electrode by an electrical connection means.
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