JPH0392867U - - Google Patents

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JPH0392867U
JPH0392867U JP73790U JP73790U JPH0392867U JP H0392867 U JPH0392867 U JP H0392867U JP 73790 U JP73790 U JP 73790U JP 73790 U JP73790 U JP 73790U JP H0392867 U JPH0392867 U JP H0392867U
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Description

【図面の簡単な説明】
第1図は本考案に係るフアクシミリ装置の一実
施例のブロツク図、第2図はフアクシミリ通信手
順の一例を示す図、第3図は第2図の通信手順に
用いられるバイナリ信号のフレーム構成を示す図
、第4図、第5図はそれぞれ送信側、受信側の処
理流れを示すフローチヤートである。 1……主制御部、2……変復調回路、3……送
信回路、4……読取制御回路、5……受信回路、
6……記録制御回路、7……原稿蓄積メモリ、8
……時刻指定処理部、9……時刻指定出力フレー
ム作成部、10……時刻指定出力フレーム検出部
、11……時刻指定出力管理テーブル。

Claims (1)

    【実用新案登録請求の範囲】
  1. 受信側に原稿蓄積メモリが設けられ、送信側は
    送信原稿の受信コピー出力日時を指定して原稿の
    画情報を受信側に送信し、受信側では送信側から
    送信された画情報を原稿蓄積メモリに蓄積し、指
    定された日時に原稿蓄積メモリを読出して受信コ
    ピー出力するようになつていることを特徴とする
    フアクシミリ装置。
JP73790U 1990-01-09 1990-01-09 Pending JPH0392867U (ja)

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JPH0392867U true JPH0392867U (ja) 1991-09-20

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