JPH0366841B2 - - Google Patents

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JPH0366841B2
JPH0366841B2 JP23813885A JP23813885A JPH0366841B2 JP H0366841 B2 JPH0366841 B2 JP H0366841B2 JP 23813885 A JP23813885 A JP 23813885A JP 23813885 A JP23813885 A JP 23813885A JP H0366841 B2 JPH0366841 B2 JP H0366841B2
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JP
Japan
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input
fet
output line
line
microwave
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JP23813885A
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Japanese (ja)
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JPS6297403A (en
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Makoto Matsunaga
Yoshitada Iyama
Fumio Takeda
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Mitsubishi Electric Corp
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Mitsubishi Electric Corp
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Publication date
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  • Waveguide Switches, Polarizers, And Phase Shifters (AREA)

Description

【発明の詳細な説明】 〔産業上の利用分野〕 この発明は、入射する電波の電力が大きい場
合、あるいは小さい場合に応じて伝搬径路を切り
換えるマイクロ波半導体スイツチに関するもので
ある。
DETAILED DESCRIPTION OF THE INVENTION [Field of Industrial Application] The present invention relates to a microwave semiconductor switch that switches a propagation path depending on whether the power of an incident radio wave is high or low.

〔従来の技術〕[Conventional technology]

第3図は、例えば1982年6月米国で開催された
シンポジウム「IEEE1982Microwave and Mili
−meter Wave Monolithic Circuits
Symposium」の論文集に示された従来のマイク
ロ波半導体スイツチの構造の一例を示す図であ
る。
Figure 3 shows, for example, the symposium "IEEE1982Microwave and Mili" held in June 1982 in the United States.
−meter Wave Monolithic Circuits
1 is a diagram showing an example of the structure of a conventional microwave semiconductor switch shown in a collection of papers of ``Symposium''.

図において、1は金属基台、2は半導体基板、
3は第1の入出力線路、4は第2の入出力線路、
5は第3の入出力線路、6は1/2波長の長さを有
する低インピーダンス線路、7は1/2波長の長さ
を有する高インピーダンス線路であり、これらマ
イクロストリツプ線路は半導体基板2に構成され
る。
In the figure, 1 is a metal base, 2 is a semiconductor substrate,
3 is a first input/output line, 4 is a second input/output line,
5 is a third input/output line, 6 is a low impedance line with a length of 1/2 wavelength, and 7 is a high impedance line with a length of 1/2 wavelength, and these microstrip lines are connected to the semiconductor substrate. It consists of 2.

また、8は第1の電界効果トランジスタ(以下
第1のFETと略称する)、9は第1のFETのドレ
イン電極、10は第1のFETのソース電極、1
1は第1のFETのゲート電極である。第1の
FETのソース電極10は金ワイヤ12等を用い
て金属基台1に接続され、第1のFETのドレイ
ン電極9は低インピーダンス線路6に接続され
る。
Further, 8 is a first field effect transistor (hereinafter abbreviated as the first FET), 9 is a drain electrode of the first FET, 10 is a source electrode of the first FET, 1
1 is the gate electrode of the first FET. first
The source electrode 10 of the FET is connected to the metal base 1 using a gold wire 12 or the like, and the drain electrode 9 of the first FET is connected to the low impedance line 6.

一方、13は第2の電界効果トランジスタ(以
下第2のFETと略称する)、14は第2のFETの
ドレイン電極、15は第2のFETのソース電極、
16は第2のFETのゲート電極である。第2の
FETのソース電極15は金ワイヤ12等を用い
て金属基台1に接続され、第2のFETのドレイ
ン電極14は高インピーダンス線路7に接続され
る。
On the other hand, 13 is a second field effect transistor (hereinafter abbreviated as second FET), 14 is a drain electrode of the second FET, 15 is a source electrode of the second FET,
16 is the gate electrode of the second FET. second
The source electrode 15 of the FET is connected to the metal base 1 using a gold wire 12 or the like, and the drain electrode 14 of the second FET is connected to the high impedance line 7.

第1のFET8のゲート電極11には、マイク
ロストリツプ線路よりなるバイアス回路17を介
して、第1のバイアス端子18からバイアス電圧
が印加される。同様に、第2のFET13のゲー
ト電極16にもバイアス回路17を介して第2の
バイアス端子19よりバイアス電圧が印加され
る。
A bias voltage is applied to the gate electrode 11 of the first FET 8 from a first bias terminal 18 via a bias circuit 17 made of a microstrip line. Similarly, a bias voltage is applied to the gate electrode 16 of the second FET 13 from the second bias terminal 19 via the bias circuit 17.

また、第1の入出力線路3と低インピーダンス
線路6および高インピーダンス線路7の接続され
る点を接続点20と呼ぶとすると、この接続点2
0よりそれぞれ1/4波長の位置の低インピーダン
ス線路6および高インピーダンス線路7に、第1
のFET8、第2のFET13のソース電極が接続
された構成である。
Furthermore, if the point where the first input/output line 3 is connected to the low impedance line 6 and the high impedance line 7 is called a connection point 20, then this connection point 2
A first wire is connected to a low impedance line 6 and a high impedance line 7 at positions 1/4 wavelength from 0, respectively.
In this configuration, the source electrodes of the FET 8 and the second FET 13 are connected.

なお、両FETともソース電極とドレイン電極
を同電位とするため、第1の入出力線路3に先端
を金属基台1に接続した接地用高インピーダンス
線路21が接続されている。
Note that in order to have the source electrode and drain electrode of both FETs at the same potential, a high impedance grounding line 21 whose tip is connected to the metal base 1 is connected to the first input/output line 3.

次に動作について説明する。 Next, the operation will be explained.

第4図は第3図に示した従来のマイクロ波半導
体スイツチの動作説明をするため、等価回路で表
わしたものである。この等価回路表示ではバイア
ス回路17、接地用高インピーダンス線路21の
図示は略した。
FIG. 4 shows an equivalent circuit to explain the operation of the conventional microwave semiconductor switch shown in FIG. 3. In this equivalent circuit representation, the bias circuit 17 and the grounding high impedance line 21 are not shown.

第4図を用いた動作説明においては、まず、第
1の入出力線路3から低電力のマイクロ波が入射
した場合、ついで数W程度の大電力マイクロ波が
入射した場合に分けて動作説明を行なう。
In explaining the operation using FIG. 4, we will first explain the operation separately for the case where a low power microwave is incident from the first input/output line 3, and then the case where a high power microwave of about several W is incident. Let's do it.

まず、第1の入出力線路3から低電力のマイク
ロ波が入射し、第3の入出力線路5に伝搬してい
く場合を考える。
First, consider a case where a low-power microwave enters from the first input/output line 3 and propagates to the third input/output line 5.

このとき、第2のバイアス端子19にはピンチ
オフ電圧VPより小さい負のバイアス電圧VBIAS(|
VBIAS|>|VP|)が印加され第2のFET13は
高インピーダンスを呈する。同時に第1のバイア
ス端子18はOVとされ、第1のFET8は低イン
ピーダンス線路を呈する。このインピーダンスを
R1とする。このR1は低インピーダンス線路6の
特性インピーダンスZ1より十分小さいため、接続
点20から第2の入出力線路4側を見たインピー
ダンスが、ほぼ開放状態に近い高インピーダンス
となる。したがつて第1の入出力線路から入射し
たマイクロ波は、高インピーダンス線路7側を伝
搬し、第3の入出力線路5に現われる。このと
き、第2のFETは高インピーダンスを呈してい
るため、伝搬するマイクロ波には影響を与えな
い。
At this time, the second bias terminal 19 has a negative bias voltage V BIAS ( |
V BIAS |>|V P |) is applied, and the second FET 13 exhibits high impedance. At the same time, the first bias terminal 18 is set to OV, and the first FET 8 presents a low impedance line. This impedance
Let it be R 1 . Since this R 1 is sufficiently smaller than the characteristic impedance Z 1 of the low impedance line 6, the impedance when looking from the connection point 20 to the second input/output line 4 side becomes a high impedance that is almost in an open state. Therefore, the microwave incident from the first input/output line propagates on the high impedance line 7 side and appears on the third input/output line 5. At this time, since the second FET exhibits high impedance, it does not affect the propagating microwave.

つぎに、第1の入出力線路3から高電力のマイ
クロ波が入射し、第2の入出力線路4に、このマ
イクロ波を供給する場合を考える。このとき、
FETに印加するバイアス条件は下記のとおりと
なる。すなわち、第2のバイアス端子19は
OV、第1のバイアス端子18はピンチオフ電圧
VPより小さい負のバイアス電圧VBIAS(|VBIAS
>|VP|)である。このバイアス条件下では、
第2のFET13は低インピーダンスR2、第1の
FET8は高インピーダンスとなる。このため、
接続点20から第3の入出力線路5側から見たイ
ンピーダンスは開放状態に近い高インピーダンス
となり、第1の入出力線路から入射したマイクロ
波は、低インピーダンス線路6側を伝搬し、第2
の入出力線路4に現われる。
Next, consider a case in which high-power microwaves enter from the first input/output line 3 and are supplied to the second input/output line 4. At this time,
The bias conditions applied to the FET are as follows. That is, the second bias terminal 19 is
OV, the first bias terminal 18 is the pinch-off voltage
Negative bias voltage V BIAS (|V BIAS
> |V P |). Under this bias condition,
The second FET 13 has a low impedance R 2 , the first
FET8 becomes high impedance. For this reason,
The impedance seen from the connection point 20 from the third input/output line 5 side is a high impedance close to an open state, and the microwave incident from the first input/output line propagates on the low impedance line 6 side and passes through the second input/output line 5.
appears on the input/output line 4.

ここで、第1のFET8は高インピーダンスを
呈しており、特性インピーダンスZ1の低インピー
ダンス線路6を伝搬するマイクロ波に影響を与え
ない。
Here, the first FET 8 exhibits high impedance and does not affect the microwave propagating through the low impedance line 6 having the characteristic impedance Z1 .

このバイアス状態のスイツチでは、高電力のマ
イクロ波が伝搬するため、第2のFET13に流
れるRF電流、第1のFET8に印加されるRF電
圧は、それぞれ大きな値となる。したがつて、こ
の値に耐えられる性能のFETを用いる必要があ
る。
In the switch in this bias state, since high-power microwaves propagate, the RF current flowing through the second FET 13 and the RF voltage applied to the first FET 8 each have large values. Therefore, it is necessary to use an FET with performance that can withstand this value.

いま、電力Pワツトのマイクロ波が入射した場
合を考えると、第2のFET13に流れるRF電流
Iは次式で表わされる。
Now, considering the case where a microwave with a power of P Watts is incident, the RF current I flowing through the second FET 13 is expressed by the following equation.

I=2Z2√2Z0P/R2Z0+2Z2 2 …(1) ここで、R2は第2のFET13のOVバイアス状
態での抵抗、Z2は高インピーダンス線路7の特性
インピーダンスである。
I=2Z 2 √2Z 0 P/R 2 Z 0 +2Z 2 2 ...(1) Here, R 2 is the resistance of the second FET 13 in the OV bias state, and Z 2 is the characteristic impedance of the high impedance line 7. .

一方、第1のFET8に印加されるRF電圧Vは
次式で表わせる。
On the other hand, the RF voltage V applied to the first FET 8 can be expressed by the following equation.

V=Z1/Z0√20 …(2) ここで、Z1は低インピーダンス線路6の特性イ
ンピーダンスである。
V=Z 1 /Z 0 √2 0 (2) Here, Z 1 is the characteristic impedance of the low impedance line 6.

例えば、入出電力として5W,Z0=50Ω,R2
3Ωとし、Z2として75Ω,Z1として40Ωの場合、
電流I、電圧VはそれぞれI=0.23A,V=14V
となる。このうち、電流値0.23Aは、通常のゲー
ト値1mmクラスのFETで流しうるドレイン電流
であり、問題はないが、電圧値V=14VはFETに
とつて許容値を越えかねない値となる。つまり、
第1のFET8のゲートバイアス電圧をVBIAS、ピ
ンチオフ電圧をVP、ゲートのブレークダウン電
圧をVBRとすると、次の関係が必要となる。
For example, input and output power is 5W, Z 0 = 50Ω, R 2 =
3Ω, and if Z 2 is 75Ω and Z 1 is 40Ω,
Current I and voltage V are I=0.23A and V=14V, respectively.
becomes. Of these, the current value of 0.23 A is the drain current that can be passed through a normal FET with a gate value of 1 mm class, and there is no problem, but the voltage value V = 14 V is a value that may exceed the permissible value for the FET. In other words,
Assuming that the gate bias voltage of the first FET 8 is V BIAS , the pinch-off voltage is V P , and the gate breakdown voltage is V BR , the following relationship is required.

|VBR|≧V+|VP|… (3) |VBIAS|=1/2V+|VP| ピンチオフ電圧|VP|=2Vと仮定すると、ブ
レークダウン電圧|VBR|として16Vバイアス電
圧|VBIAS|として9Vが必要となる。このブレー
クダウン電圧16Vは大量生産を考えたFETでは容
易には得られず、この種マイクロ波半導体スイツ
チの許容入力電力を3W程度にするのはむずかし
いという問題があつた。
|V BR |≧V+|V P |… (3) |V BIAS |=1/2V+|V P | Pinch-off voltage |V P |Assuming = 2V, the breakdown voltage |V BR | is 16V bias voltage | 9V is required as V BIAS |. This breakdown voltage of 16V cannot be easily obtained with FETs designed for mass production, and there was a problem in that it was difficult to reduce the allowable input power of this type of microwave semiconductor switch to about 3W.

さらに、FETに印加される電圧を低くするた
め低インピーダンス線路6の電気長は1/2波長必
要となり、このマイクロ波半導体スイツチを構成
する基板である半導体基板2の面積が大きくなる
という問題があつた。
Furthermore, in order to lower the voltage applied to the FET, the electrical length of the low-impedance line 6 needs to be 1/2 wavelength, which poses the problem of increasing the area of the semiconductor substrate 2 that constitutes this microwave semiconductor switch. Ta.

〔発明が解決しようとする問題点〕[Problem that the invention seeks to solve]

従来のマイクロ波半導体スイツチは以上のよう
に構成されているので、許容入力電力を数Wにす
るには、特殊な工程を経た耐圧の高いFETの製
造方法を用いる必要があり、歩留りの低下、量産
に適さないという問題があつた。また、同時に、
できるだけFETに高電圧が加わらないよう1/2波
長の低インピーダンス線路を使うため、半導体基
板の寸法が大きくなるという問題があつた。
Conventional microwave semiconductor switches are configured as described above, so in order to increase the allowable input power to several watts, it is necessary to use a manufacturing method for FETs with high breakdown voltage through a special process, resulting in a decrease in yield and There was a problem that it was not suitable for mass production. Also, at the same time,
In order to avoid applying high voltage to the FET as much as possible, a 1/2 wavelength low impedance line was used, which resulted in the problem of an increase in the size of the semiconductor substrate.

この発明は上記のような問題点を解消するため
になされたもので、マイクロ波の径路を切り換え
る高耐電力のマイクロ波半導体スイツチを得るこ
とを目的とする。
The present invention has been made to solve the above-mentioned problems, and an object of the present invention is to obtain a high-power-resistant microwave semiconductor switch for switching the microwave path.

〔問題点を解決するための手段〕[Means for solving problems]

この発明に係るマイクロ波半導体スイツチは、
3つの入出力線路の接続部近傍において、一つの
FETを一方の入出力線路に直列に挿入し、もう
一方のFETを接続部から1/4波長の位置の他の入
出力線路に並列に接続したものである。
The microwave semiconductor switch according to the present invention includes:
Near the connection of three input/output lines, one
A FET is inserted in series in one input/output line, and the other FET is connected in parallel to the other input/output line at a position 1/4 wavelength from the connection point.

〔作用〕[Effect]

この発明におけるマイクロ波半導体スイツチで
は、数Wの電力のマイクロ波が入射した場合、出
力側となる入出力線路に直列に挿入されたFET
および遮断側となる入出力線路に並列に即入され
たFETを共に低インピーダンス状態とする。こ
のためFETに印加されるRF電圧が低く、FETの
耐圧が小さくても数Wの電力を扱うことができ
る。
In the microwave semiconductor switch of this invention, when a microwave with a power of several watts is incident, an FET inserted in series in the input/output line that becomes the output side
Both the FET and the FET immediately connected in parallel to the input/output line on the cut-off side are brought into a low impedance state. Therefore, the RF voltage applied to the FET is low, and even if the FET has a low breakdown voltage, it can handle several watts of power.

〔発明の実施例〕[Embodiments of the invention]

以下、この発明の一実施例を図について説明す
る。第1図はこの発明の一実施例の構造を示した
図である。第1と第2および第3の入出力線路
3,4,5の接続点20の近傍に第1のFET8
を接続点20と第2の入出力線路4に直列に挿入
し、かつ接続点20から第3の入出力線路5へ1/
4波長の長さの点において第2のFET13を並列
に接続した構成である。直列に挿入した第1の
FET8は第1のFETのソース電極9を接続点2
0に、第1のFETのドレイン電極10を第2の
入出力線路4に接続してあり、並列に挿入した第
2のFET13は第2のFETのソース電極14を
第3の入出力線路5に接続し、第2のFETのド
レイン電極15は金ワイヤ12を介して金属基台
1に接続してある。
An embodiment of the present invention will be described below with reference to the drawings. FIG. 1 is a diagram showing the structure of an embodiment of the present invention. A first FET 8 is installed near the connection point 20 between the first, second, and third input/output lines 3, 4, and 5.
is inserted in series between the connection point 20 and the second input/output line 4, and 1/ is inserted from the connection point 20 to the third input/output line 5.
This is a configuration in which second FETs 13 are connected in parallel at the length of four wavelengths. The first inserted in series
FET8 connects the source electrode 9 of the first FET to point 2
0, the drain electrode 10 of the first FET is connected to the second input/output line 4, and the second FET 13 inserted in parallel connects the source electrode 14 of the second FET to the third input/output line 5. The drain electrode 15 of the second FET is connected to the metal base 1 via a gold wire 12.

また、21は接地用高インピーダンス線路であ
り、第1および第2のFET8,13のドレイン
電極、ソース電極を接地電位にするためのもの
で、一方の端は入出力線路に、他端は金属基台1
に接続される。
Further, 21 is a high impedance line for grounding, which is used to ground the drain electrodes and source electrodes of the first and second FETs 8 and 13, one end of which is an input/output line, and the other end of which is made of metal. Base 1
connected to.

次にこの発明の動作説明を行なう。第2図は第
1図の実施例を等価回路表示したものである。
Next, the operation of this invention will be explained. FIG. 2 shows an equivalent circuit representation of the embodiment shown in FIG.

このマイクロ波半導体スイツチは、第1の入出
力線路3から入射した高電力のマイクロ波は第2
の入出力線路4へ通過させ、第1の入出力線路3
から入射した低電力のマイクロ波は、第3の入出
力線路5へ通過させるようバイアス電圧を制御す
る。
In this microwave semiconductor switch, the high power microwave incident from the first input/output line 3 is transferred to the second input/output line 3.
The first input/output line 3
The bias voltage is controlled so that the low power microwave incident from the input/output line 5 is passed through the third input/output line 5.

まず、第1の入出力線路3から高電力のマイク
ロ波が入射した場合を考える。この場合、第1の
FET8には第1のバイアス端子18を介してOV
のゲートバイアス電圧が印加され、第1のFET
8のソース電極、ドレイン電極間のインピーダン
スは低インピーダンスR1となる。一方、第2の
FET13には第2のバイアス端子19を介して
同様にOVのゲートバイアス電圧が印加され、第
2のFET13ソース電極、ドレイン電極間のイ
ンピーダンスは低インピーダンスR2となる。こ
のとき、接続点20から第2のFET13側を見
たインピーダンスは開放状態に近い高インピーダ
ンスとなるため、第1の入出力線路3から入射し
た高電力のマイクロ波は、第1のFET8を通過
し、第2の入出力線路4へ伝搬していく。この状
態において、電力Pワツトのマイクロ波が入射し
た場合を考えると、第1および第2のFET8,
13に流れるRF電流I1,I2はそれぞれ次式で与え
られる。
First, consider the case where high-power microwaves are incident from the first input/output line 3. In this case, the first
FET8 is connected to OV via the first bias terminal 18.
A gate bias voltage of is applied to the first FET.
The impedance between the source electrode and the drain electrode of No. 8 is a low impedance R1 . On the other hand, the second
A gate bias voltage of OV is similarly applied to the FET 13 via the second bias terminal 19, and the impedance between the source electrode and the drain electrode of the second FET 13 becomes a low impedance R2 . At this time, the impedance seen from the connection point 20 to the second FET 13 becomes a high impedance close to an open state, so the high power microwave incident from the first input/output line 3 passes through the first FET 8. and propagates to the second input/output line 4. In this state, if we consider the case where a microwave with a power of P watts is incident, the first and second FETs 8,
The RF currents I 1 and I 2 flowing through 13 are given by the following equations, respectively.

I1=2√Z0P/2Z0+R1 …(4) I2=2√Z0P/2Z0+R2 …(5) 例えば、入力電力として3W、Z0=50Ω,R1
R2=3Ωとすると、第1のFET8、第2のFET
13に流れるRF電流は等しくI=0.34Aとなる。
このとき、第1、第2のFET8,13に加わる
RF電圧は等しく約1Vである。
I 1 =2√Z 0 P/2Z 0 +R 1 …(4) I 2 =2√Z 0 P/2Z 0 +R 2 …(5) For example, input power is 3W, Z 0 =50Ω, R 1 =
If R 2 = 3Ω, the first FET8, the second FET
The RF current flowing through 13 is equal to I=0.34A.
At this time, it is added to the first and second FETs 8 and 13.
The RF voltage is equally approximately 1V.

つぎに、第1の入出力線路3から低電力のマイ
クロ波が入射した場合を考える。
Next, consider a case where low power microwaves are incident from the first input/output line 3.

この場合、第1のFET8、第2のFET13と
もに負のゲートバイアス電圧VBIASはピンチオフ
電圧VPより小さい値に設定され、(|VBIAS|>|
VP|)ソース電極、ドレイン電極間のインピー
ダンスは高インピーダンスを呈する。したがつ
て、第1の入出力線路3から入射したマイクロ波
は、第2の入出力線路4側が高インピーダンスの
ため第3の入出力線路5の方向へ伝搬する。この
とき、高インピーダンス状態の両FETに印加さ
れるRF電圧は、伝搬するマイクロ波が低電圧で
あるため、FETの限界性能に対して十分小さく
問題にならない。
In this case, the negative gate bias voltage V BIAS of both the first FET 8 and the second FET 13 is set to a value smaller than the pinch-off voltage VP , and (|V BIAS |>|
V P |) The impedance between the source electrode and the drain electrode exhibits high impedance. Therefore, the microwave incident from the first input/output line 3 propagates toward the third input/output line 5 because the second input/output line 4 side has a high impedance. At this time, the RF voltage applied to both FETs in a high impedance state is sufficiently small to cause no problem with respect to the FET's performance limit, since the propagating microwave is at a low voltage.

すなわち、この構成によるマイクロ波半導体ス
イツチでは、大電領のマイクロ波が入射した場
合、2つのFETが共に低インピーダンス線路を
呈するようにバイアスされるため、FETのブレ
ークダウン電圧を越えるRF電圧が印加されるこ
とがない。さらに、低インピーダンスを呈する2
つのFETに流れるRF電流は入射するマイクロ波
の電力が増加するにつれて増えるが、これは、
FETのゲート幅を増すことによつて解決できる。
In other words, in a microwave semiconductor switch with this configuration, when a microwave with a large current area is incident, the two FETs are biased so that they both present a low impedance line, so an RF voltage exceeding the breakdown voltage of the FET is applied. never be done. Furthermore, 2 exhibiting low impedance
The RF current flowing through one FET increases as the power of the incident microwave increases;
This can be solved by increasing the FET gate width.

〔発明の効果〕〔Effect of the invention〕

以上のようにこの発明によれば、高電力のマイ
クロ波が入射した場合、2個のFETが共に低イ
ンピーダンスとなるようにバイアスされるため、
FETのドレイン・ソース電極間に印加されるRF
電圧は低くなり、FETの破損を招くことはない。
したがつて、ブレークダウン電圧の高いFETを
必要とせず、スイツチの歩留り向上に寄与すると
ころ大である。また、従来のように1/2波長の低
インピーダンス線路を用いてFETにかかるRF電
圧が低くする必要がないため、小形化が達成でき
る効果がある。
As described above, according to the present invention, when high-power microwaves are incident, both FETs are biased so that they have low impedance.
RF applied between the drain and source electrodes of the FET
The voltage will be lower and will not cause damage to the FET.
Therefore, there is no need for FETs with high breakdown voltages, which greatly contributes to improving the yield of switches. Furthermore, since there is no need to lower the RF voltage applied to the FET by using a 1/2 wavelength low impedance line as in the past, there is an effect that miniaturization can be achieved.

【図面の簡単な説明】[Brief explanation of drawings]

第1図はこの発明の一実施例によるマイクロ波
半導体スイツチの構造を示す図、第2図は第1図
に示したマイクロ波半導体スイツチの等価回路
図、第3図は従来のマイクロ波半導体スイツチの
構造を示す図、第4図は第3図の等価回路図であ
る。 2は半導体基板、3は第1の入出力線路、4は
第2の入出力線路、5は第3の入出力線路、8は
第1の電界効果トランジスタ、9は第1の電界効
果トランジスタのソース電極、10は第1の電界
効果トランジスタのドレイン電極、11は第1の
電界効果トランジスタのゲート電極、13は第2
の電界効果トランジスタ、14は第2の電界効果
トランジスタのソース電極、15は第2の電界効
果トランジスタのドレイン電極、16は第2の電
界効果トランジスタのゲート電極、17はバイア
ス回路、20は接続点である。なお、図中、同一
符号は同一、又は相当部分を示す。
FIG. 1 is a diagram showing the structure of a microwave semiconductor switch according to an embodiment of the present invention, FIG. 2 is an equivalent circuit diagram of the microwave semiconductor switch shown in FIG. 1, and FIG. 3 is a diagram showing a conventional microwave semiconductor switch. FIG. 4 is an equivalent circuit diagram of FIG. 3. 2 is a semiconductor substrate, 3 is a first input/output line, 4 is a second input/output line, 5 is a third input/output line, 8 is a first field effect transistor, and 9 is a first field effect transistor. A source electrode, 10 a drain electrode of the first field effect transistor, 11 a gate electrode of the first field effect transistor, 13 a second field effect transistor
14 is a source electrode of the second field effect transistor, 15 is a drain electrode of the second field effect transistor, 16 is a gate electrode of the second field effect transistor, 17 is a bias circuit, and 20 is a connection point. It is. In addition, in the figures, the same reference numerals indicate the same or equivalent parts.

Claims (1)

【特許請求の範囲】[Claims] 1 半導体基板に電界効果トランジスタとマイク
ロストリツプ線路とでなる回路素子を一体構成
し、上記の電界効果トランジスタのドレイン電
極、ソース電極を同電位とし、ゲート電極に印加
するバイアス電圧を変えることによりマイクロス
トリツプ線路を伝搬するマイクロ波の伝搬径路を
切り換えるマイクロ波半導体スイツチにおいて、
第1の入出力線路と第2の入出力線路および第3
の入出力線路の接続点の近傍において、上記接続
点と第2の入出力線路とに直列に第1の電界効果
トランジスタのドレイン電極とソース電極を接続
し、かつ、上記接続点から略1/4波長の長さの第
3の入出力線路の位置に、第3の入出力線路に対
して並列に、ソース電極を接地した第2の電界効
果トランジスタのドレイン電極を接続した構成と
したことを特徴とするマイクロ波半導体スイツ
チ。
1. By integrally configuring a circuit element consisting of a field effect transistor and a microstrip line on a semiconductor substrate, setting the drain electrode and source electrode of the above field effect transistor to the same potential, and changing the bias voltage applied to the gate electrode. In a microwave semiconductor switch that switches the propagation path of microwaves propagating through a microstrip line,
The first input/output line, the second input/output line, and the third input/output line.
The drain electrode and the source electrode of the first field effect transistor are connected in series to the connection point and the second input/output line in the vicinity of the connection point of the input/output line, and approximately 1/2 from the connection point. The configuration is such that the drain electrode of a second field effect transistor whose source electrode is grounded is connected to the position of the third input/output line having a length of four wavelengths in parallel to the third input/output line. Features of microwave semiconductor switch.
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