JPH0351359B2 - - Google Patents
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- JPH0351359B2 JPH0351359B2 JP59041175A JP4117584A JPH0351359B2 JP H0351359 B2 JPH0351359 B2 JP H0351359B2 JP 59041175 A JP59041175 A JP 59041175A JP 4117584 A JP4117584 A JP 4117584A JP H0351359 B2 JPH0351359 B2 JP H0351359B2
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- JP
- Japan
- Prior art keywords
- transistor
- balanced
- signal
- clamp
- circuit
- Prior art date
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Links
- 239000003990 capacitor Substances 0.000 claims description 4
- 238000005513 bias potential Methods 0.000 description 8
- 238000010586 diagram Methods 0.000 description 6
- 239000002131 composite material Substances 0.000 description 4
- NJPPVKZQTLUDBO-UHFFFAOYSA-N novaluron Chemical compound C1=C(Cl)C(OC(F)(F)C(OC(F)(F)F)F)=CC=C1NC(=O)NC(=O)C1=C(F)C=CC=C1F NJPPVKZQTLUDBO-UHFFFAOYSA-N 0.000 description 3
- 239000000969 carrier Substances 0.000 description 2
- 239000003086 colorant Substances 0.000 description 2
- 230000002265 prevention Effects 0.000 description 1
Classifications
-
- H—ELECTRICITY
- H03—ELECTRONIC CIRCUITRY
- H03C—MODULATION
- H03C1/00—Amplitude modulation
- H03C1/52—Modulators in which carrier or one sideband is wholly or partially suppressed
- H03C1/54—Balanced modulators, e.g. bridge type, ring type or double balanced type
Landscapes
- Processing Of Color Television Signals (AREA)
- Amplitude Modulation (AREA)
- Picture Signal Circuits (AREA)
Description
【発明の詳細な説明】
この発明は平衡変調回路に係り、特に、キヤリ
アリーク防止の無調整化に関する。
アリーク防止の無調整化に関する。
第１図はテレビジヨン受像機やビデオカメラ等
の映像変調系統に設置される平衡変調回路を示し
ている。この平衡変調回路には、キヤリアを色差
信号で平衡変調すべき一対の平衡変調器２Ａ，２
Ｂが設置されている。各平衡変調器２Ａ，２Ｂに
は、共通のバイアス電源４からバイアス電位が与
えられ、また、信号入力端子６Ａ，６Ｂには、コ
ンデンサ８Ａ，８Ｂを介して色差信号Ｒ−Ｙ、Ｂ
−Ｙが加えられているとともに、可変抵抗１０
Ａ，１０Ｂで基準電圧VBを分圧して得た電圧が
抵抗１２Ａ，１２Ｂを介して加えられている。
の映像変調系統に設置される平衡変調回路を示し
ている。この平衡変調回路には、キヤリアを色差
信号で平衡変調すべき一対の平衡変調器２Ａ，２
Ｂが設置されている。各平衡変調器２Ａ，２Ｂに
は、共通のバイアス電源４からバイアス電位が与
えられ、また、信号入力端子６Ａ，６Ｂには、コ
ンデンサ８Ａ，８Ｂを介して色差信号Ｒ−Ｙ、Ｂ
−Ｙが加えられているとともに、可変抵抗１０
Ａ，１０Ｂで基準電圧VBを分圧して得た電圧が
抵抗１２Ａ，１２Ｂを介して加えられている。
各平衡変調器２Ａ，２Ｂの出力は、加算器１４
で加算されてクロマ信号ｃとなり、この信号には
次の加算器１６で輝度信号Ｙが加算され、第２図
に示す合成映像信号が形成される。この合成映像
信号において、SHは水平同期信号、SBはカラーバ
ースト信号、SCは色信号である。
で加算されてクロマ信号ｃとなり、この信号には
次の加算器１６で輝度信号Ｙが加算され、第２図
に示す合成映像信号が形成される。この合成映像
信号において、SHは水平同期信号、SBはカラーバ
ースト信号、SCは色信号である。
このような平衡変調回路において、キヤリアリ
ークが生じると、適正な色を形成できないおそれ
がある。
ークが生じると、適正な色を形成できないおそれ
がある。
そこで、信号入力端子６Ａ，６Ｂに加わる直流
バイアス電位を可変抵抗１０Ａ，１０Ｂで所定の
バイアス電位に調整し、キヤリアリークが少ない
最良点に設定している。
バイアス電位を可変抵抗１０Ａ，１０Ｂで所定の
バイアス電位に調整し、キヤリアリークが少ない
最良点に設定している。
しかしながら、このような最良点範囲は非常に
狭く、その調整が面倒であるとともに、電源電圧
VCCの変動や温度特性等の影響を受け易い欠点が
ある。
狭く、その調整が面倒であるとともに、電源電圧
VCCの変動や温度特性等の影響を受け易い欠点が
ある。
そこで、この発明は、キヤリアリーク最良点の
無調整化を実現した平衡変調回路の提供を目的と
する。
無調整化を実現した平衡変調回路の提供を目的と
する。
即ち、この発明の平衡変調回路は、キヤリアを
第１の色差信号で平衡変調をする第１の平衡変調
器２Ａと、キヤリアを第２の色差信号で平衡変調
をする第２の平衡変調器２Ｂと、前記第１及び第
２の平衡変調器の前記第１及び第２の色差信号の
各入力部に個別に各入力部を一定の直流電位にク
ランプすべきクランプ回路２０Ａ，２０Ｂを設置
した平衡変調回路において、エミツタ間を共通に
した第１及び第２のトランジスタ６２，６４から
なる差動対の前記第１及び第２のトランジスタの
エミツタ側に第３のトランジスタ６０を設置し、
前記第１のトランジスタのベースに一定のバイア
ス電圧、前記第２のトランジスタのベース側にコ
ンデンサ８Ａ，８Ｂを通して前記第１又は第２の
色差信号、前記第３のトランジスタのベースにク
ランプ信号を加え、前記差動対に発生する出力を
前記第２のトランジスタに全帰還させるように前
記クランプ回路を構成したことを特徴とする。
第１の色差信号で平衡変調をする第１の平衡変調
器２Ａと、キヤリアを第２の色差信号で平衡変調
をする第２の平衡変調器２Ｂと、前記第１及び第
２の平衡変調器の前記第１及び第２の色差信号の
各入力部に個別に各入力部を一定の直流電位にク
ランプすべきクランプ回路２０Ａ，２０Ｂを設置
した平衡変調回路において、エミツタ間を共通に
した第１及び第２のトランジスタ６２，６４から
なる差動対の前記第１及び第２のトランジスタの
エミツタ側に第３のトランジスタ６０を設置し、
前記第１のトランジスタのベースに一定のバイア
ス電圧、前記第２のトランジスタのベース側にコ
ンデンサ８Ａ，８Ｂを通して前記第１又は第２の
色差信号、前記第３のトランジスタのベースにク
ランプ信号を加え、前記差動対に発生する出力を
前記第２のトランジスタに全帰還させるように前
記クランプ回路を構成したことを特徴とする。
以下、この発明を図面に示した実施例を参照し
て詳細に説明する。
て詳細に説明する。
第３図はこの発明の平衡変調回路の実施例を示
し、第１図に示す平衡変調回路と同一部分には同
一符号を付してある。
し、第１図に示す平衡変調回路と同一部分には同
一符号を付してある。
第３図において、第１及び第２の２Ａ，２Ｂの
入力部には、ペデスタルクランプ回路２０Ａ，２
０Ｂが設置され、一定の時間間隔でその入力部を
所定の直流バイアス電位にクランプできるように
成つている。
入力部には、ペデスタルクランプ回路２０Ａ，２
０Ｂが設置され、一定の時間間隔でその入力部を
所定の直流バイアス電位にクランプできるように
成つている。
各ペデスタルクランプ回路２０Ａ，２０Ｂに
は、タイミング回路２２からクランプ信号が与え
られ、このクランプ信号は水平同期信号に応動し
て形成される。
は、タイミング回路２２からクランプ信号が与え
られ、このクランプ信号は水平同期信号に応動し
て形成される。
以上の構成において、その動作を第４図を参照
して説明する。
して説明する。
第４図において、Ａは合成映像信号の一部を示
し、ｔは帰線消去区間、SHは水平同期信号であ
る。Ｂは、タイミング回路２２が発生するクラン
プ信号、Ｃは入力端子６Ａに加えられる第１の色
差信号であるＲ−Ｙ信号、Ｄは入力端子６Ｂに加
えられる第２の色差信号であるＢ−Ｙ信号であ
る。
し、ｔは帰線消去区間、SHは水平同期信号であ
る。Ｂは、タイミング回路２２が発生するクラン
プ信号、Ｃは入力端子６Ａに加えられる第１の色
差信号であるＲ−Ｙ信号、Ｄは入力端子６Ｂに加
えられる第２の色差信号であるＢ−Ｙ信号であ
る。
タイミング回路２２は、水平同期信号SHの発生
タイミングに応動して第４図Ｂに示すクランプ信
号を発生し、各ペデスタルクランプ回路２０Ａ，
２０Ｂに加える。tcはクランプ区間を示し、この
時間内に平衡変調器２Ａ，２Ｂの入力部の直流電
位が所定のバイアス電位VBに設定されることに
なる。
タイミングに応動して第４図Ｂに示すクランプ信
号を発生し、各ペデスタルクランプ回路２０Ａ，
２０Ｂに加える。tcはクランプ区間を示し、この
時間内に平衡変調器２Ａ，２Ｂの入力部の直流電
位が所定のバイアス電位VBに設定されることに
なる。
このような構成によれば、帰線消去区間におい
て、平衡変調器２Ａ，２Ｂの入力部が所定の直流
バイアス電位に設定されるので、無調整でキヤリ
アリーク最良点を常に維持することができ、正確
な色を実現することができる。
て、平衡変調器２Ａ，２Ｂの入力部が所定の直流
バイアス電位に設定されるので、無調整でキヤリ
アリーク最良点を常に維持することができ、正確
な色を実現することができる。
また、バイアスレベルが直流バイアス電位VB
に一致しているため、電源電圧VCCの変動や温度
特性の影響を受けることがない。
に一致しているため、電源電圧VCCの変動や温度
特性の影響を受けることがない。
第５図はこの発明の平衡変調回路の具体的な回
路構成例を示し、第３図に示す実施例と同一部分
には同一符号を付してある。
路構成例を示し、第３図に示す実施例と同一部分
には同一符号を付してある。
第５図において、平衡変調器２Ａ，２Ｂは、ト
ランジスタ２４，２６，２８，３０，３２，３
４、抵抗３６，３８，４０，４２及び定電流源４
４で構成され、電源端子４６とコモンラインとの
間には、駆動電源が接続され、VCCはその電圧で
ある。トランジスタ２４，３０のベース、トラン
ジスタ２６，２８のベースには、キヤリアが加え
られる。
ランジスタ２４，２６，２８，３０，３２，３
４、抵抗３６，３８，４０，４２及び定電流源４
４で構成され、電源端子４６とコモンラインとの
間には、駆動電源が接続され、VCCはその電圧で
ある。トランジスタ２４，３０のベース、トラン
ジスタ２６，２８のベースには、キヤリアが加え
られる。
そして、クランプ回路２０Ａ，２０Ｂは、トラ
ンジスタ５０，５２，５４，５６，５８から成る
スイツチング回路で構成されている。即ち、トラ
ンジスタ５０，５２は、コレクタ・エミツタを互
いに共通にするとともに、ベースを共通にしてア
ナログスイツチを構成している。トランジスタ５
４，５６は電流反転回路を構成し、トランジスタ
５８はそのベースに加えられるクランプパルス信
号により導通状態になるスイツチを構成してい
る。
ンジスタ５０，５２，５４，５６，５８から成る
スイツチング回路で構成されている。即ち、トラ
ンジスタ５０，５２は、コレクタ・エミツタを互
いに共通にするとともに、ベースを共通にしてア
ナログスイツチを構成している。トランジスタ５
４，５６は電流反転回路を構成し、トランジスタ
５８はそのベースに加えられるクランプパルス信
号により導通状態になるスイツチを構成してい
る。
このような構成によれば、トランジスタ５８の
ベースに加えられるクランプパルスに応動してト
ランジスタ３４のベース電位を電圧源４で設定さ
れる直流バイアス電位VBにクランプすることが
できる。
ベースに加えられるクランプパルスに応動してト
ランジスタ３４のベース電位を電圧源４で設定さ
れる直流バイアス電位VBにクランプすることが
できる。
また、第６図はクランプ回路２０Ａ，２０Ｂの
他の回路構成例を示し、第５図に示す実施例と同
一部分には同一符号を付してある。即ち、この実
施例のクランプ回路２０Ａ，２０Ｂは、差動対を
成す第１及び第２のトランジスタ６２，６４、ク
ランプ信号がベースに加えられてその差動対に動
作電流を流す第３のトランジスタ６０、差動対に
対して能動負荷をなすトランジスタ６６及びダイ
オード７０、トランジスタ６４のコレクタ側から
取り出される出力をトランジスタ６４のベース側
に全帰還するトランジスタ６８で構成されてい
る。即ち、この実施例のクランプ回路２０Ａ，２
０Ｂは差動増幅器で構成され、トランジスタ６０
がクランプパルスによつて導通状態になると、ト
ランジスタ６４のベースには、直流バイアス電圧
VBが発生し、平衡変調器２Ａ又は２Ｂのトラン
ジスタ３４のベース電位をその電圧にクランプす
ることができる。
他の回路構成例を示し、第５図に示す実施例と同
一部分には同一符号を付してある。即ち、この実
施例のクランプ回路２０Ａ，２０Ｂは、差動対を
成す第１及び第２のトランジスタ６２，６４、ク
ランプ信号がベースに加えられてその差動対に動
作電流を流す第３のトランジスタ６０、差動対に
対して能動負荷をなすトランジスタ６６及びダイ
オード７０、トランジスタ６４のコレクタ側から
取り出される出力をトランジスタ６４のベース側
に全帰還するトランジスタ６８で構成されてい
る。即ち、この実施例のクランプ回路２０Ａ，２
０Ｂは差動増幅器で構成され、トランジスタ６０
がクランプパルスによつて導通状態になると、ト
ランジスタ６４のベースには、直流バイアス電圧
VBが発生し、平衡変調器２Ａ又は２Ｂのトラン
ジスタ３４のベース電位をその電圧にクランプす
ることができる。
以上説明したように、この発明によれば、第１
及び第２の平衡変調器の直流バイアスレベルを無
調整で合致することができるとともに、無調整で
キヤリアリーク最良点を設定でき、その最良点に
ついて電源電圧の変動や温度特性の影響を回避し
て安定した動作特性を得ることができる。
及び第２の平衡変調器の直流バイアスレベルを無
調整で合致することができるとともに、無調整で
キヤリアリーク最良点を設定でき、その最良点に
ついて電源電圧の変動や温度特性の影響を回避し
て安定した動作特性を得ることができる。
第１図は従来の平衡変調回路を示すブロツク
図、第２図は合成映像信号を示す説明図、第３図
はこの発明の平衡変調回路の実施例を示すブロツ
ク図、第４図はその動作波形を示す説明図、第５
図はこの発明の平衡変調回路の具体的な回路構成
例を示す回路図、第６図はクランプ回路の他の実
施例を示す回路図である。 ２Ａ……第１の平衡変調器、２Ｂ……第２の平
衡変調器、８Ａ，８Ｂ……コンデンサ、２０Ａ，
２０Ｂ……クランプ回路、６０……第３のトラン
ジスタ、６２……第１のトランジスタ、６４……
第２のトランジスタ。
図、第２図は合成映像信号を示す説明図、第３図
はこの発明の平衡変調回路の実施例を示すブロツ
ク図、第４図はその動作波形を示す説明図、第５
図はこの発明の平衡変調回路の具体的な回路構成
例を示す回路図、第６図はクランプ回路の他の実
施例を示す回路図である。 ２Ａ……第１の平衡変調器、２Ｂ……第２の平
衡変調器、８Ａ，８Ｂ……コンデンサ、２０Ａ，
２０Ｂ……クランプ回路、６０……第３のトラン
ジスタ、６２……第１のトランジスタ、６４……
第２のトランジスタ。
Claims (1)
- 【特許請求の範囲】 １ キヤリアを第１の色差信号で平衡変調をする
第１の平衡変調器と、 キヤリアを第２の色差信号で平衡変調をする第
２の平衡変調器と、 前記第１及び第２の平衡変調器の前記第１及び
第２の色差信号の各入力部に個別に各入力部を一
定の直流電位にクランプすべきクランプ回路を設
置した平衡変調回路において、 エミツタ間を共通にした第１及び第２のトラン
ジスタからなる差動対の前記第１及び第２のトラ
ンジスタのエミツタ側に第３のトランジスタを設
置し、前記第１のトランジスタのベースに一定の
バイアス電圧、前記第２のトランジスタのベース
側にコンデンサを通して前記第１又は第２の色差
信号、前記第３のトランジスタのベースにクラン
プ信号を加え、前記差動対に発生する出力を前記
第２のトランジスタに全帰還させるように前記ク
ランプ回路を構成したことを特徴とする平衡変調
回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP59041175A JPS60185405A (ja) | 1984-03-02 | 1984-03-02 | 平衡変調回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP59041175A JPS60185405A (ja) | 1984-03-02 | 1984-03-02 | 平衡変調回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS60185405A JPS60185405A (ja) | 1985-09-20 |
| JPH0351359B2 true JPH0351359B2 (ja) | 1991-08-06 |
Family
ID=12601088
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP59041175A Granted JPS60185405A (ja) | 1984-03-02 | 1984-03-02 | 平衡変調回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS60185405A (ja) |
Families Citing this family (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH0746875B2 (ja) * | 1986-01-20 | 1995-05-17 | 松下電器産業株式会社 | 磁気記録再生装置 |
Citations (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5591278A (en) * | 1978-12-28 | 1980-07-10 | Nec Home Electronics Ltd | Color submodulator |
| JPS56126394A (en) * | 1980-03-11 | 1981-10-03 | Nec Corp | Color modulating circuit |
-
1984
- 1984-03-02 JP JP59041175A patent/JPS60185405A/ja active Granted
Patent Citations (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5591278A (en) * | 1978-12-28 | 1980-07-10 | Nec Home Electronics Ltd | Color submodulator |
| JPS56126394A (en) * | 1980-03-11 | 1981-10-03 | Nec Corp | Color modulating circuit |
Also Published As
| Publication number | Publication date |
|---|---|
| JPS60185405A (ja) | 1985-09-20 |
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| EXPY | Cancellation because of completion of term |