JPH0325954U - - Google Patents

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JPH0325954U
JPH0325954U JP8477789U JP8477789U JPH0325954U JP H0325954 U JPH0325954 U JP H0325954U JP 8477789 U JP8477789 U JP 8477789U JP 8477789 U JP8477789 U JP 8477789U JP H0325954 U JPH0325954 U JP H0325954U
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【図面の簡単な説明】
第1図は本考案の一実施例の回路構成を示すブ
ロツク図、第2図および第3図は同実施例を説明
するためのフローチヤート、第4図は同実施例の
表示部での表示例を説明するための図である。 1……キー入力部、2……制御部、3……デー
タメモリ、4……項目メモリ、5……表示バツフ
ア、6……ポインタ制御部、7……カウンタ、8
……ブランク発生部、9……フラグ、10……表
示部。

Claims (1)

    【実用新案登録請求の範囲】
  1. 複数の項目に関して情報を記憶する情報記憶手
    段と、複数の項目名を記憶した項目記憶手段と、
    表示手段と、項目名表示指示がある場合は上記項
    目記憶手段より項目名を読み出すとともに上記情
    報記憶手段より項目名に対応する情報を読み出し
    これら項目名および情報を上記表示手段に表示さ
    せる制御手段とを具備したことを特徴とする情報
    表示装置。
JP8477789U 1989-07-19 1989-07-19 Pending JPH0325954U (ja)

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JPH0325954U true JPH0325954U (ja) 1991-03-18

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