JPH0298854A - Tracking control circuit for rotary head type digital tape recorder - Google Patents

Tracking control circuit for rotary head type digital tape recorder

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Publication number
JPH0298854A
JPH0298854A JP63250107A JP25010788A JPH0298854A JP H0298854 A JPH0298854 A JP H0298854A JP 63250107 A JP63250107 A JP 63250107A JP 25010788 A JP25010788 A JP 25010788A JP H0298854 A JPH0298854 A JP H0298854A
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JP
Japan
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circuit
tracking
tracking control
signal
control circuit
Prior art date
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Pending
Application number
JP63250107A
Other languages
Japanese (ja)
Inventor
Tetsuya Taki
哲也 滝
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Sanyo Electric Co Ltd
Original Assignee
Sanyo Electric Co Ltd
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Filing date
Publication date
Application filed by Sanyo Electric Co Ltd filed Critical Sanyo Electric Co Ltd
Priority to JP63250107A priority Critical patent/JPH0298854A/en
Publication of JPH0298854A publication Critical patent/JPH0298854A/en
Pending legal-status Critical Current

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Abstract

PURPOSE:To reduce the power consumption by providing a sample-hold circuit which holds the tracking error signal of a tracking control circuit and a circuit which cuts off a circuit bias voltage other than a logic circuit which outputs at least sampling pulses. CONSTITUTION:A detection signal 26 obtained by a tracking area detection part T is used to control 1st - 6th transistors TR1 - TR6 and an 8th transistor TR8 for controlling bias voltages of a regenerative amplifier 1, a low-pass filter circuit 2, an envelope detector 3, a 1st sample-hold circuit 4, a subtracter 8, an equalizer circuit 5, and a zero-cross comparator 6. Then when the detection signal 26 is high, namely, when a head traces a part other than a tracking area, a 10th TR10 is turned on the ground a source voltage Vcc from a 11th TR11 and the TR1 - TR6 and TR8 turn off to cut off the bias voltages. Consequently, the power consumption is reducible and the life of a battery is prolonged.

Description

【発明の詳細な説明】 (イ) 産業上の利用分野 本発明は回転ヘッド式ディジタルオーディオテープレコ
ーダ(以下、R−DATと称す)のトラッキング制御回
路に関する。
DETAILED DESCRIPTION OF THE INVENTION (a) Field of Industrial Application The present invention relates to a tracking control circuit for a rotary head type digital audio tape recorder (hereinafter referred to as R-DAT).

(ロ)従来の技術 従来、回転ヘッド式ディジタルオーディオテープレコー
ダー(以下、R−DATと称す)のトラッキング制御は
エリア分割型ATF方式を採用しており、具体的には記
録・再生用の回転ヘッドにてヘリカルスキャンされるテ
ープの各トラックのトレース始端部とトレース終端部と
に夫々トラッキング領域を形成し、この各トラッキング
領域にトラッキング制御のためのパイロット信号が記録
されるパイロットエリアとこのパイロット信号のサンプ
リングのタイミングを設定するためのシンク信号が記録
されるシンクエリアとを夫々設け、このシンク信号の周
波数を1トラツクごとに区別し、且つ、そのエリア長も
2トラツクごとに区別する4トラツク完結型にしている
。即ち、斯る4トラツク完結型のテープパターンは第3
図に示すようになっており、flは130.67にHt
のパイロット信号、f2は522.67にHzのシンク
信号、f3は784にHz、のシンク信号、f4は1゜
568Mtlxの消去信号で、これらシンク信号は2ト
ラツクごとに0.5.1ブロツクとそのエリア長が変更
されている。
(B) Conventional technology Conventionally, tracking control of a rotary head type digital audio tape recorder (hereinafter referred to as R-DAT) has adopted an area-divided ATF method. A tracking area is formed at the trace start end and trace end of each track of the tape to be helically scanned, and each tracking area has a pilot area where a pilot signal for tracking control is recorded and a pilot area where a pilot signal for tracking control is recorded. A 4-track complete type that has a sync area in which a sync signal for setting the sampling timing is recorded, and the frequency of this sync signal is differentiated for each track, and the area length is also differentiated for every 2 tracks. I have to. That is, such a four-track complete tape pattern is
As shown in the figure, fl is 130.67 and Ht
f2 is a 522.67 Hz sync signal, f3 is a 784 Hz sync signal, f4 is a 1°568 Mtlx cancellation signal, and these sync signals are divided into 0.5.1 blocks every two tracks. The area length has been changed.

従って、この様なテープパターンが記録されたテープを
、ヘッド幅がトラック幅よりも大きい2個の記録・再生
用の回転ヘッドにより再生した場合、その回転ヘッドの
再生出力からシンク信号が検出されるタイミングに基づ
いて左右の隣接トラック夫々のパイロットエリアから再
生されたパイロット信号のクロストーク成分(以下パイ
ロットサイドリード信号と称す)をサンプリングし、こ
の両サイドリード信号のレベルを比較検出して、そのレ
ベル差をトラッキングエラー信号としてキャプスタンモ
ータ制御部に供給することで再生時のトラッキング制御
(この信号が零になるようにテープ走行制御)を行なわ
せている。具体的に、トラッキング制御回路は第4図に
示す様な構成になっており、例えば一方の記録・再生用
の回転ヘッドによりトラックの始端部が再生トレースさ
れると、この回転ヘッドの再生出力は再生アンプ(1)
によって増幅された後パイロット信号を抽出するローパ
スフィルタ回路(2)に供給される。
Therefore, when a tape on which such a tape pattern has been recorded is played back using two rotary recording/playback heads whose head width is larger than the track width, a sync signal is detected from the playback output of the rotary heads. Based on the timing, the crosstalk components of the pilot signals reproduced from the pilot areas of the left and right adjacent tracks (hereinafter referred to as pilot side lead signals) are sampled, and the levels of both side lead signals are compared and detected to determine the level. By supplying the difference as a tracking error signal to the capstan motor control section, tracking control during playback (tape running control so that this signal becomes zero) is performed. Specifically, the tracking control circuit has a configuration as shown in FIG. 4. For example, when the starting end of a track is reproduced and traced by one of the recording/reproducing rotary heads, the reproduction output of this rotary head is Playback amplifier (1)
After being amplified by the pilot signal, the pilot signal is supplied to a low-pass filter circuit (2) for extracting the pilot signal.

このローパスフィルタ回路(2)から得られるパイロッ
ト信号成分は第5図に示すようにトレースするホームト
ラックからのパイロット信号PMと隣接する左右トラッ
ク、即ち右トラツクからのパイロットサイドリード信号
P8と、左トラツクからのパイロットサイドリード信号
Pt、とから成っている。このようにローパスフィルタ
回路(2)によって抽出されたパイロット信号成分はエ
ンベロープ検波器(3)によってエンベロープ検波され
た後、第1サンプルホールド回路(4)に供給される。
The pilot signal components obtained from this low-pass filter circuit (2) are, as shown in FIG. and a pilot side read signal Pt from. The pilot signal component extracted by the low-pass filter circuit (2) in this manner is envelope-detected by an envelope detector (3) and then supplied to a first sample-and-hold circuit (4).

一方、記録・再生用の回転ヘッドからの再生信号はイコ
ライザ回路(5)によって波形等価された後、ゼロクロ
スコンパレータ(6)によってディジタル信号に変換さ
れる。そしてロジック回路(7)はこの信号をディジタ
ル処理し第5図に示す如くシンク信号を検知すると同時
に第5図に示すタイミングでパイロット信号をサンプリ
ングするためのサンプリングパルスSPIを第1サンプ
ルホールド回路(4)に供給する。従って、第1サンプ
リングホールド回路(4)ではこのサンプリングパルス
SP1によってパイロットサイドリード信号P、Iがホ
ールドされ、このパイロットサイドリード信号PRとP
tの差が減算器(8)から第2サンプルホールド回路(
9)に供給される。この時ロジック回路(7)から第5
図に示すサンプリングパルスSP2が第2サンプルホー
ルド回路(9)に供給される。従って2このサンプリン
グパルスSP2によって第2サンプルホールド回路(9
)ではパイロットサイドリード信号PRとPLの差がホ
ールドされて出力され、この出力信号がトラッキングエ
ラー信号としてキャプスタンモータ制御部に供給され、
トラッキング制御が行なわれることになる。
On the other hand, a reproduction signal from a rotary head for recording and reproduction is waveform-equalized by an equalizer circuit (5) and then converted into a digital signal by a zero-cross comparator (6). Then, the logic circuit (7) digitally processes this signal, detects the sync signal as shown in FIG. ). Therefore, in the first sampling and hold circuit (4), the pilot side read signals P and I are held by this sampling pulse SP1, and the pilot side read signals PR and P
The difference in t is transferred from the subtracter (8) to the second sample and hold circuit (
9). At this time, the fifth
A sampling pulse SP2 shown in the figure is supplied to a second sample and hold circuit (9). Therefore, by this sampling pulse SP2, the second sample hold circuit (9
), the difference between the pilot side read signals PR and PL is held and output, and this output signal is supplied to the capstan motor control section as a tracking error signal.
Tracking control will be performed.

尚、トラッキング制御に関しては例えば特開昭61−4
2768号公報(GIIB  15/467)に記載さ
れたものがある。
Regarding tracking control, for example, Japanese Patent Application Laid-Open No. 61-4
There is one described in Publication No. 2768 (GIIB 15/467).

(ハ) 発明が解決しよう、とする課題上記の如くトラ
ッキング制御方法では、回転ヘッドがトラッキング領域
をトレースする期間だけ再生信号よりトラッキングエラ
ー信号が得られ、トラッキング領域以外の領域をトレー
スする期間はその信号が保持されているだけである。つ
まり、トラッキング制御回路が働いているのは実質上、
トラッキング領域をトレースする期間だけであるので、
トラッキング制御回路を常時動作させておく必要はなく
、特に低消費電力を考えなければならない用途にはたい
へんな負担となっていた。
(c) Problems to be Solved by the Invention In the tracking control method as described above, a tracking error signal is obtained from the reproduced signal only during the period when the rotary head traces the tracking area, and during the period when the rotating head traces the area other than the tracking area. Only the signal is maintained. In other words, the tracking control circuit is actually working by
Since it is only the period during which the tracking area is traced,
It is not necessary to keep the tracking control circuit running all the time, which is a heavy burden, especially in applications where low power consumption must be considered.

(ニ)課題を解決するための手段 本発明はテープの各トラックに記録されたトラッキング
領域を検出する回路と、トラッキング制御回路のトラッ
キングエラー信号を保持するサンプルホールド回路及び
少くともサンプリングパルスを出力するロジック回路以
外の回路バイアス電圧をしゃ断する回路を備えたR−D
ATのトラッキング制御回路を提供する。
(D) Means for Solving the Problems The present invention includes a circuit for detecting a tracking area recorded on each track of a tape, a sample hold circuit for holding a tracking error signal of a tracking control circuit, and outputting at least a sampling pulse. R-D equipped with a circuit that cuts off circuit bias voltage other than logic circuits
Provides an AT tracking control circuit.

(ホ)作用 上記手段によると、回転ヘッドがトラッキング領域をト
レースする期間は再生信号よりトラッキングエラー信号
を得るためにトラッキング制御回路を構成するすべての
回路にバイアス電圧を印加し、トラッキング領域以外の
領域をトレースする期間はトラッキング制御回路のトラ
ッキングエラー信号を保持するサンプルホールド回路及
びサンプリングパルスを出力するロジック回路以外の回
路バイアス電圧をしゃ断するように作用する。
(E) Effect According to the above means, during the period when the rotary head traces the tracking area, a bias voltage is applied to all the circuits constituting the tracking control circuit in order to obtain the tracking error signal from the reproduced signal, and the area other than the tracking area is During the tracing period, the circuit bias voltage of the tracking control circuit other than the sample hold circuit that holds the tracking error signal and the logic circuit that outputs the sampling pulse is cut off.

(へ) 実施例 本発明の一実施例について図面を参照して説明する。第
1図は回路構成を示すブロック図で、従来のものと重複
する部分を省略し、第4図に示された従来のブロックに
付加された部分について説明する。
(f) Embodiment An embodiment of the present invention will be described with reference to the drawings. FIG. 1 is a block diagram showing a circuit configuration, parts that overlap with the conventional one are omitted, and parts added to the conventional block shown in FIG. 4 will be explained.

同図に於いて、(21)はカウンタ回路で、クロック端
子(22)よりR−DATのシステムクロックである9
、408MHxを1/7□0に分周して得られるクロッ
クが入力される。(23)はリセット信号生成回路で、
第2サンプリングパルス(SF3>が入力され、そのタ
イミングで前記カウンタ回路(21)をリセットする。
In the figure, (21) is a counter circuit, and the clock terminal (22) is connected to the R-DAT system clock 9.
, 408MHx divided by 1/7□0 is input. (23) is a reset signal generation circuit,
A second sampling pulse (SF3>) is input, and the counter circuit (21) is reset at that timing.

第2サンプリングパルス(SF3)を基準にして前記カ
ウンタ回路(21)で前記クロックによりカウントを行
ない、そのカウンター回IY!<211の出力をデコー
ダ(24)でデコードすると第2図(C)の如きトラッ
キングエラー検出信号を得るのである。すなわち、R−
DATのテープフォーマット(第3図参照)より第2サ
ンプリングパルス(SF3)の出力される位置がわかっ
ているので第2サンプリングパルス(SF3)を基準に
カウントを行なえばトラッキングエリアの位置が正確に
わかるのである。
The counter circuit (21) performs counting using the clock based on the second sampling pulse (SF3), and the counter times IY! When the output of <211 is decoded by the decoder (24), a tracking error detection signal as shown in FIG. 2(C) is obtained. That is, R-
Since the output position of the second sampling pulse (SF3) is known from the DAT tape format (see Figure 3), the position of the tracking area can be accurately determined by counting based on the second sampling pulse (SF3). It is.

ただし、ドロップアウト等で第2サンプリングパルス(
SF3)が得られなかった場合には、カウンタ回路(2
1)自身のカウント値によりリセットを行なうようにす
る。さらに、立上り時などのシリングの回転数が一定し
ていない場合は第2サンプリングパルス(SF3)の出
現する位置が非常に不正確であるためカウンタ回路(2
1)をシリンダロック信号(25)によってリセットし
くそのときのシリンダロック信号はハイ状態)カウント
動作を行なわないようにする。また、トラッキングエリ
ア検出信号(26)は第2サンプリングパルス(SF3
)のデイレイやジッタを考慮してトラッキングエリアで
あると判断する位置は十分なマージンをもって設定して
おく必要がある。上記の如きカウンター回F#1(21
)、リセット信号生成回路(23)及びデコーダ回路(
24)の3つの回路で構成されるトラッキングエリア検
出部(T)はアフターレコーディング時の録音・再生切
換えにおけるトラッキングエリアの検出方法としても使
用している。
However, due to dropout etc., the second sampling pulse (
SF3) is not obtained, the counter circuit (2
1) Reset using its own count value. Furthermore, if the rotational speed of the Schilling is not constant, such as at the time of rising, the position where the second sampling pulse (SF3) appears is very inaccurate, so the counter circuit (2
1) is reset by the cylinder lock signal (25) and the cylinder lock signal at that time is in a high state) so that the counting operation is not performed. Further, the tracking area detection signal (26) is the second sampling pulse (SF3
) It is necessary to set the position determined to be the tracking area with a sufficient margin, taking into account delay and jitter. Counter times F#1 (21
), reset signal generation circuit (23) and decoder circuit (
The tracking area detection section (T) consisting of the three circuits 24) is also used as a tracking area detection method during recording/playback switching during after-recording.

上記トラッキングエリア検出部(T)で得られた検出信
号(26)によって再生アンプ(1)、ローパスフィル
タ回路(2)、エンベロープ検波器(3)、第1サンプ
ルホールド回路(4)、減算器(5)、イコライザ回路
(7)及びゼロクロスコンパレータ(8)のバイアス電
圧制御用第1トランジスタ乃至第6トランジスタ(Tr
l)、 (Tr21、(Tr3)、(Tr4)、Itr
5)、(Tr61及び第8トランジスタ(Tr81を制
御するのである。その検出信号(26)がハイのとき(
ヘッドがトラッキングエリア以外をトレースしていると
き)第10トランジスタ(Triθ)がオン状態となり
、第11トランジスタ(Trlllからの電源Vccが
接地状態となり前記トランジスタ(Trl)、 (Tr
2)、(Tr3)、(Tr4)、 (TR5)、 (T
r6)、(T r 8 )はオフ状態となってバイアス
電圧はカットされる。次にトラッキングエリアをトレー
スしている状態では検出信号がローとなり、第10トラ
ンジスタ(TrlOlもロー状態となり、前記トランジ
スタfurl)、(Tr2)、(Tr3)、 (Tr4
)、 (Tr51. (Tr6)、(Tr8)はオン状
態となってバイアス電圧はカットされない。
The detection signal (26) obtained by the tracking area detection section (T) causes the regeneration amplifier (1), the low-pass filter circuit (2), the envelope detector (3), the first sample and hold circuit (4), and the subtracter ( 5), the first to sixth transistors (Tr
l), (Tr21, (Tr3), (Tr4), Itr
5), (Tr61 and the eighth transistor (Tr81) are controlled. When the detection signal (26) is high, (
When the head is tracing an area other than the tracking area), the 10th transistor (Triθ) is turned on, and the power supply Vcc from the 11th transistor (Trll) is grounded, and the transistors (Trl), (Tr
2), (Tr3), (Tr4), (TR5), (T
r6) and (T r 8 ) are turned off and the bias voltage is cut off. Next, while tracing the tracking area, the detection signal becomes low, and the tenth transistor (TrlOl also becomes low, and the transistors furl), (Tr2), (Tr3), (Tr4
), (Tr51. (Tr6) and (Tr8) are in the on state and the bias voltage is not cut.

尚、第2サンプルホールド回路(6)はトラッキングエ
ラー電圧を常にホールドしておく必要があるためバイア
ス電圧は加えたままにしておく。また、ロジック回IY
!(91もシンクシーケンスなどの状態保持の必要から
常にバイアスを加えて動作させておく。
Incidentally, since the second sample and hold circuit (6) must always hold the tracking error voltage, the bias voltage is kept applied. Also, logic times IY
! (91 is also always operated with a bias applied because it is necessary to maintain the state of the sync sequence etc.

(ト)  発明の効果 本発明によると、回転ヘッドがトラッキングエリア以外
をトレースする際、トラッキング制御回路の不必要な回
路のバイアス電圧を切ることで消費電流の低バが可能と
なり、特に、ポータプルユースにおけるバッテリーの長
寿命化が可能となり、極めて有益である。
(G) Effects of the Invention According to the present invention, when the rotating head traces an area other than the tracking area, current consumption can be reduced by cutting off the bias voltage of unnecessary circuits in the tracking control circuit. This makes it possible to extend the life of the battery in the battery, which is extremely beneficial.

さらに、トラッキングエリア以外の頭載をトレースする
期間はトラッキング制御回路を動作させないようにして
いるので、トラッキングエリア以外で得られるシンク信
号でトラッキングエラー信号を送出するようなことがな
くなり、トラッキング制御動作の信頼性が向上する。
Furthermore, since the tracking control circuit is not operated during the period when the head loading other than the tracking area is being traced, a tracking error signal is not sent out using a sync signal obtained outside the tracking area, and the tracking control operation is prevented. Improved reliability.

【図面の簡単な説明】[Brief explanation of drawings]

第1図は本発明のR−DATのトラッキング制御回路を
示すブロック図、第2図はエンベロープ信号、ヘッド切
換信号、第2サンプリングパルス信号、トラッキングエ
リア検出信号及びシリンダロック信号のタイミングを示
す図、第3図はR−DATのテープパターンを示す図、
第4図は従来のトラッキング制御回路を示すブロック図
、第5図はそのトラッキング制御回路を説明するための
各種信号のタイミング図である。 (4)、(9)・・・サンプルホールド回路、(7)・
・・コントロールロジック回路、(T)・・・トラッキ
ングエリア検出器、(Trl)、 (Tr2)、(Tr
3)、(Tr4)、(Tr5)、(tr6)、(Tr8
)、(TrlO)、 (Trll)−バイアス電圧しゃ
断用トランジスタ。
FIG. 1 is a block diagram showing the tracking control circuit of the R-DAT of the present invention, and FIG. 2 is a diagram showing the timing of the envelope signal, head switching signal, second sampling pulse signal, tracking area detection signal, and cylinder lock signal. Figure 3 is a diagram showing the tape pattern of R-DAT,
FIG. 4 is a block diagram showing a conventional tracking control circuit, and FIG. 5 is a timing diagram of various signals for explaining the tracking control circuit. (4), (9)...sample hold circuit, (7)...
...Control logic circuit, (T) ...Tracking area detector, (Trl), (Tr2), (Tr
3), (Tr4), (Tr5), (tr6), (Tr8
), (TrlO), (Trll) - bias voltage cutoff transistors.

Claims (1)

【特許請求の範囲】[Claims] (1)回転ヘッドによりヘリカルスキャンされるテープ
の各トラックに少なくともディジタル情報が記載される
記録領域と、トラッキング制御を行なうための情報が記
録されるトラッキング領域とを分割して形成し、再生時
にトラッキング領域で得られたトラッキングエラー信号
に基づいてトラッキング制御を行なう回転ヘッド式ディ
ジタルオーディオテープレコーダにおいて、 テープの各トラックに記録されたトラッキング領域を検
出する回路と、トラッキング制御回路のトラッキングエ
ラー信号を保持するサンプルホールド回路及びサンプリ
ングパルスを出力するロジック回路以外の回路バイアス
電圧をしや断する回路を設けたことを特徴とする回転ヘ
ッド式ディジタルオーディオテープレコーダのトラッキ
ング制御回路。
(1) Each track of the tape that is helically scanned by a rotating head is divided into a recording area where at least digital information is recorded and a tracking area where information for tracking control is recorded, and tracking is performed during playback. A rotary head digital audio tape recorder that performs tracking control based on tracking error signals obtained in the area includes a circuit that detects the tracking area recorded on each track of the tape and a tracking control circuit that holds the tracking error signal. A tracking control circuit for a rotary head type digital audio tape recorder, characterized in that a circuit for cutting off bias voltage of circuits other than a sample hold circuit and a logic circuit that outputs sampling pulses is provided.
JP63250107A 1988-10-04 1988-10-04 Tracking control circuit for rotary head type digital tape recorder Pending JPH0298854A (en)

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