JPH0295813U - - Google Patents
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- Publication number
- JPH0295813U JPH0295813U JP425289U JP425289U JPH0295813U JP H0295813 U JPH0295813 U JP H0295813U JP 425289 U JP425289 U JP 425289U JP 425289 U JP425289 U JP 425289U JP H0295813 U JPH0295813 U JP H0295813U
- Authority
- JP
- Japan
- Prior art keywords
- signal
- input
- value
- input signal
- input terminal
- Prior art date
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- Pending
Links
- 238000006243 chemical reaction Methods 0.000 claims description 3
- 230000001360 synchronised effect Effects 0.000 claims 1
- 238000010586 diagram Methods 0.000 description 2
- 230000002441 reversible effect Effects 0.000 description 1
Landscapes
- Transmission And Conversion Of Sensor Element Output (AREA)
Description
第1図はこの考案の一実施例を示す図、第2図
は従来のS/D変換装置を示す図である。図にお
いて1は象限選択器、2は余弦乗算器、3は正弦
乗算器、4は引き算器、5はアナログ・デイジタ
ル変換器、6は除算器、7は加算器、8はレジス
タ、9はアナログ・デイジタル変換器、10はス
コツト・トランス、11はトランス、12は位相
検波器、13は電圧制御発振器、14は可逆カウ
ンタである。なお、図中同一符号は同一または相
当部分を示す。
は従来のS/D変換装置を示す図である。図にお
いて1は象限選択器、2は余弦乗算器、3は正弦
乗算器、4は引き算器、5はアナログ・デイジタ
ル変換器、6は除算器、7は加算器、8はレジス
タ、9はアナログ・デイジタル変換器、10はス
コツト・トランス、11はトランス、12は位相
検波器、13は電圧制御発振器、14は可逆カウ
ンタである。なお、図中同一符号は同一または相
当部分を示す。
Claims (1)
- 3相のシンクロ信号を入力し、2相のレゾルバ
信号に変換するスコツト・トランスと、2つの入
力端を有しその入力端に前記2相のレゾルバ信号
を入力し、角度の象限により2つの信号を出力す
る象限選択器と、ある2つの信号を入力し、第1
の入力信号と第2の入力信号の余弦の値を乗算す
る余弦乗算器と、ある2つの信号を入力し、第1
の入力信号と第2の入力信号の正弦の値を乗算す
る正弦乗算器と、ある2つの信号を入力し第1の
入力信号の値から第2の入力信号の値を引き算す
る引き算器と、入力信号をデイジタル信号に変換
する第1のアナログ・デイジタル変換器と、ある
2つの信号を入力し第1の入力信号の値を第2の
入力信号の値で除算する除算器と、ある2つの信
号を入力し第1の入力信号の値と第2の入力信号
の値の加算を行う加算器と、ある2つの信号を入
力し第1の入力信号により、第2の入力信号の値
を一時保持するレジスタと、入力信号をアナログ
・デイジタル変換する第2のアナログ・デイジタ
ル変換器によつて構成されたシンクロ・デイジタ
ル変換装置において、第1の入力端に前記象限選
択器の2つの出力信号の一方の正弦波を入力し、
第2の入力端に前記レジスタの信号を入力し第2
の入力端の余弦の値を第1の入力端の信号に乗算
する余弦乗算器と、第1の入力端に前記象限選択
器の2つの出力信号の一方の余弦波を入力し、第
2の入力端に前記レジスタの信号を入力し、第2
の入力端の正弦の値を第1の入力端の信号に乗算
する正弦乗算器と、第1の入力端に前記余弦乗算
器の出力信号を入力し、第2の入力信号に前記正
弦乗算器の出力信号を入力し第1の入力信号の値
から第2の入力信号の値を引き算する引き算器と
、入力端に前記引き算器の出力信号を入力し、デ
イジタル信号に変換する第1のアナログ・デイジ
タル変換器と、入力端に基準信号を入力し、デイ
ジタル信号に変換する第2のアナログ・デイジタ
ル変換信号と、第1の入力端に前記第1のアナロ
グ・デイジタル変換器の出力信号を入力し、第2
の入力端に前記第2のアナログ・デイジタル変換
器の出力信号を入力し、第1の入力信号の値を第
2の入力信号の値で除算する除算器と、第1の入
力端に前記除算器の出力信号を入力し、第2の入
力端に前記レジスタの出力を入力し、第1の入力
信号の値と第2の入力信号の値を加算する加算器
と、第1の入力端に前記加算器の出力信号を入力
し、第2の入力端に与えられた信号で第2の入力
端の信号を一時保持するレジスタを備えたことを
特徴とするシンクロ・デイジタル変換装置。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP425289U JPH0295813U (ja) | 1989-01-18 | 1989-01-18 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP425289U JPH0295813U (ja) | 1989-01-18 | 1989-01-18 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPH0295813U true JPH0295813U (ja) | 1990-07-31 |
Family
ID=31206600
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP425289U Pending JPH0295813U (ja) | 1989-01-18 | 1989-01-18 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPH0295813U (ja) |
-
1989
- 1989-01-18 JP JP425289U patent/JPH0295813U/ja active Pending