JPH01105809U - - Google Patents
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- Publication number
- JPH01105809U JPH01105809U JP180988U JP180988U JPH01105809U JP H01105809 U JPH01105809 U JP H01105809U JP 180988 U JP180988 U JP 180988U JP 180988 U JP180988 U JP 180988U JP H01105809 U JPH01105809 U JP H01105809U
- Authority
- JP
- Japan
- Prior art keywords
- signal
- input
- input terminal
- inputs
- signals
- Prior art date
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- Pending
Links
- 238000006243 chemical reaction Methods 0.000 claims 3
- 238000000034 method Methods 0.000 claims 1
- 238000010586 diagram Methods 0.000 description 1
- 230000002441 reversible effect Effects 0.000 description 1
Landscapes
- Transmission And Conversion Of Sensor Element Output (AREA)
- Analogue/Digital Conversion (AREA)
Description
第１図はこの考案の一実施例を示す図、第２図
は従来のＳ／Ｄ変換装置を示す図、第３図は基準
信号が０の場合シンクロ信号とデイジタル値が０
〜９０度の範囲の記憶器のデータを示す図、第４
図は基準信号が１の場合シンクロ信号とデイジタ
ル値が０〜９０度の範囲の記憶器のデータを示す
図である。 図において、１はスコツト・トランス、２はア
ナログ・デイジタル変換器、３は象限選択回路、
４は記憶器、５はトランス、６は符号判定器、７
は加算器、８はレジスタ、９は余弦乗算器、１０
は正弦乗算器、１１は引き算器、１２は位相検波
器、１３は電圧制御発振器、１４は可逆カウンタ
である。なお、各図中同一符号は同一又は相当部
分を示す。
は従来のＳ／Ｄ変換装置を示す図、第３図は基準
信号が０の場合シンクロ信号とデイジタル値が０
〜９０度の範囲の記憶器のデータを示す図、第４
図は基準信号が１の場合シンクロ信号とデイジタ
ル値が０〜９０度の範囲の記憶器のデータを示す
図である。 図において、１はスコツト・トランス、２はア
ナログ・デイジタル変換器、３は象限選択回路、
４は記憶器、５はトランス、６は符号判定器、７
は加算器、８はレジスタ、９は余弦乗算器、１０
は正弦乗算器、１１は引き算器、１２は位相検波
器、１３は電圧制御発振器、１４は可逆カウンタ
である。なお、各図中同一符号は同一又は相当部
分を示す。
Claims (1)
- ３相のシンクロ信号を入力し、２相のレゾルバ
信号に変換するスコツト・トランス又は変換回路
と、入力端に前記スコツト・トランスの出力の２
相のレゾルバ信号の一方の正弦波の信号を入力し
、デイジタル信号に変換する第１のアナログ・デ
イジタル変換器と、入力端に前記スコツト・トラ
ンス出力の２相のレゾルバ信号の一方の余弦波の
信号を入力し、デイジタル信号に変換する第２の
アナログ・デイジタル変換器と、２つの入力端を
有し、その第１の入力端に前記第１のアナログ・
デイジタル変換器の出力信号を入力し、第２の入
力端に前記第２のアナログ・デイジタル変換器の
出力信号を入力し、角度の象限により象限を切り
変えた信号を出力する象限選択器と、入力端に基
準信号を入力しその符号を判定する符号判定器と
、アドレス信号を入力しアドレスにより指定され
たデータを出力する記憶器と、２つの信号を入力
し２つの信号の和を出力する加算器と、２つの信
号を入力し第１の入力信号により、第２の入力信
号を一時保持するレジスタにより構成されたシン
クロ・デイジタル変換装置において、３つの入力
端の第１の入力端に前記象限選択器の出力信号の
正弦波と余弦波を入力し、第２の入力端に前記レ
ジスタの信号を入力し、第３の入力端に前記符号
判定器の信号を入力し、３つの入力信号に従い記
憶したデータを出力する記憶器と、２つの入力端
の第１の入力端に前記記憶器の出力信号を入力し
、第２の入力端に前記レジスタの出力信号を入力
し２つの信号をたし算する加算器と、２つの入力
端の第１の入力端にクロツク信号を入力し、第２
の入力端に前記加算器の出力信号を入力し第１の
入力端に与えられた信号で第２の入力端に与えら
れた信号を一時保持するレジスタとを備えたこと
を特徴とするシンクロ・デイジタル変換装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP180988U JPH01105809U (ja) | 1988-01-11 | 1988-01-11 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP180988U JPH01105809U (ja) | 1988-01-11 | 1988-01-11 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH01105809U true JPH01105809U (ja) | 1989-07-17 |
Family
ID=31202019
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP180988U Pending JPH01105809U (ja) | 1988-01-11 | 1988-01-11 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH01105809U (ja) |
-
1988
- 1988-01-11 JP JP180988U patent/JPH01105809U/ja active Pending
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