JPH0288180U - - Google Patents
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- Publication number
- JPH0288180U JPH0288180U JP16705088U JP16705088U JPH0288180U JP H0288180 U JPH0288180 U JP H0288180U JP 16705088 U JP16705088 U JP 16705088U JP 16705088 U JP16705088 U JP 16705088U JP H0288180 U JPH0288180 U JP H0288180U
- Authority
- JP
- Japan
- Prior art keywords
- circuit section
- signal line
- separation
- logic circuit
- memory
- Prior art date
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- 238000000926 separation method Methods 0.000 claims description 9
- 230000004044 response Effects 0.000 claims 1
- 238000010586 diagram Methods 0.000 description 1
Landscapes
- Tests Of Electronic Circuits (AREA)
- Logic Circuits (AREA)
Description
第１図は本考案によるメモリを含む論理回路の
一実施例を示すブロツク図である。 １…メモリ回路部、２…論理回路部、３…分離
回路、４…分離回路、５…分離回路、６…分離回
路、７…分離制御信号、８…ＤＡＴＡ信号、９…
アドレス信号、１０…ＷＥ信号、１１…ＯＥ信号
、１２…ＣＳ信号。
一実施例を示すブロツク図である。 １…メモリ回路部、２…論理回路部、３…分離
回路、４…分離回路、５…分離回路、６…分離回
路、７…分離制御信号、８…ＤＡＴＡ信号、９…
アドレス信号、１０…ＷＥ信号、１１…ＯＥ信号
、１２…ＣＳ信号。
Claims (1)
- 論理回路部と、前記論理回路部より引き出され
ているアドレス信号線、ＷＥ信号線、ＯＥ信号線
およびＣＳ信号線にそれぞれ接続され、分離制御
信号により出力がハイインピーダンスになる分離
回路群と、前記分離回路群の出力に接続されたメ
モリ回路部とからなり、前記メモリ回路部を試験
する際、前記分離回路群出力をハイインピーダン
スにして前記論理回路部と前記メモリ回路部とを
電気的に分離することを特徴とするメモリを含む
論理回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP16705088U JPH0288180U (ja) | 1988-12-23 | 1988-12-23 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP16705088U JPH0288180U (ja) | 1988-12-23 | 1988-12-23 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH0288180U true JPH0288180U (ja) | 1990-07-12 |
Family
ID=31454995
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP16705088U Pending JPH0288180U (ja) | 1988-12-23 | 1988-12-23 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0288180U (ja) |
-
1988
- 1988-12-23 JP JP16705088U patent/JPH0288180U/ja active Pending
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