JPH0254186U - - Google Patents
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- Publication number
- JPH0254186U JPH0254186U JP13292588U JP13292588U JPH0254186U JP H0254186 U JPH0254186 U JP H0254186U JP 13292588 U JP13292588 U JP 13292588U JP 13292588 U JP13292588 U JP 13292588U JP H0254186 U JPH0254186 U JP H0254186U
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- JP
- Japan
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- view
- pin arrangement
- utility
- scope
- area
- Prior art date
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- Pending
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Landscapes
- Connecting Device With Holders (AREA)
- Multi-Conductor Connections (AREA)
- Testing Of Individual Semiconductor Devices (AREA)
Description
第１図ａおよびｂはそれぞれ本考案をデイツプ
ＩＣ用ソケツトに実施した場合の一実施例を示す
斜視図およびそのプリント基板上への実装断面図
、第２図ａおよびｂはそれぞれ本考案をミニフラ
ツトＩＣ用ソケツトに実施した場合の一実施例を
示す斜視図およびそのプリント基板への実装断面
図である。 １……ＩＣをセツトする上面、２……ピン配列
面、３……ＩＣ、４……プリント基板、Ｆ……セ
ツト時の力。
ＩＣ用ソケツトに実施した場合の一実施例を示す
斜視図およびそのプリント基板上への実装断面図
、第２図ａおよびｂはそれぞれ本考案をミニフラ
ツトＩＣ用ソケツトに実施した場合の一実施例を
示す斜視図およびそのプリント基板への実装断面
図である。 １……ＩＣをセツトする上面、２……ピン配列
面、３……ＩＣ、４……プリント基板、Ｆ……セ
ツト時の力。
Claims (1)
- 下面のピン配列面の面積がＩＣをセツトする上
面よりも大きく設定されていることを特徴とする
ＩＣソケツト。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP13292588U JPH0254186U (ja) | 1988-10-11 | 1988-10-11 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP13292588U JPH0254186U (ja) | 1988-10-11 | 1988-10-11 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH0254186U true JPH0254186U (ja) | 1990-04-19 |
Family
ID=31390333
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP13292588U Pending JPH0254186U (ja) | 1988-10-11 | 1988-10-11 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0254186U (ja) |
-
1988
- 1988-10-11 JP JP13292588U patent/JPH0254186U/ja active Pending