JPH024873B2 - - Google Patents

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JPH024873B2
JPH024873B2 JP55169666A JP16966680A JPH024873B2 JP H024873 B2 JPH024873 B2 JP H024873B2 JP 55169666 A JP55169666 A JP 55169666A JP 16966680 A JP16966680 A JP 16966680A JP H024873 B2 JPH024873 B2 JP H024873B2
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JP
Japan
Prior art keywords
time
circuit
time information
signal
gate
Prior art date
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Expired - Lifetime
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JP55169666A
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Japanese (ja)
Other versions
JPS5793278A (en
Inventor
Tadashi Ogura
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Casio Computer Co Ltd
Original Assignee
Casio Computer Co Ltd
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Publication date
Application filed by Casio Computer Co Ltd filed Critical Casio Computer Co Ltd
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Publication of JPS5793278A publication Critical patent/JPS5793278A/en
Publication of JPH024873B2 publication Critical patent/JPH024873B2/ja
Granted legal-status Critical Current

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    • GPHYSICS
    • G04HOROLOGY
    • G04GELECTRONIC TIME-PIECES
    • G04G13/00Producing acoustic time signals
    • G04G13/02Producing acoustic time signals at preselected times, e.g. alarm clocks

Landscapes

  • Physics & Mathematics (AREA)
  • General Physics & Mathematics (AREA)
  • Measurement Of Unknown Time Intervals (AREA)
  • Electric Clocks (AREA)

Description

【発明の詳細な説明】 この発明は、ストツプウオツチに関する。[Detailed description of the invention] This invention relates to a stopwatch.

一般に、陸上、水泳などのような、時間の優劣
を競う運動競技においては、練習を行つている際
に、その練習者にとつては自己の目標時間と今回
の自己の記録時間との対比結果は、最も知りたい
情報の一つである。
In general, in athletic events such as track and field or swimming that compete for time, when practicing, the practitioner will be asked to compare his or her target time with his or her current record time. is one of the most wanted information.

しかしながら、従来のストツプウオツチにあつ
ては、自己が目標にする時間と今回記録した時間
とを比較する場合に、その都度、表示されている
計測時間を読み取り、目標時間との対比を行つて
その優劣を決定しなければならないので、面倒で
あつた。また、競技会などにおいて、観客、選手
などは、今回の記録時間が掲示板に表示され、ア
ナウンサにより新記録であると告げられるまで記
録更新かどうかを知ることはできず、不便であつ
た。
However, with conventional stopwatches, when comparing the time you set as your goal with the time you recorded, each time you read the displayed measured time and compare it with the target time to see if it is better or worse. It was a hassle because I had to decide. Furthermore, at competitions, spectators, athletes, etc. cannot know whether the record has been updated or not until the current record time is displayed on the bulletin board and the announcer announces that it is a new record, which is inconvenient.

この発明は、前記事情に基づいてなされたもの
で、その目的とするところは、計測時間を読み取
ることなしに記録更新か否かを直ちに知ることが
できるストツプウオツチを提供することにある。
The present invention has been made based on the above-mentioned circumstances, and its purpose is to provide a stopwatch that can immediately determine whether or not a record has been updated without reading the measured time.

以下、この発明を図面に示す一実施例に基づい
て具体的に説明する。第1図はこの発明を適用し
たストツプウオツチ機能付電子時計の回路構成図
である。図において符号1は32.768Hzのクロツク
信号を発振出力する発振回路、2は前記クロツク
信号を100Hzの信号a、1Hzの信号b、0.5Hzの信
号cに分周する分周回路、3は前記1Hzの信号b
を計数して時、分、秒単位の時刻情報を得る時刻
カウンタ、4は時刻カウンタ3から出力される1
日につき1回のキヤリー信号を計数して月、日、
曜日の日付情報を得るカレンダカウンタである。
時刻カウンタ3で得られた時刻情報及びカレンダ
カウンタ4で得られた日付情報は、アンドゲート
5を介して入力情報をデイジタル表示する液晶表
示装置6に送られる。
Hereinafter, the present invention will be specifically described based on an embodiment shown in the drawings. FIG. 1 is a circuit diagram of an electronic timepiece with a stopwatch function to which the present invention is applied. In the figure, numeral 1 is an oscillation circuit that oscillates and outputs a 32.768 Hz clock signal, 2 is a frequency dividing circuit that divides the clock signal into 100 Hz signal a, 1 Hz signal b, and 0.5 Hz signal c, and 3 is the 1 Hz signal signal b
4 is a time counter that obtains time information in hours, minutes, and seconds by counting 1
By counting the carry signal once per day, the month, day,
This is a calendar counter that obtains date information for the day of the week.
The time information obtained by the time counter 3 and the date information obtained by the calendar counter 4 are sent via an AND gate 5 to a liquid crystal display device 6 that digitally displays the input information.

他方、符号S1〜S5は時計外部に備えられたマニ
ユアルスイツチであり、各スイツチS1〜S5の操作
信号は対応するワンシヨツト回路7〜11に与え
られ、パルス信号を出力させる。このワンシヨツ
ト回路7から出力されるパルス信号は、バイナリ
フリツプフロツプ(以下、T−FFと略称する)
12のT入力端子に与えられ、その出力状態を反
転させる。このT−FF12の側出力信号は、
アンドゲート5にゲート制御信号として与えら
れ、また、そのQ側出力信号は、分周回路2から
0.5Hzの信号cが入力されているアンドゲート1
3にゲート制御信号として与えられるほか、アン
ドゲート14にもゲート制御信号として与えられ
る。このアンドゲート13は0.5Hzの信号cを点
滅表示信号Eとして液晶表示装置6に与え、液晶
表示装置6に入力される所定の情報を点滅表示さ
せる。また、ワンシヨツト回路8から出力される
パルス信号は、T−FF15のT入力端子に与え
られ、その出力状態を反転させる。このT−FF
15のQ側出力信号は、分周回路2から100Hzの
信号aが入力されているアンドゲート16にゲー
ト制御信号として与えられ、アンドゲート16か
ら100Hzの信号aを出力させる。このアンドゲー
ト16から出力される100Hzの信号aは、時間計
測回路(ストツプウオツチ用カウンタ)17に与
えられ、計数される。この時間計測回路17は
100Hzの信号aが入力された時、時間計測動作が
スタートされ、100Hzの信号aの入力が禁止され
た時、時間計測動作がストツプされるもので、入
力される100Hzの信号aを計数することによつて、
例えば、59分59秒99までの時間情報を得ることが
できるものである。
On the other hand, reference numerals S 1 to S 5 indicate manual switches provided outside the timepiece, and operation signals from each of the switches S 1 to S 5 are applied to corresponding one-shot circuits 7 to 11 to output pulse signals. The pulse signal output from this one-shot circuit 7 is a binary flip-flop (hereinafter abbreviated as T-FF).
12 and inverts its output state. The side output signal of this T-FF12 is
It is given to the AND gate 5 as a gate control signal, and its Q side output signal is supplied from the frequency divider circuit 2.
AND gate 1 to which 0.5Hz signal c is input
3 as a gate control signal, and also to AND gate 14 as a gate control signal. This AND gate 13 supplies the 0.5 Hz signal c to the liquid crystal display device 6 as a blinking display signal E, and causes predetermined information inputted to the liquid crystal display device 6 to be displayed blinking. Further, the pulse signal output from the one-shot circuit 8 is applied to the T input terminal of the T-FF 15, and its output state is inverted. This T-FF
The Q side output signal 15 is given as a gate control signal to the AND gate 16 to which the 100 Hz signal a is inputted from the frequency dividing circuit 2, and causes the AND gate 16 to output the 100 Hz signal a. The 100 Hz signal a output from the AND gate 16 is applied to a time measuring circuit (stop watch counter) 17 and counted. This time measurement circuit 17
When the 100Hz signal a is input, the time measurement operation is started, and when the input of the 100Hz signal a is prohibited, the time measurement operation is stopped, and the input 100Hz signal a is counted. According to
For example, it is possible to obtain time information up to 59 minutes, 59 seconds, and 99 seconds.

この時間計測回路17で得られた時間情報は、
時間記憶部18に予め設定記憶されている任意の
時間情報と共にオアゲート19、アンドゲート1
4を順次介して液晶表示装置6に送られ、液晶表
示装置6に前記両時間情報が同時に表示される。
なお、オアゲート19は時間計測回路17および
時間記憶部18の内容を単にアンドゲート14に
与えるゲート回路である。また、T−FF15の
Q側出力信号はワンシヨツト回路20に与えら
れ、その立ち上がりに同期してパルス信号を出力
させる。このパルス信号は時間計測回路17から
時間情報が入力されているアンドゲート21及び
時間記憶部18から時間情報が入力されているア
ンドゲート22に夫々ゲート制御信号として与え
られる。これらアンドゲート21,22はワンシ
ヨツト回路20からパルス信号が入力されるタイ
ミングに同期して時間計測回路17からの時間情
報、時間記憶部18からの時間情報を同時に出力
し、比較回路23に与える。従つて、比較回路2
3には時間計測回路17の計測動作がストツプし
た際に時間計測回路17で得られた時間情報が与
えられる。
The time information obtained by this time measurement circuit 17 is
The OR gate 19 and the AND gate 1 together with any time information preset and stored in the time storage section 18.
4 to the liquid crystal display device 6, and both time information are displayed on the liquid crystal display device 6 at the same time.
Note that the OR gate 19 is a gate circuit that simply provides the contents of the time measurement circuit 17 and the time storage section 18 to the AND gate 14. Further, the Q-side output signal of the T-FF 15 is given to a one-shot circuit 20, which outputs a pulse signal in synchronization with the rising edge of the one-shot circuit 20. This pulse signal is given as a gate control signal to an AND gate 21 to which time information is input from the time measurement circuit 17 and an AND gate 22 to which time information is input from the time storage section 18, respectively. These AND gates 21 and 22 simultaneously output time information from the time measurement circuit 17 and time information from the time storage section 18 in synchronization with the timing at which the pulse signal is input from the one shot circuit 20, and provide the same to the comparison circuit 23. Therefore, comparison circuit 2
3 is given time information obtained by the time measuring circuit 17 when the measuring operation of the time measuring circuit 17 is stopped.

この比較回路23は入力される前記両時間情報
の時間的大小を比較するもので、時間計測回路1
7の時間情報が時間記憶部18に予め設定記憶さ
れた時間情報よりも小さい時、報音指令信号を出
力して、メロデイ発生回路24に与える。このメ
ロデイ発生回路24には所定曲名のメロデイ音を
編成する楽音コードが記憶されており、前記報音
指令信号が入力された時、前記楽音コードを読み
出して所定周波数の楽音信号に変換した後、この
楽音信号を電磁ブザー25に送り、電磁ブザー2
5からメロデイ音を発生させる。
This comparison circuit 23 compares the temporal magnitude of the inputted time information, and the time measurement circuit 1
When the time information No. 7 is smaller than the time information preset and stored in the time storage section 18, an alarm command signal is outputted and given to the melody generation circuit 24. This melody generating circuit 24 stores musical tone codes for organizing melody tones of a predetermined song title, and when the tone command signal is input, the musical tone code is read out and converted into a musical tone signal of a predetermined frequency, and then, This musical tone signal is sent to the electromagnetic buzzer 25, and the electromagnetic buzzer 2
5 generates a melody sound.

また、ワンシヨツト回路9から出力されるパル
ス信号は、T−FF12のQ側出力信号がゲート
制御信号として入力されているアンドゲート26
を介して時間計測回路17のリセツト端子Rに与
えられ、その内容をクリアさせる。
Further, the pulse signal output from the one-shot circuit 9 is transmitted to an AND gate 26 to which the Q side output signal of the T-FF 12 is input as a gate control signal.
is applied to the reset terminal R of the time measuring circuit 17 through the reset terminal R to clear its contents.

また、ワンシヨツト回路9から出力されるパル
ス信号は、T−FF12及び27のQ側出力信号
が夫々ゲート制御信号として入力されているアン
ドゲート28を介して4ビツトシフトレジスタ2
9に与えられ、その内容を1ビツトずつシフトさ
せる。前記T−FF27はそのT入力端子にワン
シヨツト回路11から出力されるパルス信号が入
力されることによつて出力状態が反転されるもの
で、その側出力信号はシフトレジスタ29のリ
セツト端子Rに与えられ、その内容をリセツトさ
せる。シフトレジスタ29の各ビツト出力のう
ち、2ビツト目の出力は分単位の桁選択信号X、
また、3ビツト目の出力は秒単位の桁選択信号
Y、さらに、4ビツト目の出力は1/100秒単位の
桁選択信号Zとしてアンドゲート機能を有するデ
コーダ30に与えられる。このデコーダ30には
桁選択信号X,Y,Zのほか、ワンシヨツト回路
10からのパルス信号及びT−FF27のQ側出
力信号も与えられており、ワンシヨツト回路10
からパルス信号が入力される毎に、桁選択信号
X,Y,Zに対応する時間、プリセツト信号X′,
Y′,Z′を出力し、時間記憶部18に与える。この
時間記憶部18はデコーダ30からプリセツト信
号X′,Y′,Z′が入力される毎に、対応する桁の
内容が+1されるものである。
Further, the pulse signal output from the one-shot circuit 9 is sent to the 4-bit shift register 2 via an AND gate 28 to which the Q-side output signals of the T-FFs 12 and 27 are respectively input as gate control signals.
9 and shifts its contents one bit at a time. The output state of the T-FF 27 is inverted when the pulse signal output from the one-shot circuit 11 is input to its T input terminal, and the output signal on that side is applied to the reset terminal R of the shift register 29. and reset its contents. Among the bit outputs of the shift register 29, the second bit output is the minute digit selection signal X,
Further, the output of the third bit is applied as a digit selection signal Y in units of seconds, and the output of the fourth bit is applied as a digit selection signal Z in units of 1/100 seconds to a decoder 30 having an AND gate function. In addition to the digit selection signals X, Y, and Z, this decoder 30 is also given a pulse signal from the one-shot circuit 10 and a Q-side output signal of the T-FF 27.
Each time a pulse signal is input from , the preset signals X',
Y' and Z' are outputted and given to the time storage section 18. Each time a preset signal X', Y', Z' is inputted from the decoder 30, the contents of the corresponding digit are incremented by 1 in the time storage section 18.

次に、前述の如く構成された電子時計の動作に
ついて説明する。
Next, the operation of the electronic timepiece configured as described above will be explained.

まず、T−FF12の側出力信号が2値論理
レベルの“1”にセツトされている時には、アン
ドゲート5が規制解除されるので、時刻カウンタ
3の時刻情報及びカレンダカウンタ4の日付情報
が液晶表示装置6に送られ、例えば、第2図に示
すように、現在時刻及び日付が「12時34分57秒」
及び「10月25日FR(金曜日)」がデイジタル表示
される。
First, when the side output signal of the T-FF 12 is set to the binary logic level "1", the AND gate 5 is deregulated, so the time information of the time counter 3 and the date information of the calendar counter 4 are displayed on the LCD. For example, as shown in FIG. 2, the current time and date are "12:34:57".
and “October 25th FR (Friday)” are displayed digitally.

この通常の時計モードにおいて、スイツチS1
1回操作すると、T−FF12の出力状態が反転
され、そのQ側出力信号が“1”にセツトされて
ストツプウオツチモードに切替えられる。これに
よつて、アンドゲート14が規制解除されるの
で、時間計測回路17及び時間記憶部18の内容
が液晶表示装置6に送られる。この場合、時間計
測回路17及び時間記憶部18の内容がリセツト
されているとすると、液晶表示装置6の各表示桁
には「0」がデイジタル表示される。
In this normal timepiece mode, when the switch S1 is operated once, the output state of the T-FF 12 is inverted, its Q side output signal is set to "1", and the mode is switched to the stopwatch mode. As a result, the AND gate 14 is released, and the contents of the time measurement circuit 17 and time storage section 18 are sent to the liquid crystal display device 6. In this case, assuming that the contents of the time measurement circuit 17 and the time storage section 18 have been reset, "0" is digitally displayed in each display digit of the liquid crystal display device 6.

このストツプウオツチモードにおいて、スイツ
チS5を操作してT−FF27の出力状態を反転さ
せ、そのQ側出力信号を“1”にセツトすると、
アンドゲート28が規制解除され、プリセツト可
能モードとなる。このプリセツト可能モードにお
いて、アンドゲート13が規制解除されるので、
分周回路2から取り出された0.5Hzの信号cがア
ンドゲート13を介して液晶表示装置6に与えら
れ、シフトレジスタ29の内容に応じた桁を点滅
表示させる。しかして、スイツチS3を操作する
と、ワンシヨツト回路9からパルス信号が出力さ
れ、シフトレジスタ29に与えられるので、シフ
トレジスタ29の内容はスイツチS3の操作回数に
応じてシフトされる。この時、液晶表示装置6は
シフトレジスタ29の内容に応じた桁が点滅表示
されるためにその点滅表示を視認しながら、スイ
ツチS3を操作することにより、シフトレジスタ2
9を所望の内容にセツトすることができる。そし
て、例えば、シフトレジスタ29の2ビツト目に
「1」の信号がセツトされた場合には、シフトレ
ジスタ29から桁選択信号Xが出力されるので、
スイツチS4を任意の回数操作することにより、デ
コーダ30からはスイツチS4が操作される毎にワ
ンシヨツトパルスのプリセツト信号X′が出力さ
れ、時間記憶部18の分桁の内容が+1される。
従つて、スイツチS4の操作回数に応じて1〜59分
の分単位の時間情報が時間記憶部18の分桁にプ
リセツトされる。同様に、シフトレジスタ29の
3ビツト目もしくは4ビツト目に“1”の信号が
セツトされた場合には、スイツチS4の操作回数に
応じて1〜59秒の秒単位、もしくは1/100〜99/10
0秒の1/100秒単位の時間情報が時間記憶部18の
所定桁にプリセツトされる。この時間記憶部18
にプリセツトされた時間情報、例えば、「00分26
秒30/100」は第3図に示すように液晶表示装置6
の下段にデイジタル表示され、この時、時間計測
回路17はリセツト状態にあるので、液晶表示装
置6の上段の各表示桁は「0」のままである。
In this stopwatch mode, if you operate switch S5 to invert the output state of T-FF27 and set its Q side output signal to "1",
The AND gate 28 is deregulated and enters the preset possible mode. In this preset possible mode, the AND gate 13 is deregulated, so
The 0.5 Hz signal c taken out from the frequency dividing circuit 2 is applied to the liquid crystal display device 6 via the AND gate 13, and the digit corresponding to the contents of the shift register 29 is displayed blinking. When the switch S3 is operated, a pulse signal is output from the one-shot circuit 9 and is applied to the shift register 29, so that the contents of the shift register 29 are shifted in accordance with the number of times the switch S3 is operated. At this time, the liquid crystal display device 6 flashes the digit corresponding to the contents of the shift register 29, so by operating the switch S3 while visually observing the flashing display, the shift register 2
9 can be set to the desired content. For example, when a signal of "1" is set in the second bit of the shift register 29, the digit selection signal X is output from the shift register 29.
By operating the switch S4 an arbitrary number of times, the decoder 30 outputs a one-shot pulse preset signal X' each time the switch S4 is operated, and the contents of the minute digit of the time storage section 18 are incremented by 1. .
Therefore, time information in minutes from 1 to 59 minutes is preset in the minute digit of the time storage section 18 depending on the number of times the switch S4 is operated. Similarly, when a signal of "1" is set in the 3rd or 4th bit of the shift register 29, the signal is set in units of seconds from 1 to 59 seconds, or from 1/100 to 1/100 seconds, depending on the number of operations of switch S4 . 99/10
Time information in units of 1/100 seconds of 0 seconds is preset in a predetermined digit of the time storage section 18. This time storage section 18
For example, "00 minutes 26"
"Second 30/100" is displayed on the liquid crystal display 6 as shown in Figure 3.
At this time, since the time measurement circuit 17 is in a reset state, each display digit in the upper row of the liquid crystal display device 6 remains at "0".

このようにして、所望する時間情報を時間記憶
部18にプリセツトする操作が完了した後は、も
う一度、スイツチS5を操作する。これによつて、
T−FF27の出力状態が反転され、プリセツト
可能モードが解除されると同時に、シフトレジス
タ29の内容がリセツトされる。
After completing the operation of presetting the desired time information in the time storage section 18 in this way, the switch S5 is operated once again. By this,
The output state of the T-FF 27 is inverted and the preset enable mode is released, and at the same time, the contents of the shift register 29 are reset.

しかして、ストツプウオツチモードにおいて、
スイツチS2を1回操作すると、T−FF15の出
力状態が反転されてQ側出力信号が“1”にセツ
トされる。これによつて、アンドゲート16が規
制解除されるので、アンドゲート16からは100
Hzの信号aが出力され、時間計測回路17に与え
られ、このため、時間計測回路17において計測
動作がスタートされ、100Hzの信号aを計数し始
める。
However, in stopwatch mode,
When the switch S2 is operated once, the output state of the T-FF 15 is inverted and the Q side output signal is set to "1". As a result, AND gate 16 is deregulated, and 100
The Hz signal a is output and given to the time measurement circuit 17, and therefore the time measurement circuit 17 starts a measurement operation and starts counting the 100Hz signal a.

そして、この計測動作中において、スイツチS2
をもう一度操作すると、T−FF15の出力状態
が反転され、時間計測回路17の計測動作がスト
ツプされる。これと同時に、ワンシヨツト回路2
0からパルス信号が出力され、アンドゲート21
及び22が同時に規制解除されるので、比較回路
23には時間計測回路17及び時間記憶部18か
らの両時間情報が入力される。従つて、比較回路
23は入力される両時間情報の大小の比較を行な
い、前記計測動作のストツプ時に時間計測回路1
7で得られた時間情報が時間記憶部18に予めプ
リセツトされた時間情報よりも小さいと判断した
時には、報音指令信号を出力し、メロデイ発生回
路24に与える。このため、電磁ブザー25から
は所定のメロデイ音が一定時間、発音される。
During this measurement operation, switch S2
When is operated again, the output state of the T-FF 15 is reversed and the measurement operation of the time measurement circuit 17 is stopped. At the same time, one shot circuit 2
A pulse signal is output from 0, and the AND gate 21
and 22 are deregulated at the same time, both time information from the time measurement circuit 17 and the time storage section 18 are input to the comparison circuit 23. Therefore, the comparison circuit 23 compares the magnitude of both input time information, and when the measurement operation is stopped, the time measurement circuit 1
When it is determined that the time information obtained in step 7 is smaller than the time information preset in the time storage section 18, a sound alarm command signal is outputted and given to the melody generation circuit 24. Therefore, a predetermined melody tone is emitted from the electromagnetic buzzer 25 for a certain period of time.

従つて、例えば、時間の優劣を競う運動競技に
おいて、今までの最高記録時間を時間記憶部18
にプリセツトさせたとすると、メロデイ音が発音
される場合は、計測時間がプリセツト時間よりも
小さい時であるから、メロデイ音の発生によつて
新記録の達成を直ちに知ることができる。
Therefore, for example, in an athletic competition in which time is competed, the time storage unit 18 stores the highest record time to date.
If the melody sound is preset, the measurement time is shorter than the preset time, so the generation of the melody sound immediately indicates that a new record has been achieved.

また、計測動作のストツプ時に時間計測回路1
7で得られた時間情報、例えば、「00分25秒27」
は、第3図に示すように、プリセツト時間「00分
26秒30」と共にデイジタル表示される。従つて、
表示されている計測時間を読み取つてプリセツト
時間と比較すれば、今回の記録が最高記録よりも
どの位、時間的に優つているかを正確に知ること
ができる。
Also, when the measurement operation is stopped, the time measurement circuit 1
Time information obtained in step 7, for example, "00 minutes 25 seconds 27"
As shown in Figure 3, the preset time is 00 minutes.
26 seconds 30" is displayed digitally. Therefore,
By reading the displayed measured time and comparing it with the preset time, you can find out exactly how much time-wise your current record is better than your best record.

しかして、その後、スイツチS3を操作すると、
時間計測回路17の内容は、アンドゲート26か
ら出力されるワンシヨツトのパルス信号によつて
クリアされる。従つて、新たな時間計測を行う場
合には、時間計測回路17の内容をクリアした
後、再び、スイツチS2を操作すればよい。この場
合、時間記憶部18に一旦プリセツトされた時間
情報は、新たなプリセツト操作を行なわない限
り、記憶保持される。また、ストツプウオツチモ
ードにおいて、スイツチS1を操作することによ
り、時間計測中か否かにかかわらず、時計モード
に切替えて時刻情報を見ることができる。
However, after that, when you operate Switch S 3 ,
The contents of the time measurement circuit 17 are cleared by a one-shot pulse signal output from the AND gate 26. Therefore, when a new time measurement is to be performed, the contents of the time measurement circuit 17 are cleared and then the switch S2 is operated again. In this case, the time information once preset in the time storage section 18 is stored and held until a new preset operation is performed. Furthermore, in stopwatch mode, by operating switch S1 , it is possible to switch to clock mode and view time information regardless of whether time is being measured or not.

なお、前記実施例はメロデイ発生回路を用い
て、メロデイ音を発生するようにしたが、メロデ
イ音発生回路の代わりに音声信号発生回路を用い
て、ある特定の言葉(例えば「新記録」)を音声
で発生するようにしてもよいし、勿論、所定周波
数の単一音でもよい。
In the above embodiment, a melody sound generation circuit was used to generate a melody sound, but an audio signal generation circuit was used instead of the melody sound generation circuit to generate a certain specific word (for example, "new record"). It may be generated as a voice, or of course may be a single sound of a predetermined frequency.

また、前記実施例は、例えば競技者1人の計測
時間とプリセツト時間とを比較するようにした
が、複数の時間記録部と時間計測回路を設け、複
数の競技者の計測時間とプリセツト時間とを夫々
比較したり、1つの時間記憶部に対し複数の時間
計測回路を設けて比較してもよい。
Further, in the above embodiment, for example, the measured time of one athlete and the preset time are compared, but by providing a plurality of time recording units and time measurement circuits, it is possible to compare the measured time and preset time of a plurality of athletes. Alternatively, a plurality of time measurement circuits may be provided for one time storage section and compared.

また、前記実施例は、計測時間とプリセツト時
間との比較結果を音で報知するようにしたが、光
学的な報知手段を用いてもよく、これを点滅表示
等の表示手段で報知するようにしてもよい。この
場合、表示装置をドツトマトリツクス状に構成
し、英文字、漢字などで新記録であることを表示
するようにすれば効果的である。
Further, in the above embodiment, the comparison result between the measured time and the preset time is announced by sound, but optical notification means may also be used, and this may be notified by display means such as a blinking display. It's okay. In this case, it is effective to configure the display device in the form of a dot matrix and display the fact that it is a new record using English letters, Chinese characters, or the like.

さらに、前記実施例においては、ストツプウオ
ツチを電子時計に組み込んだものに適用したが、
小型電子計算機等に組み込んでもよく、勿論、単
体であつてもよい。また、競技場の建造物に据え
付ける大型のストツプウオツチに適用することも
できる。この場合、大型スピーカからフアンフア
ーレなどを鳴らすようにすれば、新記録が達成さ
れたことを観客などにも知らせることができる。
Furthermore, in the above embodiment, the stopwatch was applied to an electronic timepiece built into the electronic timepiece.
It may be incorporated into a small electronic computer or the like, or of course may be a stand-alone device. It can also be applied to large stopwatches installed in stadium structures. In this case, by playing a song such as Juan Juare from a large speaker, it is possible to inform the audience that a new record has been achieved.

この発明は、以上詳細に説明したように、計測
動作のストツプ時に得られた計測時間と予めプリ
セツトされたプリセツト時間との大小の比較を行
なうと共に、その比較結果を報知するように構成
したから、計測時間を読み取らなくとも計測時間
がプリセツト時間よりも小さかつたことを知るこ
とができる。従つて、競技会などにおいて、競技
者、使用者及び観衆は新記録達成か否かを即座に
知ることができるとともに、所定の持時間をプリ
セツトすればタイマー装置として使用することも
できるなど様々の効果が得られる。
As described in detail above, the present invention is configured to compare the measurement time obtained when the measurement operation is stopped and the preset time preset, and to notify the comparison result. It is possible to know that the measured time was smaller than the preset time without reading the measured time. Therefore, at competitions, etc., competitors, users, and spectators can instantly know whether a new record has been achieved or not, and by presetting a predetermined time, it can be used as a timer device. Effects can be obtained.

【図面の簡単な説明】[Brief explanation of drawings]

図面はこの発明の一実施例を示し、第1図はこ
の発明を適用したストツプウオツチ付電子時計の
回路構成図、第2図ないし第4図はこのストツプ
ウオツチ付電子時計の表示部の表示状態を示した
図である。 6……液晶表示装置、17……時間計測回路、
18……時間記憶部、23……比較回路、24…
…メロデイ音発生回路、25……電磁ブザー。
The drawings show one embodiment of the present invention, FIG. 1 is a circuit diagram of an electronic timepiece with a stopwatch to which the invention is applied, and FIGS. 2 to 4 show the display state of the display section of this electronic timepiece with a stopwatch. This is a diagram. 6...Liquid crystal display device, 17...Time measurement circuit,
18... Time storage unit, 23... Comparison circuit, 24...
...melody sound generation circuit, 25...electromagnetic buzzer.

Claims (1)

【特許請求の範囲】[Claims] 1 基準クロツク信号を発生するクロツク信号発
生回路1,2と、前記クロツク信号を計数して時
間情報を計測する時間計測回路17と、この時間
計測回路17における計測動作のスタート.スト
ツプ制御を行なう制御手段S2,8,15,16
と、時間情報を入力するスイツチ手段S3,S4,2
8,29,30と、このスイツチ手段S3,S4,2
8,29,30によつて入力された時間情報を記
憶する時間記憶部18と、前記時間計測回路17
で計測される時間情報と前記時間記憶部18に記
憶される時間情報との大小を比較する比較回路2
3と、前記制御手段S2,8,15,16によるス
トツプ動作時に前記時間計測回路17で計測され
る時間情報と前記時間記憶部18に記憶される時
間情報とを前記比較回路23に送つて比較動作を
行なわせる比較制御手段20,21,22と、前
記比較回路23の比較によつて前記時間計測回路
17で計測された時間情報が前記時間記憶部18
に記憶された時間情報より小さかつたことを報知
する報知手段24,25とを具備してなるストツ
プウオツチ。
1. Clock signal generation circuits 1 and 2 that generate a reference clock signal, a time measurement circuit 17 that counts the clock signals to measure time information, and the start of a measurement operation in this time measurement circuit 17. Control means S 2 , 8, 15, 16 for performing stop control
and switch means S 3 , S 4 , 2 for inputting time information.
8, 29, 30 and the switch means S 3 , S 4 , 2
8, 29, and 30;
a comparison circuit 2 that compares the magnitude of the time information measured by the time information and the time information stored in the time storage section 18;
3, and sending the time information measured by the time measurement circuit 17 and the time information stored in the time storage section 18 to the comparison circuit 23 during the stop operation by the control means S 2 , 8, 15, and 16; The time information measured by the time measuring circuit 17 is stored in the time storage section 18 by comparing the comparison control means 20, 21, 22 that perform a comparison operation with the comparison circuit 23.
A stopwatch comprising notification means 24 and 25 for notifying that the time information is smaller than the time information stored in the stopwatch.
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