JPH0247839U - - Google Patents

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JPH0247839U
JPH0247839U JP12668888U JP12668888U JPH0247839U JP H0247839 U JPH0247839 U JP H0247839U JP 12668888 U JP12668888 U JP 12668888U JP 12668888 U JP12668888 U JP 12668888U JP H0247839 U JPH0247839 U JP H0247839U
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JP
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output
detection circuit
peak hold
level
circuit
Prior art date
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JP12668888U
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  • Circuits Of Receivers In General (AREA)

Description

【図面の簡単な説明】
第1図は本考案の実施例に係るブロツク図であ
る。 1:受信機入力端子、2:低雑音増幅器、3:
ミキサ、4:局部発振器、5:AGC増幅器、6
:検値回路、7:受信レベルメータ、8,14:
バツフアアンプ、9,15:ダイオード、10,
17,19:スイツチ、11:コンデンサ、12
:高入力インピーダンスバツフアアンプ、13:
コンパレータ、16:発光ダイオード、18:可
変抵抗器。

Claims (1)

    【実用新案登録請求の範囲】
  1. 受信入力レベルを検出する検出回路と、この検
    出回路の出力の最大値を保持するピークホールド
    回路と、このピークホールド回路の出力レベルと
    前記検出回路の出力レベルとを比較するコンパレ
    ータと、このコンパレータの出力に接続された表
    示手段とを備えたことを特徴とする受信装置。
JP12668888U 1988-09-28 1988-09-28 Pending JPH0247839U (ja)

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JP12668888U JPH0247839U (ja) 1988-09-28 1988-09-28

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JP12668888U JPH0247839U (ja) 1988-09-28 1988-09-28

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JPH0247839U true JPH0247839U (ja) 1990-04-03

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Family Applications (1)

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JP12668888U Pending JPH0247839U (ja) 1988-09-28 1988-09-28

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