JPS5973850U - ミユ−テイング回路 - Google Patents
ミユ−テイング回路Info
- Publication number
- JPS5973850U JPS5973850U JP16945582U JP16945582U JPS5973850U JP S5973850 U JPS5973850 U JP S5973850U JP 16945582 U JP16945582 U JP 16945582U JP 16945582 U JP16945582 U JP 16945582U JP S5973850 U JPS5973850 U JP S5973850U
- Authority
- JP
- Japan
- Prior art keywords
- muting circuit
- switching element
- tuning
- blocked
- muting
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
Links
Landscapes
- Control Of Amplification And Gain Control (AREA)
- Noise Elimination (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
第１図は一般に使用されているラジーオ受信機の回路ブ
ロック図、第２図は、本考案の一実施例になるミューテ
ィング回路を夫々示す。 ４・・・ミューティング回路、Ｂ・・・電源端子、Ｑ・
・・トランジスタ、Ｒ１−Ｒ３・・・抵抗、Ｄよ・・・
発光ダイオード、Ｄ２・・・ダイオード。
ロック図、第２図は、本考案の一実施例になるミューテ
ィング回路を夫々示す。 ４・・・ミューティング回路、Ｂ・・・電源端子、Ｑ・
・・トランジスタ、Ｒ１−Ｒ３・・・抵抗、Ｄよ・・・
発光ダイオード、Ｄ２・・・ダイオード。
Claims (1)
- 同調検出素子によって駆動される同調状態表示素子に並
列にスイッチング素子が接続され、このスイッチング素
子のオン又はオフ動作により、該スイッチング素子を受
信信号が通過、又は遮断する様にした事を特徴とするミ
ューティング回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP16945582U JPS5973850U (ja) | 1982-11-09 | 1982-11-09 | ミユ−テイング回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP16945582U JPS5973850U (ja) | 1982-11-09 | 1982-11-09 | ミユ−テイング回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS5973850U true JPS5973850U (ja) | 1984-05-19 |
Family
ID=30370199
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP16945582U Pending JPS5973850U (ja) | 1982-11-09 | 1982-11-09 | ミユ−テイング回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS5973850U (ja) |
-
1982
- 1982-11-09 JP JP16945582U patent/JPS5973850U/ja active Pending
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