JPH0235243U - - Google Patents

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JPH0235243U
JPH0235243U JP11153088U JP11153088U JPH0235243U JP H0235243 U JPH0235243 U JP H0235243U JP 11153088 U JP11153088 U JP 11153088U JP 11153088 U JP11153088 U JP 11153088U JP H0235243 U JPH0235243 U JP H0235243U
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JP
Japan
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contents
setting means
program
sequence
loop counter
Prior art date
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JP11153088U
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Description

【図面の簡単な説明】
第1図はこの考案によるプログラム・シーケン
ス・ストツプ装置の一実施例を示す構成図、第2
図は従来のプログラム・シーケンスストツプ装置
の一実施例を示す構成図である。 図において、1はストツプ・アドレス範囲設定
スイツチ、2はループカウンタ、3はループカウ
ンタ・ステータス設定スイツチ、4はインストラ
クシヨン・レジスタ、5はインストラクシヨン・
ステータス設定スイツチ、6はプログラム・シー
ケンス・ストツプ オン/オフ スイツチ、7は
プログラム・カウンタ、8は比較回路、9はシー
ケンス・ストツプ制御信号発生回路、10は一致
検出回路、11はストツプ・アドレス設定スイツ
チである。なお、図中同一あるいは相当部分には
同一符号を付して示してある。

Claims (1)

    【実用新案登録請求の範囲】
  1. 特定の条件が満たされたとき、プログラム・シ
    ーケンスを停止させることのできるプログラム・
    シーケンス・ストツプ装置において、プログラム
    シーケンスにおける任意のアドレス範囲を指定す
    るストツプ・アドレス範囲設定手段と、任意のル
    ープカウンタ状態を指定するループカウンタ・ス
    テータス設定手段と、任意のインストラクシヨン
    レジスタ内容を指定するインストラクシヨン・ス
    テータス設定手段とを有し、プログラム・シーケ
    ンスが前記ストツプ・アドレス範囲設定手段で指
    定された範囲にあり、かつループカウンタの内容
    が前記ループカウンタ・ステータス設定手段の内
    容と一致し、さらにインストラクシヨン・レジス
    タの内容が前記インストラクシヨン・ステータス
    の内容が前記インストラクシヨン・ステータス設
    定手段の内容と一致した時に、プログラム・シー
    ケンスを停止するように制御したことを特徴とし
    たプログラム・シーケンス・ストツプ装置。
JP11153088U 1988-08-25 1988-08-25 Pending JPH0235243U (ja)

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JP11153088U JPH0235243U (ja) 1988-08-25 1988-08-25

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JP11153088U JPH0235243U (ja) 1988-08-25 1988-08-25

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JPH0235243U true JPH0235243U (ja) 1990-03-07

Family

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