JPH02279007A - Mute circuit - Google Patents
Mute circuitInfo
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- JPH02279007A JPH02279007A JP1100931A JP10093189A JPH02279007A JP H02279007 A JPH02279007 A JP H02279007A JP 1100931 A JP1100931 A JP 1100931A JP 10093189 A JP10093189 A JP 10093189A JP H02279007 A JPH02279007 A JP H02279007A
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- 239000003990 capacitor Substances 0.000 abstract description 8
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Abstract
Description
【発明の詳細な説明】
（概要〕
電源ＯＮ／ＯＦＦ時におけるオーディオＩＮの出力を抑
止するミュート回路に関し、
ミュート回路の電源をコンデンサによってバンクアップ
し、オーディオ装置の電源ＯＮ／ＯＦＦ時のノイズ出力
を抑止することを目的とし、電源ＯＮ１０ Ｆ Ｆ時に
おけるオーディオＩＮをトランジスタなどによって短絡
してオーディオＯＵＴを抑止するミュート回路と、この
ミュート回路の電源をバンクアップする電源バンクアン
プ回路とを備え、この電源バックアップ回路によって電
源バックアップした上記ミュート回路により、電１ｆｌ
ＯＮ時およびｔ源ＯＦＦ時におけるオーディオＩＮの出
力を抑止するように構成する。[Detailed Description of the Invention] (Summary) Regarding a mute circuit that suppresses the output of audio IN when the power is turned ON/OFF, the power supply of the mute circuit is banked up with a capacitor to suppress the noise output when the power of the audio device is turned ON/OFF. For the purpose of suppressing this, the mute circuit short-circuits the audio IN with a transistor or the like to suppress the audio OUT when the power is ON10FF, and the power bank amplifier circuit that banks up the power of this mute circuit. The above-mentioned mute circuit backed up the power by the backup circuit,
The configuration is such that the output of audio IN is suppressed when the t source is turned on and when the t source is turned off.
（産業上の利用分野〕
本発明は、電源ＯＮ／ＯＦＦ時におけるオーディオＩＮ
の出力を抑止するミュート回路に関するものである。オ
ーディオ装置の高性能化に伴い、ｔａｌＯＮ時に発生す
るノイズを抑止するのみでなく、更に電源ＯＦＦ時に発
生するノイズを抑止して出力しないことが望まれている
。(Industrial Application Field) The present invention provides audio input during power ON/OFF.
This relates to a mute circuit that suppresses the output of. As the performance of audio devices increases, it is desired not only to suppress the noise generated when the audio device is turned on, but also to suppress the noise generated when the power is turned off so as not to output it.
〔従来の技術と発明が解決しようとする課題〕従来、電
源ＯＮ時にオーデイ装置に発生するノイズを抑止するた
めに、第２図に示すようなミュート回路１１を設けてい
た。[Prior Art and Problems to be Solved by the Invention] Conventionally, a mute circuit 11 as shown in FIG. 2 has been provided in order to suppress noise generated in an audio device when the power is turned on.
しかし、このミュート回路１１は、オーディオ装置のｔ
ａと共通にしていたため、オーディオ装置の電源ＯＦＦ
とともに、当該ミュート回路１１が働かなくなり、オー
ディオＩＮから来るノイズをオーディオＯＵＴに出力し
てしまうという問題があった。However, this mute circuit 11 is
Since it was shared with a, the power of the audio device was turned off.
At the same time, there is a problem in that the mute circuit 11 stops working and the noise coming from the audio IN is output to the audio OUT.
本発明は、ミュート回路のｔｆｌをコンデンサによって
バックアップし、オーディオ装置の電源０Ｎ１０ Ｆ
Ｆ時のノイズ出力を抑止することを目的としている。The present invention backs up the tfl of the mute circuit with a capacitor, and the power supply of the audio device is 0N10F.
The purpose is to suppress noise output at F time.
（課題を解決する手段〕
第１図を参照して課題を解決する手段を説明す第１図に
おいて、ミュート回路１ば、＠ａＯＮ１０ＦＦ時におけ
るオーディオＩＮをオーディオＯＵＴに出力することを
抑止する回路である。(Means for solving the problem) In FIG. 1, which explains the means for solving the problem with reference to FIG. be.
電源バックアップ回路２は、コンデンサＣおよびダイオ
ードＤなどから構成された電源バックアップ用の回路で
ある。The power supply backup circuit 2 is a power supply backup circuit composed of a capacitor C, a diode D, and the like.
本発明は、第１図に示すように、ミュート回路１に電源
バンクアップ回路２を設け、電源ＯＮ時にミュート回路
１によってオーディオＩＮをオーディオＯＵＴに出力す
ることを抑止すると共に、電ｗａＦＦ時に電源バンクア
ップ回路２によってミュート回路１に電源をしばらく継
続して供給し、オーディオ！ＮをオーディオＯＵＴに出
力することを抑止するようにしている。As shown in FIG. 1, the present invention includes a power bank up circuit 2 in a mute circuit 1, which prevents the mute circuit 1 from outputting audio IN to audio OUT when the power is turned on, and also prevents the power bank up circuit 2 from outputting audio IN to audio OUT when the power is turned on. The up circuit 2 continuously supplies power to the mute circuit 1 for a while, and the audio! Outputting N to audio OUT is suppressed.
従って、電ｆｉＯＮ１０Ｆ’Ｆ時にオーディオＩＮをオ
ーディオＯＵＴに出力することを抑止し、スピーカから
不快なノイズの発生などを抑止することが可能となる。Therefore, it is possible to prevent the audio IN from being output to the audio OUT when the electric power is ON10F'F, and to suppress the generation of unpleasant noise from the speaker.
次に、第１図を用いて本発明の１実施例の構成および動
作を順次詳細に説明する。Next, the configuration and operation of one embodiment of the present invention will be sequentially explained in detail using FIG.
第１図において、ミュート回路１ば、オーディオＯＵＴ
をミュート時に接地するトランジスタＴｒｌ、およびこ
のトランジスタＴ ｒ １ ｔ−駆動するトランジスタ
Ｔｒ２から構成され、電ｆｉＯＮ１０ＦＦ時におけるオ
ーディオＩＮをオーディオＯＵＴに出力することを抑止
する回路である。In Figure 1, mute circuit 1, audio OUT
This circuit is composed of a transistor Trl that is grounded when muted, and a transistor Tr2 that drives this transistor Tr1t-, and suppresses outputting audio IN to audio OUT when the power is turned 10FF.
電源バ、クアップ回路２ば、ダイオードＤによってコン
デンサＣを充電し、電源ＯＦＦ時にミュート回路１の電
源をバンクアンプする回路である。The power supply back-up circuit 2 is a circuit that charges a capacitor C with a diode D and performs a bank amplification of the power supply of the mute circuit 1 when the power is turned off.
リセット用ＩＣ３は、電源ＯＮ時に暫（の間だけミュー
ト信号（＊ＲＥＳ、リセット信号）を発生したり、電源
ＯＦＦ時に暫くの間だけミュート信号（＊ＲＥＳ、リセ
ット信号）を発生したりなどするものである。The reset IC 3 generates a mute signal (*RES, reset signal) for a short period of time when the power is turned on, or generates a mute signal (*RES, reset signal) for a short period of time when the power is turned off. It is.
次に、動作を説明する。Next, the operation will be explained.
（１） 電源ＯＮ待時：−ディオ装置の電源がＯＮに
されると、リセット用ＩＣ３が＊ＲＥＳ信号をしばら（
の間だけ発生し、この＊ＲＥＳ信号を図示ミュート信号
（Ｌレベルの信号）としてミュート回路１を構成するト
ランジスタＴｒ２のベースに抵抗Ｒ１を介して入力する
。これにより、トランジスタＴｒ２が導通状態となり、
電源＋ＶがトランジスタＴｒｉのベースに抵抗Ｒ２を介
して印加され、当該トランジスタＴｒｉを導通状態にす
る。これにより、オーディオＩＮが抵抗Ｒｍを介して接
地された状態となり、オーディオＯＵＴから信号が出力
されず、しばら（の間、抑止する。(1) Waiting for the power to be turned on: - When the power to the audio device is turned on, the reset IC 3 sends the *RES signal for a while (
This *RES signal is input as the illustrated mute signal (L level signal) to the base of the transistor Tr2 constituting the mute circuit 1 via the resistor R1. As a result, the transistor Tr2 becomes conductive, and
A power supply +V is applied to the base of the transistor Tri through the resistor R2, making the transistor Tri conductive. As a result, the audio IN is grounded via the resistor Rm, and no signal is output from the audio OUT, which is suppressed for a while.
しばくらして、＊ＲＥＳ信号がＨレベルになると、トラ
ンジスタＴｒ２、Ｔｒｉが非導通状態となり、オーディ
オＩＮがそのまま抵抗Ｒｍを介してオーディオＯＵＴに
出力されることとなる。After a while, when the *RES signal becomes H level, the transistors Tr2 and Tri become non-conductive, and the audio IN is directly output to the audio OUT via the resistor Rm.
（２）電源ＯＦＦ時：オーディオ装置の電源がＯＦＦに
されると、リセット用ＩＣ３が電源ＯＦＦの瞬間から、
あるいは電源ＯＦＦの少し前から＊ＲＥＳ信号を発生し
て図示ミュート信号（Ｌレベルの信号）としてミュート
回路ｌを構成するトランジスタＴｒ２のベースに抵抗Ｒ
１を介して入力する。これにより、トランジスタＴ ｒ
２が導通状態となり、ダイオードＤを介してコンデン
サＣに充電されていた電圧がトランジスタＴｒｉのベー
スに抵抗Ｒ２を介して印加され、当該トランジスタＴｒ
ｉを導通状態にする。これにより、オーディオ！Ｎが抵
抗Ｒｍを介して接地された状態となり、オーディオＩＮ
から入力されたノイズをオーディオＯＵＴに出力するこ
とを抑止するようにしている。(2) When the power is turned off: When the power of the audio device is turned off, the reset IC 3 resets from the moment the power is turned off.
Alternatively, the *RES signal is generated a little before the power is turned off, and the resistor R is connected to the base of the transistor Tr2 constituting the mute circuit l as the mute signal (L level signal) shown in the figure.
Input via 1. As a result, the transistor T r
2 becomes conductive, and the voltage charged in the capacitor C via the diode D is applied to the base of the transistor Tri via the resistor R2, and the voltage charged in the capacitor C via the diode D is applied to the base of the transistor Tri.
Make i conductive. This allows audio! N is grounded via resistor Rm, and audio IN
It is designed to suppress output of the noise input from the audio OUT to the audio OUT.
以上説明したように、本発明によれば、ミュート回路１
の電源をコンデンサＣおよびダイオードＤなどによって
電源バックアップし、オーディオ装置の電源がＯＦＦに
なってもしばらくミュート回路１を動作せる構成を採用
しているため、電源ＯＮ時に発生するノイズをオーディ
オＯＵＴから出力することを抑止するのみでなく、更に
、電源ＯＦＦ時に発生するノイズをオーディオＯＵＴか
ら出力することを極めて簡単な回路構成によって抑止す
ることができる。As explained above, according to the present invention, the mute circuit 1
The power supply is backed up by capacitor C and diode D, etc., and the mute circuit 1 is configured to operate for a while even when the power to the audio device is turned off, so the noise generated when the power is turned on is output from the audio OUT. In addition, it is possible to prevent noise generated when the power is turned off from being output from the audio OUT with an extremely simple circuit configuration.
第１図は本発明の１実施例構成図、第２図は従来技術の
説明図を示す。
図中、１はミュート回路、２は電源バンクアップ回路、
３ばリセット用Ｉ Ｃ，ＴＲ１、ＴＲ２ばトランジスタ
、Ｒ１、Ｒ２、Ｒｍは抵抗を表す。FIG. 1 shows the configuration of one embodiment of the present invention, and FIG. 2 shows an explanatory diagram of the prior art. In the figure, 1 is a mute circuit, 2 is a power bank up circuit,
3 represents a reset IC, TR1 and TR2 represent transistors, and R1, R2 and Rm represent resistors.
Claims (1)
止するミュート回路において、 電源ＯＮ／ＯＦＦ時におけるオーディオＩＮをトランジ
スタなどによって短絡してオーディオＯＵＴを抑止する
ミュート回路（１）と、 このミュート回路（１）の電源をバックアップする電源
バックアップ回路（２）とを備え、 この電源バックアップ回路（２）によって電源バックア
ップした上記ミュート回路（１）により、電源ＯＮ時お
よび電源ＯＦＦ時におけるオーディオＩＮの出力を抑止
するように構成したことを特徴とするミュート回路。[Claims] A mute circuit for suppressing the output of audio IN when the power is turned ON/OFF, comprising: a mute circuit (1) that suppresses the output of the audio IN by short-circuiting the audio IN using a transistor or the like when the power is turned ON/OFF; The mute circuit (1) is equipped with a power backup circuit (2) that backs up the power of the mute circuit (1). A mute circuit configured to suppress output of the mute circuit.
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1100931A JPH02279007A (en) | 1989-04-20 | 1989-04-20 | Mute circuit |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1100931A JPH02279007A (en) | 1989-04-20 | 1989-04-20 | Mute circuit |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH02279007A true JPH02279007A (en) | 1990-11-15 |
Family
ID=14287096
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP1100931A Pending JPH02279007A (en) | 1989-04-20 | 1989-04-20 | Mute circuit |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH02279007A (en) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH0344913U (en) * | 1989-09-05 | 1991-04-25 |
-
1989
- 1989-04-20 JP JP1100931A patent/JPH02279007A/en active Pending
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH0344913U (en) * | 1989-09-05 | 1991-04-25 |
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