JPH0227230U - - Google Patents
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- Publication number
- JPH0227230U JPH0227230U JP10567188U JP10567188U JPH0227230U JP H0227230 U JPH0227230 U JP H0227230U JP 10567188 U JP10567188 U JP 10567188U JP 10567188 U JP10567188 U JP 10567188U JP H0227230 U JPH0227230 U JP H0227230U
- Authority
- JP
- Japan
- Prior art keywords
- clock
- setting command
- oscillator
- clock setting
- command
- Prior art date
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- Pending
Links
- 238000010586 diagram Methods 0.000 description 2
Landscapes
- Test And Diagnosis Of Digital Computers (AREA)
Description
第１図はこの考案の一実施例を示す回路構成図
、第２図は従来のマージン試験回路を示す回路構
成図である。 １〜４……発振器、７……クロツク選択回路、
８……クロツクドライバ、９……クロツク命令発
生手段、１０……デコード回路、１１……保持回
路。なお、図中同一符号は同一または相当部分を
示す。
、第２図は従来のマージン試験回路を示す回路構
成図である。 １〜４……発振器、７……クロツク選択回路、
８……クロツクドライバ、９……クロツク命令発
生手段、１０……デコード回路、１１……保持回
路。なお、図中同一符号は同一または相当部分を
示す。
Claims (1)
- 周期の異なる複数のクロツクを出力する発振器
と、クロツク設定命令を発生するクロツク命令発
生手段と、そのクロツク設定命令に従つて上記発
振器の出力クロツクを選択するクロツク選択回路
と、選択されたクロツクを上記クロツク設定命令
に従つて保持する保持回路とを備えたことを特徴
とするデータ処理装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP10567188U JPH0227230U (ja) | 1988-08-10 | 1988-08-10 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP10567188U JPH0227230U (ja) | 1988-08-10 | 1988-08-10 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH0227230U true JPH0227230U (ja) | 1990-02-22 |
Family
ID=31338494
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP10567188U Pending JPH0227230U (ja) | 1988-08-10 | 1988-08-10 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0227230U (ja) |
-
1988
- 1988-08-10 JP JP10567188U patent/JPH0227230U/ja active Pending
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