JPH02192763A - Image sensor - Google Patents

Image sensor

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JPH02192763A
JPH02192763A JP1011546A JP1154689A JPH02192763A JP H02192763 A JPH02192763 A JP H02192763A JP 1011546 A JP1011546 A JP 1011546A JP 1154689 A JP1154689 A JP 1154689A JP H02192763 A JPH02192763 A JP H02192763A
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JP
Japan
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electrode
insulating film
image sensor
electrodes
reading
Prior art date
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Pending
Application number
JP1011546A
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Japanese (ja)
Inventor
Hideo Watanabe
英生 渡辺
Katsuaki Komatsu
克明 小松
Atsushi Takahashi
厚 高橋
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Konica Minolta Inc
Original Assignee
Konica Minolta Inc
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Publication date
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Abstract

PURPOSE:To realize an image sensor of simple structure wherein crosstalk does not generate by forming a second insulating film and an upper surface ground electrode cn the upper surface of a matrix wiring part, and relatively reducing electrostatic capacitance between electrodes. CONSTITUTION:On a substrate 1, a lower electrode L is arranged; a first insulating film 5 is spread thereon; an upper electrode U is formed; a second insulating film 6 is arranged thereon; an upper surface ground electrode 7 is formed so as to cover the second insulating film 6. The upper electrode U and the lower electrode L have large areas facing the upper surface ground electrode 7, so that electrostatic capacitance C'' between these electrodes is comparatively large. As a result, electrostatic capacitance C' between the upper electrodes or between the lower electrodes becomes relatively small as compared with the above electrostatic capacitance C''.

Description

【発明の詳細な説明】 (産業上の利用分野) 本発明は画像読取り用のイメージセンサに関する。[Detailed description of the invention] (Industrial application field) The present invention relates to an image sensor for reading images.

(発明の背景) ファクシミリやイメージスキャナ等の画像読取装置にフ
ォトダイオードアレイからなるイメージセンサが使用さ
れている。
(Background of the Invention) Image sensors made of photodiode arrays are used in image reading devices such as facsimiles and image scanners.

また、光電変換材料としてのアモルファスシリコンは優
れた特性を有しており、フォトダイオードの材料として
使用されている。
Furthermore, amorphous silicon as a photoelectric conversion material has excellent properties and is used as a material for photodiodes.

ところで、イメージセンサの駆動方法として、画素数の
割に駆動IC数が少ないマトリクス駆動がよく使用され
る。このマトリクス駆動は、フォトダイオードアレイを
複数のブロックに分割しておき、読取り時は、各ブロッ
クを順次切り換えながら各ブロック毎にフォトダイオー
ドに当たった光信に応じた信号を順次読出すようにした
ものである。
Incidentally, as a method for driving an image sensor, matrix driving is often used, in which the number of driving ICs is small relative to the number of pixels. In this matrix drive, the photodiode array is divided into multiple blocks, and during reading, each block is sequentially switched and the signals corresponding to the optical signals that hit the photodiodes are sequentially read out for each block. It is.

(発明が解決しようとする課題) しかし、以上のような画像情報を電流値として読出すマ
トリクス駆動では、フォトダイオードに接続された配線
のインダクタンスや配線間の浮遊容量が大きいため信号
レベルに影響を与え、正確な画像情報が得られないとい
った問題がある。
(Problem to be Solved by the Invention) However, in matrix driving in which the image information as described above is read out as a current value, the inductance of the wiring connected to the photodiode and the stray capacitance between the wirings are large, which affects the signal level. However, there is a problem in that accurate image information cannot be obtained.

そこで、第5図のような読取り回路が提案されている。Therefore, a reading circuit as shown in FIG. 5 has been proposed.

この図において、破線で囲まれた部分Mはマトリクス配
線部であり、m個の光電変換素子(等価回路で示した)
を有するブロックがn個接続されている。Bl  (1
<l <n)は各ブロックの共通接続端子であり、スイ
ッチSBI  (1<I <n)を介してバイアス電圧
−■(ブロック選択時)若しくはアース(非選択時)に
接続される。各光電変換素子は、ブロッキングダイオー
ドBDlj(1<i <n、1<j <m)と、フォト
ダイオードPDIj (1<] <n、1<j <m)
と、フォトダイオードPDijと並列に接続されると考
えられる蓄積用コンデンサCPと、ブロッキングダイオ
ードBDIjと並列に接続されると考えられるコンデン
サCBとでなる等価回路で示される。CRj(1<j<
m)は光電変換素子に接続された読取り用コンデンサで
、その容量値は蓄積用コンデンサCPより充分大きく選
ばれている。Sj  (1<j <m)は読取り用コン
デンサCRjをリセットするためのリセットスイッチ、
Aj  (1<j <m)は読取り用コンデンサCRj
の両端電圧を受けるバッファアンプ、SRj  (1<
J <m)は該バッファアンプAjの出力を読出し時に
選択するスイッチである。
In this figure, a part M surrounded by a broken line is a matrix wiring part, which has m photoelectric conversion elements (shown as an equivalent circuit).
n blocks having the following are connected. Bl (1
<l <n) is a common connection terminal of each block, and is connected to the bias voltage -■ (when a block is selected) or ground (when not selected) via a switch SBI (1<I <n). Each photoelectric conversion element includes a blocking diode BDlj (1<i<n, 1<j<m) and a photodiode PDIj (1<]<n, 1<j<m).
, a storage capacitor CP considered to be connected in parallel with the photodiode PDij, and a capacitor CB considered to be connected in parallel with the blocking diode BDIj. CRj(1<j<
m) is a reading capacitor connected to the photoelectric conversion element, and its capacitance value is selected to be sufficiently larger than that of the storage capacitor CP. Sj (1<j<m) is a reset switch for resetting the reading capacitor CRj;
Aj (1<j<m) is the reading capacitor CRj
A buffer amplifier, SRj (1<
J<m) is a switch that selects the output of the buffer amplifier Aj at the time of reading.

このような読取り回路を用いれば、ブロック選択時にフ
ォトダイオードに照射した光量に応じた電流が読取り用
コンデンサCRに充電されるので、光信号を読取り用コ
ンデンサCRの両端電圧として順次取り出すことができ
る。
If such a reading circuit is used, the reading capacitor CR is charged with a current corresponding to the amount of light irradiated to the photodiode when a block is selected, so that optical signals can be sequentially extracted as a voltage across the reading capacitor CR.

第6図は上述の第5図の回路を実際に基板に配置した場
合の概略構成を示す説明図である。図において、1はガ
ラスやセラミック等で構成された基板、2はフォトダイ
オードPDIj、 ブロッキングダイオードBDIjが
配置されるダイオード部である。尚、このダイオード部
2の配置の詳細は省略する。L、、−Lnmはそれぞれ
ダイオード部2の各フォトダイオードPDIjの出力を
導く下部r1極である。U1〜U6は下部電極Lu−L
r+mからの出力を読取り用IC4に導く上部電極であ
る。尚、ここでは上部電極をU6まで示したが、m本の
電tM (Ul〜Um)があるとして説明する。また、
下部電極り、上部電極Uは、Al、Cr、Ti。
FIG. 6 is an explanatory diagram showing a schematic configuration when the circuit shown in FIG. 5 described above is actually arranged on a board. In the figure, 1 is a substrate made of glass, ceramic, etc., and 2 is a diode section in which a photodiode PDIj and a blocking diode BDIj are arranged. Note that the details of the arrangement of this diode section 2 will be omitted. L, , -Lnm are lower r1 poles that lead the output of each photodiode PDIj of the diode section 2, respectively. U1 to U6 are lower electrodes Lu-L
This is the upper electrode that leads the output from r+m to the reading IC4. Although the upper electrodes up to U6 are shown here, the explanation will be made assuming that there are m electric currents tM (Ul to Um). Also,
The lower electrode and the upper electrode U are made of Al, Cr, and Ti.

MO等の金属で構成されている。3は下部電極Lx−L
nmと上部電極U1〜Umとの間に絶縁のために5i0
2.SiN、ポリイミド等が塗布された絶縁膜である。
It is made of metal such as MO. 3 is the lower electrode Lx-L
5i0 for insulation between nm and upper electrodes U1 to Um
2. This is an insulating film coated with SiN, polyimide, etc.

尚、下部電極と上部電極との接続箇所はコンタクトホー
ルによる。
Note that the connection point between the lower electrode and the upper electrode is a contact hole.

第7図は上述の第6図のコンタクトホールの部分を示す
拡大図である。そして、第8図は上述の第7図のA−A
’断面を示す断面図である。第9図は上述の第7図のB
−B’断面を示す断面図である。このように上部電極と
下部電極とは絶縁膜3により絶縁されており、必要な接
続箇所はコンタクトホールにより接続されている。
FIG. 7 is an enlarged view showing the contact hole portion of FIG. 6 mentioned above. And, Fig. 8 is A-A of Fig. 7 mentioned above.
'It is a sectional view showing a cross section. Figure 9 is B of Figure 7 above.
It is a sectional view showing a -B' cross section. In this way, the upper electrode and the lower electrode are insulated by the insulating film 3, and necessary connection points are connected through contact holes.

しかし、マトリクス配線部Mは信号線が長くかつ多層に
配線されているため、信号線間(上部電極間若しくは下
部電極間)に無視できない線間容量を有し、信号線間で
容量結合を生じている。そしてこの線間容量が隣接素子
間、ブロック間のクロストークの原因になっている。
However, since the matrix wiring part M has long signal lines and is wired in multiple layers, there is a non-negligible line capacitance between the signal lines (between the upper electrodes or between the lower electrodes), and capacitive coupling occurs between the signal lines. ing. This line capacitance causes crosstalk between adjacent elements and between blocks.

一例として、読取り長216mo+ (A4サイズ)。As an example, the reading length is 216mo+ (A4 size).

画素密度8doj 7mg、ブロック数27.64素子
/ブロツクのラインセンサの場合、上部電極の1ライン
ペア間の線間容量は約120pFにもなる。
In the case of a line sensor with a pixel density of 8 doj 7 mg and a block number of 27.64 elements/block, the line capacitance between one line pair of upper electrodes is about 120 pF.

このため、光電変換出力によりある信号線に電圧変動が
生じると、隣接する信号線にも線間容量を介して電圧が
誘起される。例えば、第6図において上部型WU2に電
圧変動が生じると、隣接する上部電極U、、U、にも電
圧が誘起される。このようにしてクロストークが生じる
。従ってMTFが低下するので実用にたえない。
Therefore, when a voltage fluctuation occurs in a certain signal line due to the photoelectric conversion output, a voltage is also induced in the adjacent signal line via the line capacitance. For example, in FIG. 6, when a voltage fluctuation occurs in the upper mold WU2, a voltage is also induced in the adjacent upper electrodes U, , U. Crosstalk occurs in this way. Therefore, the MTF decreases, making it impractical.

本発明はこのような問題点に鑑みてなされたものであっ
て、その目的は、簡単な構成でクロストークを生じない
イメージセンサを提供することにある。
The present invention has been made in view of these problems, and an object of the present invention is to provide an image sensor that has a simple configuration and does not cause crosstalk.

(課題を解決するための手段) 前記した課題を解決する本発明は、複数の光電変換素子
がアレイ状に配置された光電変換手段と、この光電変換
手段からの出力信号を外部に読出すためのマトリクス配
線部とを有するイメージセンサにおいて、前記マトリク
ス配線部は下部電極。
(Means for Solving the Problems) The present invention for solving the above-mentioned problems includes a photoelectric conversion means in which a plurality of photoelectric conversion elements are arranged in an array, and a device for reading out an output signal from the photoelectric conversion means to the outside. In the image sensor having a matrix wiring section, the matrix wiring section is a lower electrode.

第1絶縁層、上部電極、第2絶縁層、上面電極が積層さ
れ、この上面電極が接地されていることを特徴とするも
のである。
The device is characterized in that a first insulating layer, an upper electrode, a second insulating layer, and a top electrode are laminated, and the top electrode is grounded.

(作用) 本発明のイメージセンサおいて、上部電極の配線を覆う
ように形成された上面電極により配線間の静電容量の影
響が減少する。
(Function) In the image sensor of the present invention, the upper surface electrode formed to cover the wiring of the upper electrode reduces the influence of capacitance between the wirings.

(実施例) 以下、図面を参照して本発明の実施例を詳細に説明する
(Example) Hereinafter, an example of the present invention will be described in detail with reference to the drawings.

第1図は本発明の一実施例の基板上の配線パターンの断
面を示す断面図である。この図は下部電極りと直交する
方向の断面を示している。図において、第8図と同一物
には同一番号を付し、詳しい説明は省略する。図におい
て、5は基板1若しくは下部電極り上に塗布された第1
絶縁膜である。
FIG. 1 is a sectional view showing a cross section of a wiring pattern on a substrate according to an embodiment of the present invention. This figure shows a cross section in a direction perpendicular to the lower electrode. In the figure, the same parts as in FIG. 8 are given the same numbers, and detailed explanations are omitted. In the figure, 5 is a first layer coated on the substrate 1 or the lower electrode layer.
It is an insulating film.

この第1絶縁膜5の上に上部電極Uが配置され、更にそ
の上には第2絶縁膜が配置されている。そして、この第
2絶縁膜6を覆うように上面接地電極が形成されている
。そして、この上面接地電極7は回路のグラウンド(ア
ース)に接続されている。従って、上部電極U、下部電
極りは上面接地電極7と対向する面積が大きいため、こ
れらの間で比較的大きな静電容量C′を有することにな
る。
An upper electrode U is arranged on this first insulating film 5, and a second insulating film is further arranged above it. An upper ground electrode is formed to cover the second insulating film 6. This upper ground electrode 7 is connected to the ground (earth) of the circuit. Therefore, since the upper electrode U and the lower electrode have a large area facing the upper ground electrode 7, they have a relatively large capacitance C' between them.

このため、上部電極間や下部電極間の静電容量(線間容
ff1) C’ は上記の静電容量C′に比べ相対的に
小さくなる。このため、クロストークの影響はほとんど
なくなる。
Therefore, the capacitance (line capacitance ff1) C' between the upper electrodes and between the lower electrodes is relatively smaller than the capacitance C' described above. Therefore, the influence of crosstalk is almost eliminated.

第2図は上部電極Uと直交する方向の断面を示している
。ここでは上部電極UII+  UI2の付近を示した
。一般に、平行導体間の静電容量Cは導体の対向面積に
比例し、導体間距離に反比例する。
FIG. 2 shows a cross section in a direction perpendicular to the upper electrode U. Here, the vicinity of upper electrodes UII+UI2 is shown. Generally, the capacitance C between parallel conductors is proportional to the opposing area of the conductors and inversely proportional to the distance between the conductors.

従って、対向面積の大きい上面接地電極7と各電極との
間の静電容量が大きくなるのは明らかである。
Therefore, it is clear that the capacitance between each electrode and the upper surface ground electrode 7, which has a large opposing area, becomes large.

第3図は白/黒の繰返しパターンをイメージセンサで読
取った場合の出力信号の特性を示す特性図である。第3
図(A)は理想的なイメージセンサで得られるであろう
特性を示し、第3図(B)は従来のイメージセンサで得
られる特性を示し、第3図(C)は本発明のイメージセ
ンサで得られる特性を示している。ここでは、イメージ
センサのa、c、e、g、l、に、m番目の画素に光が
当たり、それ以外の画素には光が当たらないようにした
場合の、画素位置とセンサ出力電圧の特性を示した。尚
、第3図(B)、  (C)では読取り長216mm 
(A4サイズ)1画素密度3dat /mm。
FIG. 3 is a characteristic diagram showing the characteristics of an output signal when a repeating white/black pattern is read by an image sensor. Third
Figure (A) shows the characteristics that would be obtained with an ideal image sensor, Figure 3 (B) shows the characteristics that would be obtained with a conventional image sensor, and Figure 3 (C) shows the characteristics that would be obtained with the image sensor of the present invention. This shows the characteristics obtained with . Here, we will explain the pixel position and sensor output voltage when the m-th pixel in a, c, e, g, and l of the image sensor is illuminated and the other pixels are not illuminated. The characteristics were shown. In addition, in Fig. 3 (B) and (C), the reading length is 216 mm.
(A4 size) 1 pixel density 3 dat/mm.

ブロック数27.64素子/ブロツクのラインセンサを
使用し、4Ωp/llll11の白/黒の繰返しライン
パターンを実際に読取った場合の特性を示した。
Characteristics were shown when a line sensor with a block number of 27.64 elements/block was used to actually read a white/black repetitive line pattern of 4Ωp/llll11.

第5図(A)に示す理想イメージセンサの場合は、a、
  c、  e、  g、  i、  k、 m番目の
画素からのみ出力電圧が得られる。
In the case of the ideal image sensor shown in FIG. 5(A), a,
Output voltages are obtained only from the c, e, g, i, k, and mth pixels.

これに対し、従来からのイメージセンサの場合、第3図
(B)に示すように、クロストークの影響により受光し
ている画素の電圧レベルが低下すると共に、受光してい
ない画素(受光している画素の隣接画素)にも電圧が発
生している。この場合のMTF  (Moduraむf
an  Transrer  Function  )
は約16%であり、実用にはあまり適さない。
On the other hand, in the case of conventional image sensors, as shown in Figure 3 (B), the voltage level of pixels receiving light decreases due to the influence of crosstalk, and the voltage level of pixels receiving light decreases (pixels receiving light do not receive light). A voltage is also generated in the pixels adjacent to the pixel. In this case, MTF (Modura f
an Transrer Function)
is about 16%, which is not very suitable for practical use.

そして、第3図(C)に示す本発明のイメージセンサの
場合、受光している画素の電圧レベルが向」ニすると共
に、受光していない画素(受光している画素に隣接する
画素)の出力電圧もかなり低下する。このときのMTF
は約60%であり、従来に比較して特性の向上が著しい
。これは、上面接地電極7により電極間の線間容量が相
対的に小さくなり、電極間のクロストークが少なくなっ
ているためである。
In the case of the image sensor of the present invention shown in FIG. 3(C), the voltage level of the pixel receiving light is opposite, and the voltage level of the pixel not receiving light (the pixel adjacent to the pixel receiving light) is The output voltage also drops considerably. MTF at this time
is about 60%, which is a remarkable improvement in characteristics compared to the conventional one. This is because the line capacitance between the electrodes is relatively small due to the upper ground electrode 7, and crosstalk between the electrodes is reduced.

第4図はマトリクス配線部Mの製造工程を説明するだめ
の説明図である。尚、ここでは説明のためマトリクス配
線部の一部分を示す。まず、ダイオード部2(図示せず
)が形成された基板1上にスパッタ法若しくは真空蒸着
法によりC「の下部電極L++〜L+3を形成する(第
4図(A))。その上に5in2.SiN、ポリイミド
等の第1−絶縁膜5を形成し、その後マスクパターンに
よりエツチングする。すなわち、コンタクトホールによ
り接続を行う部分の絶縁膜を除去する(第4図(B))
。そして、Al1の2L部電極■ハ〜U、を形成し、F
部電極Lll〜L、3との接続を行う(第6図(C))
。この後、マトリクス配線部Mの全体に第2絶縁膜6を
形成し、この第2絶縁膜6の上に上面接地電極7を形成
する。そして、この上面接地電極7を回路のアースに接
続する。
FIG. 4 is an explanatory diagram for explaining the manufacturing process of the matrix wiring section M. Note that a part of the matrix wiring section is shown here for explanation. First, lower electrodes L++ to L+3 of C' are formed by sputtering or vacuum evaporation on the substrate 1 on which the diode part 2 (not shown) is formed (FIG. 4(A)). A first insulating film 5 made of SiN, polyimide, etc. is formed, and then etched using a mask pattern. That is, the insulating film in the portion where the connection is made through the contact hole is removed (FIG. 4(B)).
. Then, form the 2L portion electrodes ①~U of Al1, and
Connections are made with the partial electrodes Lll to L, 3 (Fig. 6(C)).
. Thereafter, a second insulating film 6 is formed over the entire matrix wiring section M, and an upper ground electrode 7 is formed on this second insulating film 6. Then, this upper ground electrode 7 is connected to the ground of the circuit.

尚、上述の実施例では第2絶縁膜6の全面を覆うように
上面接地1i17を形成したが、これに限定されるもの
ではない。例えば、上部電極Uや下部電極りのパターン
形状に合わせて上面接地電極7を形成してもかまわない
Incidentally, in the above embodiment, the upper surface ground 1i17 was formed so as to cover the entire surface of the second insulating film 6, but the present invention is not limited to this. For example, the upper ground electrode 7 may be formed in accordance with the pattern shape of the upper electrode U and the lower electrode.

(発明の効果) 以上詳細に説明したように、本発明では、マトリクス配
線部の上面に第2絶縁膜、上面接地電極を形成するよう
にした。このため、電極間の静電容量を相対的に減少さ
せ、クロストークを減らすことができる。従って、簡単
な構成でクロストークを生じないイメージセンサを実現
することができる。
(Effects of the Invention) As described above in detail, in the present invention, the second insulating film and the top ground electrode are formed on the top surface of the matrix wiring section. Therefore, the capacitance between the electrodes can be relatively reduced, and crosstalk can be reduced. Therefore, it is possible to realize an image sensor that does not cause crosstalk with a simple configuration.

【図面の簡単な説明】[Brief explanation of the drawing]

第1図は本発明の一実施例の配線パターンの断面を示す
断面図、第2図は配線パターンの別の断面を示す断面図
、第3図はイメージセンサの出力電圧特性を示す特性図
、第4図はは本発明のイメージセンサの製造工程を説明
する説明図、第5図はイメージセンサの回路を示す回路
図、第6図は従来のイメージセンサの回路パターン例を
示すパターン図、第7図は第6図のパターンの一部を拡
大した部分平面図、第8図は第7図のA−A’断面を示
す断面図、第9図は第7図のB−B’断面を示す断面図
である。 1・・・基板 3・・・絶縁膜 5・・・第1絶縁膜 7・・・上面接地電極 U・・・上部電極 2・・・ダイオード部 4・・・読取り用IC 6・・・第2絶縁膜 L・・・下部電極
FIG. 1 is a sectional view showing a cross section of a wiring pattern according to an embodiment of the present invention, FIG. 2 is a sectional view showing another cross section of the wiring pattern, and FIG. 3 is a characteristic diagram showing output voltage characteristics of an image sensor. FIG. 4 is an explanatory diagram explaining the manufacturing process of the image sensor of the present invention, FIG. 5 is a circuit diagram showing the circuit of the image sensor, FIG. 6 is a pattern diagram showing an example of the circuit pattern of a conventional image sensor, and FIG. 7 is a partial plan view of a part of the pattern shown in FIG. 6 on an enlarged scale, FIG. 8 is a sectional view taken along the line AA' in FIG. 7, and FIG. FIG. 1...Substrate 3...Insulating film 5...First insulating film 7...Top ground electrode U...Upper electrode 2...Diode part 4...Reading IC 6...No. 2 Insulating film L...lower electrode

Claims (1)

【特許請求の範囲】 複数の光電変換素子がアレイ状に配置された光電変換手
段と、この光電変換手段からの出力信号を外部に読出す
ためのマトリクス配線部とを有するイメージセンサにお
いて、 前記マトリクス配線部は下部電極、第1絶縁層、上部電
極、第2絶縁層、上面電極が積層され、この上面電極が
接地されていることを特徴とするイメージセンサ。
[Scope of Claims] An image sensor comprising a photoelectric conversion means in which a plurality of photoelectric conversion elements are arranged in an array, and a matrix wiring section for reading an output signal from the photoelectric conversion means to the outside, comprising: An image sensor characterized in that the wiring portion includes a lower electrode, a first insulating layer, an upper electrode, a second insulating layer, and an upper surface electrode, and the upper surface electrode is grounded.
JP1011546A 1989-01-18 1989-01-20 Image sensor Pending JPH02192763A (en)

Priority Applications (2)

Application Number Priority Date Filing Date Title
JP1011546A JPH02192763A (en) 1989-01-20 1989-01-20 Image sensor
US07/466,593 US5023443A (en) 1989-01-18 1990-01-17 Image sensor and its driving method

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP1011546A JPH02192763A (en) 1989-01-20 1989-01-20 Image sensor

Publications (1)

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ID=11780960

Family Applications (1)

Application Number Title Priority Date Filing Date
JP1011546A Pending JPH02192763A (en) 1989-01-18 1989-01-20 Image sensor

Country Status (1)

Country Link
JP (1) JPH02192763A (en)

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US5136358A (en) * 1990-06-06 1992-08-04 Fuji Xerox Co., Ltd. Multi-layered wiring structure

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* Cited by examiner, † Cited by third party
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US5136358A (en) * 1990-06-06 1992-08-04 Fuji Xerox Co., Ltd. Multi-layered wiring structure

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