JPH0210797Y2 - - Google Patents
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- JPH0210797Y2 JPH0210797Y2 JP1981112474U JP11247481U JPH0210797Y2 JP H0210797 Y2 JPH0210797 Y2 JP H0210797Y2 JP 1981112474 U JP1981112474 U JP 1981112474U JP 11247481 U JP11247481 U JP 11247481U JP H0210797 Y2 JPH0210797 Y2 JP H0210797Y2
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- diode
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- 238000004804 winding Methods 0.000 claims description 25
- 239000003990 capacitor Substances 0.000 claims description 5
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- 239000004575 stone Substances 0.000 description 2
Description
【考案の詳細な説明】
本考案は、放電灯点灯装置等に使用するのに好
適な一石式のインバータ回路に関する。[Detailed Description of the Invention] The present invention relates to a one-stone inverter circuit suitable for use in a discharge lamp lighting device or the like.
一石式のインバータ回路には種々の形式のもの
があるが、第１図に従来のインバータ回路の一例
を示す。第１図において、インバータ回路は直流
電源Ｅと出力トランスＴとスイツチング用トラン
ジスタＱとを有しており、出力トランスＴは一次
巻線N1、二次巻線N2及び帰還巻線N3を有してい
る。その出力トランスＴの一次巻線N1にはトラ
ンジスタＱのコレクタ、エミツタ間が直列に接続
され、これらに対し直流電源Ｅからの直流入力が
チヨークコイルＬを介して加えられる。また帰還
巻線N3の一端は、トランジスタＱのベースに接
続されトランジスタのベース、エミツタ間にはダ
イオードD3が接続されている。さらに、直流電
源Ｅからの直流入力を分圧するために抵抗器R1
及び抵抗器R2の直列回路が設けられ、両抵抗器
の接続点より抵抗器R3、帰還巻線N3を介してベ
ースバイアスが加えられるようになつている。ま
た、抵抗器R2に対して並列にコンデンサＣが接
続される。前記出力トランスＴの二次巻線N2に
は交流出力が得られ、この交流出力は放電灯など
の負荷Ｚに供給される。 There are various types of single-stone inverter circuits, and FIG. 1 shows an example of a conventional inverter circuit. In Fig. 1, the inverter circuit has a DC power supply E, an output transformer T, and a switching transistor Q. The output transformer T has a primary winding N1 , a secondary winding N2 , and a feedback winding N3. have. The collector and emitter of a transistor Q are connected in series to the primary winding N1 of the output transformer T, and a DC input from a DC power source E is applied to these through a choke coil L. Further, one end of the feedback winding N3 is connected to the base of the transistor Q, and a diode D3 is connected between the base and emitter of the transistor. Furthermore, a resistor R 1 is added to divide the DC input from the DC power supply E.
A series circuit consisting of a resistor R 2 and a resistor R 2 is provided, and a base bias is applied from the connection point of both resistors via a resistor R 3 and a feedback winding N 3 . Further, a capacitor C is connected in parallel to the resistor R2 . An AC output is obtained from the secondary winding N2 of the output transformer T, and this AC output is supplied to a load Z such as a discharge lamp.
ところで、第１図の如き構成であると、帰還巻
線N3に発生する電圧が、トランジスタＱのベー
スに対し順方向である場合も逆方向の場合も、帰
還巻線N3には同じ負荷がかかることになるため、
帰還巻線N3の電圧がベースに逆方向である場合、
それは損失となつて消費されることになる。特に
大きな出力を得るようなインバータ回路において
は、トランジスタＱのベース回路のインピーダン
スを小さくする必要があり、すなわち抵抗器R3
などを小さくする必要があるため、帰還巻線N3
に発生する電圧がベースに対し逆方向である場合
の損失はかなり大きくなるきらいがあつた。 By the way, with the configuration shown in Figure 1, whether the voltage generated in the feedback winding N3 is in the forward direction or in the reverse direction with respect to the base of the transistor Q, the same load is applied to the feedback winding N3 . Since it will cost
If the voltage in the feedback winding N 3 is in the opposite direction to the base, then
It will be consumed as a loss. Especially in an inverter circuit that obtains a large output, it is necessary to reduce the impedance of the base circuit of transistor Q, that is, to reduce the impedance of the base circuit of transistor Q.
etc., the feedback winding N 3
When the voltage generated at the base is in the opposite direction to the base, the loss tends to be considerably large.
本考案は、上記の欠点を除去し、効率の改善を
図つたインバータ回路を提供しようとするもので
ある。 The present invention aims to eliminate the above-mentioned drawbacks and provide an inverter circuit with improved efficiency.
以下、本考案に係るインバータ回路の実施例を
図面に従つて説明する。 Embodiments of the inverter circuit according to the present invention will be described below with reference to the drawings.
第２図において、直流電源Ｅよりの直流入力を
分圧するために抵抗器R1、ダイオードD1及び抵
抗器R2から成る直列回路が設けられており、ダ
イオードD1のカソードと抵抗器R1との接続点と
出力トランスの帰還巻線N3との間にトランジス
タＱのベースバイアスを与えるためのダイオード
D2が接続されている。またダイオードD1と抵抗
器R2の直列回路に対しコンデンサＣが並列に接
続される。なお、その他の回路構成は従来の第１
図の場合と同様である。 In FIG. 2, a series circuit consisting of a resistor R 1 , a diode D 1 and a resistor R 2 is provided to divide the DC input from the DC power supply E, and the cathode of the diode D 1 and the resistor R 1 A diode for providing a base bias of the transistor Q between the connection point with the output transformer and the feedback winding N3 of the output transformer.
D 2 is connected. Further, a capacitor C is connected in parallel to the series circuit of the diode D1 and the resistor R2 . Note that the other circuit configurations are the same as the conventional first circuit configuration.
This is the same as the case shown in the figure.
上記構成において、帰還巻線N3の誘起電圧が
トランジスタＱのベースに対し順方向の場合は、
トランジスタＱのベース、エミツタ、抵抗器R2、
ダイオードD1、ダイオードD2の経路で電流が流
れる。この場合ダイオードD1，D2は順方向であ
るから充分な電流を供給可能である。また、抵抗
器R2に対しダイオードD1が直列に挿入されてい
るので抵抗器R2をベース電流を充分に流すため
に小さな値に設定したとしても起動用の抵抗器
R1は比較的大きな値のままで良い。すなわち、
ダイオードD1がないと、抵抗器R2を小さくする
と同時に抵抗器R1をも小さくしなければならず、
無駄な電流が多くなり電力損失が増加する。一
方、帰還巻線N3に発生する電圧がトランジスタ
Ｑに対して逆方向の場合はダイオードD2の存在
により実質的に帰還巻線N3には電流が流れず効
率を向上させることができる。また、トランジス
タＱがオンからオフになるときのベース、エミツ
タ間の残留電荷がダイオードD2のカソード、ア
ノード間の容量を通してコンデンサＣに放出され
ることになり、残留電荷の迅速な除去が可能であ
り、高速のスイツチング動作が可能である。 In the above configuration, if the induced voltage in the feedback winding N 3 is in the forward direction with respect to the base of the transistor Q, then
Base of transistor Q, emitter, resistor R 2 ,
Current flows through the path of diode D 1 and diode D 2 . In this case, since the diodes D 1 and D 2 are in the forward direction, they can supply sufficient current. Also, since diode D1 is inserted in series with resistor R2 , even if resistor R2 is set to a small value to allow sufficient base current to flow, it will still be used as a starting resistor.
R 1 can be left at a relatively large value. That is,
Without diode D 1 , resistor R 1 would have to be made smaller at the same time as resistor R 2 was made smaller;
This increases wasteful current and increases power loss. On the other hand, when the voltage generated in the feedback winding N3 is in the opposite direction with respect to the transistor Q, no current substantially flows through the feedback winding N3 due to the presence of the diode D2 , thereby improving efficiency. Additionally, when transistor Q turns from on to off, the residual charge between the base and emitter is discharged to capacitor C through the capacitance between the cathode and anode of diode D2 , making it possible to quickly remove the residual charge. Yes, high-speed switching operation is possible.
以上説明したように、本考案によれば、スイツ
チング用トランジスタのベース回路に工夫を加え
ることにより、該ベース回路における電力損失を
低減し、効率の向上を図ることが可能なインバー
タ回路を得ることができる。 As explained above, according to the present invention, by adding innovation to the base circuit of the switching transistor, it is possible to obtain an inverter circuit that can reduce power loss in the base circuit and improve efficiency. can.
第１図は従来のインバータ回路を示す回路図、
第２図は本考案に係るインバータ回路の実施例を
示す回路図である。
Ｃ……コンデンサ、D1乃至D3……ダイオード、
Ｅ……直流電源、Ｌ……チヨークコイル、Ｔ……
出力トランス、N1……一次巻線、N2……二次巻
線，N3……帰還巻線、Ｑ……トランジスタ、R1，
R2……抵抗器、Ｚ……負荷。
Figure 1 is a circuit diagram showing a conventional inverter circuit.
FIG. 2 is a circuit diagram showing an embodiment of the inverter circuit according to the present invention. C...Capacitor, D1 to D3 ...Diode,
E...DC power supply, L...Chiyoke coil, T...
Output transformer, N1 ...Primary winding, N2 ...Secondary winding, N3 ...Feedback winding, Q...Transistor, R1 ,
R 2 ...Resistor, Z...Load.
Claims (1)
帰還巻線N3を有する出力トランスＴと、該出力
トランスＴの一次巻線N1にコレクタ、エミツタ
間が直列に接続されかつベースが帰還巻線N3の
一端に接続されていて前記一次巻線への前記直流
電源よりの直流入力をオン、オフするスイツチン
グ用トランジスタＱと、前記直流電源Ｅよりの直
流入力を分圧する第１の抵抗器R1、第１のダイ
オードD1及び第２の抵抗器R2から成る直列回路
と、前記第１のダイオードD1のカソードと前記
第１の抵抗器R1との接続点と前記帰還巻線N3の
他端との間に接続されてベースバイアスを与える
第２のダイオードD2と、前記第１のダイオード
D1と第２の抵抗器R2との直列接続に対し並列に
接続されるコンデンサＣとを備えたことを特徴と
するインバータ回路。 A DC power source E, an output transformer T having a primary winding N 1 , a secondary winding N 2 and a feedback winding N 3 , and a collector and an emitter connected in series to the primary winding N 1 of the output transformer T. and a switching transistor Q whose base is connected to one end of the feedback winding N3 and turns on and off the DC input from the DC power source to the primary winding, and divides the DC input from the DC power source E into voltage. A series circuit consisting of a first resistor R 1 , a first diode D 1 and a second resistor R 2 and a connection point between the cathode of the first diode D 1 and the first resistor R 1 and the other end of the feedback winding N3 to provide a base bias, and the first diode
An inverter circuit comprising a capacitor C connected in parallel to the series connection of D1 and a second resistor R2 .
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP11247481U JPS5822094U (en) | 1981-07-29 | 1981-07-29 | inverter circuit |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP11247481U JPS5822094U (en) | 1981-07-29 | 1981-07-29 | inverter circuit |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS5822094U JPS5822094U (en) | 1983-02-10 |
| JPH0210797Y2 true JPH0210797Y2 (en) | 1990-03-16 |
Family
ID=29906800
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP11247481U Granted JPS5822094U (en) | 1981-07-29 | 1981-07-29 | inverter circuit |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS5822094U (en) |
Families Citing this family (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS61144118A (en) * | 1984-12-18 | 1986-07-01 | Matsushita Electric Ind Co Ltd | Oscillating circuit |
Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5414327B2 (en) * | 1976-07-30 | 1979-06-06 |
Family Cites Families (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5414327U (en) * | 1977-07-04 | 1979-01-30 | ||
| JPS54144033U (en) * | 1978-03-29 | 1979-10-05 |
-
1981
- 1981-07-29 JP JP11247481U patent/JPS5822094U/en active Granted
Patent Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5414327B2 (en) * | 1976-07-30 | 1979-06-06 |
Also Published As
| Publication number | Publication date |
|---|---|
| JPS5822094U (en) | 1983-02-10 |
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