JPH0144074B2 - - Google Patents
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- JPH0144074B2 JPH0144074B2 JP59272115A JP27211584A JPH0144074B2 JP H0144074 B2 JPH0144074 B2 JP H0144074B2 JP 59272115 A JP59272115 A JP 59272115A JP 27211584 A JP27211584 A JP 27211584A JP H0144074 B2 JPH0144074 B2 JP H0144074B2
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Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明は、電子スチルカメラの画像信号再生装
置において１水平走査線期間（以後、1Hとする）
ごとに赤色信号（Ｒ−Ｙ）、青色信号（Ｂ−Ｙ）
と交替して送られる線順次色差信号の同時化回路
に関する。[Detailed Description of the Invention] [Industrial Field of Application] The present invention provides an image signal reproducing device for an electronic still camera in which one horizontal scanning line period (hereinafter referred to as 1H) is used.
Red signal (R-Y), blue signal (B-Y)
This invention relates to a synchronization circuit for line-sequential color difference signals sent alternately.
電子スチルカメラの色信号はＲ−Ｙ、Ｂ−Ｙの
２つの色差信号がそれぞれ中心周波数1.2MHz、
1.3MHzの線順次FM色差信号として磁気デイスク
に記録されている。従つて、再生時には1H
（63.5μs）ごとに交替する２つの色差信号を分離
して同時に出力する回路が必要になる。第３図に
1H遅延線を利用した回路を示す。
The color signals of an electronic still camera have two color difference signals, R-Y and B-Y, each with a center frequency of 1.2MHz.
It is recorded on a magnetic disk as a 1.3MHz line-sequential FM color difference signal. Therefore, during playback, 1H
A circuit that separates two color difference signals that alternate every (63.5 μs) and outputs them simultaneously is required. In Figure 3
This shows a circuit using a 1H delay line.
磁気記録装置から再生されたFM色差信号は
FM復調器１で復調されるが、1Hごとに…Ｒ−
Y1、Ｂ−Y1、Ｒ−Y2、Ｂ−Y2…と直列になつて
いる。色信号としてはＲ−Y1を1H遅延してＢ−
Y1と同時化する。Ｒ−Y2、Ｂ−Y2についても同
様である。そこでFM復調器１の出力を２分岐
し、1H遅延線２を介してスイツチ３にいたる経
路と、直接スイツチ３にいたる経路を設け、スイ
ツチ３で切替えて出力する。第３図の各点の信号
は、第４図に示してあるように、ｂ点では1H遅
れの信号となつているので、スイツチ３を駆動す
る同時化パルスのタイミングによつてＢ−ＹとＲ
−Ｙとが同時的にｃ，ｄに分離して出力される。
この図に示すように同時化パルスが“Ｈ”のとき
には（Ｒ−Y1、Ｂ−Y1）、（Ｒ−Y2、Ｂ−Y2）な
ど同一時点で写した信号が一致する。“Ｌ”のと
きは（Ｒ−Y2、Ｂ−Y1）と1Hずれるが、Ｒ−Y2
とＲ−Y1との差は少ないのでこれによる色相の
変動はない。問題になるのは同時化パルスが
“Ｈ”であるべきときに“Ｌ”あるいはその逆で
ある場合で、このときにはｄ点にＲ−Ｙ、ｅ点に
Ｂ−Ｙが表われ色が反転する。直ちに同時化パル
スを正しい位相に訂正すれば視覚的には色の反転
が見のがされるが、継続的になると画像が著しく
見にくいものとなる。 The FM color difference signal reproduced from the magnetic recording device is
It is demodulated by FM demodulator 1, but every 1H...R-
They are connected in series with Y 1 , B-Y 1 , R-Y 2 , B-Y 2 . As a color signal, R-Y 1 is delayed by 1H and B-
Synchronize with Y 1 . The same applies to RY2 and B- Y2 . Therefore, the output of the FM demodulator 1 is branched into two paths, one leading to the switch 3 via the 1H delay line 2, and the other directly leading to the switch 3, and the output is switched by the switch 3. As shown in FIG. 4, the signals at each point in FIG. 3 are delayed by 1H at point b, so the signals at each point in FIG. R
-Y are simultaneously separated into c and d and output.
As shown in this figure, when the synchronization pulse is "H", signals captured at the same time, such as (RY 1 , BY 1 ) and (RY 2 , BY 2 ), match. When “L”, there is a 1H difference from (RY 2 , B-Y 1 ), but RY 2
Since the difference between and RY 1 is small, there is no change in hue due to this. The problem arises when the synchronized pulse is "L" when it should be "H" or vice versa, and in this case, R-Y appears at point d and B-Y appears at point e, and the colors are reversed. . If the synchronization pulse is immediately corrected to the correct phase, the color inversion can be visually overlooked, but if it continues, the image becomes extremely difficult to see.
同時化パルスはFM復調器１の出力信号と水平
同期信号とから第３図の点線で囲む同時化パルス
発生回路４で発生させる。この回路にはＲ−Ｙ、
Ｂ−Ｙか判定する回路が必要で、それに基づいて
同時化パルスを制御する。しかし電子スチルカメ
ラは現在開発中であつて、上記同時化パルス発生
回路は周知でない。 A synchronization pulse is generated from the output signal of the FM demodulator 1 and the horizontal synchronization signal by a synchronization pulse generation circuit 4 surrounded by a dotted line in FIG. This circuit includes R-Y,
A circuit is required to determine whether it is B-Y, and the synchronization pulse is controlled based on this. However, electronic still cameras are currently under development, and the above synchronization pulse generation circuit is not well known.
本発明の目的は、前記した線順次色差信号をこ
の信号と、この信号を1H遅延させた信号との２
線にわけ、出力側の２線との接続をスイツチによ
り1Hごとに反転することで２つの色差信号を分
離し同時に出力する方式において、上記のスイツ
チを駆動する同時化パルスを安定に発生する回路
を提供することにある。特に1Hごとに送られて
くる線順次色差信号がＲ−ＹかＢ−Ｙか常に監視
して、それに追随して適合した同時化パルスを発
生するようにしたものである。
It is an object of the present invention to convert the above-mentioned line-sequential color difference signal into two signals: this signal and a signal delayed by 1H.
A circuit that stably generates the synchronization pulse that drives the above switch in a method that separates two color difference signals and outputs them simultaneously by inverting the connection with the two output wires every 1H using a switch. Our goal is to provide the following. In particular, it constantly monitors whether the line-sequential color difference signal sent every 1H is R-Y or B-Y, and generates an appropriate synchronization pulse to follow it.
本発明の回路は、制御部・サンプル部・色差信
号判定部からなる。
The circuit of the present invention includes a control section, a sample section, and a color difference signal determination section.
制御部は、水平同期信号を交互に２つのパルス
列（サンプリングパルス）に分配するとともに、
1Hごとに“Ｈ”、“Ｌ”と交替する制御信号を発
生する。 The control unit alternately distributes the horizontal synchronization signal into two pulse trains (sampling pulses), and
A control signal that alternates between "H" and "L" is generated every 1H.
サンプル部は、1Hごとに送られてくる線順次
色差信号を２分岐し、各分岐に設けたサンプルホ
ールド回路に導き、前記制御部のサンプリングパ
ルスによりサンプルした出力を2H間保持出力す
る。 The sample section branches the line-sequential color difference signal sent every 1H into two, guides it to a sample hold circuit provided in each branch, and holds and outputs the output sampled by the sampling pulse of the control section for 2H.
色差信号判定部は、Ａ、Ｂの２入力端子の比較
器のＡ入力端子に前記サンプル部の１出力を導
き、Ｂ入力端子には前記サンプル部の他の出力と
比較器の出力を反転し1H内の遅延を与えられた
出力とを切替スイツチにより交替に入力する。 The color difference signal determination section introduces one output of the sample section to the A input terminal of a comparator having two input terminals, A and B, and inverts the other output of the sample section and the output of the comparator to the B input terminal. A changeover switch is used to alternately input the output with a delay of within 1H.
本発明の回路では、制御部で発生した制御信号
によつて、色差信号判定部の切替スイツチの切替
を行ない、比較器の出力を同時化パルスとして出
力する。 In the circuit of the present invention, the control signal generated by the control section switches the changeover switch of the color difference signal determination section, and outputs the output of the comparator as a synchronization pulse.
本発明は、FM変調された色差信号の中心周波
数がＲ−Ｙでは1.2MHz、Ｂ−Ｙでは1.3MHzとな
つているから、再生時に復調された色差信号が
1Hごとに直流レベルを異にすることを利用して
いる。直流レベルは各1Hのブランキング期間に
サンプルし、2H保持するようにすることで、隣
り合うＨ間の直流レベルを比較することで、Ｒ−
ＹかＢ−Ｙか判定する。この判定により同時化パ
ルスを発生する。常に、Ｒ−Ｙ、Ｂ−Ｙの直流レ
ベルを比較するので、誤動作が少ない安定した同
時化パルスを発生できる。
In the present invention, since the center frequency of the FM-modulated color difference signal is 1.2MHz for R-Y and 1.3MHz for B-Y, the demodulated color difference signal during playback is
It makes use of changing the DC level every 1 hour. By sampling the DC level during each 1H blanking period and holding it for 2H, by comparing the DC levels between adjacent H, R-
Determine whether it is Y or BY. Based on this determination, a synchronization pulse is generated. Since the DC levels of R-Y and B-Y are always compared, stable synchronization pulses with fewer malfunctions can be generated.
第１図に本発明の一実施例の回路ブロツク図を
示す。１０が制御部、２０がサンプル部、その他
が色差信号判定部３０となつている。第２図のタ
イムチヤートを参照して以下動作説明を行なう。
FIG. 1 shows a circuit block diagram of an embodiment of the present invention. 10 is a control section, 20 is a sample section, and the others are a color difference signal determination section 30. The operation will be explained below with reference to the time chart shown in FIG.
制御部１０は同期信号をＤ型フリツプフロツプ
１１に入力する。Ｄ型フリツプフロツプ１１は
の出力をデータ入力端子に接続しているから同期
信号ごとに反転し、アンドゲート１２，１３を開
閉するから、同期信号は2Hごとのパルス列の信
号１２ａ，１３ａに分配される。信号１２ａ，１
３ａは1Hずつ位相を異にするサンプリングパル
スとしてサンプル部２０のサンプリングホールド
回路２１，２２にそれぞれ入力する。また信号１
２ａ，１３ａによりRSラツチ回路１４は1Hごと
に“Ｈ”、“Ｌ”と交替する制御信号１４ａを出力
し、切替スイツチ３１をON側、OFF側にそれぞ
れ切替える。サンプル部２０では、色差信号が２
つのサンプリングホールド回路２１，２２に分岐
して入力するが、前記信号１２ａ，１３ａによつ
て2Hごとのサンプリングを行なう。サンプリン
グ時点はいずれもブランキング期間で、映像信号
に関係なく直流レベルをサンプルし2H期間サン
プル値を保持している。 The control section 10 inputs a synchronizing signal to the D-type flip-flop 11. Since the output of the D-type flip-flop 11 is connected to the data input terminal, it is inverted for each synchronization signal, and AND gates 12 and 13 are opened and closed, so the synchronization signal is distributed into pulse train signals 12a and 13a every 2H. . Signal 12a,1
3a is input to the sampling and hold circuits 21 and 22 of the sample section 20 as sampling pulses whose phases differ by 1H. Also signal 1
2a and 13a, the RS latch circuit 14 outputs a control signal 14a that alternates between "H" and "L" every 1H, and switches the changeover switch 31 to the ON side and OFF side, respectively. In the sample section 20, the color difference signal is 2
The signals are branched and input to two sampling and hold circuits 21 and 22, and sampling is performed every 2H using the signals 12a and 13a. All sampling points are blanking periods, and the DC level is sampled regardless of the video signal, and the sampled values are held for a 2H period.
第２図最上部にはＢ−Ｙ、Ｒ−Ｙの復調波形を
図示してある。この波形に示すようにＢ−Ｙ、Ｒ
−Ｙには直流レベル差があり、サンプリングは
各々の前縁で行なう。 At the top of FIG. 2, demodulated waveforms of BY and RY are illustrated. As shown in this waveform, B-Y, R
-Y has a DC level difference and sampling is done at each leading edge.
色差信号判定部３０は比較器３２と、RSラツ
チ回路１４の出力を遅延する遅延回路３４と、Ｄ
型フリツプフロツプ３３とを有している。比較器
３２の入力側のＡ入力端子には直接にサンプリン
グホールド回路２１の出力２１ａが入力するが、
Ｂ入力端子にはサンプリングホールド回路２２の
出力２２ａとＤ型フリツプフロツプ３３の出力
とが切替スイツチ３１によつて切替えて入力す
る。切替スイツチ３１は制御信号１４ａが“Ｈ”
のときON側を、“Ｌ”のときOFF側を導通する
ものとする。 The color difference signal determination unit 30 includes a comparator 32, a delay circuit 34 that delays the output of the RS latch circuit 14, and a D
type flip-flop 33. The output 21a of the sampling hold circuit 21 is directly input to the A input terminal on the input side of the comparator 32.
The output 22a of the sampling hold circuit 22 and the output of the D-type flip-flop 33 are input to the B input terminal by being switched by the changeover switch 31. The control signal 14a of the changeover switch 31 is “H”
The ON side is conductive when it is “L”, and the OFF side is conductive when it is “L”.
つまり、制御信号１４ａが“Ｈ”のときのみＲ
−Ｙ、Ｂ−Ｙのサンプリング値を比較する。この
ように1Hの時間をおいて比較する理由を次に説
明する。 In other words, only when the control signal 14a is "H"
Compare the sampling values of -Y and B-Y. The reason for comparing after 1 hour is explained next.
サンプリングホールド回路２１，２２のサンプ
リング2Hごとになされ、しかも2Hホールドされ
るので、その出力２１ａ，２２ａは正常動作では
常に同一であり、したがつて比較器３２に、出力
２１ａ，２２ａを直接導くならば、比較器出力は
一定である。しかし同時化パルスは第４図に示す
ように“Ｈ”、“Ｌ”と反転しなければならないの
で、2H期間の1H期間のみサンプリングホールド
回路２１，２２の出力２１ａ，２２ａを比較し
て、次の1H期間では反転する回路が必要となる。
本実施例ではＤ型フリツプフロツプ３３の出力を
切替スイツチ３１を介して比較器３２の一端子に
入力することで行なつているが、この動作説明に
ついては後述する。しばらくは、1H期間で比較
した後、比較器３２の出力は次の1H期間で反転
するものとしておく。 Since the sampling and holding circuits 21 and 22 perform sampling every 2H and are held for 2H, their outputs 21a and 22a are always the same in normal operation. Therefore, if the outputs 21a and 22a are directly led to the comparator 32, For example, the comparator output is constant. However, since the synchronization pulse must be inverted to "H" and "L" as shown in FIG. An inversion circuit is required for the 1H period.
In this embodiment, the output of the D-type flip-flop 33 is inputted to one terminal of the comparator 32 via the changeover switch 31, and this operation will be explained later. For a while, it is assumed that after the comparison is made in 1H period, the output of the comparator 32 is inverted in the next 1H period.
ところで、第１図の回路でわかるように、Ｒ−
Ｙ、Ｂ−Ｙを比較する時点は信号１２ａが“Ｈ”
でRSラツチ回路１４が“Ｈ”出力になるときで
ある。すなわちサンプリングホールド回路２２に
入力信号がサンプリングされ、サンプリングホー
ルド回路２１にホールドされているホールド値と
比較される。第２図の最上部に示す位相で線順次
色差信号が入力されているとすると、サンプリン
グホールド回路２２にＢ−Ｙがサンプリングさ
れ、高いレベルの信号２２ａがサンプリングホー
ルド回路２１のホールドされているＲ−Ｙの信号
値（低レベルの信号２１ａ）と比較される。した
がつて比較器３２の出力（同時化パルス）は
“Ｈ”となる。この関係は第４図のスイツチ関係
と合致し、正しく色差信号の同時化がなされてい
る。 By the way, as you can see from the circuit in Figure 1, R-
At the time of comparing Y and B-Y, the signal 12a is “H”
This is when the RS latch circuit 14 outputs "H". That is, the input signal is sampled by the sampling hold circuit 22 and compared with the hold value held by the sampling hold circuit 21. Assuming that a line-sequential color difference signal is input with the phase shown at the top of FIG. -Y signal value (low level signal 21a). Therefore, the output (synchronization pulse) of the comparator 32 becomes "H". This relationship matches the switch relationship shown in FIG. 4, and the color difference signals are correctly synchronized.
逆に尚らかの原因により、線順次色差信号のＲ
−Ｙ、Ｂ−Ｙの奇数走査線・偶数走査線にわりあ
てた順がずれるようになつた場合、サンプリング
ホールド回路２２には、Ｒ−Ｙがサンプリングさ
れ、信号２２ａが低いレベルに、信号２１ａが高
いレベルとなり、同時化パルスは“Ｌ”となる。
すなわち線順次色差信号の位相変化に対して同時
化パルスも位相が反転し、第３図の同時化回路は
正しく動作し、分離出力されるＲ−Ｙ、Ｂ−Ｙの
色相が反転することがない。2H以内で常に訂正
がなされる。 On the other hand, due to certain reasons, the line-sequential color difference signal R
If the order in which -Y and B-Y are assigned to odd and even scanning lines shifts, R-Y is sampled in the sampling and hold circuit 22, and the signal 22a goes to a low level and the signal 21a goes to a low level. It becomes a high level, and the synchronization pulse becomes "L".
In other words, the phase of the synchronization pulse is reversed in response to a change in the phase of the line-sequential color difference signal, so that the synchronization circuit shown in FIG. do not have. Corrections are always made within 2 hours.
次に前に説明をのばしておいた色差信号判定部
３０のＤ型フリツプフロツプ３３、遅延回路３４
につき説明する。前述したようにこの回路はサン
プリングホールド回路２１，２２の出力を直接に
比較器３２の端子に導いたとき、その出力は一定
であるので、同時化パルスにするためには1Hご
との“Ｈ”、“Ｌ”の反転をするようにしたもので
ある。 Next, the D-type flip-flop 33 and the delay circuit 34 of the color difference signal determination section 30 whose explanation has been extended
I will explain about it. As mentioned above, when this circuit leads the outputs of the sampling and holding circuits 21 and 22 directly to the terminal of the comparator 32, the output is constant. , "L" is inverted.
制御信号１４ａが“Ｌ”になると切替スイツチ
３１はOFF側になりＤ型フリツプフロツプ３３
の出力が比較器３２のＢ入力端子に導かれる。
Ｄ型フリツプフロツプ３３には制御信号１４ａが
遅延回路３４により1H以内で遅延してクロツク
として入力しているので、Ｄ型フリツプフロツプ
３３は比較器３２の出力３２ａのデータを1H期
間内で取入れ2Hだけ保持している。Ｄ型フリツ
プフロツプ３３は比較器３２の出力を反転して出
力するが、通常のICとして“Ｌ”として0Vに近
く“Ｈ”として4Vの位の出力値になる。 When the control signal 14a becomes “L”, the changeover switch 31 turns to the OFF side, and the D-type flip-flop 33
The output of is led to the B input terminal of comparator 32.
Since the control signal 14a is delayed within 1H by the delay circuit 34 and input as a clock to the D-type flip-flop 33, the D-type flip-flop 33 takes in the data from the output 32a of the comparator 32 within a 1H period and holds it for 2H. are doing. The D-type flip-flop 33 inverts the output of the comparator 32 and outputs it, and as a normal IC, the output value becomes "L" close to 0V and "H" the output value is on the order of 4V.
第２図は、入力が第４図に対応する正規の色順
序のときで、比較段階（切替スイツチ３１が
ON）で信号３２ａは“Ｈ”となり次に切替スイ
ツチ３１がOFFになる期間で、信号２１ａとＤ
型フリツプフロツプ３３のとを比較する。この
とき“Ｌ”である。一方信号２１ａは再生色差
信号として２〜2.5V程度の基準レベルを有し、
Ｒ−Ｙ、Ｂ−Ｙもこの範囲よりそれ程ずれないの
で、の出力である通常のICとしての“Ｌ”レ
ベルより常に大、“Ｈ”レベルにより常に小の関
係にある。したがつて、この場合には比較器３２
の出力は“Ｌ”となり同時化パルスは反転する。 FIG. 2 shows the case where the input is in the regular color order corresponding to FIG.
ON), the signal 32a becomes "H" and then the changeover switch 31 turns OFF, during which time the signal 21a and D
Compare the type flip-flop 33. At this time, it is "L". On the other hand, the signal 21a has a reference level of about 2 to 2.5V as a reproduced color difference signal,
Since R-Y and B-Y do not deviate much from this range, they are always higher than the "L" level output of a normal IC, and always lower than the "H" level. Therefore, in this case the comparator 32
The output becomes "L" and the synchronization pulse is inverted.
詳しくいうと、正規の色順序の場合、Ｄ型フリ
ツプフロツプ３３のCKは第２図に示すように信
号１２ａより1H期間以内にあるので、信号１４
ａが“Ｈ”で切替スイツチ３１がONになる比較
段階、すなわち比較器３２の出力が“Ｈ”の期間
内、図示のto，t1，t2…にそのデータを取りこみ
2H期間保持する。したがつてＤ型フリツプフロ
ツプ３３のは“Ｌ”レベルをずつと維持してい
る。そして切替スイツチ３１がOFFになつた場
合に前述したレベルの大小関係から信号２１ａは
Ｑより大きいので、比較器３２の出力（同時化パ
ルス）信号３２ａは反転する。なお、正規の色順
序がずれ、比較段階で信号３２ａが“Ｌ”の場合
でも、必ず反転が行なわれ、色順序に合わせた同
時化パルスが作成される。 Specifically, in the case of the normal color order, since CK of the D-type flip-flop 33 is within 1H period from the signal 12a as shown in FIG.
During the comparison stage when a is "H" and the selector switch 31 is ON, that is, during the period when the output of the comparator 32 is "H", the data is taken into to, t 1 , t 2 . . . shown in the figure.
Retained for 2H period. Therefore, the D-type flip-flop 33 maintains the "L" level. When the changeover switch 31 is turned off, the signal 21a is larger than Q due to the above-mentioned level relationship, so the output (synchronization pulse) signal 32a of the comparator 32 is inverted. Note that even if the normal color order is deviated and the signal 32a is "L" at the comparison stage, inversion is always performed and a synchronization pulse matching the color order is created.
以上、詳しく説明したように、本発明は電子カ
メラの再生装置において、磁気記録装置から再生
された線順次色差信号を、2Hごとに、現在の色
差信号と過去の1H前の色差信号とを比較して、
そのレベル差から色差信号を判別して、適切な同
時化パルスを発生する回路である。この同時化パ
ルスによつて、線順次色差信号を直接に伝達する
経路と1Hだけ遅延する経路との２線を出力２線
に接続する極性を1Hごとに反転することによつ
てＲ−ＹとＢ−Ｙとを分離し同時に出力すること
ができる。
As described in detail above, the present invention is a reproducing device for an electronic camera, in which line-sequential color difference signals reproduced from a magnetic recording device are compared every 2H with the current color difference signal and the color difference signal from 1H before. do,
This circuit determines the color difference signal from the level difference and generates an appropriate synchronization pulse. By using this synchronization pulse, the polarity of connecting the two lines, the path that directly transmits the line-sequential color difference signal and the path that delays it by 1H, to the output 2 lines is reversed every 1H, so that R-Y is transmitted. B and Y can be separated and output simultaneously.
同時化パルスは固定的なものでなく、Ｒ−Ｙ、
Ｂ−Ｙの線順次が時間的にずれてくる場合にもそ
れに追随して正しい極性のパルスとなつている。
つまり2H期間で追随可能になり、固定的な同時
化パルスでは何らかの方法で調整をしないと色相
が全く反転する場合に比較して極めて有利であ
る。 The synchronization pulse is not fixed, but R-Y,
Even if the line sequence of B-Y shifts in time, the pulses follow this and have the correct polarity.
In other words, it can be tracked in a 2H period, which is extremely advantageous compared to the case where the hue is completely reversed with a fixed synchronization pulse unless some adjustment is made.
第１図は本発明の一実施例の回路ブロツク図、
第２図は第１図のタイムチヤート、第３図、第４
図は線順次色差信号の同時化回路およびそのタイ
ムチヤートである。
１０……制御部、１１……Ｄ型フリツプフロツ
プ、１２，１３……ANDゲート、１４……RSラ
ツチ回路、２０……サンプル部、２１，２２……
サンプリングホールド回路、３０……色差信号判
定部、３１……切替スイツチ、３２……比較器、
３３……Ｄ型フリツプフロツプ、３４……遅延回
路。
FIG. 1 is a circuit block diagram of an embodiment of the present invention.
Figure 2 is the time chart of Figure 1, Figure 3, and Figure 4.
The figure shows a line-sequential color difference signal synchronization circuit and its time chart. 10...control section, 11...D-type flip-flop, 12, 13...AND gate, 14...RS latch circuit, 20...sample section, 21, 22...
Sampling hold circuit, 30... Color difference signal determination section, 31... Changeover switch, 32... Comparator,
33...D-type flip-flop, 34...delay circuit.
Claims (1)
プリングパルス）に分配するとともに、1Hご
とに“Ｈ”、“Ｌ”と交替する制御信号を発生す
る制御部と、 (ロ) 1Hごとに送られてくる線順次色差信号を２
分岐し、各分岐に設けたサンプルホールド回路
に導き、前記制御部のサンプリングパルスによ
りサンプルした出力を2H間保持出力するサン
プル部と、 (ハ) Ａ、Ｂの２入力端子の比較器のＡ入力端子に
前記サンプル部の１出力を導き、Ｂ入力端子に
は前記サンプル部の他の出力と、比較器の出力
を反転し1H内の遅延を与えられた出力とを切
替スイツチにより交替に入力する色差信号判定
部と、 を有し、前記制御部で発生した制御信号によつて
前記色差信号判定部の切替スイツチの切替を行な
い、前記比較器の出力を同時化パルスとして出力
することを特徴とする同時化パルス発生回路。[Claims] 1. In a playback device for an electronic still camera, (a) control that alternately distributes a horizontal synchronizing signal into two pulse trains (sampling pulses) and alternates between "H" and "L" every 1H; (b) A control unit that generates a signal, and (b) a line-sequential color difference signal sent every 1H.
A sample section that branches and leads to a sample hold circuit provided in each branch and holds and outputs the output sampled by the sampling pulse of the control section for 2H, and (c) A input of a comparator with two input terminals A and B. One output of the sample section is led to the terminal, and the other output of the sample section and the output obtained by inverting the output of the comparator and given a delay of 1H are alternately input to the B input terminal using a changeover switch. and a color difference signal determination section, wherein a changeover switch of the color difference signal determination section is switched by a control signal generated by the control section, and the output of the comparator is output as a synchronized pulse. Simultaneous pulse generation circuit.
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP59272115A JPS61150590A (en) | 1984-12-25 | 1984-12-25 | Coinciding pulse generating circuit of electronic still camera |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP59272115A JPS61150590A (en) | 1984-12-25 | 1984-12-25 | Coinciding pulse generating circuit of electronic still camera |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS61150590A JPS61150590A (en) | 1986-07-09 |
| JPH0144074B2 true JPH0144074B2 (en) | 1989-09-25 |
Family
ID=17509292
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP59272115A Granted JPS61150590A (en) | 1984-12-25 | 1984-12-25 | Coinciding pulse generating circuit of electronic still camera |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS61150590A (en) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2019059942A (en) * | 2018-11-26 | 2019-04-18 | 第一工業製薬株式会社 | Composition for rock bolt anchoring material, rock bolt anchoring material and rock bolt method |
Families Citing this family (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2532452B2 (en) * | 1987-03-31 | 1996-09-11 | 松下電器産業株式会社 | Color signal reproduction processing circuit |
| CA2034984A1 (en) * | 1990-09-21 | 1992-03-22 | Paul T. Van Gompel | Absorbent article with poly baffle |
Citations (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS59115688A (en) * | 1982-12-10 | 1984-07-04 | トムソン−セ−エスエフ | Line half frequency clock phase matching method and device in pal or secam color television receiver |
| JPS59158695A (en) * | 1983-03-01 | 1984-09-08 | Matsushita Electric Ind Co Ltd | Processing system of line sequential color signal |
-
1984
- 1984-12-25 JP JP59272115A patent/JPS61150590A/en active Granted
Patent Citations (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS59115688A (en) * | 1982-12-10 | 1984-07-04 | トムソン−セ−エスエフ | Line half frequency clock phase matching method and device in pal or secam color television receiver |
| JPS59158695A (en) * | 1983-03-01 | 1984-09-08 | Matsushita Electric Ind Co Ltd | Processing system of line sequential color signal |
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|---|---|---|---|---|
| JP2019059942A (en) * | 2018-11-26 | 2019-04-18 | 第一工業製薬株式会社 | Composition for rock bolt anchoring material, rock bolt anchoring material and rock bolt method |
Also Published As
| Publication number | Publication date |
|---|---|
| JPS61150590A (en) | 1986-07-09 |
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