JPH0143891B2 - - Google Patents
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- Publication number
- JPH0143891B2 JPH0143891B2 JP16048981A JP16048981A JPH0143891B2 JP H0143891 B2 JPH0143891 B2 JP H0143891B2 JP 16048981 A JP16048981 A JP 16048981A JP 16048981 A JP16048981 A JP 16048981A JP H0143891 B2 JPH0143891 B2 JP H0143891B2
- Authority
- JP
- Japan
- Prior art keywords
- count data
- voltage signal
- analog
- converter
- weighing
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Expired
Links
- 238000005303 weighing Methods 0.000 claims description 17
- 238000006243 chemical reaction Methods 0.000 claims description 2
- 238000013481 data capture Methods 0.000 claims 1
- 101100434411 Saccharomyces cerevisiae (strain ATCC 204508 / S288c) ADH1 gene Proteins 0.000 description 8
- 101150102866 adc1 gene Proteins 0.000 description 8
- 101150042711 adc2 gene Proteins 0.000 description 6
- 101710170230 Antimicrobial peptide 1 Proteins 0.000 description 2
- 101710170231 Antimicrobial peptide 2 Proteins 0.000 description 2
- 101710096660 Probable acetoacetate decarboxylase 2 Proteins 0.000 description 1
- 230000008676 import Effects 0.000 description 1
- 230000010354 integration Effects 0.000 description 1
- 230000007257 malfunction Effects 0.000 description 1
- 239000011159 matrix material Substances 0.000 description 1
- 238000005259 measurement Methods 0.000 description 1
- 238000000034 method Methods 0.000 description 1
Classifications
-
- G—PHYSICS
- G01—MEASURING; TESTING
- G01G—WEIGHING
- G01G23/00—Auxiliary devices for weighing apparatus
- G01G23/18—Indicating devices, e.g. for remote indication; Recording devices; Scales, e.g. graduated
- G01G23/36—Indicating the weight by electrical means, e.g. using photoelectric cells
- G01G23/37—Indicating the weight by electrical means, e.g. using photoelectric cells involving digital counting
- G01G23/3707—Indicating the weight by electrical means, e.g. using photoelectric cells involving digital counting using a microprocessor
Landscapes
- Engineering & Computer Science (AREA)
- Computer Hardware Design (AREA)
- Microelectronics & Electronic Packaging (AREA)
- Physics & Mathematics (AREA)
- General Physics & Mathematics (AREA)
- Testing Or Calibration Of Command Recording Devices (AREA)
- Arrangements For Transmission Of Measured Signals (AREA)
Description
【発明の詳細な説明】
この発明は複数の秤部を有する計量装置に関す
る。
る。
従来、この種計量装置においては例えば各秤部
設けられたロードセルに対してアナログ・デイジ
タル変換器（以下AD変換器と称す。）を共通に
設け、各ロードセルからの荷重に対応した電圧信
号をそれぞれアナログスイツチを介してAD変換
器に入力するようにし、かつ各アナログスイツチ
をAD変換器のデータ処理時間に合わせて順次駆
動させるものが知られている。しかしAD変換器
が１個の電圧信号を取込んでからカウントデータ
として出力するまでのデータ処理時間が数百ｍ
secかかるので、AD変換器が同一の秤部につい
て前回のデータ処理時から今回のデータ処理時ま
でに要する時間間隔が１台の秤部のデータ処理に
要する時間（数百ｍsec）×秤部の台数となり、計
量時の台皿の変化に対してAD変換器の追従性が
悪くなり高精度な計量処理ができない欠点があつ
た。
設けられたロードセルに対してアナログ・デイジ
タル変換器（以下AD変換器と称す。）を共通に
設け、各ロードセルからの荷重に対応した電圧信
号をそれぞれアナログスイツチを介してAD変換
器に入力するようにし、かつ各アナログスイツチ
をAD変換器のデータ処理時間に合わせて順次駆
動させるものが知られている。しかしAD変換器
が１個の電圧信号を取込んでからカウントデータ
として出力するまでのデータ処理時間が数百ｍ
secかかるので、AD変換器が同一の秤部につい
て前回のデータ処理時から今回のデータ処理時ま
でに要する時間間隔が１台の秤部のデータ処理に
要する時間（数百ｍsec）×秤部の台数となり、計
量時の台皿の変化に対してAD変換器の追従性が
悪くなり高精度な計量処理ができない欠点があつ
た。
このため各ロードセルに対応してそれぞれAD
変換器を設けることが考えられるが、単にこのよ
うにしたのでは各AD変換器が勝手に動作し、場
合によつて複数のAD変換器から同時にカウント
データが出力することが生じ、誤動作を生じる虞
れがある。
変換器を設けることが考えられるが、単にこのよ
うにしたのでは各AD変換器が勝手に動作し、場
合によつて複数のAD変換器から同時にカウント
データが出力することが生じ、誤動作を生じる虞
れがある。
この発明はこのような事情に鑑みてなされたも
ので、複数の秤部にロードセルとアナログ・デイ
ジタル変換器をそれぞれ設けることによつて荷重
による台皿変化、すなわちロードセル出力変化に
対してアナログ・デイジタル変換器の追従性を向
上することができて計量精度の向上を図かること
ができ、しかも各アナログ・デイジタル変換器か
らのカウントデータの取込みタイミングを制御す
ることによつて確実なカウントデータの取込みが
できる計量装置を提供することを目的とする。
ので、複数の秤部にロードセルとアナログ・デイ
ジタル変換器をそれぞれ設けることによつて荷重
による台皿変化、すなわちロードセル出力変化に
対してアナログ・デイジタル変換器の追従性を向
上することができて計量精度の向上を図かること
ができ、しかも各アナログ・デイジタル変換器か
らのカウントデータの取込みタイミングを制御す
ることによつて確実なカウントデータの取込みが
できる計量装置を提供することを目的とする。
以下、この発明の実施例を図面を参照して説明
する。
する。
第１図において１は演算回路、インストラクシ
ヨンデコーダ、メモリ制御回路等が内蔵された
CPU（中央処理ユニツト）、２は上記CPU１が処
理に必要なメモリ等が設けられたRAM（ランダ
ム・アクセス・メモリ）、３は上記CPU１が行な
う各種の処理用プログラムが格納されたROM
（リード・オンリー・メモリ）、４は第１の秤部、
５は第２の秤部、６は上記両秤部４，５に内蔵さ
れている後述するアナログ・デイジタル変換器
（以下AD変換器と称す。）を動作制御するタイミ
ング回路である。７は各種キー入力をデータ化す
るキーマトリクス回路、８は重量表示器、料金表
示器等を設けた表示装置である。前記両秤部４，
５は第２図に示すようにそれぞれ台皿への荷重に
対応した電圧信号を出力するロードセルLC１，
LC２、このロードセル出力の雑音をカツトする
ローパス回路LP１，LP２、このローパス回路
LP１，LP２をそれぞれ介して入力される電圧信
号を増幅する増幅回路AMP１，AMP２、この増
幅回路AMP１，AMP２からそれぞれ出力される
電圧信号を取込んで電圧レベルに対応したカウン
トデータに変換するAD変換器ADC１，ADC２
によつて構成されている。なお、前記AD変換器
ADC１，ADC２は電圧信号の取込み動作を開始
してからカウントデータを整えて出力するまでに
要する時間を数百ｍsecに設定されている。そし
て前記AD変換器ADC１，ADC２からのカウン
トデータを割込みによつて前記CPU１に入力す
るようにしている。前記タイミング回路６は発振
器６１、この発振器６１出力を分周する分周回路
６２、この分周回路６２出力をカウントするカウ
ンタ６３、このカウンタ６３のカウント内容をデ
コードしてカウンタ６３が所定数カウントする毎
に複数の出力端子から順次信号を出力するデコー
ダ６４とからなり、上記デコーダ６４からの出力
信号によつて前記第１、第２の秤部４，５のAD
変換器ADC１，ADC２のＲ／Ｈ端子を順次付勢
し電圧信号取込み動作を順次開始させるようにし
ている。すなわち前記AD変換器ADC１，ADC
２は電圧信号取込み動作をスタートすると第３図
に示すようにオートゼロ処理○イ電圧信号の積分処
理○ロ、リフアレンス積分処理○ハを順次サイクリツ
クに行なうもので、前記タイミング回路６は先ず
AD変換器ADC１のスタートをかけ、続いて数十
〜数百μsec遅れたタイミングでAD変換器ADC２
のスタートをかけるようにしている。そして前記
CPU１はAD変換器ADC１，ADC２がリフアレ
ンス積分処理○ハが終了するタイミングでAD変換
器からのストローブ信号をチエツクしてAD変換
器ADC１からのカウントデータ取込み○
ヨンデコーダ、メモリ制御回路等が内蔵された
CPU（中央処理ユニツト）、２は上記CPU１が処
理に必要なメモリ等が設けられたRAM（ランダ
ム・アクセス・メモリ）、３は上記CPU１が行な
う各種の処理用プログラムが格納されたROM
（リード・オンリー・メモリ）、４は第１の秤部、
５は第２の秤部、６は上記両秤部４，５に内蔵さ
れている後述するアナログ・デイジタル変換器
（以下AD変換器と称す。）を動作制御するタイミ
ング回路である。７は各種キー入力をデータ化す
るキーマトリクス回路、８は重量表示器、料金表
示器等を設けた表示装置である。前記両秤部４，
５は第２図に示すようにそれぞれ台皿への荷重に
対応した電圧信号を出力するロードセルLC１，
LC２、このロードセル出力の雑音をカツトする
ローパス回路LP１，LP２、このローパス回路
LP１，LP２をそれぞれ介して入力される電圧信
号を増幅する増幅回路AMP１，AMP２、この増
幅回路AMP１，AMP２からそれぞれ出力される
電圧信号を取込んで電圧レベルに対応したカウン
トデータに変換するAD変換器ADC１，ADC２
によつて構成されている。なお、前記AD変換器
ADC１，ADC２は電圧信号の取込み動作を開始
してからカウントデータを整えて出力するまでに
要する時間を数百ｍsecに設定されている。そし
て前記AD変換器ADC１，ADC２からのカウン
トデータを割込みによつて前記CPU１に入力す
るようにしている。前記タイミング回路６は発振
器６１、この発振器６１出力を分周する分周回路
６２、この分周回路６２出力をカウントするカウ
ンタ６３、このカウンタ６３のカウント内容をデ
コードしてカウンタ６３が所定数カウントする毎
に複数の出力端子から順次信号を出力するデコー
ダ６４とからなり、上記デコーダ６４からの出力
信号によつて前記第１、第２の秤部４，５のAD
変換器ADC１，ADC２のＲ／Ｈ端子を順次付勢
し電圧信号取込み動作を順次開始させるようにし
ている。すなわち前記AD変換器ADC１，ADC
２は電圧信号取込み動作をスタートすると第３図
に示すようにオートゼロ処理○イ電圧信号の積分処
理○ロ、リフアレンス積分処理○ハを順次サイクリツ
クに行なうもので、前記タイミング回路６は先ず
AD変換器ADC１のスタートをかけ、続いて数十
〜数百μsec遅れたタイミングでAD変換器ADC２
のスタートをかけるようにしている。そして前記
CPU１はAD変換器ADC１，ADC２がリフアレ
ンス積分処理○ハが終了するタイミングでAD変換
器からのストローブ信号をチエツクしてAD変換
器ADC１からのカウントデータ取込み○
Claims (1)
- １ 荷重に対応した電圧信号を出力するロードセ
ル及びこのロードセルからの電圧信号を取込んで
カウントデータに変換するアナログ・デイジタル
変換器を設けた複数の秤部と、この各秤部のアナ
ログ・デイジタル変換器に電圧信号の取込み動作
を所定のタイミングで順次ずらして行なわせるタ
イミング回路と、上記各アナログ・デイジタル変
換器から順次出力されるカウントデータを順次取
込んで所定の重量カウントデータを複数得るカウ
ントデータ取込み手段と、この手段にて得られた
各重量カウントデータの１つをグラム変換して表
示器に表示させる手段とを設け、前記タイミング
回路による電圧信号取込みタイミングのずれを前
記カウントデータ取込み手段が１つのカウントデ
ータを取込むに必要な時間に設定したことを特徴
とする計量装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP16048981A JPS5861428A (ja) | 1981-10-08 | 1981-10-08 | 計量装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP16048981A JPS5861428A (ja) | 1981-10-08 | 1981-10-08 | 計量装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS5861428A JPS5861428A (ja) | 1983-04-12 |
| JPH0143891B2 true JPH0143891B2 (ja) | 1989-09-25 |
Family
ID=15716037
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP16048981A Granted JPS5861428A (ja) | 1981-10-08 | 1981-10-08 | 計量装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS5861428A (ja) |
-
1981
- 1981-10-08 JP JP16048981A patent/JPS5861428A/ja active Granted
Also Published As
| Publication number | Publication date |
|---|---|
| JPS5861428A (ja) | 1983-04-12 |
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