JPH01173790U - - Google Patents

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JPH01173790U
JPH01173790U JP7164188U JP7164188U JPH01173790U JP H01173790 U JPH01173790 U JP H01173790U JP 7164188 U JP7164188 U JP 7164188U JP 7164188 U JP7164188 U JP 7164188U JP H01173790 U JPH01173790 U JP H01173790U
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【図面の簡単な説明】
第1図は本考案の一実施例の回路図及び再トリ
ガ形単安定マルチバイブレータの動作を示す図、
第2図はCRTデイスプレイ表示装置のブロツク
図、第3図は本考案の一例のタイミングチヤート
、第4図は本考案の一例のフローチヤート、第5
図は従来回路の回路図、第6図は従来装置の一例
のフローチヤートである。 1……コンピユータ、2……CRT制御回路、
3……マルチプレクサ、4……バス、5……画像
メモリ、6……CRTデイスプレイ、7……競合
回避回路、8……シリアル・パラレル変換回路、
〜R……抵抗、C〜C……コンデンサ
、MM,MM……再トリガ型単安定マルチバ
イブレータ(モノマルチ)。

Claims (1)

    【実用新案登録請求の範囲】
  1. 垂直帰線期間中には画像表示装置に表示する画
    像表示データをメモリに書き込み、水平走査期間
    中には該メモリに記憶された該画像表示データを
    読み出して該画像表示装置に表示するよう該メモ
    リに対するアクセスの競合を回避するアクセス競
    合回避回路において、垂直帰線期間の開始時点を
    検出する垂直帰線期間検出手段と、該垂直帰線期
    間検出手段により検出された該開始時点より一定
    の期間内に該メモリに該画像表示データを書き込
    む書き込み手段とを設けてなるアクセス競合回避
    回路。
JP7164188U 1988-05-30 1988-05-30 Pending JPH01173790U (ja)

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JP7164188U JPH01173790U (ja) 1988-05-30 1988-05-30

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JP7164188U JPH01173790U (ja) 1988-05-30 1988-05-30

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JPH01173790U true JPH01173790U (ja) 1989-12-11

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JP7164188U Pending JPH01173790U (ja) 1988-05-30 1988-05-30

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