JPH01117778U - - Google Patents
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- Publication number
- JPH01117778U JPH01117778U JP1041588U JP1041588U JPH01117778U JP H01117778 U JPH01117778 U JP H01117778U JP 1041588 U JP1041588 U JP 1041588U JP 1041588 U JP1041588 U JP 1041588U JP H01117778 U JPH01117778 U JP H01117778U
- Authority
- JP
- Japan
- Prior art keywords
- signal
- circuit
- trigger
- generates
- input signal
- Prior art date
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- Pending
Links
- 230000007274 generation of a signal involved in cell-cell signaling Effects 0.000 claims description 5
- 238000005070 sampling Methods 0.000 claims 1
- 238000010586 diagram Methods 0.000 description 3
Landscapes
- Tests Of Electronic Circuits (AREA)
Description
第１図はこの考案の一実施例であるトリガ信号
生成装置の回路図、第２図ａ，ｂはタイムチヤー
ト図、第３図は従来のトリガ信号生成装置の回路
図、第４図はタイムチヤート図である。 ６……遅延回路、７……排他論理和回路、９…
…トリガ許可期間生成回路、４１……第１論理積
回路、４２……第２論理積回路。
生成装置の回路図、第２図ａ，ｂはタイムチヤー
ト図、第３図は従来のトリガ信号生成装置の回路
図、第４図はタイムチヤート図である。 ６……遅延回路、７……排他論理和回路、９…
…トリガ許可期間生成回路、４１……第１論理積
回路、４２……第２論理積回路。
Claims (1)
- 入力信号をサンプルして記憶するメモリと、上
記入力信号から別途指定されたトリガ条件用信号
を選択し、それらの論理積を求めてトリガ信号を
生成する第１論理積回路と、上記メモリに対して
書込み制御信号及び書込みアドレスを与えるサン
プリング制御回路とを備えたトリガ信号生成回路
において、上記入力信号から遅延開始信号を生成
する第２論理積回路と、上記遅延開始信号に基づ
き出力され、かつ一定時間に設定されたパルス信
号を生成して上記第１論理積回路へ出力するトリ
ガ許可期間信号生成回路とを備えたことを特徴と
するトリガ信号生成装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1041588U JPH01117778U (ja) | 1988-01-28 | 1988-01-28 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1041588U JPH01117778U (ja) | 1988-01-28 | 1988-01-28 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH01117778U true JPH01117778U (ja) | 1989-08-09 |
Family
ID=31218057
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP1041588U Pending JPH01117778U (ja) | 1988-01-28 | 1988-01-28 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH01117778U (ja) |
-
1988
- 1988-01-28 JP JP1041588U patent/JPH01117778U/ja active Pending