JPH01114763A - Electronic watthour meter for reactive power - Google Patents
Electronic watthour meter for reactive powerInfo
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Abstract
Description
【発明の詳細な説明】
〔産業上の利用分野〕
この発明は、電子式無効電力量計に係り、特に、移相器
として積分器を用いた場合の周波数数変動分の補正に関
するものである。[Detailed Description of the Invention] [Industrial Application Field] The present invention relates to an electronic reactive energy meter, and particularly relates to correction of frequency fluctuations when an integrator is used as a phase shifter. .
今、負荷電圧の瞬時値および実効値をそれぞれガおよび
VRで表し、負荷電流の瞬時値および実効値をi およ
び工、で表し、負荷電流IRが負荷電圧eHよりも位相
角φだけ遅れているものとすると、これらの間に次式の
関係がある。Now, the instantaneous value and effective value of the load voltage are expressed by g and VR, respectively, and the instantaneous value and effective value of the load current are expressed by i and h, and the load current IR lags the load voltage eH by the phase angle φ. Assuming that, there is a relationship between these as shown in the following equation.
eR−J 2VR8INωt −(1)i
−J21 5IN(ωを一φ) ・・・(
2)RR
また、無効電力QRは次式で表される。eR-J 2VR8INωt −(1)i
-J21 5IN (ω is one φ) ...(
2) RR In addition, the reactive power QR is expressed by the following formula.
QR” VRI RSINφ ・(3)
ただし、
ω:角周波数
t:時間
である。QR” VRI RSINφ ・(3)
However, ω: angular frequency t: time.
ここで、(1)式で示した瞬時値eRの位相角をπ/2
だけずらして次式
e R’ −J 2 VRSIN (ωt yr /
2 ) ・・・(4)を得、この瞬時値eR′と(2
)式の瞬時値IRとを次式のように乗算して
eR’ X IR
−vRIR8INφ−VRIRcos (ωt−yr/
2−φ)−(5)を得、これにより(3)式に示した無
効電力料、すなわち、
QR−VRIRSINφ
を得ることができる。Here, the phase angle of the instantaneous value eR shown in equation (1) is π/2
Shift by the following formula e R' −J 2 VRSIN (ωt yr /
2) ...(4) is obtained, and this instantaneous value eR' and (2
) by the instantaneous value IR of the equation as shown below to obtain eR'
2-φ)-(5), and thereby the reactive power charge shown in equation (3), that is, QR-VRIRSINφ can be obtained.
第7図はこの基本的な理論に従って構成された従来の電
子式無効電力量計の構成を示すブロック図である。同図
において変圧器1が負荷電圧eHに比例した電圧信号e
tを出力する一方、変流器2が負荷電流IRに比例した
電流信号itを出力する。このうち、電圧信号etは移
相器3によって位相角がπ/2だけ遅れた電圧信号e
に変換される。この電圧信号e と変流器2から出力さ
れる電流信号11とが乗算器4で乗算されて無効電力成
分が得られる。なお、電流信号itは電圧モードに変換
されて乗算器4に入力される場合もある。ここで、移相
器3として積分器を用いると、電源周波数の影響をうけ
るので、この影響を取除くために周波数に対応した係数
値を発生する係数器5と、乗算器4の出力にこの係数を
乗算するもう一つの乗算器6とが設けられている。この
乗算器6から出力された無効電力値は積分器7でパルス
周波数に変換されると共に、表示器8で表示されるよう
になっている。FIG. 7 is a block diagram showing the configuration of a conventional electronic reactive watt-hour meter constructed according to this basic theory. In the figure, the transformer 1 generates a voltage signal e proportional to the load voltage eH.
t, while the current transformer 2 outputs a current signal it proportional to the load current IR. Among these, the voltage signal et is a voltage signal e whose phase angle is delayed by π/2 by the phase shifter 3.
is converted to This voltage signal e and the current signal 11 output from the current transformer 2 are multiplied by a multiplier 4 to obtain a reactive power component. Note that the current signal it may be converted into voltage mode and input to the multiplier 4. Here, if an integrator is used as the phase shifter 3, it will be affected by the power supply frequency, so in order to remove this effect, a coefficient unit 5 that generates a coefficient value corresponding to the frequency and an integrator that generates a coefficient value corresponding to the frequency and the output of the multiplier 4 are used. Another multiplier 6 for multiplying the coefficients is provided. The reactive power value output from the multiplier 6 is converted into a pulse frequency by an integrator 7 and displayed on a display 8.
第8図は移相器3の詳細な構成を示す回路図であり、演
算増幅器A1の非反転入力端子が接地され、反転入力端
子に入力抵抗R1が接続され、さらに、反転入力端子と
出力端子間にコンデンサC1が接続されている。この移
相器に負荷電圧に比例した電圧信号etが入力されると
、出力e。FIG. 8 is a circuit diagram showing a detailed configuration of the phase shifter 3, in which the non-inverting input terminal of the operational amplifier A1 is grounded, the input resistor R1 is connected to the inverting input terminal, and the inverting input terminal and output terminal A capacitor C1 is connected between them. When a voltage signal et proportional to the load voltage is input to this phase shifter, the output e.
は
e −J 2V / (RICl) f SINωt
d tq t
=J 2V / (Rt Ct ω) CO8ωt−4
2V / (RIC1ω) sin (ωt −π/2
) −(6)となり、π/2の移相を生じる。ここで
、Vtはe の実効値である。is e −J 2V / (RICl) f SINωt
d tq t = J 2V / (Rt Ct ω) CO8ωt-4
2V / (RIC1ω) sin (ωt −π/2
) −(6), resulting in a phase shift of π/2. Here, Vt is the effective value of e.
この(6)式に示された電圧e は最大振幅が(V2v
/RIC1ω)のようになって1/ωの制約を受ける
ので、この影響を取除くべく係数器5および乗算器6が
設けられている。The voltage e shown in equation (6) has a maximum amplitude of (V2v
/RIC1ω) and is subject to the constraint of 1/ω, so a coefficient unit 5 and a multiplier 6 are provided to remove this influence.
また、第9図は積分器7の詳細な構成を示す回路図であ
る。ここでは、演算増幅器A2、入力抵抗Rおよびコン
デンサCpによって積分回路が構成され、この積分回路
の出力端にレベル検出器11が接続されている。また、
レベル検出器11の出力に基づいてコンデンサCFに充
電された電荷を放電させる帰還パルス発生器12が設け
られている。なお、この帰還パルス発生器12の振幅は
基準電圧(または基準電流)回路13の出力により、時
間幅は基準パルス発生器14のパルス幅によってそれぞ
れ決まるようになっている。Further, FIG. 9 is a circuit diagram showing the detailed configuration of the integrator 7. Here, an integrating circuit is constituted by an operational amplifier A2, an input resistor R, and a capacitor Cp, and a level detector 11 is connected to the output terminal of this integrating circuit. Also,
A feedback pulse generator 12 is provided that discharges the charge stored in the capacitor CF based on the output of the level detector 11. The amplitude of the feedback pulse generator 12 is determined by the output of the reference voltage (or reference current) circuit 13, and the time width is determined by the pulse width of the reference pulse generator 14.
次に、この積分器7の動作を第10図のタイムチャート
をも参照して簡単に説明する。Next, the operation of this integrator 7 will be briefly explained with reference to the time chart of FIG.
乗算器6の出力電圧E が入力抵抗RMに加えられたこ
とにより、電流信号I M ”” E M/ RMに変
換される。ここで、乗算器6の出力が電流モードの時は
入力抵抗RMは不要で、乗算器6の出力■ は直接積分
器に入力される。この電流IMがコンデンサCに流れる
と演算増幅器A2の出力電位eAは次第に降下する。そ
して、その電位がレベル検出器11に設定された値まで
降下すると、このレベル検出器11からパルスel、が
出力される。また、このとき、帰還パルス発生器12が
動作して、基準電圧回路13によってきまる振幅Isと
、基準パルス発生器14によってきまる時間幅τ とを
持つ帰還パルスを出力して、τSの時間だけ電流Isを
帰還させると共に、パルスe を出力する。これにより
、Q−I8・τ8の電荷が放電され、この間に演算増幅
器A2の出力電位は元に回復する。この時、充電された
電荷I −T と放電された電荷I ・τ とは等
しM、[’ SS
いので次の式が成立する。By applying the output voltage E of the multiplier 6 to the input resistor RM, it is converted into a current signal I M "" E M/RM. Here, when the output of the multiplier 6 is in the current mode, the input resistor RM is not necessary, and the output (2) of the multiplier 6 is directly input to the integrator. When this current IM flows through the capacitor C, the output potential eA of the operational amplifier A2 gradually drops. When the potential drops to a value set in the level detector 11, the level detector 11 outputs a pulse el. Also, at this time, the feedback pulse generator 12 operates to output a feedback pulse having an amplitude Is determined by the reference voltage circuit 13 and a time width τ determined by the reference pulse generator 14, and the current is While feeding back Is, a pulse e is output. As a result, the charges of Q-I8·τ8 are discharged, and during this time, the output potential of the operational amplifier A2 is restored to its original state. At this time, the charged charge I -T and the discharged charge I .tau. are equal to M, [' SS , so the following equation holds true.
■8・T p−I s・ 8 ・・・(7
)F■1 / T p
−■/(τ弓)
M 5S
−E /(τ ・■ ・R) ・・・(8)M
SSM
ただし、T、、はパルス周波数出力の周期、Fはその周
波数である。■8・Tp-Is・8...(7
) F■1 / T p -■ / (τ bow) M 5S -E / (τ ・■ ・R) ... (8) M
SSM where T, is the period of the pulse frequency output, and F is its frequency.
かくして、積分器7は無効電力に比例した電圧信号また
は電流信号を積分してパルス周波数に変換していること
が分る。Thus, it can be seen that the integrator 7 integrates the voltage signal or current signal proportional to the reactive power and converts it into a pulse frequency.
上述した従来の電子式無効電力量計においては、係数器
5と乗算器6とによって周波数の影響を除去しているが
、構成要素が比較的多く、その分だけ構成が複雑化する
と同時にコストが高騰するという問題点があった。In the above-mentioned conventional electronic reactive energy meter, the influence of frequency is removed by the coefficient unit 5 and the multiplier 6, but there are a relatively large number of components, which increases the complexity of the configuration and the cost. There was a problem with rising prices.
この発明は上記の問題点を解決するためになされたもの
で、構成の簡易化を図ると同時に、装置コストの低減を
図り得る電子式無効電力量計を提供することを目的とす
る。The present invention has been made to solve the above-mentioned problems, and an object of the present invention is to provide an electronic reactive watt-hour meter that can simplify the configuration and reduce the cost of the device.
この発明に係る電子式無効電力量計は、負荷の電圧に比
例した信号および前記負荷の電流に比例した信号のいず
れか一方を第1の積分器を含む移相器で移相して他方と
乗算し、得られた信号を第2の積分器で積分すると共に
、その積分値が基準のパルス信号のパルス幅とパルス振
幅との積に一致する毎に単位無効電力量に対応するパル
スを発生する電子式無効電力量計において、前記基準の
パルス信号のパルス幅またはパルス振幅を前記負荷の電
圧の周波数に反比例するように変化させて前記第1の積
分器の移相に起因する無効電力の周波数数変動分を補正
する周波数数変動分補正手段を備えたことを特徴とする
ものである。The electronic reactive energy meter according to the present invention phase-shifts one of a signal proportional to the voltage of a load and a signal proportional to the current of the load using a phase shifter including a first integrator. The second integrator integrates the resulting signal, and generates a pulse corresponding to unit reactive energy each time the integrated value matches the product of the pulse width and pulse amplitude of the reference pulse signal. In the electronic reactive energy meter, the pulse width or pulse amplitude of the reference pulse signal is changed in inverse proportion to the frequency of the voltage of the load to reduce the reactive power caused by the phase shift of the first integrator. The present invention is characterized in that it includes frequency number variation correction means for correcting frequency number variation.
第7図に示した従来の電子式無効電力量計では、係数器
5と乗算器6とで周波数数変動分を除去していたが、若
し、第9図に示した積分器7に周波数数変動分を補償す
る機能を容易に付加することができるならば係数器5お
よび乗算器6が不要化される。ここで見方を変えて、係
数器5に対応する周波数数変動分補正手段を設けてその
出力を積分器7の帰還パルス発生器12に加えるならば
、係数器5および乗算器6が不要化されると同時に、基
準電圧回路13または基準パルス発生器14のいずれか
一方を除去することができる。本発明はこの考えに従っ
てなされたものである。In the conventional electronic reactive energy meter shown in FIG. 7, the coefficient unit 5 and the multiplier 6 remove frequency fluctuations, but if the integrator 7 shown in FIG. If a function for compensating for numerical fluctuations could be easily added, the coefficient unit 5 and the multiplier 6 would be unnecessary. Looking at this from a different perspective, if a frequency number variation correction means corresponding to the coefficient multiplier 5 is provided and its output is applied to the feedback pulse generator 12 of the integrator 7, the coefficient multiplier 5 and the multiplier 6 can be made unnecessary. At the same time, either the reference voltage circuit 13 or the reference pulse generator 14 can be removed. The present invention has been made in accordance with this idea.
すなわち、乗算器の出力EM (電圧モード)または1
M (電流モード)は、変流器2の出力Itと、(6)
式のe の積であるから次式が得られる。That is, the multiplier output EM (voltage mode) or 1
M (current mode) is the output It of current transformer 2 and (6)
Since it is a product of e in the equation, the following equation is obtained.
E (又はIM) −に、VRIR8INφ/(RIC1ω)・・・(9) ただし、K1は比例定数である。E (or IM) −, VRIR8INφ/(RIC1ω)...(9) However, K1 is a proportionality constant.
このり9)式と上記(8)式とから次式が得られる。The following equation is obtained from equation 9) and equation (8) above.
FM−KIVRI、、SINφ/(τsIsω)・・・
(10)
ここでは周波数数変動分補正手段を用いて、1/τ −
K ωまたは1/I −に3ωにすることS2
s
により、構成の簡易化および装置コストの低減を図るこ
とができている。FM-KIVRI,, SINφ/(τsIsω)...
(10) Here, using a frequency number variation correction means, 1/τ −
K ω or 1/I − to 3ω S2
s makes it possible to simplify the configuration and reduce device costs.
第1図はこの発明の一実施例の構成を示すブロック図で
あり、図中、第7図と同一の符号を付したものはそれぞ
れ同一の要素を示している。そして、第7図中の係数器
5および乗算器6を除去し、この代わりに周波数数変動
分補正手段としての周期検出器21を設けると共に、第
9図の積分器の代わりに、第2図に示した如く、基準パ
ルス発生器14を除去した積分器7aを用いた点が第7
図と異なっている。FIG. 1 is a block diagram showing the configuration of an embodiment of the present invention. In the figure, the same reference numerals as in FIG. 7 indicate the same elements. Then, the coefficient unit 5 and the multiplier 6 in FIG. 7 are removed, and a period detector 21 as a frequency number variation correction means is provided in their place, and the integrator in FIG. As shown in FIG. 7, the use of the integrator 7a without the reference pulse generator 14
It is different from the illustration.
ここで、周期検出器21は第3図のタイムチャートに示
すように、変圧器1の出力から出力される正弦波電圧e
tを波形整形してパルス信号eB′を得、さらに、この
パルス信号を1/2分周して得られた電圧信号eBを帰
還パルス発生器12に加えている。これにより、1/τ
S−に2ωとして周波数数変動分を除去することができ
る。Here, the period detector 21 detects a sine wave voltage e output from the output of the transformer 1, as shown in the time chart of FIG.
t is waveform-shaped to obtain a pulse signal eB', and this pulse signal is further frequency-divided by 1/2 to obtain a voltage signal eB, which is applied to the feedback pulse generator 12. As a result, 1/τ
The frequency variation can be removed by setting 2ω to S-.
なお、第9図に示した基準パルス発生器14が、正弦波
電圧e に比べて周波数がはるかに高いパルスを帰還パ
ルス発生器12に与えている場合には、第4図に示すよ
うに、周波数fの正弦波電圧e をPLL形逓倍回路2
2に入力して、周波数がN1 ・fのパルス周波数を得
、周期が2π/N ωのパルス信号epを帰還パルス発
生器12に加えるようにすればよい。Note that when the reference pulse generator 14 shown in FIG. 9 gives a pulse having a much higher frequency than the sine wave voltage e to the feedback pulse generator 12, as shown in FIG. PLL type multiplier circuit 2 converts the sine wave voltage e of frequency f into
2 to obtain a pulse frequency with a frequency of N1·f, and apply a pulse signal ep with a period of 2π/Nω to the feedback pulse generator 12.
第5図は帰還パルス発生器12に周期が2π/N ωの
パルス信号epを加える他の実施例の構成を示すブロッ
ク図である。ここで、正弦波電圧etを周期検出器21
で波形整形してパルス信号eBを出力する一方、正弦波
電圧e、よりも格段に周波数の高いクロック信号を発生
する基準クロック発生器24を設け、そのクロックを分
周器25で1/N に分周した後、パルス信号eBと
共にANDゲート26に加え、その出力パルスをカウン
タ27で計数し、カウンタ27の計数値をラッチ28で
保持する。また、基準クロック発生器24のクロックは
もう一つのカウンタ2っで計数され、その計数値とラッ
チ28に保持された値が一致検出回路30で比較される
。そして、両者が一致する毎にパルスを発生してカウン
タ29にリセットパルスとして加えると共に、波形整形
回路31に加える。この結果、波形整形回路31から、
周期が2π/(N ω)のパルス信号epが出力され
る。FIG. 5 is a block diagram showing the configuration of another embodiment in which a pulse signal ep with a period of 2π/Nω is applied to the feedback pulse generator 12. Here, the sine wave voltage et is detected by the period detector 21.
A reference clock generator 24 is provided which outputs a pulse signal eB by shaping the waveform at the sine wave voltage e, and also generates a clock signal with a much higher frequency than the sine wave voltage e.The clock is divided into 1/N by a frequency divider 25. After frequency division, it is applied to the AND gate 26 together with the pulse signal eB, the output pulses are counted by the counter 27, and the count value of the counter 27 is held by the latch 28. Further, the clock from the reference clock generator 24 is counted by another counter 2, and the counted value and the value held in the latch 28 are compared by a coincidence detection circuit 30. Then, each time the two match, a pulse is generated and applied to the counter 29 as a reset pulse, and also applied to the waveform shaping circuit 31. As a result, from the waveform shaping circuit 31,
A pulse signal ep with a period of 2π/(N ω) is output.
上記実施例はいずれも帰還パルス発生器12に加わる基
準パルスを周波数によって変更するものであるが、この
代わりに、帰還パルス発生器の電流値を周波数によって
変更してもよい。第6図はその例で、周期検出器21の
出力パルスeBと、基準クロック発生器24のクロック
とをANDゲート26に加え、そ・の出力パルスをカウ
ンタ27で計数する。そして、その計数値をラッチ28
で保持し、これをD/Aコンバータ32でアナログ電流
信号l または電圧信号E8に変換する。このようにし
て得られたアナログ信号■8またはE は正弦波電圧e
の周波数に反比例し、E8S
【
の場合は電流変換して1/■s−に3ωに従った周波数
補正が可能となる。これにより、基準電圧回路13を除
去した簡易構成の積分器7bの使用が可能となる。In all of the above embodiments, the reference pulse applied to the feedback pulse generator 12 is changed depending on the frequency, but instead of this, the current value of the feedback pulse generator may be changed depending on the frequency. FIG. 6 shows an example of this, in which the output pulse eB of the period detector 21 and the clock of the reference clock generator 24 are applied to an AND gate 26, and the output pulses thereof are counted by a counter 27. Then, the count value is latched 28
The D/A converter 32 converts this into an analog current signal l or voltage signal E8. The analog signal 8 or E obtained in this way is the sine wave voltage e
is inversely proportional to the frequency of E8S
In the case of [, it is possible to perform current conversion and perform frequency correction according to 3ω to 1/■s-. This makes it possible to use an integrator 7b with a simple configuration in which the reference voltage circuit 13 is removed.
以上の説明によって明らかなように、この発明によれば
、第1の積分器の移相に起因する無効電力の周波数数変
動分を、第2の積分器のパルス周波数に関連する基準の
パルス信号のパルス幅またはパルス振幅を負荷の電圧の
周波数に反比例するように変化させて補正する周波数数
変動分補正手段を備えているので、従来装置と較べて構
成を著しく簡易化し得ると同時に、装置コストを低減さ
せることかできるという効果がある。As is clear from the above description, according to the present invention, the frequency variation of the reactive power due to the phase shift of the first integrator is converted into a reference pulse signal related to the pulse frequency of the second integrator. Since it is equipped with a frequency number variation correction means that corrects the pulse width or pulse amplitude by changing it in inverse proportion to the frequency of the load voltage, the configuration can be significantly simplified compared to conventional devices, and at the same time, the device cost can be reduced. This has the effect of reducing the
第1図はこの発明の一実施例の構成を示すブロック図、
第2図は同実施例の主要素の詳細な構成を示すブロック
回路図、第3図は同実施例の動作を説明するための波形
図、第4図はこの発明の第2の実施例の構成を示すブロ
ック図、第5図はこの発明の第3の実施例の構成を示す
ブロック図、第6図はこの発明の第4の実施例の構成を
示すブロック回路図、第7図は従来の電子式無効電力量
計の構成を示すブロック図、第8図および第9図は同装
置の主要素の詳細な構成を示すブロック回路図、第10
図は同装置の動作を説明するための波形図である。
1・・・変圧器、2・・・変流器、3・・・移相器、4
・・・乗算器、7a、7b・・・積分器、8・・・表示
器、21・・・周期検出器、22・・・PLL形逓倍回
路、26・・・基準クロック発生器、25・・・分周器
、26・・・ANDゲート、27.29・・・カウンタ
、28・・・ラッチ、30・・・−数回路、31・・・
波形整形回路、32・・・D/Aコンバータ。
出願人代理人 佐 藤 −雄
図rri7)i>・u(lシ′、1に変更なし)ノ
しt
第1図
n
第2図
第3図
第4図
第9図
手続補正書
昭和62年12月7.5″日FIG. 1 is a block diagram showing the configuration of an embodiment of the present invention.
Fig. 2 is a block circuit diagram showing the detailed configuration of the main elements of the embodiment, Fig. 3 is a waveform diagram for explaining the operation of the embodiment, and Fig. 4 is a diagram of the second embodiment of the invention. FIG. 5 is a block diagram showing the configuration of the third embodiment of the present invention, FIG. 6 is a block diagram showing the configuration of the fourth embodiment of the present invention, and FIG. 7 is the conventional circuit diagram. FIGS. 8 and 9 are block diagrams showing the configuration of the electronic reactive energy meter; FIGS. 8 and 9 are block circuit diagrams showing the detailed configuration of the main elements of the device; FIGS.
The figure is a waveform diagram for explaining the operation of the device. 1...Transformer, 2...Current transformer, 3...Phase shifter, 4
... Multiplier, 7a, 7b... Integrator, 8... Display, 21... Period detector, 22... PLL type multiplier circuit, 26... Reference clock generator, 25... ...Frequency divider, 26...AND gate, 27.29...Counter, 28...Latch, 30...-number circuit, 31...
Waveform shaping circuit, 32...D/A converter. Applicant's agent Sato - Yu figure rri7) i>・u (l si', no change to 1) not Figure 1 n Figure 2 Figure 3 Figure 4 Figure 9 Procedure amendment 1986 December 7.5″ day
Claims (1)
した信号のいずれか一方を第1の積分器を含む移相器で
移相して他方と乗算し、得られた信号を第2の積分器で
積分すると共に、その積分値が基準のパルス信号のパル
ス幅とパルス振幅との積に一致する毎に単位無効電力量
に対応するパルスを発生する電子式無効電力量計におい
て、前記基準のパルス信号のパルス幅またはパルス振幅
を前記負荷の電圧の周波数に反比例するように変化させ
て前記第1の積分器の移相に起因する無効電力の周波数
数変動分を補正する周波数変動分補正手段を備えたこと
を特徴とする電子式無効電力量計。Either one of the signal proportional to the voltage of the load and the signal proportional to the current of the load is phase-shifted by a phase shifter including a first integrator and multiplied by the other, and the obtained signal is subjected to second integration. In an electronic reactive energy meter that integrates with a device and generates a pulse corresponding to unit reactive energy every time the integrated value matches the product of the pulse width and pulse amplitude of a reference pulse signal, Frequency variation correction means for correcting frequency variation of reactive power caused by phase shift of the first integrator by changing the pulse width or pulse amplitude of the pulse signal in inverse proportion to the frequency of the voltage of the load. An electronic reactive watt-hour meter characterized by comprising:
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP62273921A JPH0646200B2 (en) | 1987-10-29 | 1987-10-29 | Electronic reactive energy meter |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
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JP62273921A JPH0646200B2 (en) | 1987-10-29 | 1987-10-29 | Electronic reactive energy meter |
Publications (2)
Publication Number | Publication Date |
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JPH01114763A true JPH01114763A (en) | 1989-05-08 |
JPH0646200B2 JPH0646200B2 (en) | 1994-06-15 |
Family
ID=17534427
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
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JP62273921A Expired - Fee Related JPH0646200B2 (en) | 1987-10-29 | 1987-10-29 | Electronic reactive energy meter |
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JP (1) | JPH0646200B2 (en) |
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
CN107238753A (en) * | 2017-06-12 | 2017-10-10 | 威胜集团有限公司 | Digital phase shift measures the frequency error compensation method of reactive power under fixed frequency sampling |
Citations (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS5726762A (en) * | 1980-07-25 | 1982-02-12 | Toshiba Corp | Reactive watt-hour meter |
-
1987
- 1987-10-29 JP JP62273921A patent/JPH0646200B2/en not_active Expired - Fee Related
Patent Citations (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS5726762A (en) * | 1980-07-25 | 1982-02-12 | Toshiba Corp | Reactive watt-hour meter |
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
CN107238753A (en) * | 2017-06-12 | 2017-10-10 | 威胜集团有限公司 | Digital phase shift measures the frequency error compensation method of reactive power under fixed frequency sampling |
Also Published As
Publication number | Publication date |
---|---|
JPH0646200B2 (en) | 1994-06-15 |
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