JPH01110560U - - Google Patents

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JPH01110560U
JPH01110560U JP510488U JP510488U JPH01110560U JP H01110560 U JPH01110560 U JP H01110560U JP 510488 U JP510488 U JP 510488U JP 510488 U JP510488 U JP 510488U JP H01110560 U JPH01110560 U JP H01110560U
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circuit
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dot
information
reduction
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JP510488U
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【図面の簡単な説明】
第1図は本考案の一実施例を示すブロツク図、
第2図a及びbは通常パターン状態の元のドツト
情報及びこれを論理和演算を用いて縮小したドツ
ト情報を示す模式図、第3図a乃至cは反転パタ
ーン状態の元のドツト情報、これを論理和演算を
用いて縮小したドツト情報及び元のドツト情報を
論理積演算を用いて縮小したドツト情報を示す模
式図である。 2……画像メモリ、5……論理和演算回路、6
……論理積演算回路、7……選択回路。

Claims (1)

    【実用新案登録請求の範囲】
  1. 任意の数の画素から成るドツト情報を任意の縮
    小率にて縮小する回路において、上記ドツト情報
    から上記縮小率に応じた数づつドツト情報を取り
    出して論理和演算を行なう演算回路と、上記ドツ
    ト情報から上記縮小率に応じた数づつドツド情報
    を取り出して論理積演算を行なう演算回路と、上
    記論理和演算回路もしくは論理積演算回路の一方
    を選択する選択回路とを備えたことを特徴とする
    ドツト情報の縮小回路。
JP510488U 1988-01-19 1988-01-19 Pending JPH01110560U (ja)

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JP510488U JPH01110560U (ja) 1988-01-19 1988-01-19

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JPH01110560U true JPH01110560U (ja) 1989-07-26

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