JPS61145991U - - Google Patents
Info
- Publication number
- JPS61145991U JPS61145991U JP2864585U JP2864585U JPS61145991U JP S61145991 U JPS61145991 U JP S61145991U JP 2864585 U JP2864585 U JP 2864585U JP 2864585 U JP2864585 U JP 2864585U JP S61145991 U JPS61145991 U JP S61145991U
- Authority
- JP
- Japan
- Prior art keywords
- frame memory
- crt
- control circuit
- image information
- display control
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
Links
- 238000010586 diagram Methods 0.000 description 2
Description
第１図は本考案の一実施例のＣＲＴ表示制御回
路の構成を示すブロツク図、第２図は従来回路の
構成を示すブロツク図である。 １１……フレーム・メモリ、１２……ＣＲＴ制
御回路、１３……ＣＰＵ、１４……セレクタ、１
５……ＣＲＴインタフエース回路、１６……ライ
ン・メモリ。
路の構成を示すブロツク図、第２図は従来回路の
構成を示すブロツク図である。 １１……フレーム・メモリ、１２……ＣＲＴ制
御回路、１３……ＣＰＵ、１４……セレクタ、１
５……ＣＲＴインタフエース回路、１６……ライ
ン・メモリ。
Claims (1)
- 【実用新案登録請求の範囲】 １画面分の画像情報を格納するフレーム・メモ
リと、このフレーム・メモリの内容を順次読出し
てＣＲＴに供給する順次読出し手段と、この順次
読出しの合間にこのフレーム・メモリに対するラ
ンダムアクセスを行うＣＰＵとを備えたＣＲＴ表
示制御回路において、 前記順次読出し手段は、前記フレーム・メモリ
の画像情報を表示速度よりも高速に１ライン分ず
つつ間歇的に読出すことを特徴とするＣＲＴ表示
制御回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2864585U JPS61145991U (ja) | 1985-02-28 | 1985-02-28 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2864585U JPS61145991U (ja) | 1985-02-28 | 1985-02-28 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS61145991U true JPS61145991U (ja) | 1986-09-09 |
Family
ID=30526719
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP2864585U Pending JPS61145991U (ja) | 1985-02-28 | 1985-02-28 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS61145991U (ja) |
-
1985
- 1985-02-28 JP JP2864585U patent/JPS61145991U/ja active Pending
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