JP7443533B2 - 基準信号処理方法、装置、第1通信ノード及び第2通信ノード - Google Patents
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Description
w個のシーケンスを発生させるステップであって、異なる第1通信ノードの前記wの値は全て同じであることはなく、wは正の整数である、ステップと、前記w個のシーケンスに基づいて、基準信号を生成するステップと、前記基準信号および対応するデータ信号を送信するステップとを含む。
複数の第1通信ノードの基準信号およびデータ信号を受信するステップと、各前記基準信号のうちの目標基準信号を生成する少なくとも1つのシーケンスに基づいて、前記目標基準信号に対応するデータ信号に復調するステップと、前記データ信号に基づいて前記目標基準信号を生成するw個のシーケンスを確定するステップと、前記w個のシーケンスに基づいて干渉除去を行い、各前記基準信号に対する除去が全て完了するまで、引き続き次の目標基準信号を確定するステップとを含む。
w個のシーケンスを発生させるように構成された発生モジュールであって、異なる第1通信ノードの前記wの値は全て同じであることはなく、前記wは正の整数である、発生モジュールと、前記w個のシーケンスに基づいて、基準信号を生成するように構成された生成モジュールと、前記基準信号および対応するデータ信号を送信するように構成された送信モジュールとを含む。
複数の第1通信ノードの基準信号およびデータ信号を受信するように構成された受信モジュールと、各前記基準信号のうちの目標基準信号を生成する少なくとも1つのシーケンスに基づいて、前記目標基準信号に対応するデータ信号に復調するように構成された復調モジュールと、前記データ信号に基づいて前記目標基準信号を生成するw個のシーケンスを確定するように構成された確定モジュールと、前記w個のシーケンスに基づいて干渉除去を行い、各前記基準信号に対する除去が全て完了するまで、引き続き次の目標基準信号を確定するように構成された干渉除去モジュールとを含む。
1つまたは複数のプロセッサと、1つまたは複数のプログラムを記憶するように構成された記憶装置とを含み、
前記1つまたは複数のプログラムが前記1つまたは複数のプロセッサによって実行されたときに、前記1つまたは複数のプロセッサに第1通信ノードに適用される基準信号処理方法を実現させる。
1つまたは複数のプロセッサと、1つまたは複数のプログラムを記憶するように構成された記憶装置とを含み、
前記1つまたは複数のプログラムが前記1つまたは複数のプロセッサによって実行されたときに、前記1つまたは複数のプロセッサに第2通信ノードに適用される基準信号処理方法を実現させる。
w個のシーケンスを発生させた後、このステップは、各シーケンスに基づいて基準信号を生成することができる。ここでは、生成する手段について限定せず、例えば、重ね合わせの方法または異なる時間周波数リソースへマッピングする方法とすることができる。重ね合わせの方法は、シーケンスの重ね合わせによって実現できる。
表3はwとビットシンボルとの対応関係表である。表3を参照し、wの取り得る値は3種類あり、2ビットシンボルxによって示す必要がある。この2ビットシンボルは、巡回冗長検査(CRC:Cyclic Redundancy Check)が付加される前の情報ビット、CRCが付加された後且つチャネル符号化前のビット、またはチャネル符号化後の符号語に対して、マッピングして得られるものであってもよい。すなわち、wは、CRCが付加される前の情報ビット、CRCが付加された後且つチャネル符号化前のビット、またはチャネル符号化後の符号語から、2ビットシンボル(すなわち、x)を取って確定できる。UEがwを確定するとき、xの値に基づいてwを確定できる。例えば、UEは、CRCが付加される前の情報ビットから2ビットシンボルをxとして取り、そして、表3に基づいて対応するwを確定する。UE1におけるxの値が01であれば、UE1におけるwの値は3である。
巡回冗長検査前の情報ビットまたは巡回冗長検査後の情報ビットに対して部分スクランブリング処理を行うことを含む。
前記w個のシーケンスを重ね合わせて、前記基準信号を生成するステップ、または、前記w個のシーケンスを、異なる時間周波数リソースにマッピングして、前記基準信号を生成するステップとを含む。
Claims (20)
- 第1通信ノードに適用される基準信号処理方法であって、
w個のシーケンスを発生させるステップであって、異なる第1通信ノードに対応する各wの値のうち少なくとも1つは異なるように選択され、wは正の整数である、ステップと、
前記w個のシーケンスに基づいて、基準信号を生成するステップと、
前記基準信号および前記基準信号に対応するデータ信号を送信するステップとを含む基準信号処理方法。 - wの値は、基地局によって示されるか、または、離散確率分布と、転送の優先順位と、データ情報と、のうちの1つに基づいて確定される、請求項1に記載の方法。
- 前記w個のシーケンスの、シーケンス指示情報と、シーケンス番号オフセットと、のうちの少なくとも1つは、データ情報によって確定される、請求項1に記載の方法。
- 前記データ情報は、前記第1通信ノードによる変調前の情報ビットまたは符号語である、請求項2又は3に記載の方法。
- 前記データ情報は、巡回冗長検査が付加される前の情報ビット、巡回冗長検査が付加された後且つチャネル符号化前のビット、またはチャネル符号化後の符号語である、請求項4に記載の方法。
- 前記データ情報は、前記第1通信ノードの識別情報を含む、請求項2又は3に記載の方法。
- 前記データ情報のビット桁数は、wの値の範囲に基づいて確定され、前記データ情報はwを示す、請求項2又は3に記載の方法。
- 前記データ信号は、wの値情報と、番号指示情報と、シーケンス番号オフセットと、のうちの少なくとも1つを含み、前記データ信号は、データ情報に基づいて確定される、請求項1に記載の方法。
- 前記データ情報は、1つのwの値情報と、w個のシーケンス指示情報と、のうちの少なくとも1つを含み、前記w個のシーケンス指示情報は前記w個のシーケンスを示すように構成されている、請求項2又は3又は8に記載の方法。
- 前記データ情報は、1つのwの値情報と、w-1個のシーケンス番号オフセットと、のうちの少なくとも1つを含む、請求項2又は3又は8に記載の方法。
- 異なる第1通信ノードのvの値が同一である場合、前記データ情報はv個のnビットの情報を含み、異なる第1通信ノードのvの値が異なる場合、前記データ情報はv個のnビットの情報とvの値情報とを含み、
前記v個のnビット情報のうち重複しない情報の数はwであり、
前記方法はさらに、前記v個のnビット情報のうち重複しない情報を番号指示情報として確定するステップを含み、
ただし、nは正の整数で、vは正の整数であり、vの値は全ての第1通信ノードのw以上である、請求項2又は3又は8に記載の方法。 - 前記データ情報は、w個のnビットの情報と、1つのqビットの終了シーケンスとを含み、nの値は、前記w個のシーケンスを取得するシーケンスセットに含まれるシーケンスの数に基づいて確定され、qは正の整数であり、
前記終了シーケンスの先頭nビットが示す数はwであり、前記w個のnビットの情報は前記w個のシーケンスの番号指示情報を示す、請求項2又は3又は8に記載の方法。 - 巡回冗長検査前の情報ビットまたは巡回冗長検査後の情報ビットに対して部分スクランブリング処理を行うステップをさらに含む請求項5に記載の方法。
- 前記基準信号は、プリアンブルと、パイロットと、復調基準信号と、のうちの少なくとも1つを含む、請求項1に記載の方法。
- 前記の前記w個のシーケンスに基づいて、基準信号を生成するステップは、
前記w個のシーケンスを重ね合わせて、前記基準信号を生成するステップ、または、
前記w個のシーケンスを、異なる時間周波数リソースにマッピングして、前記基準信号を生成するステップを含む、請求項1に記載の方法。 - 第2通信ノードに適用される基準信号処理方法であって、
複数の第1通信ノードの基準信号およびデータ信号を受信するステップと、
前記複数の第1通信ノードの基準信号のうちの目標基準信号を生成する少なくとも1つのシーケンスに基づいて、前記複数の第1通信ノードのデータ信号のうちの、前記目標基準信号に対応するデータ信号に復調するステップと、
前記目標基準信号に対応するデータ信号に基づいて前記目標基準信号を生成するw個のシーケンスを確定するステップと、
前記w個のシーケンスに基づいて干渉除去を行い、前記複数の第1通信ノードの基準信号に対して干渉除去が全て行われるまで、引き続き次の目標基準信号を確定するステップとを含み、
前記w個のシーケンスは第1通信ノードによって発生し、異なる第1通信ノードに対応する各wの値のうち少なくとも1つは異なるように選択され、wは正の整数である、基準信号処理方法。 - 第1通信ノードに配置される基準信号処理装置であって、
w個のシーケンスを発生させるように構成された発生モジュールであって、異なる第1通信ノードに対応する各wの値のうち少なくとも1つは異なるように選択され、wは正の整数である、発生モジュールと、
前記w個のシーケンスに基づいて、基準信号を生成するように構成された生成モジュールと、
前記基準信号および前記基準信号に対応するデータ信号を送信するように構成された送信モジュールとを含む基準信号処理装置。 - 少なくとも1つのプロセッサと、
少なくとも1つのプログラムを記憶するように構成された記憶装置とを含み、
前記少なくとも1つのプログラムが前記少なくとも1つのプロセッサによって実行されたときに、前記少なくとも1つのプロセッサに請求項1~15の何れか一項に記載の基準信号処理方法を実現させる第1通信ノード。 - 少なくとも1つのプロセッサと、
少なくとも1つのプログラムを記憶するように構成された記憶装置とを含み、
前記少なくとも1つのプログラムが前記少なくとも1つのプロセッサによって実行されたときに、前記少なくとも1つのプロセッサに請求項16に記載の基準信号処理方法を実現させる第2通信ノード。 - コンピュータプログラムを記憶している記憶媒体であって、前記コンピュータプログラムがプロセッサによって実行されたときに、請求項1~16の何れか一項に記載の基準信号処理方法を実現する記憶媒体。
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