JP7214746B2 - 電力制御アービトレーション - Google Patents
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Description
・ クライアントとサーバの実施形態において、一部の例でおよそ10%だけ性能を向上させることができる;
・ より高い周波数に達することを可能にする、最大動作電流ICCmax違反のきめ細かいクリッピングにより、既知のシステムに対して性能を高めることができる;
・ いっそうきめ細かい位相のマネジメントにより、完全一体型電圧レギュレータ(Fully Integrated Voltage Regulator;FIVR)効率を向上させることができ、これは、少なくとも2-6%のコア電力低減を提供し得るとともに、電力制限されるシナリオにおいて対応する性能利得を与え得る;
・ 個々のプロセッシングユニットにおいて、より高速なインテリジェント周波数スイッチを可能にし、例えば、入り混じった命令幅を持つワークロードについて少なくとも約10%の性能改善を提供する。
1)周波数と利用率の関数としての電力、
2)利用率と電力の関数としての周波数、及び
3)電力と周波数の関数としての利用率。
一部の実施形態において、個々のプロセッシングユニット410の電力消費は、ローカル電力制御アービタ430が動作周波数を割り当てる前に特に考慮されないが、代わりに、例えばグローバル電力コントローラによって設定される最大周波数などの制約を満たす支配的なワークロードのための適切な周波数を選択するために、例えば、もっと高い又は低いスループットが必要とされるなどの、単純な決定が使用されてもよい。従って、電力プロファイルの代わりに、あるいは加えて、周波数-電圧カーブが使用されてもよい。
・ コア550がアイドル状態にあるが、それでもなお、高い電圧及び周波数で動作するように設定されているときをローカルに検出して、短いアイドル期間と一致するように周波数低減を実装することを可能にできること;
・ 例えばコア550などのプロセッシングユニットが複数のスレッドを走らせることから単一のスレッド空間を走らせることに移行(これは、10-15%だけ低い動的キャパシタンスをもたらし得る)したときを、より細かい時間スケールで検出できること;
・ 既知のシステムでは、グローバル電力制御ユニットに適用可能な時間スケールとして数百マイクロ秒での電圧補償に固定していたところで、動的キャパシタンスにおける変化に対してもっと迅速に適応して、動作周波数及び電圧を低減させて電力を節減できること;
・ グローバル電力制御アービタのみでは、コアが周波数において不必要に制限されることをもたらし得る比較的長い時間にわたって最悪の場合が当てはまると仮定してしまい得るのに対し、ICCmaxの値に基づいてプロセッサコア550の動作を制限できること;
・ 例えばメモリ停止や、スピンループや、同様のものが存在する状況など、処理スループットがより高い周波数設定からの恩恵を受けていない状況を検出できることであり、このために、ローカル電力制御アービタによって維持管理されるカウンタが使用され得る。
このL2Gメールボックス424(図4参照)は、LコードがGコードにコマンドを送ることを可能にする。Gコードは、コマンド結果をデータレジスタに書き込み、制御レジスタとしてこれらにアクセスする。RUN_BUSYビットはGコードによってリセットされ、Lコードによってセットされる。L2G_mailbox_IFレジスタは、RUN_BUSYビットがセットされている場合には、Gコードによってのみ書き込み可能であるが、RUN_BUSYビットがクリアされている場合にはハードウェアによってのみ書き込み可能である。L2G_mailbox_data_low及びL2G_mailbox_data_highレジスタにデータが書き込まれる。CORE_BUSYフィールド及びWINNING_CORE_IDフィールドは、例えば複数のプロセッシングコアなどの複数のプロセッシングエンティティのうちどれが現在L2Gメールボックスを制御しているかを指し示すために使用され得る。“WINNING_CORE”で表される現在制御しているコア以外のコアによって試みられる書き込み操作は、メールボックスインタフェースによって無視される。従って、L2Gメールボックスは、所与の時点に単一のコアのみにサービス提供する。従って、所与のLコードは、WINNING_CORE_ID==my core IDとなるまで、再試行を続けるべきである。
以下の例は、更なる実施形態に関する。
例1は、複数のプロセッシングエンティティを有するプロセッシングプラットフォームのグローバル電力制御ユニットとインタフェースをとるローカル電力制御アービタであり、当該ローカル電力制御アービタは、前記プロセッシングプラットフォームのローカルプロセッシングユニットを制御するものであり、当該ローカル電力制御アービタは、
グローバル電力制御評価に応じて前記ローカルプロセッシングユニットに割り当てられたローカル性能リミットを、前記グローバル電力制御ユニットから受信するインタフェースと、
プロセッシング回路であり、
前記グローバル電力制御ユニットによって前記ローカル性能リミットが前記ローカルプロセッシングユニットに適用される期間よりも短い時間スケールで前記ローカルプロセッシングユニットにおいて見られる1つ以上の処理状態に対する変化を決定し、且つ
前記ローカル性能リミットと、存在する場合の、前記ローカルプロセッシングユニット上で見られる処理状態について決定された変化と、の双方に応じて、前記ローカルプロセッシングユニットの性能レベルを選択する、
プロセッシング回路と、
を有する。
例2
前記ローカル性能リミットは、周波数上限、電圧上限、電力上限、及び電流上限のうちの少なくとも1つを有する、例1に記載のローカル電力制御アービタ。
例3
前記グローバル電力制御ユニットによって前記ローカル性能リミットが前記ローカルプロセッシングユニットに適用される前記期間は、100マイクロ秒よりも長く、前記処理状態に対する変化が決定される時間スケールは、10マイクロ秒と100マイクロ秒との間の範囲内である、例1又は2に記載のローカル電力制御アービタ。
例4
前記処理状態において決定される変化は、前記プロセッシングユニット上で実行されているスレッドの数における変化、処理しているワークロードにおける変化、及び前記プロセッシングユニットの利用率における変化、のうちの少なくとも1つを有する、例1乃至3のいずれか一に記載のローカル電力制御アービタ。
例5
前記ローカルプロセッシングユニットから、前記ローカルプロセッシングユニットの性能レベルの変更要求を受信し、該性能レベルの変更要求を、その後の、前記ローカル性能リミットを更新するためのグローバル電力評価のために、前記グローバル電力制御ユニットに中継する、ように構成されている例1乃至4のいずれか一に記載のローカル電力制御アービタ。
例6
当該ローカル電力制御アービタは、前記ローカルプロセッシングユニットの少なくとも1つのプロセッシングエンティティについての閾値電力、前記ローカルプロセッシングユニットの少なくとも1つのプロセッシングエンティティについての閾値電流、前記ローカルプロセッシングユニットの少なくとも1つのプロセッシングエンティティについての1つ以上のターボ比リミット、及び前記ローカルプロセッシングユニットの少なくとも1つのプロセッシングエンティティ上で実行されている処理中のワークロードのスケーラビリティ、のうちの少なくとも1つを管理する、例1乃至5のいずれか一に記載のローカル電力制御アービタ。
例7
前記グローバル電力制御ユニットによって決定された前記ローカル性能リミットと、前記ローカルプロセッシングユニットによって要求されたローカル電力制約と、の間で調停を行うワークポイントアービタ、を有する例1乃至6のいずれか一に記載のローカル電力制御アービタ。
例8
前記ワークポイントアービタは、前記ローカル性能リミットの制約の範囲内で、前記ローカルプロセッシングユニットの1つ以上のプロセッシングエンティティについて、複数の異なるローカル性能レベルの間で選択する、例7に記載のローカル電力制御アービタ。
例9
前記ローカル性能レベルは、レジスタのセットに格納された所定の値に基づいて選択される、例8に記載のローカル電力制御アービタ。
例10
マイクロプロセッサと、不揮発性メモリと、入力/出力インタフェースとを有する例1乃至9のいずれか一に記載のローカル電力制御アービタ。
例11
前記ローカルプロセッシングユニットは、プロセッサコア、グラフィックス処理ユニット、及び画像処理ユニットのうちの1つを有する、例1乃至10のいずれか一に記載のローカル電力制御アービタ。
例12
前記グローバル電力制御ユニットから当該ローカル電力制御アービタにコマンドを送信するための1つ以上のハードウェアレジスタを有するグローバル・ツー・ローカルメールボックス、を有する例1乃至11のいずれか一に記載のローカル電力制御アービタ。
例13
前記グローバル・ツー・ローカルメールボックスは、前記グローバル電力制御ユニットからコマンドを受信すべき複数のプロセッシングユニットのうちの1つの選択を可能にするレジスタフィールドを有する、例12に記載のローカル電力制御アービタ。
例14
当該ローカル電力制御アービタが前記グローバル電力制御ユニットにコマンドを送信することを可能にする1つ以上のハードウェアレジスタを有するローカル・ツー・グローバルメールボックス、を有する例1乃至13のいずれか一に記載のローカル電力制御アービタ。
例15
前記ローカル・ツー・グローバルメールボックスは、存在する場合に前記ローカル・ツー・グローバルメールボックスを現在制御しているのが前記プロセッシングプラットフォームの前記複数のプロセッシングエンティティのうちのいずれの1つであるかを特定するレジスタフィールドを有する、例14に記載のローカル電力制御アービタ。
例16
前記ローカル・ツー・グローバルメールボックスは、前記現在制御しているプロセッシングエンティティ以外のプロセッシングエンティティからの前記ローカル・ツー・グローバルメールボックスへの書き込みの試みを無効にするレジスタフィールドを有する、例15に記載のローカル電力制御アービタ。
例17
リセット動作中に前記プロセッシングプラットフォームのオペレーティングシステムの基本入力出力システムBIOSから設定データをロードするように構成される、例16に記載のローカル電力制御アービタ。
例18は、プロセッシングプラットフォームであって、当該プロセッシングプラットフォームは、
複数のプロセッシングエンティティと、
前記複数のプロセッシングエンティティの性能レベルを制御するグローバル電力制御ユニットと、
少なくとも1つの、例1乃至17のいずれか一に記載のローカル電力制御アービタと、
を有し、
前記複数のプロセッシングエンティティのうちの少なくとも1つのサブセットが、それぞれのローカル電力制御アービタによって制御される。
例19
当該プロセッシングプラットフォームのそれぞれの複数のプロセッシングユニットを制御する複数のローカル電力制御アービタを有し、各プロセッシングユニットが、少なくとも1つのプロセッサコアを有する、例18に記載のプロセッシングプラットフォーム。
例20は、例18又は19に記載のプロセッシングプラットフォームを有する集積回路である。
例21
一時的又は非一時的な機械読み取り可能媒体上で提供される機械読み取り可能命令であって、機械読み取り可能命令は、ローカル電力制御アービタの1つ以上のプロセッサによる実行を受けて、
プロセッシングプラットフォームのグローバル電力制御ユニットから、グローバル電力制御評価に応じて前記プロセッシングプラットフォームのローカルプロセッシングユニットに割り当てられたローカル性能リミットを受信し、
前記グローバル電力制御ユニットによって前記ローカル性能リミットが前記ローカルプロセッシングユニットに適用される期間よりも短い時間スケールで前記ローカルプロセッシングユニットにおいて見られる1つ以上の処理状態に対する変化を決定し、且つ
前記ローカル性能リミットと、存在する場合の、前記ローカルプロセッシングユニット上で見られる処理状態について決定された変化と、の双方に応じて、前記ローカルプロセッシングユニットの性能レベルを選択する、
機械読み取り可能命令。
例22
前記ローカル性能リミットは、前記プロセッシングユニットについての周波数上限を有し、該周波数上限は、前記プロセッシングユニットの1つ以上のプロセッサコアに適用される、例21に記載の機械読み取り可能命令。
例23
グローバル電力制御ユニットを有するプロセッシングプラットフォームのローカルプロセッシングユニットの性能レベルを制御する方法であって、
前記グローバル電力制御ユニットから、グローバル電力制御評価に応じて前記プロセッシングプラットフォームの前記ローカルプロセッシングユニットに割り当てられたローカル性能リミットを受信し、
前記グローバル電力制御ユニットによって前記ローカル性能リミットが前記ローカルプロセッシングユニットに適用される期間よりも短い時間スケールで前記ローカルプロセッシングユニットにおいて見られる1つ以上の処理状態に対する変化を決定し、且つ
前記ローカル性能リミットと、存在する場合の、前記ローカルプロセッシングユニット上で見られる処理状態について決定された変化と、の双方に応じて、前記ローカルプロセッシングユニットの性能レベルを選択する、
ことを有する方法。
例24
前記ローカルプロセッシングユニットから、前記プロセッシングユニットの性能レベルに対する変更の要求を受信し、前記ローカル性能リミットを更新するために前記要求を前記グローバル電力制御ユニットに中継する、ことを有する例23に記載の方法。
Claims (22)
- 複数のプロセッシングエンティティを有するプロセッシングプラットフォームのグローバル電力制御ユニットとインタフェースをとるローカル電力制御アービタであって、当該ローカル電力制御アービタは、前記プロセッシングプラットフォームのローカルプロセッシングユニットを制御するものであり、当該ローカル電力制御アービタは、
グローバル電力制御評価に応じて前記ローカルプロセッシングユニットに割り当てられたローカル性能リミットを、前記グローバル電力制御ユニットから受信するインタフェースと、
当該ローカル電力制御アービタが前記グローバル電力制御ユニットにコマンドを送信することを可能にする1つ以上のハードウェアレジスタを有するローカル・ツー・グローバルメールボックスと、
プロセッシング回路であり、
前記グローバル電力制御ユニットによって前記ローカル性能リミットが前記ローカルプロセッシングユニットに適用される期間よりも短い時間スケールで前記ローカルプロセッシングユニットにおいて見られる1つ以上の処理状態に対する変化を決定し、且つ
前記ローカル性能リミットと、存在する場合の、前記ローカルプロセッシングユニット上で見られる処理状態について決定された変化と、の双方に応じて、前記ローカルプロセッシングユニットの性能レベルを選択する、
プロセッシング回路と、
を有する、ローカル電力制御アービタ。 - 前記ローカル性能リミットは、周波数上限、電圧上限、電力上限、及び電流上限のうちの少なくとも1つを有する、請求項1に記載のローカル電力制御アービタ。
- 前記グローバル電力制御ユニットによって前記ローカル性能リミットが前記ローカルプロセッシングユニットに適用される前記期間は、100マイクロ秒よりも長く、前記処理状態に対する変化が決定される時間スケールは、10マイクロ秒と100マイクロ秒との間の範囲内である、請求項1に記載のローカル電力制御アービタ。
- 前記処理状態において決定される変化は、前記ローカルプロセッシングユニット上で実行されているスレッドの数における変化、処理しているワークロードにおける変化、及び前記ローカルプロセッシングユニットの利用率における変化、のうちの少なくとも1つを有する、請求項1に記載のローカル電力制御アービタ。
- 前記ローカルプロセッシングユニットから、前記ローカルプロセッシングユニットの性能レベルの変更要求を受信し、該性能レベルの変更要求を、その後の、前記ローカル性能リミットを更新するためのグローバル電力評価のために、前記グローバル電力制御ユニットに中継する、ように構成されている請求項1に記載のローカル電力制御アービタ。
- 当該ローカル電力制御アービタは、前記ローカルプロセッシングユニットの少なくとも1つのプロセッシングエンティティについての閾値電力、前記ローカルプロセッシングユニットの少なくとも1つのプロセッシングエンティティについての閾値電流、前記ローカルプロセッシングユニットの少なくとも1つのプロセッシングエンティティについての1つ以上のターボ比リミット、及び前記ローカルプロセッシングユニットの少なくとも1つのプロセッシングエンティティ上で実行されている処理中のワークロードのスケーラビリティ、のうちの少なくとも1つを管理する、請求項1に記載のローカル電力制御アービタ。
- 前記グローバル電力制御ユニットによって決定された前記ローカル性能リミットと、前記ローカルプロセッシングユニットによって要求されたローカル電力制約と、の間で調停を行うワークポイントアービタ、を有する請求項1に記載のローカル電力制御アービタ。
- 前記ワークポイントアービタは、前記ローカル性能リミットの制約の範囲内で、前記ローカルプロセッシングユニットの1つ以上のプロセッシングエンティティについて、複数の異なるローカル性能レベルの間で選択する、請求項7に記載のローカル電力制御アービタ。
- 前記ローカル性能レベルは、レジスタのセットに格納された所定の値に基づいて選択される、請求項8に記載のローカル電力制御アービタ。
- マイクロプロセッサと、不揮発性メモリと、入力/出力インタフェースとを有する請求項1に記載のローカル電力制御アービタ。
- 前記ローカルプロセッシングユニットは、プロセッサコア、グラフィックス処理ユニット、及び画像処理ユニットのうちの1つを有する、請求項1に記載のローカル電力制御アービタ。
- 前記グローバル電力制御ユニットから当該ローカル電力制御アービタにコマンドを送信するための1つ以上のハードウェアレジスタを有するグローバル・ツー・ローカルメールボックス、を有する請求項1に記載のローカル電力制御アービタ。
- 前記グローバル・ツー・ローカルメールボックスは、前記グローバル電力制御ユニットからコマンドを受信すべき複数のローカルプロセッシングユニットのうちの1つの選択を可能にするレジスタフィールドを有する、請求項12に記載のローカル電力制御アービタ。
- 前記ローカル・ツー・グローバルメールボックスは、存在する場合に前記ローカル・ツー・グローバルメールボックスを現在制御しているのが前記プロセッシングプラットフォームの前記複数のプロセッシングエンティティのうちのいずれの1つであるかを特定するレジスタフィールドを有する、請求項1に記載のローカル電力制御アービタ。
- 前記ローカル・ツー・グローバルメールボックスは、前記現在制御しているプロセッシングエンティティ以外のプロセッシングエンティティからの前記ローカル・ツー・グローバルメールボックスへの書き込みの試みを無効にするレジスタフィールドを有する、請求項14に記載のローカル電力制御アービタ。
- リセット動作中に前記プロセッシングプラットフォームのオペレーティングシステムの基本入力出力システムBIOSから設定データをロードするように構成される、請求項15に記載のローカル電力制御アービタ。
- 複数のプロセッシングエンティティと、
前記複数のプロセッシングエンティティの性能レベルを制御するグローバル電力制御ユニットと、
少なくとも1つの、請求項1乃至16のいずれか一項に記載のローカル電力制御アービタと、
を有し、
前記複数のプロセッシングエンティティのうちの少なくとも1つのサブセットが、それぞれのローカル電力制御アービタによって制御される、
プロセッシングプラットフォーム。 - 当該プロセッシングプラットフォームのそれぞれの複数のローカルプロセッシングユニットを制御する複数のローカル電力制御アービタを有し、各ローカルプロセッシングユニットが、少なくとも1つのプロセッサコアを有する、請求項17に記載のプロセッシングプラットフォーム。
- 請求項17又は18に記載のプロセッシングプラットフォームを有する集積回路。
- 一時的又は非一時的な機械読み取り可能媒体上で提供される機械読み取り可能命令であって、機械読み取り可能命令は、ローカル電力制御アービタの1つ以上のプロセッサによる実行を受けて、
プロセッシングプラットフォームのグローバル電力制御ユニットから、グローバル電力制御評価に応じて前記プロセッシングプラットフォームのローカルプロセッシングユニットに割り当てられたローカル性能リミットを受信し、
前記グローバル電力制御ユニットによって前記ローカル性能リミットが前記ローカルプロセッシングユニットに適用される期間よりも短い時間スケールで前記ローカルプロセッシングユニットにおいて見られる1つ以上の処理状態に対する変化を決定し、且つ
前記ローカル性能リミットと、存在する場合の、前記ローカルプロセッシングユニット上で見られる処理状態について決定された変化と、の双方に応じて、前記ローカルプロセッシングユニットの性能レベルを選択し、
前記ローカルプロセッシングユニットから、前記ローカルプロセッシングユニットの性能レベルに対する変更の要求を受信し、前記ローカル性能リミットを更新するために前記要求を前記グローバル電力制御ユニットに中継する、
機械読み取り可能命令。 - 前記ローカル性能リミットは、前記ローカルプロセッシングユニットについての周波数上限を有し、該周波数上限は、前記ローカルプロセッシングユニットの1つ以上のプロセッサコアに適用される、請求項20に記載の機械読み取り可能命令。
- グローバル電力制御ユニットを有するプロセッシングプラットフォームのローカルプロセッシングユニットの性能レベルを制御する方法であって、
前記グローバル電力制御ユニットから、グローバル電力制御評価に応じて前記プロセッシングプラットフォームの前記ローカルプロセッシングユニットに割り当てられたローカル性能リミットを受信し、
前記グローバル電力制御ユニットによって前記ローカル性能リミットが前記ローカルプロセッシングユニットに適用される期間よりも短い時間スケールで前記ローカルプロセッシングユニットにおいて見られる1つ以上の処理状態に対する変化を決定し、
前記ローカル性能リミットと、存在する場合の、前記ローカルプロセッシングユニット上で見られる処理状態について決定された変化と、の双方に応じて、前記ローカルプロセッシングユニットの性能レベルを選択し、
前記ローカルプロセッシングユニットから、前記ローカルプロセッシングユニットの性能レベルに対する変更の要求を受信し、前記ローカル性能リミットを更新するために前記要求を前記グローバル電力制御ユニットに中継する、
ことを有する方法。
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
PCT/US2018/030517 WO2019212541A1 (en) | 2018-05-01 | 2018-05-01 | Power control arbitration |
Publications (2)
Publication Number | Publication Date |
---|---|
JP2021531526A JP2021531526A (ja) | 2021-11-18 |
JP7214746B2 true JP7214746B2 (ja) | 2023-01-30 |
Family
ID=68387017
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP2020551527A Active JP7214746B2 (ja) | 2018-05-01 | 2018-05-01 | 電力制御アービトレーション |
Country Status (5)
Country | Link |
---|---|
US (1) | US11543878B2 (ja) |
JP (1) | JP7214746B2 (ja) |
CN (1) | CN111971641A (ja) |
DE (1) | DE112018007545T5 (ja) |
WO (1) | WO2019212541A1 (ja) |
Families Citing this family (13)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
CN112912820A (zh) * | 2018-10-26 | 2021-06-04 | 华为技术有限公司 | Cpu调节器的能效调整 |
US11100698B2 (en) * | 2019-06-28 | 2021-08-24 | Ati Technologies Ulc | Real-time GPU rendering with performance guaranteed power management |
US11320476B2 (en) * | 2019-07-15 | 2022-05-03 | The Boeing Company | Eddy current system for use with electrically-insulative structures and methods for inductively heating or inductively inspecting |
US11435806B2 (en) * | 2019-12-16 | 2022-09-06 | Advanced Micro Devices, Inc. | Automatic voltage reconfiguration |
US11334133B2 (en) * | 2020-04-24 | 2022-05-17 | Dell Products L.P. | Power management of voltage regulators in an information handling system |
US11275663B2 (en) * | 2020-06-08 | 2022-03-15 | Intel Corporation | Fast dynamic capacitance, frequency, and/or voltage throttling apparatus and method |
US11334103B2 (en) * | 2020-08-18 | 2022-05-17 | Google Llc | Programmable system TDP with ASIC power capping |
US11822414B2 (en) | 2021-02-08 | 2023-11-21 | Microsoft Technology Licensing, Llc | Processor-based system employing configurable local frequency throttling management to manage power demand and consumption, and related methods |
US11327552B1 (en) * | 2021-02-17 | 2022-05-10 | Microsoft Licensing Technology, LLC | Processor-based system employing local dynamic power management based on controlling performance and operating power consumption, and related methods |
WO2023287576A1 (en) * | 2021-07-13 | 2023-01-19 | SiFive, Inc. | Selectable and hierarchical power management |
CN113505095B (zh) * | 2021-07-30 | 2023-03-21 | 上海壁仞智能科技有限公司 | 多核异相处理的系统级芯片和集成电路 |
US20230176645A1 (en) * | 2021-12-06 | 2023-06-08 | Mediatek Inc. | Maximum current suppression for power management in a multi-core system |
US20240094796A1 (en) * | 2022-06-10 | 2024-03-21 | Nvidia Corporation | Techniques to modify processor performance |
Citations (3)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US20070198863A1 (en) | 2006-02-17 | 2007-08-23 | Pradip Bose | Method and system for controlling power in a chip through a power-performance monitor and control unit |
US20120166854A1 (en) | 2011-11-30 | 2012-06-28 | Efraim Rotem | Controlling Current Transients In A Processor |
JP2014157601A (ja) | 2013-02-15 | 2014-08-28 | Intel Corp | プロセッサの最大動作電圧を動的に制御する方法 |
Family Cites Families (5)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US7017060B2 (en) | 2001-03-19 | 2006-03-21 | Intel Corporation | Power management system that changes processor level if processor utilization crosses threshold over a period that is different for switching up or down |
US7426648B2 (en) | 2004-09-30 | 2008-09-16 | Intel Corporation | Global and pseudo power state management for multiple processing elements |
US8601288B2 (en) * | 2010-08-31 | 2013-12-03 | Sonics, Inc. | Intelligent power controller |
US9152210B2 (en) * | 2013-02-15 | 2015-10-06 | Apple Inc. | Method and apparatus for determining tunable parameters to use in power and performance management |
US9832028B2 (en) * | 2014-09-25 | 2017-11-28 | Texas Instruments Incorporated | Automatic power budget management for power-over-Ethernet apparatus |
-
2018
- 2018-05-01 US US17/042,804 patent/US11543878B2/en active Active
- 2018-05-01 CN CN201880091711.0A patent/CN111971641A/zh active Pending
- 2018-05-01 JP JP2020551527A patent/JP7214746B2/ja active Active
- 2018-05-01 WO PCT/US2018/030517 patent/WO2019212541A1/en active Application Filing
- 2018-05-01 DE DE112018007545.1T patent/DE112018007545T5/de active Pending
Patent Citations (3)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US20070198863A1 (en) | 2006-02-17 | 2007-08-23 | Pradip Bose | Method and system for controlling power in a chip through a power-performance monitor and control unit |
US20120166854A1 (en) | 2011-11-30 | 2012-06-28 | Efraim Rotem | Controlling Current Transients In A Processor |
JP2014157601A (ja) | 2013-02-15 | 2014-08-28 | Intel Corp | プロセッサの最大動作電圧を動的に制御する方法 |
Also Published As
Publication number | Publication date |
---|---|
DE112018007545T5 (de) | 2021-01-21 |
CN111971641A (zh) | 2020-11-20 |
WO2019212541A1 (en) | 2019-11-07 |
US20210018971A1 (en) | 2021-01-21 |
JP2021531526A (ja) | 2021-11-18 |
US11543878B2 (en) | 2023-01-03 |
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A977 | Report on retrieval |
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A131 | Notification of reasons for refusal |
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