JP6917370B2 - Rfスイッチの脚とアンカーにおける電流取り扱い - Google Patents
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Description
内部に複数の電極が形成された基板を備え、上記複数の電極は、少なくともアンカー電極と、プルダウン電極と、RF電極とを含み、
上記基板及び上記プルダウン電極の上に配置された絶縁層と、
上記RF電極から第1の距離だけ離れるとともに、上記RF電極から上記第1の距離とは異なる第2の距離だけ離れた位置から移動可能なスイッチング素子とを備え、
このスイッチング素子は、
底層、
頂層、および
上記底層を上記頂層に接続する複数のビアを有し、
上記スイッチング素子は、第1のアンカー部分、第1の脚部分、およびブリッジ部分を含み、上記複数のビアは、上記アンカー部分および上記ブリッジ部分内に配置され、上記アンカー部分は上記アンカー電極に結合されている。
内部に複数の電極が形成された基板を備え、上記複数の電極は、少なくともアンカー電極と、プルダウン電極と、RF電極とを含み、
上記アンカー電極の上に配置されたアンカーコンタクトと、
上記基板及び上記プルダウン電極の上に配置された絶縁層と、
上記RF電極から第1の距離だけ離れるとともに、上記RF電極から上記第1の距離とは異なる第2の距離だけ離れた位置から移動可能なスイッチング素子とを備え、
このスイッチング素子は、
底層、
頂層、および
上記底層を上記頂層に接続する複数のビアを有し、上記スイッチング素子はキャビティ内に封じられ、
上記底層、頂層およびアンカーコンタクトと接触しているキャビティ側壁を備え、このキャビティ側壁は、上記底層、頂層およびアンカーコンタクトに電気的に結合されている。
内部に複数の電極が形成された基板を備え、上記複数の電極は、少なくともアンカー電極と、プルダウン電極と、RF電極とを含み、
上記アンカー電極の上に配置されたアンカーコンタクトと、
上記基板及び上記プルダウン電極の上に配置された絶縁層と、
上記RF電極から第1の距離だけ離れるとともに、上記RF電極から上記第1の距離とは異なる第2の距離だけ離れた位置から移動可能なスイッチング素子とを備え、
このスイッチング素子は、
底層、
頂層、および
上記底層を上記頂層に接続する複数のビアを有し、
上記スイッチング素子は、第1のアンカー部分、第1の脚部分、およびブリッジ部分を含み、上記複数のビアは、上記アンカー部分および上記ブリッジ部分内に配置され、上記アンカー部分は上記アンカー電極に結合されており、
上記底層、頂層およびアンカーコンタクトと接触しているキャビティ側壁を備え、このキャビティ側壁は、上記底層、頂層およびアンカーコンタクトに電気的に結合されている。
Claims (20)
- MEMSデバイスであって、
内部に複数の電極が形成された基板を備え、上記複数の電極は、少なくとも第1のアンカー電極と、プルダウン電極と、RF電極とを含み、
上記基板及び上記プルダウン電極の上に配置された絶縁層と、
上記RF電極から第1の距離だけ離れるとともに、上記RF電極から上記第1の距離とは異なる第2の距離だけ離れた位置から移動可能なスイッチング素子とを備え、
このスイッチング素子は、
底層、
頂層、および
上記底層を上記頂層に接続する複数の第1のビアを有し、
上記スイッチング素子は、第1のアンカー部分、第1の脚部分、およびブリッジ部分を含み、上記複数の第1のビアは、上記第1のアンカー部分および上記ブリッジ部分内に配置され、上記第1のアンカー部分は上記第1のアンカー電極に結合されており、
上記第1のアンカー電極と上記スイッチング素子との間に配置されたアンカーコンタクトを備え、上記スイッチング素子は、上記底層を上記アンカーコンタクトに接続する少なくとも1つの第2のビアによって形成される第1の電流経路、および上記スイッチング素子の側面に配置された導電層によって形成される第2の電流経路によって上記アンカーコンタクトに電気的に結合されている、MEMSデバイス。 - 請求項1に記載のMEMSデバイスにおいて、
上記第1のアンカー部分は、上記底層の一部、上記頂層の一部、および上記底層を上記頂層に接続する少なくとも1つの第1のビアを含む、MEMSデバイス。 - 請求項2に記載のMEMSデバイスにおいて、
上記アンカーコンタクトは、上記第1のアンカー電極と上記少なくとも1つの第2のビアとの間に配置されている、MEMSデバイス。 - 請求項3に記載のMEMSデバイスにおいて、さらに、
上記頂層の頂面に結合された誘電体層を備えた、MEMSデバイス。 - 請求項4に記載のMEMSデバイスにおいて、
上記第1のアンカー電極、上記アンカーコンタクト、上記少なくとも1つの第2のビア、上記底層、上記少なくとも1つの第1のビア、および上記頂層は、断面視ですべて鉛直方向に並んでいる、MEMSデバイス。 - 請求項5に記載のMEMSデバイスにおいて、
上記複数の電極は、上記第1のアンカー電極から上記スイッチング素子の反対側の端部に配置された第2のアンカー電極を含む、MEMSデバイス。 - 請求項6に記載のMEMSデバイスにおいて、
上記スイッチング素子は第2のアンカー部分を含み、
上記第2のアンカー部分は、上記底層の一部、上記頂層の一部、上記底層を上記頂層に接続する少なくとも1つの第1のビア、および、上記底層を上記第2のアンカー電極に接続する少なくとも1つの第2のビアを含む、MEMSデバイス。 - MEMSデバイスであって、
内部に複数の電極が形成された基板を備え、上記複数の電極は、少なくとも第1のアンカー電極と、プルダウン電極と、RF電極とを含み、
上記第1のアンカー電極の上に配置されたアンカーコンタクトと、
上記基板及び上記プルダウン電極の上に配置された絶縁層と、
上記RF電極から第1の距離だけ離れるとともに、上記RF電極から上記第1の距離とは異なる第2の距離だけ離れた位置から移動可能なスイッチング素子とを備え、
このスイッチング素子は、
底層、
頂層、および
上記底層を上記頂層に接続する複数のビアを有し、上記スイッチング素子はキャビティ内に封じられ、
上記底層、頂層およびアンカーコンタクトと接触しているキャビティ側壁を備え、このキャビティ側壁は、上記底層、頂層およびアンカーコンタクトに電気的に結合されており、上記スイッチング素子は、2つの別個の電流経路によって上記アンカーコンタクトに電気的に結合されている、MEMSデバイス。 - 請求項8に記載のMEMSデバイスにおいて、
上記複数の電極は、上記第1のアンカー電極から上記スイッチング素子の反対側の端部に配置された第2のアンカー電極を含む、MEMSデバイス。 - 請求項9に記載のMEMSデバイスにおいて、
上記第2のアンカー電極上に第2のアンカーコンタクトが配置され、
上記キャビティ側壁は、上記底層、頂層および第2のアンカーコンタクトと接触している、MEMSデバイス。 - 請求項10に記載のMEMSデバイスにおいて、さらに、
上記底層を上記アンカーコンタクトに接続するビアを備えた、MEMSデバイス。 - MEMSデバイスであって、
内部に複数の電極が形成された基板を備え、上記複数の電極は、少なくとも第1のアンカー電極と、プルダウン電極と、RF電極とを含み、
上記第1のアンカー電極の上に配置されたアンカーコンタクトと、
上記基板及び上記プルダウン電極の上に配置された絶縁層と、
上記RF電極から第1の距離だけ離れるとともに、上記RF電極から上記第1の距離とは異なる第2の距離だけ離れた位置から移動可能なスイッチング素子とを備え、
このスイッチング素子は、
底層、
頂層、および
上記底層を上記頂層に接続する複数のビアを有し、
上記スイッチング素子は、第1のアンカー部分、第1の脚部分、およびブリッジ部分を含み、上記複数のビアは、上記第1のアンカー部分および上記ブリッジ部分内に配置され、上記第1のアンカー部分は上記第1のアンカー電極に結合されており、
上記底層、頂層およびアンカーコンタクトと接触しているキャビティ側壁を備え、このキャビティ側壁は、上記底層、頂層およびアンカーコンタクトに電気的に結合されており、上記スイッチング素子は、2つの別個の電流経路によって上記アンカーコンタクトに電気的に結合されている、MEMSデバイス。 - 請求項12に記載のMEMSデバイスにおいて、
上記第1のアンカー部分は、上記底層の一部、上記頂層の一部、上記底層を上記頂層に接続する少なくとも1つの第1のビア、および、上記底層を上記第1のアンカー電極に接続する少なくとも1つの第2のビアを含む、MEMSデバイス。 - 請求項13に記載のMEMSデバイスにおいて、さらに、
上記第1のアンカー電極と上記少なくとも1つの第2のビアとの間に配置されたアンカーコンタクトを備えた、MEMSデバイス。 - 請求項14に記載のMEMSデバイスにおいて、さらに、
上記頂層の頂面に結合された誘電体層を備えた、MEMSデバイス。 - 請求項15に記載のMEMSデバイスにおいて、
上記第1のアンカー電極、上記アンカーコンタクト、上記少なくとも1つの第2のビア、上記底層、上記少なくとも1つの第1のビア、および上記頂層は、断面視ですべて鉛直方向に並んでいる、MEMSデバイス。 - 請求項16に記載のMEMSデバイスにおいて、
上記複数の電極は、上記第1のアンカー電極から上記スイッチング素子の反対側の端部に配置された第2のアンカー電極を含む、MEMSデバイス。 - 請求項17に記載のMEMSデバイスにおいて、
上記スイッチング素子は第2のアンカー部分を含み、
上記第2のアンカー部分は、上記底層の一部、上記頂層の一部、上記底層を上記頂層に接続する少なくとも1つの第1のビア、および、上記底層を上記第2のアンカー電極に接続する少なくとも1つの第2のビアを含む、MEMSデバイス。 - 請求項12に記載のMEMSデバイスにおいて、
上記複数の電極は第2のアンカー電極を含む、MEMSデバイス。 - 請求項19に記載のMEMSデバイスにおいて、
上記第2のアンカー電極上に第2のアンカーコンタクトが配置され、
上記キャビティ側壁は、上記底層、頂層および第2のアンカーコンタクトと接触している、MEMSデバイス。
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