JP6911574B2 - シリコン光電荷分離素子 - Google Patents
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Claims (10)
- 第1のpn接合部、第2のpn接合部、第3のpn接合部及び第4のpn接合部を光入射面側から順に膜厚が厚くなるように積層され、
設置場所の春分の日及び秋分の日における日照時間内の8時間以上において前記第1のpn接合部、前記第2のpn接合部、前記第3のpn接合部及び前記第4のpn接合部において太陽光の入射に伴って発生する電流密度の一致度が80%以上であるように前記第1のpn接合部、前記第2のpn接合部、前記第3のpn接合部及び前記第4のpn接合部の膜厚が設定されていることを特徴とする結晶性シリコン光電荷分離素子。 - 請求項1に記載の結晶性シリコン光電荷分離素子であって、
設置場所の春分の日及び秋分の日の正午に太陽光スペクトルが垂直に入射する場合において前記第1のpn接合部、前記第2のpn接合部、前記第3のpn接合部及び前記第4のpn接合部の光電流密度が一致する最適膜厚に対して、
前記第1のpn接合部は、70%以上160%以下の膜厚とし、
前記第2のpn接合部は、70%以上150%以下の膜厚とし、
前記第3のpn接合部は、70%以上150%以下の膜厚とし、
前記第4のpn接合部は、30%以上の膜厚とすることを特徴とする結晶性シリコン光電荷分離素子。 - 請求項2に記載の結晶性シリコン光電荷分離素子であって、
設置場所の春分の日及び秋分の日の正午における太陽光スペクトルがAM1.5である場合、
前記第1のpn接合部の膜厚は、0.42μm以上1.02μm以下とし、
前記第2のpn接合部の膜厚は、1.65μm以上3.56μm以下とし、
前記第3のpn接合部の膜厚は、5.73μm以上14.8μm以下とし、
前記第4のpn接合部の膜厚は、60μm以上とすることを特徴とする結晶性シリコン光電荷分離素子。 - 請求項2に記載の結晶性シリコン光電荷分離素子であって、
設置場所の春分の日及び秋分の日の正午における太陽光スペクトルがAM1.2である場合、
前記第1のpn接合部の膜厚は、0.44μm以上1.02μm以下とし、
前記第2のpn接合部の膜厚は、1.58μm以上3.38μm以下とし、
前記第3のpn接合部の膜厚は、6.44μm以上13.8μm以下とし、
前記第4のpn接合部の膜厚は、60μm以上とすることを特徴とする結晶性シリコン光電荷分離素子。 - 請求項2に記載の結晶性シリコン光電荷分離素子であって、
設置場所の春分の日及び秋分の日の正午における太陽光スペクトルがAM1.8である場合、
前記第1のpn接合部の膜厚は、0.50μm以上1.14μm以下とし、
前記第2のpn接合部の膜厚は、1.70μm以上3.66μm以下とし、
前記第3のpn接合部の膜厚は、6.81μm以上14.6μm以下とし、
前記第4のpn接合部の膜厚は、60μm以上とすることを特徴とする結晶性シリコン光電荷分離素子。 - 請求項1〜5のいずれか1項に記載の結晶性シリコン光電荷分離素子であって、
前記膜厚は、前記第1のpn接合部、前記第2のpn接合部、前記第3のpn接合部及び前記第4のpn接合部での結晶性シリコン層の膜厚であることを特徴とする結晶性シリコン光電荷分離素子。 - 請求項1〜6のいずれか1項に記載の結晶性シリコン光電荷分離素子の一方の面に酸化触媒を担持させ、他方の面に還元触媒を担持させた光触媒体。
- 請求項1〜6のいずれか1項に記載の結晶性シリコン光電荷分離素子の製造方法であって、
第1の導電型のシリコンウェハの裏面に第1の導電型のドーパントがドープされた第1導電型高濃度層を設け、前記シリコンウェハの表面に第2の導電型のドーパントがドープされた第2導電型高濃度層を設けて前記第4のpn接合部を形成する第1の工程と、
前記第4のpn接合部上に、第1の導電型のドーパントがドープされた第1導電型高濃度層、第1の導電型のドーパントが当該第1導電型高濃度層よりも低い濃度でドープされた第1導電型低濃度層、及び、第2の導電型のドーパントがドープされた第2導電型高濃度層を積層して前記第3のpn接合部を形成する第2の工程と、
前記第3のpn接合部上に、第1の導電型のドーパントがドープされた第1導電型高濃度層、第1の導電型のドーパントが当該第1導電型高濃度層よりも低い濃度でドープされた第1導電型低濃度層、及び、第2の導電型のドーパントがドープされた第2導電型高濃度層を積層して前記第2のpn接合部を形成する第3の工程と、
前記第2のpn接合部上に、第1の導電型のドーパントがドープされた第1導電型高濃度層、第1の導電型のドーパントが当該第1導電型高濃度層よりも低い濃度でドープされた第1導電型低濃度層、及び、第2の導電型のドーパントがドープされた第2導電型高濃度層を積層して前記第1のpn接合部を形成する第4の工程と、
を備えることを特徴とする結晶性シリコン光電荷分離素子の製造方法。 - 請求項1〜6のいずれか1項に記載の結晶性シリコン光電荷分離素子の製造方法であって、
前記第4のpn接合部上に、エピタキシャル−リフトオフ技術を用いて作製された前記第3のpn接合部、前記第2のpn接合部及び前記第1のpn接合部を順に貼り付ける工程を備えることを特徴とする結晶性シリコン光電荷分離素子の製造方法。 - 請求項1〜6のいずれか1項に記載の結晶性シリコン光電荷分離素子の製造方法であって、
支持基板上に、エピタキシャル−リフトオフ技術を用いて作製された前記第4のpn接合部、前記第3のpn接合部、前記第2のpn接合部及び前記第1のpn接合部を順に貼り付ける工程を備えることを特徴とする結晶性シリコン光電荷分離素子の製造方法。
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