JP6897574B2 - アクセラレータ制御装置、アクセラレータ制御方法およびプログラム - Google Patents
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Description
本発明は、日本国特許出願:特願2016−015352号(2016年1月29日出願)の優先権主張に基づくものであり、同出願の全記載内容は引用をもって本書に組み込み記載されているものとする。
本発明はアクセラレータ制御装置、アクセラレータ制御方法およびプログラムに関し、特にアクセラレータを用いた計算を制御するアクセラレータ制御装置、アクセラレータ制御方法およびプログラムに関する。
処理性能:100ギガフロップ(CPU:Central Processing Unit) ⇒ 1テラフロップ(GPU)
メモリ容量:1テラバイト(CPU) ⇒ 10ギガバイト(GPU)
次に、第1の実施形態に係るアクセラレータ制御装置について、図面を参照して詳細に説明する。
図8は、本実施形態に係るアクセラレータ制御装置1の構成を例示するブロック図である。図8を参照すると、アクセラレータ制御装置1は、アクセラレータ51〜53、メインメモリ4、アクセラレータ制御部3、ユーザプログラム21、および、DAG(Directed Acyclic Graph)作成部22を備えている。アクセラレータ制御装置1は、一例として、ホストコンピュータによって実現される。なお、ユーザプログラム21は、アクセラレータ制御装置1の外部の構成としてもよい。
(1)I/O待ち
サブタスクの入力データパーティションの準備および出力データパーティションのメモリ確保を、サブタスクを実行するアクセラレータのメモリに対して行うことを待っている状態(例えば図4のI/O前の状態)
(2)実行待ち
入力データパーティションの準備および出力データパーティションのメモリ確保が完了し、アクセラレータでサブタスクが実行されるのを待っている状態(例えば図4のI/Oが完了してFIFOに蓄積された状態)
(3)実行中
サブタスクがアクセラレータ上のプロセッサで実行中の状態(例えば図4のProcessingの状態)
(4)実行完了
サブタスクの実行が完了した状態(例えば図4のProcessingが完了した状態)
次に、本実施形態の動作について、図8、図13および図17を参照して詳細に説明する。図17は、本実施形態に係るアクセラレータ制御装置1の動作を例示するフロー図である。
「アクセラレータにロードする入力データ量」+「アクセラレータからスワップアウトされるデータ量」
から算出する。
「上式第1項としてロードされる入力データ量」+「出力領域としてアクセラレータメモリ上に確保すべき領域のサイズ」−「ロード先のアクセラレータメモリのしきい値までの空き容量」
から算出する(ステップE3)。一例として、しきい値までの空きメモリ容量を1GBとし、新たにアクセラレータにロードする入力データを500MBとし、確保する出力領域を1GBとした場合、上式第2項の「アクセラレータからスワップアウトされるデータ」量は、
500MB(ロードする入力データ) + 1GB(確保する出力領域) - 1GB(空き領域) = 500MB
となる。
次に、第2の実施形態に係るアクセラレータ制御装置について説明する。本実施形態のアクセラレータ制御装置は、第1の実施形態のアクセラレータ制御装置1(図8〜図21)と同様の構成を有し、同様の動作を行うことから、差分についてのみ説明する。
次に、第3の実施形態について説明する。本実施形態では、CPU(Central Processing Unit)とメモリを備えたコンピュータに対して、第1、第2の実施形態に係るアクセラレータ制御装置1の動作を行わせる。特に、CPUに対して、ユーザプログラム21、DAG(Directed Acyclic Graph)作成部22、プログラム解析部31、タスクスケジューラ321、タスク実行部322、データスケジューラ331、および、データ移動部332の機能を行わせる。一方、コンピュータのメモリを、データ管理テーブル34、メモリ管理テーブル35、サブタスク記憶部36、および、メインメモリ4として使用する。ここで、メモリとは、広義の記憶手段であり、半導体メモリおよび一般に二次記憶と呼ばれるハードディスクやフラッシュディスクを含む。また、アクセラレータはコンピュータのI/O(Input/Output)スロットに挿入する。あるいは、I/Oデバイス用のインターコネクションを用いてアクセラレータとコンピュータを接続することも可能である。
3 アクセラレータ制御部
4 メインメモリ
8 情報処理装置
11 タスク記憶部
12 データスケジューラ
13 タスクスケジューラ
14 第1の記憶部
15 第2の記憶部
21 ユーザプログラム
22 DAG作成部
31 プログラム解析部
32 タスク処理部
33 データ管理部
34 データ管理テーブル
35 メモリ管理テーブル
36 サブタスク記憶部
51〜53 アクセラレータ
61〜66 データ
61−1〜61−4、62−1〜62−4、63−1〜63−4 データパーティション
71〜74 タスク
71−1〜71−4、72−1〜72−4 サブタスク
81 共有メモリ
321 タスクスケジューラ
322 タスク実行部
331 データスケジューラ
332 データ移動部
334 先読み判定部
336 次回サブタスク判定部
361 実行不可能サブタスク記憶部
362 実行可能サブタスク記憶部
363 アクセラレータ実行可能サブタスク記憶部
511〜513 プロセッサ
521〜523 アクセラレータメモリ
821〜823 アクセラレータ
Claims (15)
- 実行可能なタスクを保持するタスク記憶部と、
メモリを有するアクセラレータ上で実行するときの前記メモリへの入出力データ量が相対的に少ないタスクを、前記実行可能なタスクの中から選択し、選択したタスクに対する前記メモリにおけるデータ入出力の準備を前記アクセラレータに指示するデータスケジューラと、
前記選択されたタスクを実行するように前記アクセラレータに指示し、前記選択されたタスクの完了により実行可能となるタスクを前記タスク記憶部に追加するタスクスケジューラと、を備え、
前記データスケジューラは、前記メモリの使用状況に応じて、前記タスク記憶部が保持する実行可能なタスクの中から次のタスクの選択と、選択した次のタスクに対するデータ入出力の準備を継続する、
ことを特徴とするアクセラレータ制御装置。 - 前記データスケジューラは、前記アクセラレータ上で実行するときに前記メモリへロードすべき入力データ量と、前記メモリから外部のメモリに退避すべき出力データ量の和が相対的に少ないタスクを、前記タスク記憶部が保持するタスクの中から選択する、
請求項1に記載のアクセラレータ制御装置。 - 前記データスケジューラは、前記メモリの使用量が所定のしきい値未満の場合、次のタスクの選択と、選択した次のタスクに対するデータ入出力の準備を継続する、
請求項1または2に記載のアクセラレータ制御装置。 - 前記タスク記憶部は、
実行可能なタスクであって実行先のアクセラレータが制限されないタスクを保持する第1の記憶部と、
実行先のアクセラレータが制限されたタスクを保持する第2の記憶部と、を有し、
前記データスケジューラは、アクセラレータ上で実行するときのメモリへの入出力データ量が相対的に少ないタスクを、前記第2の記憶部が保持するタスクであって実行先が該アクセラレータに制限されたタスク、および、前記第1の記憶部が保持するタスクの中から選択する、
請求項1ないし3のいずれか1項に記載のアクセラレータ制御装置。 - 前記第1の記憶部は、最上流のタスク、または、上流のすべてのタスクの実行が完了したタスクを保持し、
前記第2の記憶部は、実行先のアクセラレータが制限されたタスクとして、上流のタスクの少なくとも1つが該アクセラレータで実行待ちであり、かつ、上流の残りのすべてのタスクの実行が完了したタスクを保持する、
請求項4に記載のアクセラレータ制御装置。 - 前記タスクスケジューラは、前記選択されたタスクの実行が完了した場合、前記第1および/または第2の記憶部が保持するタスクを更新する、
請求項5に記載のアクセラレータ制御装置。 - 前記データスケジューラまたは前記タスクスケジューラは、前記選択されたタスクに対するデータ入出力の準備が完了した場合、第2の記憶部が保持するタスクを更新する、
請求項5または6に記載のアクセラレータ制御装置。 - メモリと、アクセラレータと、を備えるアクセラレータ制御装置を制御する方法であり、
実行可能なタスクを記憶部に保持するステップと、
メモリを有するアクセラレータ上で実行するときの前記メモリへの入出力データ量が相対的に少ないタスクを、前記実行可能なタスクの中から選択し、選択したタスクに対する前記メモリにおけるデータ入出力の準備を前記アクセラレータに指示するステップと、
前記選択されたタスクを実行するように前記アクセラレータに指示し、前記選択されたタスクの完了により実行可能となるタスクを前記記憶部に追加するステップと、
前記メモリの使用状況に応じて、前記記憶部が保持する実行可能なタスクの中から次のタスクの選択と、選択した次のタスクに対するデータ入出力の準備を継続するステップと、を含む、
ことを特徴とするアクセラレータ制御方法。 - 前記アクセラレータ上で実行するときに前記メモリへロードすべき入力データ量と、前記メモリから外部のメモリに退避すべき出力データ量の和が相対的に少ないタスクを、前記記憶部が保持するタスクの中から選択する、
請求項8に記載のアクセラレータ制御方法。 - 前記メモリの使用量が所定のしきい値未満の場合、次のタスクの選択と、選択した次のタスクに対するデータ入出力の準備を継続する、
請求項8または9に記載のアクセラレータ制御方法。 - 実行可能なタスクであって実行先のアクセラレータが制限されない第1のタスクを前記記憶部に保持するステップと、
実行先のアクセラレータが制限された第2のタスクを前記記憶部に保持するステップと、を含み、
アクセラレータ上で実行するときのメモリへの入出力データ量が相対的に少ないタスクは、前記第2のタスクであって実行先が該アクセラレータに制限されたタスク、および、前記第1のタスクの中から選択される、
請求項8ないし10のいずれか1項に記載のアクセラレータ制御方法。 - 前記第1のタスクは、最上流のタスク、または、上流のすべてのタスクの実行が完了したタスクであり、
前記第2のタスクは、実行先のアクセラレータが制限されたタスクであって、上流のタスクの少なくとも1つが該アクセラレータで実行待ちであり、かつ、上流の残りのすべてのタスクの実行が完了したタスクである、
請求項11に記載のアクセラレータ制御方法。 - 前記記憶部が保持する前記第1および/または第2のタスクは、前記選択されたタスクの実行が完了した場合に更新される、
請求項12に記載のアクセラレータ制御方法。 - 前記記憶部が保持する前記第2のタスクは、前記選択されたタスクに対するデータ入出力の準備が完了した場合に更新される、
請求項11または12に記載のアクセラレータ制御方法。 - 実行可能なタスクを記憶部に保持する処理と、
メモリを有するアクセラレータ上で実行するときの前記メモリへの入出力データ量が相対的に少ないタスクを、前記実行可能なタスクの中から選択し、選択したタスクに対する前記メモリにおけるデータ入出力の準備を前記アクセラレータに指示する処理と、
前記選択されたタスクを実行するように前記アクセラレータに指示し、前記選択されたタスクの完了により実行可能となるタスクを前記記憶部に追加する処理と、
前記メモリの使用状況に応じて、前記記憶部が保持する実行可能なタスクの中から次のタスクの選択と、選択した次のタスクに対するデータ入出力の準備を継続する処理と、をコンピュータに実行させる、
ことを特徴とするプログラム。
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