JP6148129B2 - 情報処理装置、ファームウェア更新方法およびファームウェア更新プログラム - Google Patents

情報処理装置、ファームウェア更新方法およびファームウェア更新プログラム Download PDF

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本発明は、情報処理装置、ファームウェア更新方法およびファームウェア更新プログラムに関し、特に、情報処理装置に設けられた中央処理装置の負荷状況によりファームウェアを更新するか否かを判断する情報処理装置、ファームウェア更新方法およびファームウェア更新プログラムに関する。
コンピュータ等の情報処理装置は、一般的に、中央処理装置(以下、「CPU」と言う。)と、各種の電子回路と、該情報処理装置の基本的動作を制御したり、各種の該電子回路等の動作状況を監視したり、こうして監視した動作状況を記憶装置に記録したりするファームウェアとを備えている。
係るファームウェアに何らかの不具合が発見された場合には、当該ファームウェアを、係る不具合を修正した新しいファームウェアに更新する必要があり、そして、この更新は情報処理装置の通常の運用中に行なわれる場合がある。
なお、ファームウェアの更新に関する関連技術として、特許文献1および特許文献2には、複数のOSを複数のパーティションで動作させるようなシステムにおいて、他のパーティションの運用に影響を与えることなく、パーティション単位のファームウェアの更新を行うための技術が記載されている。
また、特許文献3には、計算機サーバシステムのファームウェアを更新するために必要なシステム停止時間を最小限に抑えるための技術が記載されている。
さらに、ファームウェアの更新とは直接関連しないが、特許文献4には、あるラックに搭載されている複数のCPUブレード装置上のBMCのいずれか1つを、当該ラック全体の消費電力制御部に設定し、各該ブレード装置のCPU負荷情報に基づいて、電力供給制御を自動的に行うことができる技術が記載されている。
特開2006−146709号広報 特開2011−145910号広報 特開2006−260058号広報 特開2012−173926号広報
しかしながら、上述したように、ファームウェアの更新を情報処理装置の通常の運用中に行う場合、情報処理装置が行っている通常の業務処理を一旦中断して更新を行うが、CPUの負荷が高くなる業務処理を行っている時に更新を実行すると、当該業務処理の遂行に多大な影響を与えることになってしまうという問題点がある。
なお、特許文献1乃至4には、CPUの負荷状況とファームウェアの更新の時期との関係については何ら記載されていない。
本発明の目的は、上述の問題点を解決した情報処理装置を提供することにある。
本発明の情報処理装置は、
中央処理装置と、
各種の電子回路からなる電子回路群と、
前記中央処理装置および前記電子回路群の基本的動作を制御するファームウェアを記憶したファームウェア記憶手段と、
ファームウェア更新手段と
を備え、
前記ファームウェアの更新の指示に応答して、前記ファームウェア更新手段は、
前記中央処理装置の負荷状況を示すCPU負荷値を計測し、該CPU負荷値が予め定めたCPU負荷閾値未満になった場合に、前記中央処理装置で実行されているオペレーティングシステムプログラムおよびアプリケーションプログラムの実行を一時的に停止させ、前記ファームウェア記憶手段に記憶された前記ファームウェアを更新用ファームウェアで書き換えた後、前記オペレーティングシステムプログラムおよび前記アプリケーションプログラムの実行を再開させる。
本発明のファームウェア更新方法は、
ファームウェアの更新の指示を受け取る更新指示受取ステップと、
前記更新の指示に応答して、中央処理装置の負荷状況を示すCPU負荷値を計測し、該CPU負荷値が予め定めたCPU負荷閾値未満になった場合に、前記中央処理装置で実行されているオペレーティングシステムプログラムおよびアプリケーションプログラムの実行を一時的に停止させ、ファームウェア記憶手段に記憶され、少なくとも前記中央処理装置の基本動作を制御するファームウェアを更新用ファームウェアで書き換えた後、前記オペレーティングシステムプログラムおよび前記アプリケーションプログラムの実行を再開させる更新ステップと
を含む。
本発明のファームウェア更新プログラムは、
中央処理装置と、各種の電子回路からなる電子回路群と、中央処理装置および電子回路群の基本的動作を制御するファームウェアを記憶したファームウェア記憶手段とを含むコンピュータに、
前記ファームウェアの更新の指示に応答して、前記中央処理装置の負荷状況を示すCPU負荷値を計測し、該CPU負荷値が予め定めたCPU負荷閾値未満になった場合に、前記中央処理装置で実行されているオペレーティングシステムプログラムおよびアプリケーションプログラムの実行を一時的に停止させ、前記ファームウェア記憶手段に記憶されたファームウェアを更新用ファームウェアで書き換えた後、前記オペレーティングシステムプログラムおよび前記アプリケーションプログラムの実行を再開させる更新処理
を実行させる。
本発明には、ファームウェアの更新を情報処理装置の通常の運用中に行う場合、アプリケーションプログラムの処理への影響をできるだけ少なくすることができるという効果がある。
図1は、本発明の実施形態を示すブロック図である。 図2は、本発明の実施形態におけるファームウェア更新手段14の動作を示すフローチャートである。
次に、本発明の実施形態について図面を参照して詳細に説明する。
図1は本発明の実施形態を示すブロック図である。
図1を参照すると、本実施形態は、情報処理装置10と、外部記憶装置20とから構成される。
情報処理装置10は、CPU15と、各種の電子回路からなる電子回路群11と、ファームウェア16を記憶した不揮発性メモリからなるファームウェア記憶手段12と、CPU15で実行されるオペレーティングシステムプログラム(以下、「OS」と言う。)および複数のアプリケーションプログラム並びに種々のデータを記憶した記憶手段13と、ファームウェア更新手段14とを備える。
ファームウェア更新手段14は、CPU15と、ファームウェア記憶手段12と、外部記憶装置20とに接続される。このファームウェア更新手段14は、専用のハードウェアで実現しても良いし、CPU15等で実行されるプログラムで実現しても良い。
ファームウェア16は、情報処理装置10の基本的動作を制御したり、電子回路群11の動作状況を監視したり、こうして監視した動作状況を記憶手段13に記録したりするある種のプログラムである。
外部記憶装置20は、更新用ファームウェア21を記憶している。
次に、本実施形態の動作について詳細に説明する。
図2は、ファームウェア更新手段14の動作を示すフローチャートである。
今、ファームウェア16に不具合が予め発見され、その不具合を修正した更新用ファームウェア21が作成され、外部記憶装置20に予め記憶されているものとする。
図2を参照すると、ファームウェア更新手段14は、情報処理装置10が各種のアプリケーションプログラムを実行中に、利用者から入力装置(図示せず)を介してファームウェアの更新の指示を受け取ると、まず、CPUの負荷状況を示すCPU負荷値の計測を実行する(ステップS10)。CPU負荷値は、例えば、CPUの使用率、一定時間毎のCPU使用率の平均値または実行中のプログラムの数等である。
次に、ファームウェア更新手段14は、ステップS10で計測したCPU負荷値が所定のCPU負荷閾値以上であるか否かを判断する(ステップS11)。
ステップS11において、CPU負荷値が所定のCPU負荷閾値以上である場合は(ステップS11で「YES」の場合)、ファームウェア更新手段14は、新たに、CPU負荷値の計測を実行した後、ステップS11の処理を再度実行する。
一方、ステップS11において、CPU負荷値が所定のCPU負荷閾値未満である場合(ステップS11で「NO」の場合)、ファームウェア更新手段14は、OSおよびアプリケーションプログラムの実行を一時的に停止させる(ステップS12)。
次に、ファームウェア更新手段14は、外部記憶装置20から更新用ファームウェア21を取得し、ファームウェア記憶手段12に格納されているファームウェア16を、更新用ファームウェア21で書き換える(ステップS13)。
その後、ファームウェア更新手段14は、ステップS12で一時的に実行を停止させたOSおよびアプリケーションプログラムの実行を再開させ、ファームウェア更新処理を終了する(ステップS14)。
なお、ステップS12でOSおよびアプリケーションプログラムの実行の一時的な停止は、例えば、使用するCPU15がインテル(登録商標)社製のCPUであるならば、「システム管理モード(SMM:System Management Mode)」を使用して実現できる。
システム管理モードはCPUの動作モードの一つであり、CPUは、「システム管理割り込み(SMI:System Management Interrupt)」と呼ばれる最高の優先度を持った割り込みを契機にこのモードに遷移する。
CPUは、上記システム管理割り込みを受信すると、OSやアプリケーションプログラムを実行するための制御情報等をSMRAM(System Management Random Access Memory)と呼ばれる専用のメモリ領域に退避し、OSやアプリケーションプログラムの実行を中止し、上記SMRAMに予め格納されているSMIハンドラと呼ばれるプログラムを実行する。
そして、SMIハンドラに含まれるrsm命令(Return from System Management instruction命令)によって、CPUは、システム管理モードに遷移する以前の状態に復帰する。
以上、説明したように、本実施形態では、ファームウェアの更新を情報処理装置の通常の運用中に行う場合、アプリケーションプログラムの処理への影響をできるだけ少なくすることができるという効果がある。
その理由は、ファームウェア更新手段14がCPU15の負荷状況を示すCPU負荷値を計測し、予めに設定した所定のCPU負荷閾値よりCPU負荷値が小さい場合のみ、アプリケーションプログラム等の実行を停止させ、ファームウェア記憶手段12に記憶されたファームウェア16を更新用ファームウェア21で書き換えるためである。
10 情報処理装置
11 電子回路群
12 ファームウェア記憶手段
13 記憶手段
14 ファームウェア更新手段
15 CPU
16 ファームウェア
20 外部記憶装置
21 更新用ファームウェア

Claims (7)

  1. 中央処理装置と、
    各種の電子回路からなる電子回路群と、
    前記中央処理装置および前記電子回路群の基本的動作を制御するファームウェアを記憶したファームウェア記憶手段と、
    ファームウェア更新手段と
    を備え、
    前記ファームウェアの更新の指示に応答して、前記ファームウェア更新手段は、
    前記中央処理装置の負荷状況を示すCPU負荷値を計測し、該CPU負荷値が予め定めたCPU負荷閾値未満になった場合に、前記中央処理装置で実行されているオペレーティングシステムプログラムおよびアプリケーションプログラムの実行を一時的に停止させ、前記ファームウェア記憶手段に記憶された前記ファームウェアを更新用ファームウェアで書き換えた後、前記オペレーティングシステムプログラムおよび前記アプリケーションプログラムの実行を再開させる
    ことを特徴とする情報処理装置。
  2. 前記更新用ファームウェアは外部に設けられた外部記憶装置に予め記憶されている
    ことを特徴とする請求項1記載の情報処理装置。
  3. 前記中央処理装置で実行される前記オペレーティングシステムプログラムおよび前記少なくとも一つのアプリケーションプログラム並びに種々のデータを記憶する記憶手段を備える
    ことを特徴とする請求項1または2記載の情報処理装置。
  4. ファームウェアの更新の指示を受け取る更新指示受取ステップと、
    前記更新の指示に応答して、中央処理装置の負荷状況を示すCPU負荷値を計測し、該CPU負荷値が予め定めたCPU負荷閾値未満になった場合に、前記中央処理装置で実行されているオペレーティングシステムプログラムおよびアプリケーションプログラムの実行を一時的に停止させ、ファームウェア記憶手段に記憶され、少なくとも前記中央処理装置の基本動作を制御するファームウェアを更新用ファームウェアで書き換えた後、前記オペレーティングシステムプログラムおよび前記アプリケーションプログラムの実行を再開させる更新ステップと
    を含むことを特徴とするファームウェア更新方法。
  5. 前記更新用ファームウェアは外部に設けられた外部記憶装置に予め記憶されている
    ことを特徴とする請求項4記載のファームウェア更新方法。
  6. 中央処理装置と、各種の電子回路からなる電子回路群と、中央処理装置および電子回路群の基本的動作を制御するファームウェアを記憶したファームウェア記憶手段とを含むコンピュータに、
    前記ファームウェアの更新の指示に応答して、前記中央処理装置の負荷状況を示すCPU負荷値を計測し、該CPU負荷値が予め定めたCPU負荷閾値未満になった場合に、前記中央処理装置で実行されているオペレーティングシステムプログラムおよびアプリケーションプログラムの実行を一時的に停止させ、前記ファームウェア記憶手段に記憶されたファームウェアを更新用ファームウェアで書き換えた後、前記オペレーティングシステムプログラムおよび前記アプリケーションプログラムの実行を再開させる更新処理
    を実行させることを特徴とするファームウェア更新プログラム。
  7. 前記更新用ファームウェアは外部に設けられた外部記憶装置に予め記憶されている
    ことを特徴とする請求項6記載のファームウェア更新プログラム。
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Families Citing this family (4)

* Cited by examiner, † Cited by third party
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WO2016166799A1 (ja) * 2015-04-13 2016-10-20 三菱電機株式会社 制御システム及びプログラマブルロジックコントローラ
JP6894266B2 (ja) * 2017-03-09 2021-06-30 Necプラットフォームズ株式会社 情報処理装置、管理制御装置のプログラム更新制御方法及びプログラム更新制御プログラム
JP6696927B2 (ja) * 2017-03-21 2020-05-20 西日本電信電話株式会社 クラスタシステム、クラスタシステムのアップデート管理装置、アップデート振分装置、アップデート管理方法、アップデート振分方法及びプログラム
JP2021158537A (ja) * 2020-03-27 2021-10-07 パナソニックIpマネジメント株式会社 ハンズフリー装置、データ転送方法、およびプログラム

Family Cites Families (4)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH1131077A (ja) * 1997-07-14 1999-02-02 Nec Corp 情報処理システム及びそのファームウェア置換方法
JP2011154437A (ja) * 2010-01-26 2011-08-11 Alpine Electronics Inc 共用プログラムの更新システム
JP5629927B2 (ja) * 2010-11-12 2014-11-26 クラリオン株式会社 車載機のオンライン更新方法
US9223611B2 (en) * 2010-12-28 2015-12-29 Microsoft Technology Licensing, Llc Storing and resuming application runtime state

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