JP6063492B2 - Display device - Google Patents

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Description

本開示は、階調電位を保持する複数種類の電位線を用いて映像表示を行う表示装置に関する。   The present disclosure relates to a display device that performs video display using a plurality of types of potential lines that hold gradation potentials.

従来、例えば液晶素子や有機EL(Electro Luminescence)素子の様々なタイプの表示素子を用いた表示装置が開発されている。このような表示装置では一般に、複数の画素を有する表示領域(有効表示領域)の外縁(外周)に位置する額縁領域(非表示領域)に、周辺回路が配設されている。この周辺回路は、複数の画素を駆動する駆動回路等からなり、例えば、複数の画素を順次駆動する走査線駆動回路や、駆動対象の画素に対して映像信号を供給する信号線駆動回路などが挙げられる。   Conventionally, display devices using various types of display elements such as liquid crystal elements and organic EL (Electro Luminescence) elements have been developed. In such a display device, a peripheral circuit is generally arranged in a frame region (non-display region) located on the outer edge (outer periphery) of a display region (effective display region) having a plurality of pixels. The peripheral circuit includes a drive circuit that drives a plurality of pixels. For example, a scanning line drive circuit that sequentially drives the plurality of pixels, a signal line drive circuit that supplies video signals to the pixels to be driven, and the like. Can be mentioned.

また、近年では、各画素内に所定の画素回路(記憶回路等)が形成された表示装置も提案されている(例えば、特許文献1参照)。   In recent years, a display device in which a predetermined pixel circuit (such as a memory circuit) is formed in each pixel has also been proposed (see, for example, Patent Document 1).

特開平08−286170号公報Japanese Patent Laid-Open No. 08-286170

ところで、昨今における表示装置の大型化や高解像度化に伴い、特に上記のような画素回路を内蔵する表示装置では、例えば異物等による電極間の短絡などに起因して、製造の際の歩留まりが低下してしまうという問題があった。   By the way, with the recent increase in size and resolution of display devices, particularly in display devices incorporating the pixel circuit as described above, the yield in manufacturing is increased due to, for example, a short circuit between electrodes due to foreign matter or the like. There was a problem of being lowered.

本開示はかかる問題点に鑑みてなされたもので、その目的は、製造の際の歩留まりを向上させることが可能な表示装置および電子機器を提供することにある。   The present disclosure has been made in view of such problems, and an object of the present disclosure is to provide a display device and an electronic apparatus capable of improving yield in manufacturing.

本開示の表示装置は、表示領域内にそれぞれ配置された複数の画素と、表示領域内にそれぞれ配置され、互いに異なる階調電位を保持する複数種類の電位線と、を備え、前記複数の画素の各々は、表示素子と、映像信号を記憶する記憶回路を含み、前記複数種類の電位線のうちの前記記憶回路に基づいて選択された1種の電位線の階調電位が前記表示素子に対して供給されるように、各画素の表示駆動を行う画素回路と、を含み、前記表示素子への印加電圧または印加電流の変動量に対する表示輝度の変動量に対応する輝度勾配が相対的に急峻である階調電位を保持する第1の電位線の抵抗値が、前記輝度勾配が相対的に緩やかである階調電位を保持する第2の電位線の抵抗値と比べて低くなっている。   A display device according to the present disclosure includes a plurality of pixels each disposed in a display region, and a plurality of types of potential lines that are respectively disposed in the display region and hold different gradation potentials. Each of which includes a display element and a storage circuit for storing a video signal, and the gradation potential of one type of potential line selected based on the storage circuit among the plurality of types of potential lines is applied to the display element. A luminance gradient corresponding to the amount of variation in display luminance relative to the amount of variation in applied voltage or applied current to the display element. The resistance value of the first potential line holding the steep gradation potential is lower than the resistance value of the second potential line holding the gradation potential having a relatively gradual luminance gradient. .

本開示の表示装置によれば、上記輝度勾配が相対的に急峻である階調電位を保持する第1の電位線の抵抗値が、上記輝度勾配が相対的に緩やかである階調電位を保持する第2の電位線の抵抗値と比べて低くなるようにしたので、第1の電位線の電位が変動した場合であっても、この第1の電位線の階調電位が供給された表示素子における表示輝度の変動を抑えることができる。よって、例えば画素の線欠陥(第1の電位線に沿った複数の画素の欠陥)を回避して点欠陥で済ませること等ができ、製造の際の歩留まりを向上させることが可能となる。   According to the display device of the present disclosure, the resistance value of the first potential line that holds the gradation potential with the relatively steep luminance gradient holds the gradation potential with the relatively gentle luminance gradient. Since the resistance value is lower than the resistance value of the second potential line, even if the potential of the first potential line fluctuates, the display to which the gradation potential of the first potential line is supplied is displayed. Variation in display luminance in the element can be suppressed. Therefore, for example, pixel line defects (defects of a plurality of pixels along the first potential line) can be avoided and point defects can be avoided, and the yield in manufacturing can be improved.

本開示の一実施の形態に係る表示装置の概略構成例を表すブロック図である。It is a block diagram showing the schematic structural example of the display apparatus which concerns on one embodiment of this indication. 図1に示した画素の構成例を模式的に表す回路図である。FIG. 2 is a circuit diagram schematically illustrating a configuration example of a pixel illustrated in FIG. 1. 図2に示した画素における白表示時の動作の概要を表す回路図である。FIG. 3 is a circuit diagram illustrating an outline of an operation during white display in the pixel illustrated in FIG. 2. 図2に示した画素における黒表示時の動作の概要を表す回路図である。FIG. 3 is a circuit diagram illustrating an outline of an operation during black display in the pixel illustrated in FIG. 2. 隣接画素同士における画素電極間の短絡について説明するための回路図である。It is a circuit diagram for demonstrating the short circuit between the pixel electrodes in adjacent pixels. 画素内における画素電極と対向電極との間の短絡について説明するための回路図である。It is a circuit diagram for demonstrating the short circuit between the pixel electrode and counter electrode in a pixel. 液晶素子に対する印加電圧と光の透過率との関係の一例を表す特性図である。It is a characteristic view showing an example of the relationship between the applied voltage with respect to a liquid crystal element, and the transmittance | permeability of light. 実施の形態に係る黒電位線および白電位線の構成例を表す模式平面図である。FIG. 3 is a schematic plan view illustrating a configuration example of a black potential line and a white potential line according to an embodiment. 変形例1に係る黒電位線の構成例を表す模式平面図である。10 is a schematic plan view illustrating a configuration example of a black potential line according to Modification 1. FIG. 変形例2に係る画素の構成例を模式的に表す回路図である。12 is a circuit diagram schematically illustrating a configuration example of a pixel according to Modification 2. FIG. 図10に示した画素における階調表示動作の概要を表す図である。It is a figure showing the outline | summary of the gradation display operation | movement in the pixel shown in FIG. 変形例2に係る黒電位線および白電位線の構成例を表す図である。It is a figure showing the structural example of the black electric potential line which concerns on the modification 2, and a white electric potential line. 実施の形態および変形例の表示装置の適用例1の外観を表す斜視図である。It is a perspective view showing the external appearance of the example 1 of application of a display device of an embodiment and a modification. (A)は適用例2の表側から見た外観を表す斜視図であり、(B)は裏側から見た外観を表す斜視図である。(A) is a perspective view showing the external appearance seen from the front side of the application example 2, (B) is a perspective view showing the external appearance seen from the back side. 適用例3の外観を表す斜視図である。12 is a perspective view illustrating an appearance of application example 3. FIG. 適用例4の外観を表す斜視図である。14 is a perspective view illustrating an appearance of application example 4. FIG. (A)は適用例5の開いた状態の正面図、(B)はその側面図、(C)は閉じた状態の正面図、(D)は左側面図、(E)は右側面図、(F)は上面図、(G)は下面図である。(A) is a front view of the application example 5 in an open state, (B) is a side view thereof, (C) is a front view in a closed state, (D) is a left side view, and (E) is a right side view, (F) is a top view and (G) is a bottom view.

以下、本開示の実施の形態について、図面を参照して詳細に説明する。なお、説明は以下の順序で行う。
1.実施の形態(配線幅の相違により電位線の抵抗値同士を異ならせた例)
2.変形例
変形例1(構成材料(抵抗率)の相違により電位線の抵抗値同士を異ならせた例)
変形例2(複数ビットの映像信号を用いて階調表示を行う場合の例)
3.適用例(電子機器への適用例)
4.その他の変形例
Hereinafter, embodiments of the present disclosure will be described in detail with reference to the drawings. The description will be given in the following order.
1. Embodiment (example in which resistance values of potential lines are varied due to differences in wiring width)
2. Modified example Modified example 1 (example in which the resistance values of the potential lines are made different from each other due to the difference in constituent materials (resistivity))
Modification 2 (example in which gradation display is performed using a video signal of a plurality of bits)
3. Application example (application example to electronic equipment)
4). Other variations

<実施の形態>
[表示装置1の全体構成]
図1は、本開示の一実施の形態に係る表示装置(表示装置1)の概略構成をブロック図で表わしたものである。表示装置1は、外部から供給される映像信号(図示せず)に基づいて映像表示を行うものであり、ここでは一例として、後述する液晶素子(液晶素子LC)を用いた液晶表示装置となっている。この表示装置1は、液晶表示パネル3およびバックライト4を備えている。
<Embodiment>
[Overall Configuration of Display Device 1]
FIG. 1 is a block diagram illustrating a schematic configuration of a display device (display device 1) according to an embodiment of the present disclosure. The display device 1 performs video display based on a video signal (not shown) supplied from the outside. Here, as an example, the display device 1 is a liquid crystal display device using a liquid crystal element (liquid crystal element LC) described later. ing. The display device 1 includes a liquid crystal display panel 3 and a backlight 4.

バックライト4は、液晶表示パネル3に対して光を射出する光源部であり、例えば、冷陰極管(CCFL;Cold Cathode Fluorescent Lamp)や、発光ダイオード(LED;Light Emitting Diode)などの発光素子を用いて構成されている。   The backlight 4 is a light source unit that emits light to the liquid crystal display panel 3. For example, the backlight 4 includes a light emitting element such as a cold cathode fluorescent lamp (CCFL) or a light emitting diode (LED). It is configured using.

液晶表示パネル3は、例えばガラス等からなる基板上に、複数の画素10、走査線駆動回路121,122、信号線駆動回路13および接続用端子14を備えている。複数の画素10は、表示領域(有効表示領域)11内に配置され、走査線駆動回路121,122、信号線駆動回路13および接続用端子14はそれぞれ、この表示領域11の周縁(外縁)に位置する額縁領域(非表示領域)に配置されている。   The liquid crystal display panel 3 includes a plurality of pixels 10, scanning line driving circuits 121 and 122, a signal line driving circuit 13, and connection terminals 14 on a substrate made of, for example, glass. The plurality of pixels 10 are arranged in the display area (effective display area) 11, and the scanning line driving circuits 121 and 122, the signal line driving circuit 13, and the connection terminal 14 are respectively on the periphery (outer edge) of the display area 11. It is arranged in the frame area (non-display area) located.

接続用端子14は、表示装置の外部との間で各種信号の配線同士を接続するための端子である。   The connection terminal 14 is a terminal for connecting various signal lines to the outside of the display device.

走査線駆動回路121,122および信号線駆動回路123(駆動部)は、接続用端子14を介して外部から入力された信号(映像信号)に基づいて、各画素10の表示駆動を行う回路である。これらの駆動回路は、詳細は後述するが、複数種類の電位線(ここでは、後述する黒電位線LBおよび白電位線LW)のうちの選択された1種の電位線の階調電位(後述する黒階調電位または白階調電位)が各画素10内の表示素子(ここでは後述する液晶素子LC)に対して供給されるように、表示駆動を行うようになっている。   The scanning line drive circuits 121 and 122 and the signal line drive circuit 123 (drive unit) are circuits that perform display drive of each pixel 10 based on a signal (video signal) input from the outside via the connection terminal 14. is there. Although these drive circuits will be described in detail later, the gradation potential (described later) of one selected potential line among a plurality of types of potential lines (here, a black potential line LB and a white potential line LW described later). The display drive is performed so that the black gradation potential or the white gradation potential to be supplied to the display element (here, a liquid crystal element LC described later) in each pixel 10.

走査線駆動回路121,122はそれぞれ、水平ライン(行)方向に沿って延在する複数の走査線(ゲート線)Gを用いて、複数の画素10を水平ラインごとに順次選択することにより、駆動対象の画素10を線順次で選択する(線順次走査を行う)回路である。   Each of the scanning line driving circuits 121 and 122 uses a plurality of scanning lines (gate lines) G extending along the horizontal line (row) direction to sequentially select the plurality of pixels 10 for each horizontal line, This is a circuit that selects pixels 10 to be driven in a line sequential manner (performs a line sequential scanning).

また、信号線駆動回路13は、垂直ライン(列)方向に沿って延在する複数の信号線(データ線)Sを用いて、駆動対象の画素10に対して映像信号を供給する回路である。この信号線Sには、ここでは2値(「L(ロー)」信号(「0」)および「H(ハイ)」信号(「1」)の2値)のデータ(デジタルデータ)からなる1ビットの映像信号が供給されるようになっている。   The signal line driving circuit 13 is a circuit that supplies a video signal to the pixel 10 to be driven using a plurality of signal lines (data lines) S extending along the vertical line (column) direction. . In this signal line S, here, binary (binary data of “L (low)” signal (“0”) and “H (high)” signal (“1”)) is data 1 (digital data). Bit video signals are supplied.

複数の画素10は、上記した表示領域11内にマトリクス状に配置されている。   The plurality of pixels 10 are arranged in a matrix in the display area 11 described above.

[画素10の詳細構成]
図2は、各画素10の回路構成例を表したものである。各画素10は、液晶素子LC(表示素子)および画素回路2を備えている。画素回路2は、TFT(Thin Film Transistor)素子Tr1および記憶回路(メモリ回路)21を有している。また、各画素10には、上記した走査線Gおよび信号線Sと、共通電位線(対向電位線)VCOMと、黒電位線LB(第1の電位線)および白電位線LW(第2の電位線)とが接続されている。
[Detailed Configuration of Pixel 10]
FIG. 2 illustrates a circuit configuration example of each pixel 10. Each pixel 10 includes a liquid crystal element LC (display element) and a pixel circuit 2. The pixel circuit 2 includes a TFT (Thin Film Transistor) element Tr 1 and a memory circuit (memory circuit) 21. Further, each pixel 10 includes the above-described scanning line G and signal line S, common potential line (opposing potential line) VCOM, black potential line LB (first potential line), and white potential line LW (second potential line). Potential line).

黒電位線LBおよび白電位線LWは、互いに異なる階調電位を保持する複数種類(ここでは2種類)の電位線であり、水平ライン方向に沿って延在するように形成されている。黒電位線LBは、黒階調電位(例えば、3V〜4V程度)を保持する電位線であり、白電位線LWは、白階調電位(例えば、0V〜1V程度)を保持する電位線である。ここで、本実施の形態では、黒電位線LBの抵抗値が白電位線LWの抵抗値と比べて低くなるように設定されている。具体的には、黒電位線LBの配線幅が、白電位線LWの配線幅と比べて太くなっている。なお、この黒電位線LBおよび白電位線LWの各配線同士の関係の詳細については、後述する。   The black potential line LB and the white potential line LW are a plurality of types (two types here) of potential lines that hold different gradation potentials, and are formed so as to extend along the horizontal line direction. The black potential line LB is a potential line that holds a black gradation potential (for example, about 3 V to 4 V), and the white potential line LW is a potential line that holds a white gradation potential (for example, about 0 V to 1 V). is there. Here, in the present embodiment, the resistance value of the black potential line LB is set to be lower than the resistance value of the white potential line LW. Specifically, the wiring width of the black potential line LB is thicker than the wiring width of the white potential line LW. Details of the relationship between the black potential line LB and the white potential line LW will be described later.

液晶素子LCは、画素回路2による画素駆動に従って、表示動作を行うものである。この液晶素子LCは、例えばVA(Vertical Alignment)モードやTN(Twisted Nematic)モードの液晶を用いて構成されている。また、ここでは一例として、この液晶素子LCはノーマリーホワイトモードの液晶素子からなる。液晶素子LCの一端(画素電極20側)は、TFT素子Tr2およびTFT素子Tr3の各ドレインに接続され、他端(対向電極側)は共通電位線VCOMに接続されている。   The liquid crystal element LC performs a display operation in accordance with pixel driving by the pixel circuit 2. The liquid crystal element LC is configured by using, for example, VA (Vertical Alignment) mode or TN (Twisted Nematic) mode liquid crystal. As an example, the liquid crystal element LC is a normally white mode liquid crystal element. One end (pixel electrode 20 side) of the liquid crystal element LC is connected to the drains of the TFT element Tr2 and the TFT element Tr3, and the other end (counter electrode side) is connected to the common potential line VCOM.

画素回路2は、信号線Sを介して供給される映像信号に基づいて、黒電位線LBおよび白電位線LWのうちの一方の電位線の階調電位(黒階調電位または白階調電位)を選択し、液晶素子LCを供給する回路である。   Based on the video signal supplied via the signal line S, the pixel circuit 2 performs the gradation potential (black gradation potential or white gradation potential) of one of the black potential line LB and the white potential line LW. ) And supplies the liquid crystal element LC.

TFT素子Tr1は、信号線Sから供給される映像信号を記憶回路21に対して供給するためのスイッチング素子であり、ここではN型のトランジスタとなっている。このTFT素子Tr1のゲートは走査線Gに接続され、ソースは信号線Sに接続されている。   The TFT element Tr1 is a switching element for supplying a video signal supplied from the signal line S to the memory circuit 21, and is an N-type transistor here. The gate of the TFT element Tr1 is connected to the scanning line G, and the source is connected to the signal line S.

記憶回路21は、信号線SからTFT素子Tr1を介して入力された映像信号を記憶(一時的に保持)する回路(ラッチ回路)であり、ここでは6つのTFT素子Tr2〜Tr7を有するSRAM(Static Random Access Memory)回路からなる。これらのTFT素子Tr2〜Tr7のうち、4つのTFT素子Tr2,Tr3,Tr4,Tr5はN型のトランジスタであり、2つのTFT素子Tr6,Tr7はP型のトランジスタである。TFT素子Tr2のゲートは、TFT素子Tr1のドレイン、TFT素子Tr4のゲート、TFT素子Tr6のゲート、TFT素子Tr5のドレインおよびTFT素子Tr7のドレインに接続されている。TFT素子Tr2のソースは白電位線LWに接続され、ドレインは画素電極20に接続されている。TFT素子Tr3のゲートは、TFT素子Tr5のゲート、TFT素子Tr7のゲート、TFT素子Tr4のドレインおよびTFT素子Tr6のドレインに接続されている。TFT素子Tr3のソースは黒電位線LBに接続され、ドレインは画素電極20に接続されている。TFT素子Tr4のソースおよびTFT素子Tr5のソースはそれぞれ、接地電位VSSに接続され、TFT素子Tr6のソースおよびTFT素子Tr7のソースはそれぞれ、電源電位VDDに接続されている。   The memory circuit 21 is a circuit (latch circuit) that stores (temporarily holds) a video signal input from the signal line S via the TFT element Tr1, and here, an SRAM (slave having six TFT elements Tr2 to Tr7). Static Random Access Memory) circuit. Of these TFT elements Tr2 to Tr7, four TFT elements Tr2, Tr3, Tr4, Tr5 are N-type transistors, and two TFT elements Tr6, Tr7 are P-type transistors. The gate of the TFT element Tr2 is connected to the drain of the TFT element Tr1, the gate of the TFT element Tr4, the gate of the TFT element Tr6, the drain of the TFT element Tr5, and the drain of the TFT element Tr7. The source of the TFT element Tr2 is connected to the white potential line LW, and the drain is connected to the pixel electrode 20. The gate of the TFT element Tr3 is connected to the gate of the TFT element Tr5, the gate of the TFT element Tr7, the drain of the TFT element Tr4, and the drain of the TFT element Tr6. The source of the TFT element Tr3 is connected to the black potential line LB, and the drain is connected to the pixel electrode 20. The source of the TFT element Tr4 and the source of the TFT element Tr5 are each connected to the ground potential VSS, and the source of the TFT element Tr6 and the source of the TFT element Tr7 are each connected to the power supply potential VDD.

[表示装置1の作用・効果]
(1.表示動作)
この表示装置1では、接続用端子14を介して外部から供給される入力信号に基づいて、走査線駆動回路121,122および信号線駆動回路13がそれぞれ、互いに同期した表示駆動動作を行う。具体的には、走査線駆動回路121,122はそれぞれ、走査線Gを用いて画素10を水平ラインごとに順次選択し、線順次走査を行う。また、信号線駆動回路13は、駆動対象の画素10に対して信号線Sを介して映像信号を供給する。そして、映像信号が供給された画素10では、バックライト4からの照明光が変調され、表示光として出射される。これにより、入力信号に基づく映像表示が表示装置1において行われる。
[Operation and Effect of Display Device 1]
(1. Display operation)
In the display device 1, the scanning line driving circuits 121 and 122 and the signal line driving circuit 13 perform display driving operations synchronized with each other based on an input signal supplied from the outside via the connection terminal 14. Specifically, each of the scanning line driving circuits 121 and 122 sequentially selects the pixels 10 for each horizontal line using the scanning line G, and performs line sequential scanning. Further, the signal line drive circuit 13 supplies a video signal via the signal line S to the pixel 10 to be driven. In the pixel 10 supplied with the video signal, the illumination light from the backlight 4 is modulated and emitted as display light. Thereby, video display based on the input signal is performed on the display device 1.

ここで、図3および図4を参照して、各画素10における表示動作の詳細について説明する。なお、ここでは前述したように、液晶素子LCがノーマリーホワイトモードの液晶素子である場合の例について説明する。また、これらの図3および図4では、説明の便宜上、各TFT素子Tr1〜Tr7をスイッチとして図示している。したがって、これらの図では、駆動対象の画素10であるとして、TFT素子Tr1がオン状態となっている。   Here, with reference to FIG. 3 and FIG. 4, the detail of the display operation in each pixel 10 is demonstrated. Here, as described above, an example in which the liquid crystal element LC is a normally white mode liquid crystal element will be described. In FIGS. 3 and 4, the TFT elements Tr <b> 1 to Tr <b> 7 are illustrated as switches for convenience of explanation. Therefore, in these drawings, the TFT element Tr1 is in the on state, assuming that the pixel 10 is to be driven.

まず、図3に示したように、駆動対象の画素10に対して信号線Sから「H」信号が供給された場合、その画素10では以下のようにして白表示がなされる。すなわち、TFT素子Tr1を介して、記憶回路21へ「H」信号が供給されてラッチされる(一時的に保持される)ため、TFT素子Tr2,Tr4,Tr7がそれぞれオン状態となると共に、TFT素子Tr3,Tr5,Tr6がそれぞれオフ状態となる。したがって、図3中の矢印P11で示したように、白電位線LWの電位(白階調電位)が液晶素子LCの画素電極20へ供給され、液晶素子LCにおいて白表示がなされる。   First, as shown in FIG. 3, when an “H” signal is supplied from the signal line S to the pixel 10 to be driven, the pixel 10 performs white display as follows. That is, since the “H” signal is supplied to the memory circuit 21 through the TFT element Tr1 and latched (temporarily held), the TFT elements Tr2, Tr4, Tr7 are turned on, and the TFT The elements Tr3, Tr5, Tr6 are turned off. Therefore, as indicated by an arrow P11 in FIG. 3, the potential of the white potential line LW (white gradation potential) is supplied to the pixel electrode 20 of the liquid crystal element LC, and white display is performed in the liquid crystal element LC.

一方、図4に示したように、駆動対象の画素10に対して信号線Sから「L」信号が供給された場合、その画素10では以下のようにして黒表示がなされる。すなわち、TFT素子Tr1を介して、記憶回路21へ「L」信号が供給されてラッチされるため、白表示の場合とは逆に、TFT素子Tr3,Tr5,Tr6がそれぞれオン状態となると共に、TFT素子Tr2,Tr4,Tr7がそれぞれオフ状態となる。したがって、図4中の矢印P12で示したように、黒電位線LBの電位(黒階調電位)が液晶素子LCの画素電極20へ供給され、液晶素子LCにおいて黒表示がなされる。   On the other hand, as shown in FIG. 4, when the “L” signal is supplied from the signal line S to the pixel 10 to be driven, the pixel 10 displays black as follows. That is, since the “L” signal is supplied to the memory circuit 21 via the TFT element Tr1 and latched, the TFT elements Tr3, Tr5, and Tr6 are turned on, contrary to the case of white display. The TFT elements Tr2, Tr4, Tr7 are each turned off. Therefore, as indicated by an arrow P12 in FIG. 4, the potential of the black potential line LB (black gradation potential) is supplied to the pixel electrode 20 of the liquid crystal element LC, and black display is performed in the liquid crystal element LC.

このようにして各画素10において、信号線Sを介して供給される映像信号に基づいて、黒電位線LBおよび白電位線LWのうちの一方の電位線の階調電位(黒階調電位または白階調電位)が選択的に液晶素子LCへ供給され、黒表示または白表示(2色表示)がなされる。なお、表示領域11内の複数の画素10が、カラーフィルタ等を用いて、例えば赤色(R)画素、緑色(G)画素および青色(B)画素の3原色の画素により構成されている場合には、各色の画素で2色表示が行われると、全体としては2×2×2=8色表示がなされることになる。   Thus, in each pixel 10, based on the video signal supplied via the signal line S, the gradation potential (black gradation potential or black potential line LB) or one of the white potential lines LW is selected. White gradation potential) is selectively supplied to the liquid crystal element LC, and black display or white display (two-color display) is performed. In addition, when the plurality of pixels 10 in the display area 11 are configured by pixels of three primary colors, for example, red (R) pixels, green (G) pixels, and blue (B) pixels, using a color filter or the like. When two-color display is performed with pixels of each color, 2 × 2 × 2 = 8 colors are displayed as a whole.

(2.特徴的部分の作用)
次に、図5〜図8を参照して、液晶表示パネル3における特徴的部分の作用について詳細に説明する。
(2. Action of characteristic parts)
Next, with reference to FIGS. 5 to 8, the operation of the characteristic part in the liquid crystal display panel 3 will be described in detail.

まず、液晶表示パネル3では、製造時の工程不良等により混入した異物等に起因して、電極間の短絡(ショート)が生じる場合がある。すなわち、図5に示した例では、異物等に起因して、垂直ライン方向に沿って隣接する2つの画素10−1,10―2間で、画素電極20同士の短絡が生じている(図5中の矢印P21参照)。また、図6に示した例では、異物等に起因して、液晶素子LCにおける画素電極20側と対向電極側(共通電位線VCOM側)との短絡が生じている(図6中の矢印P22参照)。なお、図5では、図示の簡略化のため、液晶素子LCの図示を省略している。   First, in the liquid crystal display panel 3, there may be a case where a short circuit occurs between the electrodes due to foreign matters mixed due to process defects during manufacturing. That is, in the example shown in FIG. 5, a short circuit between the pixel electrodes 20 occurs between two adjacent pixels 10-1 and 10-2 along the vertical line direction due to foreign matters or the like (FIG. 5). (See arrow P21 in FIG. 5). In the example shown in FIG. 6, a short circuit occurs between the pixel electrode 20 side and the counter electrode side (common potential line VCOM side) in the liquid crystal element LC due to foreign matters or the like (arrow P22 in FIG. 6). reference). In FIG. 5, the liquid crystal element LC is not shown for the sake of simplicity.

このような電極間の短絡が生じると、図5,図6中の矢印P21,P22から分かるように、黒電位線LBや白電位線LWの電位(黒階調電位や白階調電位)が変動するため、それに伴って以下説明する表示輝度の変動が生じ、製造の際の歩留まりが低下してしまうことになる。   When such a short circuit occurs between the electrodes, as can be seen from arrows P21 and P22 in FIGS. 5 and 6, the potentials of the black potential line LB and the white potential line LW (black gradation potential and white gradation potential) are changed. Therefore, the display luminance will be changed as described below, and the manufacturing yield will be reduced.

ここで、図7は、液晶素子LCに対する印加電圧と光の透過率(表示輝度)との関係(表示特性)の一例を表したものである。この図7の例では、印加電圧=0〜0.7V程度の電圧範囲では、透過率が略一定(0.40程度:白階調に対応)となっていると共に、印加電圧=2.5〜4.0V程度の電圧範囲においても、透過率が略一定(0程度:黒階調に対応)となっている。一方、それらの間の電圧範囲である、印加電圧=0.7〜2.5V程度の電圧範囲では、白階調と黒階調との間で透過率が急峻に変化している。すなわち、この電圧範囲(中間調に対応する電圧範囲)では、印加電圧の変化(変動量)に対する透過率の変化(変動量)に対応する輝度勾配(輝度傾斜)が、急峻となっている。   Here, FIG. 7 shows an example of the relationship (display characteristics) between the voltage applied to the liquid crystal element LC and the light transmittance (display luminance). In the example of FIG. 7, in the voltage range of applied voltage = 0 to 0.7V, the transmittance is substantially constant (about 0.40: corresponding to white gradation) and applied voltage = 2.5. Even in a voltage range of about ~ 4.0V, the transmittance is substantially constant (about 0: corresponding to black gradation). On the other hand, in the voltage range between them, the applied voltage = 0.7 to 2.5 V, the transmittance changes steeply between the white gradation and the black gradation. That is, in this voltage range (voltage range corresponding to the halftone), the luminance gradient (luminance slope) corresponding to the change in transmittance (variation amount) with respect to the change in applied voltage (variation amount) is steep.

したがって、上記した電極間の短絡に起因した黒階調電位や白階調電位の変動(本来の印加電圧からの変動)が生じると、図7中の矢印P3B,P3Wで示したように、液晶素子LCにおける透過率(表示輝度)の変動が生じてしまう。特に、ここでは矢印P3B,P3Wから分かるように、白階調電位の変動による表示輝度の変動量よりも、黒階調電位の変動による表示輝度の変動量のほうが、相対的に大きくなっている。これは、白階調電位付近における輝度勾配と比べ、黒階調電位付近における輝度勾配のほうが相対的に急峻となっていることによる。そして、このような画素10における電極間の短絡に起因した輝度変動が生じると、その画素10単体での点欠陥には留まらず、黒電位線LWや白電位線LWに沿った1水平ライン分の複数の画素10における線欠陥となってしまい、製造の際の歩留まりが低下してしまう。なお、このような問題は、表示装置の大型化や高解像度化に伴い、本実施の形態のような画素回路を内蔵する表示装置では特に顕著に生じ得る。   Therefore, when the black gradation potential and the white gradation potential change (change from the original applied voltage) due to the short circuit between the electrodes described above occurs, as shown by arrows P3B and P3W in FIG. The transmittance (display luminance) in the element LC varies. In particular, as can be seen from the arrows P3B and P3W here, the amount of variation in display luminance due to variation in black gradation potential is relatively larger than the amount of variation in display luminance due to variation in white gradation potential. . This is because the luminance gradient near the black gradation potential is relatively steeper than the luminance gradient near the white gradation potential. When the luminance variation caused by the short circuit between the electrodes in the pixel 10 occurs, the pixel 10 is not limited to a point defect, but is equivalent to one horizontal line along the black potential line LW or the white potential line LW. Thus, a line defect occurs in the plurality of pixels 10, and the manufacturing yield decreases. Such a problem may be particularly noticeable in a display device incorporating a pixel circuit as in this embodiment as the display device is increased in size and resolution.

そこで本実施の形態では、上記した輝度勾配が相対的に急峻である階調電位(ここでは黒階調電位)を保持する電位線(ここでは黒電位線LB)の抵抗値が、輝度勾配が相対的に緩やかである階調電位(ここでは白階調電位)を保持する電位線(ここでは白電位線LW)の抵抗値と比べて低くなっている。すなわち、黒電位線LBの抵抗値をRB、白電位線LWの抵抗値をRWとすると、RB<RWとなっている。なお、このときの抵抗値の差はできるだけ大きいことが望ましく、抵抗値の比としては、例えば、RB:RW=1.0:1.5〜1:10程度が挙げられる。   Therefore, in this embodiment, the resistance value of the potential line (here, the black potential line LB) that holds the gradation potential (here, the black gradation potential) having a relatively steep luminance gradient has the luminance gradient. It is lower than the resistance value of a potential line (here, white potential line LW) that holds a relatively gentle gradation potential (here, white gradation potential). That is, assuming that the resistance value of the black potential line LB is RB and the resistance value of the white potential line LW is RW, RB <RW. Note that the difference in resistance value at this time is desirably as large as possible, and the ratio of the resistance values is, for example, about RB: RW = 1.0: 1.5 to 1:10.

具体的には、本実施の形態では図8に示したように、黒電位線LBの配線幅Wbが、白電位線LWの配線幅Wwと比べて太くなっている(Wb>Ww)ことにより、RB<RWとなっている。なお、このときの配線幅の差もできるだけ大きいことが望ましく、配線幅の比としては、例えば、Wb:Ww=1.5:1.0〜10:1程度(一例として、Wb:Ww=1.5:1.0)が挙げられる。   Specifically, in the present embodiment, as shown in FIG. 8, the wiring width Wb of the black potential line LB is larger than the wiring width Ww of the white potential line LW (Wb> Ww). RB <RW. Note that the difference in the wiring width at this time is preferably as large as possible, and the wiring width ratio is, for example, about Wb: Ww = 1.5: 1.0 to 10: 1 (for example, Wb: Ww = 1). .5: 1.0).

これにより本実施の形態では、上記したように、異物等に起因した電極間の短絡等が生じて黒電位線LBの電位(黒階調電位:輝度勾配が相対的に急峻である階調電位)が変動した場合であっても、この黒階調電位が供給された液晶素子LCにおける表示輝度の変動が抑えられる。   As a result, in this embodiment, as described above, a short circuit between electrodes caused by a foreign substance or the like occurs, and the potential of the black potential line LB (black gradation potential: gradation potential having a relatively steep luminance gradient). ) Fluctuates, the variation in display luminance in the liquid crystal element LC supplied with the black gradation potential can be suppressed.

以上のように本実施の形態では、輝度勾配が相対的に急峻である黒階調電位を保持する黒電位線LBの抵抗値RBが、輝度勾配が相対的に緩やかである白階調電位を保持する白電位線LWの抵抗値RWと比べて低くなるようにしたので、黒階調電位が変動した場合であっても、この黒階調電位が供給された液晶素子LCにおける表示輝度の変動を抑えることができる。よって、例えば画素10の線欠陥(ここでは、黒電位線LBに沿った複数の画素10の欠陥)を回避して点欠陥で済ませること等ができ、製造の際の歩留まりを向上させることが可能となると共に、表示画質を向上させることも可能となる。   As described above, in the present embodiment, the resistance value RB of the black potential line LB that holds the black gradation potential having a relatively steep luminance gradient has the white gradation potential having a relatively gentle luminance gradient. Since the resistance value RW of the white potential line LW to be held is lower, even when the black gradation potential fluctuates, the display luminance in the liquid crystal element LC to which the black gradation potential is supplied varies. Can be suppressed. Therefore, for example, it is possible to avoid the line defect of the pixel 10 (here, the defect of the plurality of pixels 10 along the black potential line LB) and to perform the point defect, and it is possible to improve the manufacturing yield. In addition, the display image quality can be improved.

また、黒電位線LBの配線幅Wbが白電位線LWの配線幅Wwと比べて太くなっている(Wb>Ww)ことにより、RB<RWとなっているようにしたので、黒電位線LBや白電位線LWの構成材料等を変更することなく、これらの電位線を形成する際のマスクパターンの変更のみで対応することができ、簡易に実現することが可能となる。   Further, since the wiring width Wb of the black potential line LB is larger than the wiring width Ww of the white potential line LW (Wb> Ww), RB <RW is satisfied, so that the black potential line LB It is possible to cope with the problem by changing only the mask pattern when forming these potential lines without changing the constituent material of the white potential line LW or the like.

更に、例えば、黒電位線LBの配線幅Wbと白電位線LWの配線幅Wwとの合計値(Wb+Ww)を、これらの配線幅が均等(Wb=Ww)となっている従来のものと同等とすれば、表示領域11内での画素10の解像度を低下させることなく(解像度を保持しつつ)、上記の効果を得ることが可能となる。   Further, for example, the total value (Wb + Ww) of the wiring width Wb of the black potential line LB and the wiring width Ww of the white potential line LW is equivalent to the conventional one in which these wiring widths are equal (Wb = Ww). Then, it is possible to obtain the above effect without reducing the resolution of the pixel 10 in the display area 11 (while maintaining the resolution).

<変形例>
続いて、上記実施の形態の変形例(変形例1,2)について説明する。なお、実施の形態における構成要素と同一のものには同一の符号を付し、適宜説明を省略する。
<Modification>
Subsequently, modified examples (modified examples 1 and 2) of the above embodiment will be described. In addition, the same code | symbol is attached | subjected to the same thing as the component in embodiment, and description is abbreviate | omitted suitably.

[変形例1]
図9は、変形例1に係る黒電位線(黒電位線LB1,LB2)の平面構成例を模式的に表したものである。まず、本変形例の表示装置1においても、上記実施の形態と同様に、輝度勾配が相対的に急峻である黒階調電位を保持する黒電位線LBの抵抗値RBが、輝度勾配が相対的に緩やかである白階調電位を保持する白電位線LWの抵抗値RWと比べて低くなっている(RB<RW)。
[Modification 1]
FIG. 9 schematically illustrates a planar configuration example of the black potential lines (black potential lines LB1 and LB2) according to the first modification. First, also in the display device 1 of this modification, as in the above embodiment, the resistance value RB of the black potential line LB holding the black gradation potential having a relatively steep luminance gradient has a relative luminance gradient. It is lower than the resistance value RW of the white potential line LW that holds the white gradation potential that is moderately low (RB <RW).

ただし、本変形例では実施の形態とは異なり、黒電位線における少なくとも一部の配線の抵抗率が、白電位線LWの抵抗率と比べて低くなっていることにより、RB<RWとなっている。具体的には、本変形例では、黒電位線が、互いに配線の構成材料(配線の抵抗率)が異なると共に互いに異なる層に形成された、2つの配線(黒電位線LB1,LB2)から構成されている。   However, in this modified example, unlike the embodiment, the resistivity of at least a part of the black potential line is lower than the resistivity of the white potential line LW, so that RB <RW. Yes. Specifically, in this modification, the black potential line is composed of two wirings (black potential lines LB1 and LB2) that are formed in different layers from each other and have different wiring constituent materials (wiring resistivity). Has been.

詳細には、黒電位線LB1(高抵抗率配線)は、白電位線LW(図9中に図示せず)と同一層内に形成されると共に、この白電位線LWと同一材料(例えば、モリブデン(Mo)等)からなる。この黒電位線LB1は、実施の形態で説明した黒電位線LBと同様に、各々が水平ライン方向に沿って延在するように、複数設けられている。   Specifically, the black potential line LB1 (high resistivity wiring) is formed in the same layer as the white potential line LW (not shown in FIG. 9), and the same material (for example, for example, the white potential line LW) Molybdenum (Mo) or the like. Similar to the black potential line LB described in the embodiment, a plurality of black potential lines LB1 are provided so that each extends along the horizontal line direction.

一方、黒電位線LB2(低抵抗率配線)は、白電位線LWと異なる層内において、図示しないコンタクト等を介して黒電位線LB1と電気的に接続されるように形成されると共に、白電位線LWよりも抵抗率の低い材料(例えば、アルミニウム(Al)等)からなる。すなわち、黒電位線LB1および白電位線LWにおける抵抗率をρ1、黒電位線LB2における抵抗率をρ2とすると、ρ2<ρ1となっている。なお、このときの抵抗率の差もできるだけ大きいことが望ましく、抵抗率の比としては、例えば、ρ1:ρ2=10:1〜100:1程度が挙げられる。   On the other hand, the black potential line LB2 (low resistivity wiring) is formed so as to be electrically connected to the black potential line LB1 via a contact or the like (not shown) in a layer different from the white potential line LW. It consists of a material (for example, aluminum (Al) etc.) whose resistivity is lower than that of the potential line LW. That is, if the resistivity in the black potential line LB1 and the white potential line LW is ρ1, and the resistivity in the black potential line LB2 is ρ2, ρ2 <ρ1. In addition, it is desirable that the difference in resistivity at this time is as large as possible. As a ratio of the resistivity, for example, about ρ1: ρ2 = 10: 1 to 100: 1 can be given.

この黒電位線LB2は、ここでは黒電位線LB1および白電位線LWとは異なり、各々が垂直ライン方向に沿って延在するように、複数設けられている。そして、本変形例では、これら複数の黒電位線LB2が、表示領域11内の複数の画素10に対して間引き配置されている。すなわち、水平ライン方向に沿った複数個の画素10に対して1つの黒電位線LB2の割合で、黒電位線LB2が配置されている。   Unlike the black potential line LB1 and the white potential line LW, a plurality of black potential lines LB2 are provided so as to extend along the vertical line direction. In this modification, the plurality of black potential lines LB <b> 2 are thinned out with respect to the plurality of pixels 10 in the display area 11. That is, the black potential lines LB2 are arranged at a ratio of one black potential line LB2 to the plurality of pixels 10 along the horizontal line direction.

以上のように本変形例では、黒電位線における少なくとも一部の配線の抵抗率が、白電位線LWの抵抗率と比べて低くなっていることによって、RB<RWとなっているようにしたので、上記実施の形態と同様の作用により同様の効果を得ることが可能である。   As described above, in this modified example, the resistivity of at least some of the black potential lines is lower than the resistivity of the white potential line LW, so that RB <RW. Therefore, it is possible to obtain the same effect by the same operation as the above embodiment.

また、複数の黒電位線LB2が、表示領域11内の複数の画素10に対して間引き配置されているようにしたので、例えば、低抵抗率材料からなる黒電位線LB2の配線間での短絡不良等の発生を抑えることが可能となる。   Further, since the plurality of black potential lines LB2 are thinned out with respect to the plurality of pixels 10 in the display region 11, for example, a short circuit between the black potential lines LB2 made of a low resistivity material. It is possible to suppress the occurrence of defects and the like.

なお、本変形例では、互いに配線の構成材料(配線の抵抗率)が異なる2つの黒電位線LB1,LB2同士が、互いに異なる層に形成されている場合について説明したが、場合によっては、これらの黒電位線LB1,LB2同士が同一層内に形成されていてもよい。ただし、一般には、同一層内に構成材料が異なる複数の配線層を形成することは難しい(あるいは、製造工程が複雑化してしまう)ことから、本変形例のように構成したほうが望ましいと言える。   In this modification, the case where the two black potential lines LB1 and LB2 having different wiring constituent materials (wiring resistivity) are formed in different layers has been described. The black potential lines LB1 and LB2 may be formed in the same layer. However, in general, it is difficult to form a plurality of wiring layers having different constituent materials in the same layer (or the manufacturing process becomes complicated), so it can be said that it is desirable to configure as in this modification.

[変形例2]
(画素20Aの回路構成)
図10は、変形例2に係る画素(画素10A)の回路構成例を模式的に表したものである。本変形例の表示装置1は、多ビット(複数ビット)の映像信号を用いて、各画素10Aにおいて多階調表示を行うようにしたものである。ここでは一例として、映像信号が2ビットの信号(各ビットは、「L」または「H」の2値データ)からなるものとして説明する。すなわち、後述するように、2ビット×2階調(黒階調および白階調)=4階調の表示が各画素10Aにおいてなされるものとする。なお、図10では、図示の簡略化のため、液晶素子LCおよび共通電位線VCOMの図示を省略している。
[Modification 2]
(Circuit configuration of the pixel 20A)
FIG. 10 schematically illustrates a circuit configuration example of a pixel (pixel 10A) according to the second modification. The display device 1 of this modification is configured to perform multi-gradation display in each pixel 10A using a multi-bit (multiple-bit) video signal. Here, as an example, it is assumed that the video signal is composed of a 2-bit signal (each bit is binary data of “L” or “H”). That is, as described later, it is assumed that display of 2 bits × 2 gradations (black gradation and white gradation) = 4 gradations is performed in each pixel 10A. In FIG. 10, the liquid crystal element LC and the common potential line VCOM are not shown for the sake of simplicity.

このことから、本変形例における各画素10Aは、低ビット側(1ビット目)の階調表示に用いられるサブ画素10ALと、高ビット側(2ビット目)の階調表示に用いられるサブ画素10AHとを有している(複数のサブ画素構造)。サブ画素10ALは、TFT素子Tr1Lと、画素電極20Lを含む液晶素子LCと、記憶回路21とを有している。同様に、サブ画素10AHは、TFT素子Tr1Hと、画素電極20Hを含む液晶素子LCと、記憶回路21とを有している。ここで、これらのサブ画素10AL,10AHは、映像信号における各ビットの重み付けに対応した面積の表示領域(画素電極の面積に対応)を有している。すなわち、ここでは、高ビット側のサブ画素10AHにおける画素電極20Hの面積S(H)は、低ビット側のサブ画素10ALにおける画素電極20Lの面積S(L)の2倍の大きさとなっている(S(H)=2×S(L))。   Therefore, each pixel 10A in the present modification includes a sub-pixel 10AL used for gradation display on the low bit side (first bit) and a sub-pixel used for gradation display on the high bit side (second bit). 10AH (multiple sub-pixel structures). The sub-pixel 10AL includes a TFT element Tr1L, a liquid crystal element LC including the pixel electrode 20L, and a memory circuit 21. Similarly, the sub pixel 10AH includes a TFT element Tr1H, a liquid crystal element LC including the pixel electrode 20H, and a memory circuit 21. Here, these sub-pixels 10AL and 10AH have a display area (corresponding to the area of the pixel electrode) having an area corresponding to the weighting of each bit in the video signal. That is, here, the area S (H) of the pixel electrode 20H in the sub-pixel 10AH on the high bit side is twice the area S (L) of the pixel electrode 20L in the sub-pixel 10AL on the low bit side. (S (H) = 2 × S (L)).

また、各画素10Aには、走査線G、信号線S、黒電位線LBおよび白電位線LWがそれぞれ、映像信号における各ビットごとに個別に接続されている。具体的には、低ビット側のサブ画素10ALには、走査線GL、信号線SL、黒電位線LB(L)および白電位線LW(L)が接続されている。また、高ビット側のサブ画素10AHには、走査線GH、信号線SH、黒電位線LB(H)および白電位線LW(H)が接続されている。なお、サブ画素10AL,10AHにおける各配線の接続態様は、実施の形態における画素10における接続態様と同様であるため、説明を省略する。   Further, the scanning line G, the signal line S, the black potential line LB, and the white potential line LW are individually connected to each pixel 10A for each bit in the video signal. Specifically, the scanning line GL, the signal line SL, the black potential line LB (L), and the white potential line LW (L) are connected to the sub-pixel 10AL on the low bit side. Further, a scanning line GH, a signal line SH, a black potential line LB (H), and a white potential line LW (H) are connected to the sub-pixel 10AH on the high bit side. Note that the connection mode of each wiring in the sub-pixels 10AL and 10AH is the same as the connection mode in the pixel 10 in the embodiment, and thus description thereof is omitted.

(画素10Aにおける表示動作)
このような構成により画素10Aでは、実施の形態と同様に液晶素子LCがノーマリーホワイトモードの液晶素子であるものとすると、図11に示したようにして表示動作が行われる。すなわち、まず、駆動対象の画素10に対して、信号線SHから「L」信号、信号線SLから「L」信号がそれぞれ供給された場合、サブ画素10AH(画素電極20H)およびサブ画素10AL(画素電極20L)の双方において黒表示となる。したがって、この場合には、表示輝度が最も低い黒階調表示(0階調目の表示)となる。
(Display operation in pixel 10A)
With this configuration, in the pixel 10A, when the liquid crystal element LC is a normally white mode liquid crystal element as in the embodiment, a display operation is performed as shown in FIG. That is, first, when the “L” signal is supplied from the signal line SH and the “L” signal is supplied from the signal line SL to the pixel 10 to be driven, the sub-pixel 10AH (pixel electrode 20H) and the sub-pixel 10AL ( Both the pixel electrodes 20L) display black. Therefore, in this case, the black gradation display (display of the 0th gradation) having the lowest display luminance is obtained.

また、駆動対象の画素10に対して、信号線SHから「L」信号、信号線SLから「H」信号がそれぞれ供給された場合、サブ画素10AH(画素電極20H)では黒表示、サブ画素10AL(画素電極20L)では白表示となる。したがって、サブ画素10AH,10ALにおける画素電極20H,20Lの面積S(H),S(L)同士の重み付けを考慮すると、この場合には、表示輝度が2番目に低い中間調(グレイ)表示(1階調目の表示)となる。   Further, when the “L” signal is supplied from the signal line SH and the “H” signal is supplied from the signal line SL to the pixel 10 to be driven, the sub-pixel 10AH (pixel electrode 20H) displays black and the sub-pixel 10AL. In (pixel electrode 20L), white display is performed. Therefore, in consideration of the weighting between the areas S (H) and S (L) of the pixel electrodes 20H and 20L in the sub-pixels 10AH and 10AL, in this case, the gray level (gray) display with the second lowest display luminance ( 1st gradation display).

駆動対象の画素10に対して、信号線SHから「H」信号、信号線SLから「L」信号がそれぞれ供給された場合、サブ画素10AH(画素電極20H)では白表示、サブ画素10AL(画素電極20L)では黒表示となる。したがって、サブ画素10AH,10ALにおける画素電極20H,20Lの面積S(H),S(L)同士の重み付けを考慮すると、この場合には、表示輝度が2番目に高い中間調(グレイ)表示(2階調目の表示)となる。   When an “H” signal is supplied from the signal line SH and an “L” signal is supplied from the signal line SL to the pixel 10 to be driven, the sub-pixel 10AH (pixel electrode 20H) performs white display and the sub-pixel 10AL (pixel). The electrode 20L) displays black. Therefore, in consideration of the weighting of the areas S (H) and S (L) of the pixel electrodes 20H and 20L in the sub-pixels 10AH and 10AL, in this case, the display tone is the second highest gray level (gray) ( 2nd gradation display).

そして、駆動対象の画素10に対して、信号線SHから「H」信号、信号線SLから「H」信号がそれぞれ供給された場合、サブ画素10AH(画素電極20H)およびサブ画素10AL(画素電極20L)の双方において白表示となる。したがって、この場合には、表示輝度が最も高い白階調表示(3階調目の表示)となる。   When the “H” signal is supplied from the signal line SH and the “H” signal is supplied from the signal line SL to the pixel 10 to be driven, the sub pixel 10AH (pixel electrode 20H) and the sub pixel 10AL (pixel electrode) are supplied. 20L), white display is performed. Therefore, in this case, the white gradation display (the third gradation display) with the highest display luminance is obtained.

このようにして本変形例では、複数ビットの映像信号を用いて各画素10Aにおいて多階調表示が行われる。   Thus, in this modification, multi-gradation display is performed in each pixel 10A using a plurality of bits of video signals.

(特徴的部分の構成・作用)
ここで、本変形例においても実施の形態と同様に、輝度勾配が相対的に急峻である黒階調電位を保持する黒電位線の抵抗値が、輝度勾配が相対的に緩やかである白階調電位を保持する白電位線の抵抗値と比べて低くなっている。具体的には、低ビット側のサブ画素10ALでは、黒電位線LB(L)の抵抗値RB(L)が、白電位線LW(L)の抵抗値RW(L)と比べて低くなっている(RB(L)<RW(L))。同様に、高ビット側のサブ画素10AHでは、黒電位線LB(H)の抵抗値RB(H)が、白電位線LW(H)の抵抗値RW(H)と比べて低くなっている(RB(H)<RW(H))。ここで、一例として実施の形態と同様に、配線幅の相違によって抵抗値を異ならせるとすると、低ビット側のサブ画素10ALでは、黒電位線LB(L)の配線幅Wb(L)が、白電位線LW(L)の配線幅Ww(L)と比べて太くなっている(Wb(L)>Ww(L))。同様に、高ビット側のサブ画素10AHでは、黒電位線LB(H)の配線幅Wb(H)が、白電位線LW(H)の配線幅Ww(H)と比べて太くなっている(Wb(H)>Ww(H))。
(Composition and action of characteristic parts)
Here, also in the present modification, as in the embodiment, the resistance value of the black potential line holding the black gradation potential having a relatively steep luminance gradient is a white floor having a relatively gradual luminance gradient. It is lower than the resistance value of the white potential line holding the potential adjustment. Specifically, in the sub-pixel 10AL on the low bit side, the resistance value RB (L) of the black potential line LB (L) is lower than the resistance value RW (L) of the white potential line LW (L). (RB (L) <RW (L)). Similarly, in the sub-pixel 10AH on the high bit side, the resistance value RB (H) of the black potential line LB (H) is lower than the resistance value RW (H) of the white potential line LW (H) ( RB (H) <RW (H)). Here, as an example, in the same manner as in the embodiment, if the resistance value is made different depending on the wiring width, the wiring width Wb (L) of the black potential line LB (L) in the sub-pixel 10AL on the low bit side is The white potential line LW (L) is thicker than the wiring width Ww (L) (Wb (L)> Ww (L)). Similarly, in the sub-pixel 10AH on the high bit side, the wiring width Wb (H) of the black potential line LB (H) is thicker than the wiring width Ww (H) of the white potential line LW (H) ( Wb (H)> Ww (H)).

また、本変形例では、高ビット側の黒電位線LB(H)の抵抗値RB(H)が、低ビット側の黒電位線LB(L)の抵抗値RB(L)以下となっている(RB(H)≦RB(L))。同様に、高ビット側の白電位線LW(H)の抵抗値RW(H)が、低ビット側の白電位線LW(L)の抵抗値RW(L)以下となっている(RW(H)≦RW(L))。ここで、一例として実施の形態と同様に、配線幅の相違によって抵抗値を異ならせるとすると、高ビット側の黒電位線LB(H)の配線幅Wb(H)が、低ビット側の黒電位線LB(L)の配線幅Wb(L)以上の太さとなっている(Wb(H)≧Wb(L))。同様に、高ビット側の白電位線LW(H)の配線幅Ww(H)が、低ビット側の白電位線LW(L)の配線幅Ww(L)以上の太さとなっている(Ww(H)≧Ww(L))。   In this modification, the resistance value RB (H) of the black potential line LB (H) on the high bit side is equal to or lower than the resistance value RB (L) of the black potential line LB (L) on the low bit side. (RB (H) ≦ RB (L)). Similarly, the resistance value RW (H) of the white potential line LW (H) on the high bit side is equal to or lower than the resistance value RW (L) of the white potential line LW (L) on the low bit side (RW (H ) ≦ RW (L)). Here, as an example, as in the embodiment, if the resistance value is made different depending on the wiring width, the wiring width Wb (H) of the black potential line LB (H) on the high bit side is equal to the black voltage on the low bit side. The thickness is equal to or larger than the wiring width Wb (L) of the potential line LB (L) (Wb (H) ≧ Wb (L)). Similarly, the wiring width Ww (H) of the white potential line LW (H) on the high bit side is larger than the wiring width Ww (L) of the white potential line LW (L) on the low bit side (Ww). (H) ≧ Ww (L)).

以上のことをまとめると、本変形例では、黒電位線LB(L),LB(H)の抵抗値RB(L),RB(H)および配線幅Wb(L),Wb(H)と、白電位線LW(L),LW(H)の抵抗値RW(L),RW(H)および配線幅Ww(L),Ww(H)とについて、例えば図12(A)〜(C)に示した条件式を満たす場合が挙げられる。   In summary, in the present modification, the resistance values RB (L) and RB (H) and the wiring widths Wb (L) and Wb (H) of the black potential lines LB (L) and LB (H) The resistance values RW (L) and RW (H) and the wiring widths Ww (L) and Ww (H) of the white potential lines LW (L) and LW (H) are shown in FIGS. A case where the conditional expression shown is satisfied is given.

すなわち、まず、図12(A)に示した例では、以下の(1)式(一例として以下の(2)式)を満たしている。
RB(H)<RB(L)<RW(H)<RW(L) ……(1)
Wb(H)>Wb(L)>Ww(H)>Ww(L) ……(2)
That is, first, in the example shown in FIG. 12A, the following expression (1) (as an example, the following expression (2)) is satisfied.
RB (H) <RB (L) <RW (H) <RW (L) (1)
Wb (H)> Wb (L)> Ww (H)> Ww (L) (2)

また、図12(B)に示した例では、以下の(3)式(一例として以下の(4)式)を満たしている。
RB(H)<RB(L)<RW(H)=RW(L) ……(3)
Wb(H)>Wb(L)>Ww(H)=Ww(L) ……(4)
In the example shown in FIG. 12B, the following expression (3) (for example, the following expression (4)) is satisfied.
RB (H) <RB (L) <RW (H) = RW (L) (3)
Wb (H)> Wb (L)> Ww (H) = Ww (L) (4)

更に、図12(C)に示した例では、以下の(5)式(一例として以下の(6)式)を満たしている。
RB(H)=RB(L)<RW(H)=RW(L) ……(5)
Wb(H)=Wb(L)>Ww(H)=Ww(L) ……(6)
Further, in the example shown in FIG. 12C, the following expression (5) (for example, the following expression (6)) is satisfied.
RB (H) = RB (L) <RW (H) = RW (L) (5)
Wb (H) = Wb (L)> Ww (H) = Ww (L) (6)

以上のように本変形例では、RB(H)≦RB(L)およびRW(H)≦RW(L)を満たすようにしたので、上記実施の形態における効果に加え、複数ビットの映像信号を用いて多階調表示を行う場合において特に以下の効果を得ることも可能となる。すなわち、まず、表示領域(画素電極)における面積の重み付けを考慮すると、高ビット側のサブ画素10AHにおける階調表示の際の輝度変動のほうが、低ビット側のサブ画素10ALにおける階調表示の際の輝度変動と比べて見え易い(表示画質低下の影響が大きい)。このことから、上記のように、高ビット側の電位線の抵抗値を、高ビット側の電位線の抵抗値以下(望ましくは、高ビット側の電位線の抵抗値未満)とすることによって、高ビット側での輝度変動を優先的に抑えることができ、表示画質を更に向上させることが可能となる。   As described above, in the present modification, RB (H) ≦ RB (L) and RW (H) ≦ RW (L) are satisfied, so in addition to the effects in the above embodiment, a video signal of a plurality of bits is converted. In particular, the following effects can be obtained when multi-gradation display is used. That is, first, considering the weighting of the area in the display region (pixel electrode), the luminance variation at the time of gradation display in the sub-pixel 10AH on the high bit side is more suitable for the gradation display on the sub-pixel 10AL on the low bit side. It is easy to see compared with the luminance fluctuation of (the influence of the display image quality deterioration is great). Therefore, as described above, by setting the resistance value of the high bit side potential line to be equal to or lower than the resistance value of the high bit side potential line (desirably, less than the resistance value of the high bit side potential line), Luminance fluctuation on the high bit side can be preferentially suppressed, and the display image quality can be further improved.

なお、本変形例では、実施の形態と同様に配線幅の相違によって電位線同士の抵抗値を異ならせる場合について説明したが、これには限られず、上記変形例1と同様に、抵抗率(配線の構成材料)の相違によって電位線同士の抵抗値を異ならせるようにしてもよい。   In the present modification, the case where the resistance values of the potential lines are made different depending on the wiring width as in the embodiment has been described. However, the present invention is not limited to this, and as in the first modification, the resistivity ( The resistance values of the potential lines may be varied depending on the difference in the constituent materials of the wiring.

また、本変形例では、映像信号が2ビットの信号からなる場合について説明したが、これには限られず、映像信号が3ビット以上の信号からなるようにしてもよい。   In this modification, the case where the video signal is made up of a 2-bit signal has been described. However, the present invention is not limited to this, and the video signal may be made up of a signal of 3 bits or more.

<適用例>
続いて、図13〜図17を参照して、上記実施の形態および変形例で説明した表示装置1の適用例について説明する。上記実施の形態等の表示装置1は、テレビジョン装置,デジタルカメラ,ノート型パーソナルコンピュータ、携帯電話等の携帯端末装置あるいはビデオカメラなどのあらゆる分野の電子機器に適用することが可能である。言い換えると、この表示装置1は、外部から入力された映像信号あるいは内部で生成した映像信号を、画像あるいは映像として表示するあらゆる分野の電子機器に適用することが可能である。
<Application example>
Subsequently, application examples of the display device 1 described in the above embodiment and the modified examples will be described with reference to FIGS. The display device 1 according to the above-described embodiment can be applied to electronic devices in various fields such as a television device, a digital camera, a notebook personal computer, a mobile terminal device such as a mobile phone, or a video camera. In other words, the display device 1 can be applied to electronic devices in various fields that display a video signal input from the outside or a video signal generated inside as an image or video.

(適用例1)
図13は、表示装置1が適用されるテレビジョン装置の外観を表したものである。このテレビジョン装置は、例えば、フロントパネル310およびフィルターガラス320を含む映像表示画面部300を有しており、この映像表示画面部300が表示装置1により構成されている。
(Application example 1)
FIG. 13 illustrates an appearance of a television device to which the display device 1 is applied. The television device has a video display screen unit 300 including a front panel 310 and a filter glass 320, for example, and the video display screen unit 300 is configured by the display device 1.

(適用例2)
図14は、表示装置1が適用されるデジタルカメラの外観を表したものである。このデジタルカメラは、例えば、フラッシュ用の発光部410、表示部420、メニュースイッチ430およびシャッターボタン440を有しており、この表示部420が表示装置1により構成されている。
(Application example 2)
FIG. 14 shows the appearance of a digital camera to which the display device 1 is applied. The digital camera includes, for example, a flash light emitting unit 410, a display unit 420, a menu switch 430, and a shutter button 440, and the display unit 420 includes the display device 1.

(適用例3)
図15は、表示装置1が適用されるノート型パーソナルコンピュータの外観を表したものである。このノート型パーソナルコンピュータは、例えば、本体510,文字等の入力操作のためのキーボード520および画像を表示する表示部530を有しており、この表示部530が表示装置1により構成されている。
(Application example 3)
FIG. 15 shows the appearance of a notebook personal computer to which the display device 1 is applied. The notebook personal computer includes, for example, a main body 510, a keyboard 520 for inputting characters and the like, and a display unit 530 that displays an image. The display unit 530 is configured by the display device 1.

(適用例4)
図16は、表示装置1が適用されるビデオカメラの外観を表したものである。このビデオカメラは、例えば、本体部610,この本体部610の前方側面に設けられた被写体撮影用のレンズ620,撮影時のスタート/ストップスイッチ630および表示部640を有している。そして、この表示部640が表示装置1により構成されている。
(Application example 4)
FIG. 16 shows the appearance of a video camera to which the display device 1 is applied. This video camera includes, for example, a main body 610, a subject photographing lens 620 provided on the front side surface of the main body 610, a start / stop switch 630 at the time of photographing, and a display 640. The display unit 640 includes the display device 1.

(適用例5)
図17は、表示装置1が適用される携帯電話機の外観を表したものである。この携帯電話機は、例えば、上側筐体710と下側筐体720とを連結部(ヒンジ部)730で連結したものであり、ディスプレイ740,サブディスプレイ750,ピクチャーライト760およびカメラ770を有している。そして、これらのうちのディスプレイ740またはサブディスプレイ750が、表示装置1により構成されている。
(Application example 5)
FIG. 17 shows the appearance of a mobile phone to which the display device 1 is applied. For example, the mobile phone is obtained by connecting an upper housing 710 and a lower housing 720 with a connecting portion (hinge portion) 730, and includes a display 740, a sub-display 750, a picture light 760, and a camera 770. Yes. Of these, the display 740 or the sub-display 750 is constituted by the display device 1.

<その他の変形例>
以上、実施の形態、変形例および適用例を挙げて本技術を説明したが、本技術はこれらの実施の形態等に限定されず、種々の変形が可能である。
<Other variations>
Although the present technology has been described with the embodiment, the modification, and the application example, the present technology is not limited to the embodiment and the like, and various modifications can be made.

例えば、上記実施の形態等では、液晶素子LCがノーマリーホワイトモードの液晶素子からなる場合について説明したが、これには限られず、液晶素子LCがノーマリーブラックモードの液晶素子からなるようにしてもよい。この場合、前述した輝度勾配における黒電位線LBと白電位線LWとの関係が逆になる(白階調電位のほうが、黒階調電位と比べて相対的に輝度勾配が急峻となる)。したがって、この場合には、上記実施の形態等とは逆に、白電位線LW(第1の電位線)の抵抗値RWが、黒電位線LB(第2の電位線)の抵抗値RBと比べて低くなるようにすればよい(RW<RB)。   For example, in the above-described embodiment, the case where the liquid crystal element LC is formed of a normally white mode liquid crystal element has been described. However, the present invention is not limited thereto, and the liquid crystal element LC is formed of a normally black mode liquid crystal element. Also good. In this case, the relationship between the black potential line LB and the white potential line LW in the luminance gradient described above is reversed (the white gradient potential is relatively steeper than the black gradation potential). Therefore, in this case, contrary to the above-described embodiment, the resistance value RW of the white potential line LW (first potential line) is equal to the resistance value RB of the black potential line LB (second potential line). What is necessary is just to make it low compared (RW <RB).

また、上記実施の形態等では、複数種類の電位線が、黒階調電位を保持する黒電位線LBと白階調電位を保持する白電位線LWとの2種類の電位線からなる場合について説明したが、この場合には限られず、3種類以上の電位線を用いて映像表示を行ってもよい。   In the above-described embodiment and the like, a case where a plurality of types of potential lines are composed of two types of potential lines, a black potential line LB that holds a black gradation potential and a white potential line LW that holds a white gradation potential. Although described, the present invention is not limited to this case, and video display may be performed using three or more types of potential lines.

更に、上記実施の形態等では、各画素内の記憶回路が、SRAM回路からなる場合について説明したが、これには限られず、例えばDRAM(Dynamic Random Access Memory)等の他の記憶回路を用いてもよい。つまり、本技術は、複数種類の電位線から選択的に供給された電位に応じて表示素子の階調が決定される、あらゆる表示装置に対して適用し得る。   Further, in the above-described embodiment, the case where the storage circuit in each pixel is an SRAM circuit has been described. However, the present invention is not limited to this. For example, another storage circuit such as a DRAM (Dynamic Random Access Memory) is used. Also good. That is, the present technology can be applied to any display device in which the gradation of the display element is determined according to the potential selectively supplied from a plurality of types of potential lines.

加えて、上記実施の形態等(実施の形態、変形例1,2等)で説明した各構成を、任意に組み合わせてもよい。   In addition, the configurations described in the above embodiments and the like (embodiments, modified examples 1 and 2) may be arbitrarily combined.

また、上記実施の形態等では、各画素における表示素子が液晶素子LCである場合(液晶表示装置である場合)について説明したが、この場合には限られない。すなわち、表示素子が、例えば有機EL素子等の他の表示素子から構成されていてもよい(他の表示方式の表示装置であってもよい)。なお、この有機EL素子の場合には、印加電圧または/および印加電流と表示輝度との関係によって、前述した輝度勾配が規定されることになる。すなわち、他の表示素子においても、上記実施の形態等で述べたのと同様、各電位線から供給される階調電位と、表示素子への印加電圧または印加電流の変動量に対する表示輝度の変動量に対応する輝度勾配の関係に応じて、各電位線の抵抗値を調整することで、本技術を適用可能である。なお、その場合の表示素子の輝度とは、自発光型の表示装置においては例えば各画素の発光強度、電気泳動型の電子ペーパーにおいては例えば各画素の明度といった形で、その表示素子の画素の特性に応じて規定し得る。   In the above-described embodiment and the like, the case where the display element in each pixel is the liquid crystal element LC (in the case of a liquid crystal display device) has been described. That is, the display element may be composed of another display element such as an organic EL element (may be a display device of another display method). In the case of this organic EL element, the aforementioned luminance gradient is defined by the relationship between the applied voltage or / and the applied current and the display luminance. That is, in other display elements as well, as described in the above embodiments and the like, fluctuations in display luminance with respect to gradation potentials supplied from the respective potential lines and fluctuation amounts of applied voltage or applied current to the display elements. The present technology can be applied by adjusting the resistance value of each potential line according to the relationship of the luminance gradient corresponding to the quantity. Note that the luminance of the display element in that case is, for example, the light emission intensity of each pixel in a self-luminous display device, and the brightness of each pixel in an electrophoretic electronic paper, for example. It can be defined according to characteristics.

なお、本技術は以下のような構成を取ることも可能である。
(1)
表示素子を含む複数の画素と、
互いに異なる階調電位を保持する複数種類の電位線と、
前記複数種類の電位線のうちの選択された1種の電位線の階調電位が前記表示素子に対して供給されるように、映像信号に基づいて各画素の表示駆動を行う駆動部と
を備え、
前記表示素子への印加電圧または印加電流の変動量に対する表示輝度の変動量に対応する輝度勾配が相対的に急峻である階調電位を保持する第1の電位線の抵抗値が、前記輝度勾配が相対的に緩やかである階調電位を保持する第2の電位線の抵抗値と比べて低くなっている
表示装置。
(2)
前記第1の電位線の配線幅が、前記第2の電位線の配線幅と比べて太くなっている
前記(1)に記載の表示装置。
(3)
前記第1の電位線における少なくとも一部の配線の抵抗率が、前記第2の電位線の抵抗率と比べて低くなっている
前記(1)または(2)に記載の表示装置。
(4)
前記第1の電位線が、
前記第2の電位線と同一層内に形成され、前記第2の電位線と同一材料からなる高抵抗率配線と、
前記第2の電位線と異なる層内において前記高抵抗率層と電気的に接続されるように形成され、前記第2の電位線よりも抵抗率の低い材料からなる低抵抗率配線と
により構成されている
前記(3)に記載の表示装置。
(5)
前記低抵抗率配線が複数設けられると共に、これら複数の低抵抗率配線が、前記複数の画素に対して間引き配置されている
前記(4)に記載の表示装置。
(6)
前記映像信号が複数ビットの信号からなり、
各画素は、前記映像信号における各ビットの重み付けに対応した面積の表示領域を有する複数のサブ画素を含み、
前記第1および第2の電位線がそれぞれ、前記映像信号における各ビットごとに個別に設けられると共に、高ビット側に対応する第1および第2の電位線の抵抗値が、低ビット側に対応する第1および第2の電位線の抵抗値以下となっている
前記(1)に記載の表示装置。
(7)
前記高ビット側に対応する第1および第2の電位線の配線幅が、前記低ビット側に対応する第1および第2の電位線の配線幅以上の太さとなっている
前記(6)に記載の表示装置。
(8)
前記複数種類の電位線が、黒階調電位を保持する黒電位線と、白階調電位を保持する白電位線とからなり、
前記駆動部は、前記黒階調電位および前記白階調電位のうちの選択された一方の階調電位が前記表示素子に対して供給されるように、前記表示駆動を行う
前記(1)ないし(7)のいずれか1項に記載の表示装置。
(9)
前記第1の電位線が前記黒電位線であると共に、前記第2の電位線が前記白電位線である
前記(8)に記載の表示装置。
(10)
各画素は、
前記表示素子と、
前記映像信号に基づいて前記1種の電位線の階調電位を選択し、前記表示素子へ供給する画素回路と
を有する前記(1)ないし(9)のいずれか1項に記載の表示装置。
(11)
前記画素回路は、前記映像信号を記憶する記憶回路を含む
前記(10)に記載の表示装置。
(12)
前記表示素子が、液晶表示素子である
前記(1)ないし(11)のいずれか1項に記載の表示装置。
(13)
表示装置を備え、
前記表示装置は、
表示素子を含む複数の画素と、
互いに異なる階調電位を保持する複数種類の電位線と、
前記複数種類の電位線のうちの選択された1種の電位線の階調電位が前記表示素子に対して供給されるように、映像信号に基づいて各画素の表示駆動を行う駆動部と
を有し、
前記表示素子への印加電圧または印加電流の変動量に対する表示輝度の変動量に対応する輝度勾配が相対的に急峻である階調電位を保持する第1の電位線の抵抗値が、前記輝度勾配が相対的に緩やかである階調電位を保持する第2の電位線の抵抗値と比べて低くなっている
電子機器。
In addition, this technique can also take the following structures.
(1)
A plurality of pixels including a display element;
A plurality of types of potential lines holding different gradation potentials;
A driving unit that performs display driving of each pixel based on a video signal so that a gradation potential of one type of potential line selected from the plurality of types of potential lines is supplied to the display element; Prepared,
The resistance value of the first potential line holding the gradation potential having a relatively steep luminance gradient corresponding to the variation amount of the display luminance with respect to the variation amount of the applied voltage or applied current to the display element is the luminance gradient. The display device is lower than the resistance value of the second potential line which holds a relatively gentle gradation potential.
(2)
The display device according to (1), wherein a wiring width of the first potential line is larger than a wiring width of the second potential line.
(3)
The display device according to (1) or (2), wherein a resistivity of at least a part of the wiring in the first potential line is lower than a resistivity of the second potential line.
(4)
The first potential line is
A high resistivity wiring formed in the same layer as the second potential line and made of the same material as the second potential line;
A low resistivity wiring made of a material having a lower resistivity than that of the second potential line, which is formed so as to be electrically connected to the high resistivity layer in a layer different from the second potential line. The display device according to (3).
(5)
The display device according to (4), wherein a plurality of the low resistivity wirings are provided, and the plurality of low resistivity wirings are thinned out with respect to the plurality of pixels.
(6)
The video signal comprises a multi-bit signal,
Each pixel includes a plurality of sub-pixels having a display area having an area corresponding to the weighting of each bit in the video signal,
The first and second potential lines are individually provided for each bit in the video signal, and the resistance values of the first and second potential lines corresponding to the high bit side correspond to the low bit side. The display device according to (1), wherein the display device is equal to or less than a resistance value of the first and second potential lines.
(7)
The wiring width of the first and second potential lines corresponding to the high bit side is larger than the wiring width of the first and second potential lines corresponding to the low bit side. The display device described.
(8)
The plurality of types of potential lines are composed of a black potential line holding a black gradation potential and a white potential line holding a white gradation potential,
The driving unit performs the display driving so that one selected from the black gradation potential and the white gradation potential is supplied to the display element. The display device according to any one of (7).
(9)
The display device according to (8), wherein the first potential line is the black potential line, and the second potential line is the white potential line.
(10)
Each pixel is
The display element;
The display device according to any one of (1) to (9), further comprising: a pixel circuit that selects a gradation potential of the one type of potential line based on the video signal and supplies the selected potential potential to the display element.
(11)
The display device according to (10), wherein the pixel circuit includes a storage circuit that stores the video signal.
(12)
The display device according to any one of (1) to (11), wherein the display element is a liquid crystal display element.
(13)
A display device,
The display device
A plurality of pixels including a display element;
A plurality of types of potential lines holding different gradation potentials;
A driving unit that performs display driving of each pixel based on a video signal so that a gradation potential of one type of potential line selected from the plurality of types of potential lines is supplied to the display element; Have
The resistance value of the first potential line holding the gradation potential having a relatively steep luminance gradient corresponding to the variation amount of the display luminance with respect to the variation amount of the applied voltage or applied current to the display element is the luminance gradient. Is lower than the resistance value of the second potential line that holds the gradation potential that is relatively gentle.

1…表示装置、10,10−1,10−2,10A…画素、10AL,10AH…サブ画素、11…表示領域、121,122…走査線駆動回路、13…信号線駆動回路、14…接続用端子、2…画素回路、20,20L,20H…画素電極、21…記憶回路(メモリ回路)、3…液晶表示パネル、4…バックライト、G,G1,G2,GL,GH…走査線、S,SL,SH…信号線、VCOM…共通電位線(対向電位線)、LB,LB1,LB2,LB(L),LB(H)…黒電位線、LW,LW(L),LW(H)…白電位線、LC…液晶素子、Tr1〜Tr7,Tr1L,Tr1H…TFT素子、VDD…電源電位、VSS…接地電位、Wb,Ww,Wb(L),Wb(H),Ww(L),Ww(H)…配線幅、ρ1,ρ2…抵抗率、S(L),S(H)…面積、RB(L),RB(H),RW(L),RW(H)…抵抗値。
DESCRIPTION OF SYMBOLS 1 ... Display apparatus 10, 10-1, 10-2, 10A ... Pixel, 10AL, 10AH ... Sub pixel, 11 ... Display area, 121, 122 ... Scan line drive circuit, 13 ... Signal line drive circuit, 14 ... Connection Terminal, 2 ... pixel circuit, 20, 20L, 20H ... pixel electrode, 21 ... memory circuit (memory circuit), 3 ... liquid crystal display panel, 4 ... backlight, G, G1, G2, GL, GH ... scanning line, S, SL, SH: signal line, VCOM: common potential line (opposing potential line), LB, LB1, LB2, LB (L), LB (H) ... black potential line, LW, LW (L), LW (H ) ... White potential line, LC ... Liquid crystal element, Tr1 to Tr7, Tr1L, Tr1H ... TFT element, VDD ... Power supply potential, VSS ... Ground potential, Wb, Ww, Wb (L), Wb (H), Ww (L) , Ww (H): wiring width, ρ1, ρ2: resistivity, S (L), S (H)... Area, RB (L), RB (H), RW (L), RW (H).

Claims (7)

表示領域内にそれぞれ配置された複数の画素と、
表示領域内にそれぞれ配置され、互いに異なる階調電位を保持する複数種類の表示領域内電位線と、
を備え、
前記複数の画素の各々は、
表示素子と、
映像信号を記憶する記憶回路を含み、前記複数種類の表示領域内電位線のうちの前記記憶回路に基づいて選択された1種の表示領域内電位線の階調電位が前記表示素子に対して供給されるように、各画素の表示駆動を行う画素回路と、
を含み、
前記表示素子への印加電圧または印加電流の変動量に対する表示輝度の変動量に対応する輝度勾配が相対的に急峻である階調電位を保持する第1の表示領域内電位線の抵抗値が、前記輝度勾配が相対的に緩やかである階調電位を保持する第2の表示領域内電位線の抵抗値と比べて低くなっている
表示装置。
A plurality of pixels respectively arranged in the display area;
A plurality of types of display area potential lines that are arranged in the display area and hold different gradation potentials;
With
Each of the plurality of pixels is
A display element;
Including a storage circuit for storing a video signal, and a gradation potential of one type of display area potential line selected based on the storage circuit among the plurality of types of display area potential lines is applied to the display element; A pixel circuit for driving the display of each pixel,
Including
A resistance value of a potential line in the first display area that holds a gradation potential having a relatively steep luminance gradient corresponding to a variation amount of display luminance with respect to a variation amount of applied voltage or applied current to the display element, The display device, wherein the brightness gradient is lower than a resistance value of a potential line in the second display region that holds a gradation potential that is relatively gentle.
前記第1の表示領域内電位線の配線幅が、前記第2の表示領域内電位線の配線幅と比べて太くなっている
請求項1に記載の表示装置。
The wiring width of the first display area potential line, the display device according to claim 1 which is thicker than the wiring width of the second display region potential line.
前記第1の表示領域内電位線における少なくとも一部の配線の抵抗率が、前記第2の表示領域内電位線の抵抗率と比べて低くなっている
請求項1に記載の表示装置。
The display device according to claim 1, wherein a resistivity of at least a part of the wiring in the first display area potential line is lower than a resistivity of the second display area potential line.
前記第1の表示領域内電位線が、
前記第2の表示領域内電位線と同一層内に形成され、前記第2の表示領域内電位線と同一材料からなる高抵抗率配線と、
前記第2の表示領域内電位線と異なる層内において前記高抵抗率配線と電気的に接続されるように形成され、前記第2の表示領域内電位線よりも抵抗率の低い材料からなる低抵抗率配線と
により構成されている
請求項3に記載の表示装置。
The potential line in the first display area is
Wherein formed on the second display potential line in the same layer region, and the high resistivity wiring made of the same material as the second display region potential line,
A low-resistance material formed so as to be electrically connected to the high resistivity wiring in a layer different from the second display region potential line and having a lower resistivity than the second display region potential line. The display device according to claim 3, comprising: a resistivity wiring.
前記低抵抗率配線が複数設けられると共に、これら複数の低抵抗率配線が、前記複数の画素に対して間引き配置されている
請求項4に記載の表示装置。
The display device according to claim 4, wherein a plurality of the low resistivity wirings are provided, and the plurality of low resistivity wirings are thinned out with respect to the plurality of pixels.
前記複数種類の表示領域内電位線が、黒階調電位を保持する黒電位線と、白階調電位を保持する白電位線とからなり、
前記黒階調電位および前記白階調電位のうちの選択された一方の階調電位が前記表示素子に対して供給されるように、前記表示駆動を行う駆動部を更に備える、
請求項1に記載の表示装置。
The plurality of types of display area potential lines are composed of a black potential line holding a black gradation potential and a white potential line holding a white gradation potential,
A drive unit that performs the display drive so that one selected from the black gradation potential and the white gradation potential is supplied to the display element;
The display device according to claim 1.
前記第1の表示領域内電位線が前記黒電位線であると共に、前記第2の表示領域内電位線が前記白電位線である
請求項6に記載の表示装置。
The display device according to claim 6, wherein the first display area potential line is the black potential line, and the second display area potential line is the white potential line.
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