JP6051924B2 - 情報処理装置の制御方法、制御プログラム、情報処理装置 - Google Patents
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Description
図1、図2を参照して、マルチコアCPU(以下、CPUとする)の稼働コア数と消費電力との関係を説明する。ここでは、マルチコアCPUとして、2つのコアを有する、所謂デュアルコアCPUを使用することとする。
以下、図3〜図13を参照して、第1の実施形態にかかる携帯情報端末100を説明する。本実施形態では、携帯情報端末100として、例えばスマートフォンやタブレットPC(Personal Computer)等を使用しても良い。又、携帯情報端末100に搭載されるOS(Operating System)として、Android(登録商標)を使用しても良い。Androidは、OSカーネルと、アプリケーションフレームワーク/ライブラリと、を含み、本実施形態にかかる制御プログラムは、アプリケーションフレームワーク/ライブラリに組み込まれる。但し、本発明の態様は、これに限定されるものではなく、Android以外のOSを採用しても良い。さらに、本実施形態にかかる制御プログラムを、アプリケーションフレームワーク/ライブラリ以外に組み込んでも良い。
図3は、第1の実施形態にかかる携帯情報端末100のハードウェア構成の概略図である。
図4は、第1の実施形態にかかる携帯情報端末100の機能ブロックの概略図である。
図5は、第1の実施形態にかかるアプリ/サービス動作情報301の概略図である。
図6は、第1の実施形態にかかるCPUコア制御パラメータ情報302の概略図である。
図7は、第1の実施形態にかかるCPU制御情報303の概略図である。
図8は、第1の実施形態にかかるプロセス動作情報304の概略図である。
図9は、第1の実施形態にかかるシステム状態情報305の概略図である。
図10は、第1の実施形態にかかるCPUコア制御判定処理のフローチャートである。
図11は、第1の実施形態にかかるコア増加判定処理のフローチャートである。
図12は、第1の実施形態にかかるスレッド負荷計測処理のフローチャートである。
図13は、第1の実施形態にかかるコア減少判定処理のフローチャートである。
以下、図14〜図17を参照して、第2の実施形態にかかる携帯情報端末100Aを説明する。
図14は、第2の実施形態にかかる携帯情報端末100Aのハードウェア構成の概略図である。
図15は、第2の実施形態にかかる携帯情報端末100Aの機能ブロックの概略図である。
図16は、第2の実施形態にかかるCPUコア制御パラメータ情報302Aの概略図である。
図17は、第2の実施形態にかかるシステム状態情報305Aの概略図である。
第1の実施形態にかかるCPUコア制御判定部202は、CPU101の稼働コアが1つであるか否かを判断する(ステップS011)。ここで、CPU101の稼働コアが1つであると判断された場合(ステップS011のYes)、CPUコア制御判定部202は、稼働コアが1つであるときの制御パラメータを取得する(ステップS012)。
100A:携帯情報端末
101:CPU
101A:CPU
102:メインメモリ
103:補助メモリ
104:クロック供給回路
105:電圧供給回路
106:ディスプレイ
107:タッチスクリーン
108:バス
201:アプリ実行管理部
202:CPUコア制御判定部
202A:CPUコア制御判定部
203:システム負荷計測部
204:スレッド負荷計測部
205:CPU周波数制御部
206:CPU周波数/状態設定部
207:プロセス/システム管理部
208:CPU状態制御部
209:タイマ部
301:アプリ/サービス動作情報
302:CPUコア制御パラメータ情報
302A:CPUコア制御パラメータ情報
303:CPU制御情報
304:プロセス動作情報
305:システム状態情報
305A:システム状態情報
1011:コア0
1012:コア1
1013:コア2
1014:コア3
Claims (6)
- マルチコアCPUの負荷状況に基づき、稼働コアの個数を増減させる情報処理装置の制御方法に於いて、
前記マルチコアCPUの稼働コアの個数がM個であるときの消費電力が、前記稼働コアの個数がM+N個であるときに前記マルチコアCPUを最低動作周波数で動作させたときの消費電力よりも小さい場合、前記稼働コアの個数のM個からM+N個への増加を禁止し、
前記マルチコアCPUの稼働コアの個数がM個であるときの消費電力が、前記稼働コアの個数がM+N個であるときの前記マルチコアCPUを最低動作周波数で動作させたときの消費電力よりも大きい場合、前記マルチコアCPUにより実行されるスレッド数に関する指標を算出し、前記スレッド数に関する指標に基づき、前記稼働コアの個数をM個からM+N個に増加するかどうかを判断する、情報処理装置の制御方法。 - 請求項1に記載の情報処理装置の制御方法に於いて、
前記マルチコアCPUの動作周波数に基づき、前記マルチコアCPUの稼働コアの個数がM個であるときの消費電力が、前記稼働コアの個数がM+N個であるときに前記マルチコアCPUを最低動作周波数で動作させたときの消費電力よりも小さいかどうかを判断する、情報処理装置の制御方法。 - 請求項1又は2に記載の情報処理装置の制御方法に於いて、
前記マルチコアCPUにより実行されるスレッド毎のCPU負荷を取得し、
前記CPU負荷がしきい値以上であるスレッド数を前記スレッド数に関する指標とする、情報処理装置の制御方法。 - 請求項3に記載の情報処理装置の制御方法に於いて、
前記CPU負荷がしきい値以上であるスレッド数がM個以下である場合、前記稼働コアの個数のM個からM+N個への増加を禁止する、情報処理装置の制御方法。 - マルチコアCPUの負荷状況に基づき、稼働コアの個数を増減させる情報処理装置の制御プログラムに於いて、
前記制御プログラムは、前記情報処理装置に、
前記マルチコアCPUの稼働コアの個数がM個であるときの消費電力が、前記稼働コアの個数がM+N個であるときに前記マルチコアCPUを最低動作周波数で動作させたときの消費電力よりも小さい場合、前記稼働コアの個数をM個からM+N個に増加させず、
前記マルチコアCPUの稼働コアの個数がM個であるときの消費電力が、前記稼働コアの個数がM+N個であるときの前記マルチコアCPUを最低動作周波数で動作させたときの消費電力よりも大きい場合、前記マルチコアCPUにより実行されるスレッド数に関する指標を算出し、前記スレッド数に関する指標に基づき、前記稼働コアの個数をM個からM+N個に増加するかどうかを判断する、情報処理装置の制御プログラム。 - マルチコアCPUの負荷状況に基づき、稼働コアの個数を増減させる情報処理装置に於いて、
前記マルチコアCPUの稼働コアの個数がM個であるときの消費電力が、前記稼働コアの個数がM+N個であるときに前記マルチコアCPUを最低動作周波数で動作させたときの消費電力よりも小さい場合、前記稼働コアの個数をM個からM+N個に増加させず、前記マルチコアCPUの稼働コアの個数がM個であるときの消費電力が、前記稼働コアの個数がM+N個であるときの前記マルチコアCPUを最低動作周波数で動作させたときの消費電力よりも大きい場合、前記マルチコアCPUにより実行されるスレッド数に関する指標を算出し、前記スレッド数に関する指標に基づき、前記稼働コアの個数をM個からM+N個に増加するかどうかを判断するCPUコア制御判定部を備える、情報処理装置。
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