JP5152715B2 - Three-dimensional fine processing method and three-dimensional fine structure - Google Patents

Three-dimensional fine processing method and three-dimensional fine structure Download PDF

Info

Publication number
JP5152715B2
JP5152715B2 JP2007246322A JP2007246322A JP5152715B2 JP 5152715 B2 JP5152715 B2 JP 5152715B2 JP 2007246322 A JP2007246322 A JP 2007246322A JP 2007246322 A JP2007246322 A JP 2007246322A JP 5152715 B2 JP5152715 B2 JP 5152715B2
Authority
JP
Japan
Prior art keywords
iii
dimensional
substrate
electron beam
group
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Active
Application number
JP2007246322A
Other languages
Japanese (ja)
Other versions
JP2009076795A (en
Inventor
忠昭 金子
一宏 松田
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Kwansei Gakuin Educational Foundation
Original Assignee
Kwansei Gakuin Educational Foundation
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Kwansei Gakuin Educational Foundation filed Critical Kwansei Gakuin Educational Foundation
Priority to JP2007246322A priority Critical patent/JP5152715B2/en
Publication of JP2009076795A publication Critical patent/JP2009076795A/en
Application granted granted Critical
Publication of JP5152715B2 publication Critical patent/JP5152715B2/en
Active legal-status Critical Current
Anticipated expiration legal-status Critical

Links

Landscapes

  • Optical Integrated Circuits (AREA)
  • Drying Of Semiconductors (AREA)
  • Physical Deposition Of Substances That Are Components Of Semiconductor Devices (AREA)
  • Semiconductor Lasers (AREA)

Description

本発明は、基板の表面に形成されたIII−V族化合物層の表面、又はIII−V族化合物基板の表面に微細構造を形成する三次元微細加工方法に関する。   The present invention relates to a three-dimensional microfabrication method for forming a microstructure on the surface of a group III-V compound layer formed on the surface of a substrate or the surface of a group III-V compound substrate.

光リソグラフィーを中心とする現在の半導体微細加工は技術的限界に達しており、半導体関連産業が今後も主たる経済産業分野の牽引役として持続するには、新しいパラダイムに基づいた方法論の展開が急務である。その1つがナノテクノロジーであり、光リソグラフィー技術が抱える装置限界(複雑化・巨大化・高コスト化)の呪縛から解き放つものと期待されている。   The current semiconductor microfabrication centering on optical lithography has reached the technological limit, and in order for the semiconductor-related industry to continue to be the main driver of the economic and industrial field, it is urgent to develop a methodology based on a new paradigm. is there. One of them is nanotechnology, which is expected to release the device limitations (complexity, enlargement, and cost) of optical lithography technology.

ターゲットとなるべき技術課題とは、少量多品種型生産を可能(設計変更容易・低コスト)にする三次元ナノ微細化技術の開発である。とくに“光・電子デバイス”展開の観点からは、求められるプロセス機能として無損傷・無汚染が前提となり、さらに“一括デバイス化”と“その場制御化”が必要になる。   The technical issue that should be targeted is the development of 3D nano-miniaturization technology that enables small-lot, multi-product production (easy design change and low cost). In particular, from the viewpoint of the development of “optical / electronic devices”, the required process functions are assumed to be non-damaged and non-polluted, and “collective devices” and “in-situ control” are required.

リソグラフィーに必要な条件はスループット(レジストの高感度化)と解像度(レジストの分解能)の2つであり、それらのバランスが重要となる。電子ビームは光に比べて波長が短いことから、光リソグラフィーの解像度限界を超えるものとして開発が進められている。   There are two conditions required for lithography: throughput (resist sensitivity enhancement) and resolution (resist resolution), and the balance between them is important. Since the electron beam has a shorter wavelength than that of light, it is being developed as exceeding the resolution limit of photolithography.

電子ビームリソグラフィーでは、一般にスループットの観点から光リソグラフィーと同様に有機レジストが従来用いられており、解像度に優れる無機レジストは感度が低いため、一般には用いられてこなかった。有機レジストの中で感度は比較的低いが解像度に優れるものとしてPMMAが一般に用いられている。解像度が優れる無機レジストの感度をPMMAと同等とするか若しくはそれを凌駕させること、それが無機レジスト開発に向けた1つのターゲットである。   In electron beam lithography, generally, an organic resist has been conventionally used in the same manner as optical lithography from the viewpoint of throughput, and an inorganic resist having excellent resolution has not been generally used because of its low sensitivity. PMMA is generally used as an organic resist having relatively low sensitivity but excellent resolution. Making the sensitivity of an inorganic resist with excellent resolution equal to or surpassing that of PMMA is one target for the development of inorganic resists.

なお、代表的な有機レジスト及び無機レジストについて、レジストの感度と解像度の関係を図1に示す。この図1には、本発明の一実施形態でマスクとして使用されるGaAs自然酸化膜をレジストとして捉えた場合の位置付けが併せて示されている。   FIG. 1 shows the relationship between resist sensitivity and resolution for typical organic resists and inorganic resists. FIG. 1 also shows the positioning of a GaAs natural oxide film used as a mask in one embodiment of the present invention as a resist.

電子ビームリソグラフィーにおけるもう1つの問題は、入射電子だけではなくレジストおよび基板内からの二次電子散乱の影響である(proximity効果と呼ばれる)。この影響により、入射電子ビームのもつビーム径よりかなり大きな領域がレジストに対する反応領域となってしまう。この効果は、隣接する描画ライン間での解像度を決定する。proximity効果を低減させるため多くの努力がなされており、その一例が多層レジストによる基板内浸入電子線の屈折率制御を用いた実効ビーム径の低減化である。しかし、現状では、そのproximity効果(ビーム径より大きなレジスト反応領域)が微細化に対する大きな制限となっている。   Another problem in electron beam lithography is the effect of secondary electron scattering from within the resist and substrate as well as the incident electrons (referred to as the proximity effect). Due to this influence, a region considerably larger than the beam diameter of the incident electron beam becomes a reaction region for the resist. This effect determines the resolution between adjacent drawing lines. Many efforts have been made to reduce the proximity effect, and one example is the reduction of the effective beam diameter using the refractive index control of the intrusion electron beam in the substrate by a multilayer resist. However, at present, the proximity effect (resist reaction region larger than the beam diameter) is a major limitation on miniaturization.

一般にレジストは感度の特徴から2種類に分けることができ、ひとつは電子ビームのエネルギー照射量に依存してある臨界値で急峻な反応が起きるデジタル型レジスト、もうひとつはあるエネルギー照射量幅に対して連続的に反応が進行するアナログ型レジストである。この2種類のうち、サブミクロン領域での微細化には空間分解能を得やすいデジタル型が有利とされてきた。それにより形成された“硬い”反応領域がマスクとして用いられ、後工程のエッチングや成長(再成長と呼ばれる)に対して選択的な機能をもたらしてきた。一方、アナログ型レジストは空間分解能に限界はあるものの、後工程のプロセスに対して“柔らかい”マスクとして機能するため、高低差を制御した構造の作製に用いられてきた。任意の三次元微細構造を作製するためには、空間分解能に優れかつ高低差制御に優れたアナログ型のレジスト開発そして後工程のプロセス開発が必要であった。   In general, resists can be classified into two types according to sensitivity characteristics. One is a digital resist that causes a sharp reaction at a certain critical value depending on the energy dose of the electron beam, and the other is for a certain energy dose range. It is an analog type resist that reacts continuously. Of these two types, a digital type that can easily obtain a spatial resolution has been advantageous for miniaturization in the submicron region. The resulting “hard” reaction region has been used as a mask and has provided a selective function for subsequent etching and growth (called regrowth). On the other hand, an analog resist has a limit in spatial resolution, but functions as a “soft” mask for a subsequent process, and thus has been used to fabricate a structure with a controlled height difference. In order to produce an arbitrary three-dimensional microstructure, it was necessary to develop an analog type resist having excellent spatial resolution and excellent height difference control, and development of a post-process.

また、従来、マスクパターン形成後の選択的成長プロセスとして、表面拡散長が長いガス種を用いた成長法(CVD、GSMBE、CBE等)が用いられてきた。それは、成長前に形成されたマスクパターンが一般には光リソグラフィーにより作製されたため、マスク幅(すなわち選択的に成長が抑制されるべき領域幅)が極めて大きく、非マスク領域への選択成長を引き起こすためには、マスク上に照射された成長原料原子が拡散により排除されなくてはならないからであった。この手法を用いた選択成長はGaNを含むあらゆる化合物半導体およびSiプロセスに応用され、三次元構造制御手法の一手法として確立されている。   Conventionally, as a selective growth process after mask pattern formation, a growth method (CVD, GSMBE, CBE, etc.) using a gas species having a long surface diffusion length has been used. This is because the mask width (that is, the region width that should be selectively suppressed) is extremely large because the mask pattern formed before the growth is generally produced by photolithography, which causes selective growth to a non-mask region. This is because the growth source atoms irradiated on the mask must be eliminated by diffusion. Selective growth using this technique is applied to all compound semiconductors including GaN and Si processes, and has been established as a technique for controlling a three-dimensional structure.

しかし、サブミクロン領域を含むさらに小さな三次元構造制御に対しては、ガス種のもつ大きな表面拡散長により、極めて微細なマスク領域が埋もれてしまうという問題点がある。小さなマスク領域にはそれに対応した表面拡散長の短い(マスク幅よりは大きいが)プロセスとの組み合わせが必要である。   However, there is a problem that an extremely fine mask region is buried due to the large surface diffusion length of the gas species for the smaller three-dimensional structure control including the submicron region. A small mask region requires a combination with a corresponding process with a short surface diffusion length (greater than the mask width).

なお、例えば、CVD法を用いているものとして、特許文献1に開示されるものがある。この特許文献1は、CVD法の中でも有機金属化学気相蒸着法(以下、MOCVD法とする)を用いて、III−V族化合物半導体を選択成長させるものである。
特開平8−172053号公報
For example, there is one disclosed in Patent Document 1 as using the CVD method. In Patent Document 1, a group III-V compound semiconductor is selectively grown using a metal organic chemical vapor deposition method (hereinafter referred to as MOCVD method) among CVD methods.
Japanese Patent Laid-Open No. 8-172053

しかし、特許文献1のものは、MOCVD法を用いていることから表面原子の拡散長が長くなり、高密度配列の基板上でのIII−V族化合物半導体の選択成長が十分にはできず、基板を高密度化することが困難である。また、ナノオーダーで結晶成長方向の各成長結晶膜厚を一定に揃えることはできない。   However, since the thing of patent document 1 uses the MOCVD method, the diffusion length of a surface atom becomes long, and the selective growth of the III-V group compound semiconductor on the substrate of a high-density arrangement cannot fully be performed, It is difficult to increase the density of the substrate. Moreover, it is impossible to make the growth crystal film thicknesses in the crystal growth direction constant in the nano order.

本発明は以上の事情に鑑みてされたものであり、その目的は、基板の高密度化を容易に行うことができ、かつ、ナノオーダーで結晶成長方向の結晶膜厚が一定に揃えられたパターンをその場で形成可能な三次元微細加工方法及び高密度三次元微細構造を提供することにある。   The present invention has been made in view of the above circumstances, and the purpose thereof is to easily increase the density of the substrate, and the crystal film thickness in the crystal growth direction is made uniform in the nano order. The object is to provide a three-dimensional microfabrication method and a high-density three-dimensional microstructure capable of forming a pattern in situ.

課題を解決するための手段及び効果Means and effects for solving the problems

本発明の解決しようとする課題は以上の如くであり、次にこの課題を解決するための手段とその効果を説明する。   The problems to be solved by the present invention are as described above. Next, means for solving the problems and the effects thereof will be described.

本発明の第1の観点によれば、基板の表面に形成されたIII−V族化合物層の表面微細構造を形成する三次元微細加工方法において、以下の工程を行う方法が提供される。即ち、第1工程では、真空中で前記III−V族化合物層の表面に電子ビームを照射することにより、当該III−V族化合物層の表面の自然酸化膜III族酸化物に置換させ、前記III−V族化合物層上に改質マスク部を周期的に形成する。第2工程では、真空中で前記基板を昇温させることにより、前記改質マスク部以外の部分の前記自然酸化膜を脱離させてIII−V族化合物層表面を露出させる。第3工程では、真空にV族原料を供給した環境下で前記基板を所定温度で加熱することで、前記III−V族化合物層表面の露出部分からIII族原子を優先的に剥離させて前記改質マスク部上をホッピングさせることにより、当該露出部分に窪みを形成する。第4工程では、固体成長原料を用いた分子線エピタキシャル成長法を行うことで、前記窪みの部分にIII−V族化合物結晶を選択成長させる。前記第1工程における前記電子ビームの加速電圧は1kV以上50kV以下であり、線ドーズ量の範囲は10nC/cm以上1μC/cm以下であり、当該電子ビームの照射は単一ラインモードで行う。前記第1工程において、電子ビームは、前記III−V族化合物層の結晶方位[100]、[110]、[−110]の何れかに一致するラインを描画するように照射される。第2工程において、前記基板は300℃以上650℃以下の温度に昇温される。前記第3工程において、前記基板は300℃以上650℃以下の温度に加熱されるものとし、前記III−V族化合物層に形成される窪みの深さは、前記改質マスク部とその隣の改質マスク部との間に形成されるIII−V族化合物層表面の開口部が大きいときよりも小さいときの方が深くなり、前記開口部の大きさが1000nm以上の場合は前記窪みの深さは当該開口部の大きさの1/100以下であり、前記開口部の大きさが300nm以下の場合は前記窪みの深さは当該開口部の大きさの1/4以上である。前記第1工程において電子ビームの描画ラインを複数交差させることで、前記第4工程において、前記描画ラインに囲まれた区域内にIII−V族化合物結晶を選択成長させる。 According to a first aspect of the present invention, there is provided a method for performing the following steps in a three-dimensional microfabrication method for forming a fine structure on the surface of a III-V compound layer formed on the surface of a substrate. That is, in the first step, the surface of the III-V compound layer is irradiated with an electron beam in a vacuum, thereby replacing the natural oxide film on the surface of the III-V compound layer with a group III oxide, Modified mask portions are periodically formed on the III-V compound layer . In the second step, the temperature of the substrate is raised in a vacuum, so that the natural oxide film in portions other than the modified mask portion is desorbed to expose the surface of the III-V group compound layer . In the third step, the substrate is heated at a predetermined temperature in an environment in which a group V raw material is supplied to a vacuum, so that the group III atoms are preferentially separated from the exposed portion of the surface of the group III-V compound layer. A dent is formed in the exposed portion by hopping the modified mask portion. In the fourth step, a group III-V compound crystal is selectively grown in the depression by performing a molecular beam epitaxial growth method using a solid growth raw material. The acceleration voltage of the electron beam in the first step is 1 kV or more and 50 kV or less, the range of the line dose is 10 nC / cm or more and 1 μC / cm or less, and the electron beam irradiation is performed in a single line mode. In the first step, the electron beam is irradiated so as to draw a line that coincides with any one of the crystal orientations [100], [110], and [−110] of the III-V compound layer. In the second step, the substrate is heated to a temperature of 300 ° C. or higher and 650 ° C. or lower. In the third step, the substrate is heated to a temperature of 300 ° C. or more and 650 ° C. or less, and the depth of the recess formed in the III-V group compound layer is determined by the modified mask portion and the adjacent one. When the opening on the surface of the III-V group compound layer formed between the modified mask portion is smaller than when it is large, the depth of the depression is increased when the size of the opening is 1000 nm or more. The depth is 1/100 or less of the size of the opening. When the size of the opening is 300 nm or less, the depth of the recess is 1/4 or more of the size of the opening. By crossing a plurality of electron beam drawing lines in the first step, a group III-V compound crystal is selectively grown in the area surrounded by the drawing lines in the fourth step.

この方法により、基板の表面に自然に形成されている自然酸化膜を除去することなく、この自然酸化膜に対して電子ビームを照射することで、化学的に安定なIII族酸化物に置換し、改質マスク部を形成できる。そして、この改質マスク部を周期的に形成した上で基板の露出表面を優先的に剥離することで、ネガ型パターンを精度良く作製できる。また、電子ビームの描画間隔を広くすれば優先的な剥離部分が浅くなり、描画間隔を狭くすれば深く剥離されるという特徴を有しているので、従来では不可能であった複雑かつ多様な形状を有する三次元微細構造を形成することができる。また、高密度のパターンであっても、MBE法の成長条件を制御して表面原子拡散長を制御することにより、III−V族化合物結晶の選択成長を容易に行うことができる。また、結晶成長方向の結晶膜厚を一定に揃えることも容易である。更に、III−V族化合物の成長結晶は、その根元部において壁の立ち上がりが良好であり、高精度の微細構造を形成することができる。また、ネガ型パターンを一層精度良く形成することができるので、微細構造の精度及び再現性に優れ、ネガ型の三次元微細構造を精度良く形成することができる。更に、微細構造単位が縦横に並ぶ三次元微細構造を容易に形成できる。 By this method, without removing the natural oxide film naturally formed on the surface of the substrate, this natural oxide film is irradiated with an electron beam to replace it with a chemically stable group III oxide. A modified mask portion can be formed. Then, by periodically forming the modified mask portion and then preferentially peeling the exposed surface of the substrate, a negative pattern can be accurately produced. In addition, if the drawing interval of the electron beam is widened, the preferential peeling portion becomes shallow, and if the drawing interval is narrowed, it is deeply peeled off. A three-dimensional microstructure having a shape can be formed. Even for a high-density pattern, selective growth of a III-V group compound crystal can be easily performed by controlling the growth conditions of the MBE method to control the surface atom diffusion length. It is also easy to make the crystal film thickness in the crystal growth direction uniform. Furthermore, the growth crystal of the III-V group compound has a good wall rise at the base portion, and can form a highly accurate fine structure. Further, since the negative pattern can be formed with higher accuracy, the fine structure can be accurately and reproducibly, and a negative three-dimensional fine structure can be formed with high accuracy. Furthermore, it is possible to easily form a three-dimensional fine structure in which fine structure units are arranged vertically and horizontally.

前記の三次元微細加工方法においては、前記第3工程の前若しくは後、又は第3工程と同時に、臭素化物によるドライエッチングを行うことが好ましい。   In the three-dimensional microfabrication method, it is preferable to perform dry etching with bromide before or after the third step or simultaneously with the third step.

この方法により、形成される窪みの深さ制御の自由度を増大でき、より複雑な形状の三次元微細構造を形成することができる。   By this method, the degree of freedom in controlling the depth of the depression formed can be increased, and a three-dimensional microstructure having a more complicated shape can be formed.

前記の三次元微細加工方法においては、前記第1工程から第3工程までを単一の超高真空環境内で行うことが好ましい。   In the three-dimensional microfabrication method, it is preferable to perform the first to third steps in a single ultra-high vacuum environment.

この方法により、基板表面に対する微細加工のコストを大幅に低減できるとともに、スループットも良好になる。   By this method, the cost of microfabrication on the substrate surface can be greatly reduced, and the throughput can be improved.

前記の三次元微細加工方法においては、前記第4工程において、前記基板は300℃以上650℃以下の温度に加熱されるものとし、固体成長原料のV族とIII族のフラックス比FV/FIIIは1以上100以下であり、結晶成長速度は0.01ML/sec以上2ML/sec以下であり、結晶成長層の膜厚は、前記改質マスク部とその隣の改質マスク部との間に形成される開口部の大きさに反比例することが好ましい。 In the three-dimensional microfabrication method, in the fourth step, the substrate is heated to a temperature of 300 ° C. or more and 650 ° C. or less, and the solid growth raw material group V and group III flux ratio F V / F III is 1 or more and 100 or less, the crystal growth rate is 0.01 ML / sec or more and 2 ML / sec or less, and the thickness of the crystal growth layer is between the modified mask portion and the adjacent modified mask portion. It is preferable to be inversely proportional to the size of the opening formed in the.

この方法により、ポジ型の三次元微細構造を精度良く形成することができる。   By this method, a positive three-dimensional microstructure can be formed with high accuracy.

前記の三次元微細加工方法においては、前記第4工程において、電子線回折法を用いて、分子線エピタキシャル成長法によるIII−V族化合物結晶の成長途中の前記基板表面をその場観察することにより、前記III−V族化合物結晶の成長を制御可能であることが好ましい。   In the three-dimensional microfabrication method, in the fourth step, by using the electron diffraction method, in-situ observation of the substrate surface during the growth of the group III-V compound crystal by the molecular beam epitaxial growth method, It is preferable that the growth of the III-V compound crystal can be controlled.

この方法により、III−V族化合物結晶の成長を精度良く制御できるので、三次元微細構造を精度良く作製できるとともに、その再現性も良好である。   By this method, the growth of the III-V group compound crystal can be controlled with high accuracy, so that a three-dimensional microstructure can be manufactured with high accuracy and its reproducibility is also good.

前記の三次元微細加工方法においては、前記第1工程から前記第4工程までを単一の超高真空環境内で一括して行うことが好ましい。   In the three-dimensional microfabrication method, it is preferable that the first process to the fourth process are collectively performed in a single ultra-high vacuum environment.

この方法により、基板表面に対する微細加工のコストを大幅に低減できるとともに、スループットも良好になる。   By this method, the cost of microfabrication on the substrate surface can be greatly reduced, and the throughput can be improved.

前記の三次元微細加工方法においては、前記第2工程において自然酸化膜が脱離した後のIII族酸化物の幅が、照射した電子ビーム径よりも小さいことが好ましい。   In the three-dimensional microfabrication method, the width of the group III oxide after the natural oxide film is detached in the second step is preferably smaller than the irradiated electron beam diameter.

この方法により、改質される自然酸化膜領域よりも小さい構造制御が可能になり、微細構造の一層の高精度化、高密度化を実現できる。   By this method, it is possible to control the structure smaller than the region of the natural oxide film to be modified, and it is possible to realize further high precision and high density of the fine structure.

前記の三次元微細加工方法においては、前記電子ビームの照射間隔を変化させることにより、複数の種類の立体形状を有する三次元微細構造を形成することが好ましい。   In the three-dimensional fine processing method, it is preferable to form a three-dimensional fine structure having a plurality of types of three-dimensional shapes by changing the irradiation interval of the electron beam.

この方法により、複雑かつ多様な形状を有する三次元微細構造を容易に形成することができる。   By this method, a three-dimensional microstructure having complicated and various shapes can be easily formed.

次に、発明の実施の形態を説明する。図2には、本実施形態の三次元微細加工方法の各工程が(a)から(d)まで順に示されている。また、図3は本実施形態の三次元微細加工方法における各工程の温度推移の一例を示すグラフであり、グラフに示された(a)〜(d)の記号は図2(a)〜図2(d)にそれぞれ対応している。   Next, embodiments of the invention will be described. In FIG. 2, each step of the three-dimensional microfabrication method of this embodiment is shown in order from (a) to (d). FIG. 3 is a graph showing an example of the temperature transition of each step in the three-dimensional microfabrication method of the present embodiment, and the symbols (a) to (d) shown in the graph are shown in FIGS. 2 (d) respectively.

図2(a)には、本実施形態の微細加工の対象物としてのGaAs基板(III−V族化合物基板)1が示されている。このGaAs基板1の表面には、3nmから6nm程度の厚みを有する自然酸化膜2が形成されている。   FIG. 2A shows a GaAs substrate (III-V compound substrate) 1 as an object of microfabrication of the present embodiment. A natural oxide film 2 having a thickness of about 3 nm to 6 nm is formed on the surface of the GaAs substrate 1.

本実施形態の微細加工方法は、まず図2(a)に示すように、この自然酸化膜2に対して電子ビームを真空中で照射する。すると、電子ビームの照射部分の自然酸化膜2が、化学的に安定した酸化物Ga23(III族酸化物)に置換される。このとき、電子ビームによってGaAs基板1の表面に平行ライン等の周期的パターンを描画すると、後述の工程により、GaAs基板1の表面に優先剥離による窪みを形成することができる。なお、高精度のパターンを形成する観点から、電子ビームの照射にあたっては、加速電圧を1kV以上50kV以下とし、線ドーズ量の範囲は10nC/cm以上1μC/cm以下とするのが好ましい。また、電子ビームの照射は単一ラインモードで行うことが好ましい。 In the microfabrication method of this embodiment, first, as shown in FIG. 2A, the natural oxide film 2 is irradiated with an electron beam in a vacuum. Then, the natural oxide film 2 in the electron beam irradiated portion is replaced with a chemically stable oxide Ga 2 O 3 (Group III oxide). At this time, when a periodic pattern such as parallel lines is drawn on the surface of the GaAs substrate 1 by the electron beam, a depression due to preferential peeling can be formed on the surface of the GaAs substrate 1 by a process described later. Note that, from the viewpoint of forming a highly accurate pattern, it is preferable that the electron beam is irradiated with an acceleration voltage of 1 kV to 50 kV and a line dose range of 10 nC / cm to 1 μC / cm. Further, it is preferable that the electron beam irradiation be performed in a single line mode.

次に、図2(b)に示すように、表面の自然酸化膜2の一部をGa23に置換したGaAs基板1を、真空中にAs4(V族原料)を供給した環境下で、580℃以上630℃以下の所定温度まで昇温する。なお、図3には図2の微細加工を行う際の温度制御の一例が示され、図3の例では630℃まで温度を直線的に上昇させている。すると、温度が580℃付近となった時点で、図2(b)に示すように、Ga23に置換された部分以外の自然酸化膜2が熱脱離して除去される。 Next, as shown in FIG. 2B, the GaAs substrate 1 in which a part of the surface natural oxide film 2 is replaced with Ga 2 O 3 is placed in an environment in which As 4 (group V material) is supplied in a vacuum. Then, the temperature is raised to a predetermined temperature of 580 ° C. or higher and 630 ° C. or lower. Note that FIG. 3 shows an example of temperature control when the fine processing of FIG. 2 is performed. In the example of FIG. 3, the temperature is linearly increased to 630.degree. Then, when the temperature reaches around 580 ° C., as shown in FIG. 2B, the natural oxide film 2 other than the portion replaced with Ga 2 O 3 is thermally desorbed and removed.

ここで一般に、電子ビーム法で改質される自然酸化膜領域は、入射電子線(一次電子)と薄膜内での散乱電子(二次電子)により決定される。しかしながら、本実施形態の方法によれば、Ga23に置換された部分以外の自然酸化膜2だけでなく、Ga23に置換された部分のうち低エネルギーの二次電子による改質領域も熱脱離する。即ち、本実施形態において自然酸化膜に電子ビームで描画したことによるマスクは、一次電子が有する高エネルギー領域のみに対して選択性が現れる。従って、自然酸化膜が脱離した後のGa23(改質部3)の幅を、照射した電子ビームのビーム径よりも小さくすることができる。これにより、改質される自然酸化膜領域以下の構造制御が可能となる。 Here, the natural oxide film region modified by the electron beam method is generally determined by an incident electron beam (primary electron) and scattered electrons (secondary electrons) in the thin film. However, according to the method of the present embodiment, not only the natural oxide film 2 other than the portion replaced with Ga 2 O 3 , but also the modification by the low energy secondary electrons in the portion replaced with Ga 2 O 3. The region is also thermally desorbed. That is, in the present embodiment, the mask formed by drawing an electron beam on the natural oxide film exhibits selectivity only for the high energy region of the primary electrons. Therefore, the width of Ga 2 O 3 (modified portion 3) after the natural oxide film is detached can be made smaller than the beam diameter of the irradiated electron beam. Thereby, it is possible to control the structure below the natural oxide film region to be modified.

次に、真空中にAs4を供給した環境下で、580℃以上630℃以下の所定温度(図3の例では610℃)でのGaAs基板1に対する加熱を継続する。すると、Ga23の存在しないGaAs基板1の表面のGa分子が当該表面から優先的に剥離されて拡散し、電子ビームの周期パターン描画領域の端部に移動し、堆積する。この結果、図2(c)に示すように、GaAs基板1の表面に窪み4が形成され、ネガ型の三次元微細構造が作製される。こうして得られる窪み4の深さは、Ga23に改質された部分である改質部3と、それに隣接する改質部3との間に形成される開口部の大きさにほぼ反比例する。具体的には、前記開口部の大きさ(開口径)が1000nm以上の場合は、窪み4の深さを当該開口径の1/100以下とすることができる。また、前記開口部の大きさ(開口径)が300nm以下の場合は、窪み4の深さを当該開口径の1/4以上とすることができる。 Next, heating the GaAs substrate 1 at a predetermined temperature of 580 ° C. or more and 630 ° C. or less (610 ° C. in the example of FIG. 3) is continued in an environment where As 4 is supplied in a vacuum. Then, Ga molecules on the surface of the GaAs substrate 1 in which Ga 2 O 3 is not present are peeled off and diffused preferentially from the surface, move to the edge of the periodic pattern drawing region of the electron beam, and are deposited. As a result, as shown in FIG. 2C, a recess 4 is formed on the surface of the GaAs substrate 1, and a negative three-dimensional microstructure is produced. The depth of the recess 4 obtained in this way is almost inversely proportional to the size of the opening formed between the modified portion 3 which is a portion modified with Ga 2 O 3 and the modified portion 3 adjacent thereto. To do. Specifically, when the size (opening diameter) of the opening is 1000 nm or more, the depth of the recess 4 can be set to 1/100 or less of the opening diameter. Moreover, when the size (opening diameter) of the opening is 300 nm or less, the depth of the recess 4 can be set to 1/4 or more of the opening diameter.

次に、基板の表面に形成された窪み4の部分に、分子線エピタキシー法(MBE法)によってGaAsを選択成長させる。このMBE法は、GaAsの成長方向をGaAs基板1の面方位(100)に合わせて、結晶成長温度を450℃以上600℃以下の所定温度(図3の例では580℃)とし、As4分子とGa原子とのフラックス比(FAs/FGa)は1以上100以下の範囲とし、GaAs結晶成長速度を0.01ML/sec以上2ML/sec以下(分子層/秒:二次元薄膜に対する成長速度換算)として行う。こうして得られるGaAs成長層膜厚は、前記改質部3と隣接する改質部3との間に形成される開口部の大きさにほぼ反比例する。 Next, GaAs is selectively grown by a molecular beam epitaxy method (MBE method) in the recess 4 formed on the surface of the substrate. In this MBE method, the growth direction of GaAs is aligned with the plane orientation (100) of the GaAs substrate 1, the crystal growth temperature is set to a predetermined temperature of 450 ° C. to 600 ° C. (580 ° C. in the example of FIG. 3), and As 4 molecules And the Ga atom flux ratio (F As / F Ga ) is in the range of 1 to 100, and the GaAs crystal growth rate is 0.01 ML / sec to 2 ML / sec (molecular layer / second: growth rate for a two-dimensional thin film). Conversion). The thickness of the GaAs growth layer obtained in this way is almost inversely proportional to the size of the opening formed between the modified portion 3 and the adjacent modified portion 3.

ここで、GaAs結晶成長速度は、試料薄膜や基板の表面状態をその場観察するための反射高速電子線回折装置(以下、RHEEDと称する)を用いて調整することが好ましい。GaAs結晶成長速度が決定されれば、GaAs結晶成長時間の調整により成長結晶の膜厚を制御することができる。   Here, the GaAs crystal growth rate is preferably adjusted using a reflection high-energy electron diffraction apparatus (hereinafter referred to as RHEED) for in situ observation of the surface state of the sample thin film or the substrate. If the GaAs crystal growth rate is determined, the film thickness of the grown crystal can be controlled by adjusting the GaAs crystal growth time.

以上により、図2(d)に示すように、GaAs基板1の表面にGaAs成長結晶5が形成され、ポジ型の三次元微細構造を作製することができる。これにより、高密度で各GaAs成長結晶の膜厚が一定である基板の作製が可能となる。   As described above, as shown in FIG. 2D, the GaAs growth crystal 5 is formed on the surface of the GaAs substrate 1, and a positive three-dimensional microstructure can be produced. This makes it possible to produce a substrate with a high density and a constant thickness of each GaAs growth crystal.

図4には、基板表面に対する電子ビームのライン間隔を大きくして、図2で説明した三次元微細加工方法を同様に行った場合が示されている。なお、本明細書において電子ビームのライン間隔とは、電子ビームを単一ラインモードで照射し、次に照射するラインまで平行移動させる距離(電子ビームの幅方向中心線間の距離)をいう。   FIG. 4 shows a case where the line spacing of the electron beam with respect to the substrate surface is increased and the three-dimensional microfabrication method described in FIG. 2 is performed in the same manner. In this specification, the line interval of the electron beam refers to a distance (distance between center lines in the width direction of the electron beam) in which the electron beam is irradiated in a single line mode and then translated to the next irradiation line.

ここで、図4(c)及び図2(c)に示すように、本実施形態の微細加工方法は、電子ビームの描画間隔を広くすると、優先剥離によって形成される窪みの深さが小さくなり、描画間隔を狭くすると、優先剥離による窪みの深さが大きくなる特徴を有している。   Here, as shown in FIG. 4C and FIG. 2C, in the microfabrication method of the present embodiment, when the electron beam drawing interval is widened, the depth of the depression formed by the preferential peeling is reduced. When the drawing interval is narrowed, the depth of the depression due to the priority peeling is increased.

なお、図5(a)〜図5(f)には、描画ライン間隔を6μmから1.4μmまで6段階に変化させながら電子ビームで格子状に描画し、自然酸化膜の脱離及び優先剥離を行ったネガ型三次元微細構造の表面AFM写真を示している。また、図6(a)〜図6(f)は、図5(a)〜図5(f)で示すネガ型の三次元微細構造について、窪みの形成深さをそれぞれ模式的に示している。なお、照射電子ビーム径は等しいにもかかわらず、描画ライン間隔を最小の1.4μmとして照射した図6(f)の場合のマスク幅d2は、間隔を最大の6μmとして照射した図6(a)の場合のマスク幅d1よりも小さいことが明らかに認められており(d2<d1)、窪み形成後のマスク幅が優先剥離の深さと反比例するという知見が得られた。   In FIGS. 5A to 5F, the drawing line interval is changed in six steps from 6 μm to 1.4 μm and drawn in a lattice shape with an electron beam, and the natural oxide film is detached and preferentially peeled off. FIG. 2 shows a surface AFM photograph of a negative three-dimensional microstructure subjected to the above-described process. 6 (a) to 6 (f) schematically show the formation depths of the recesses for the negative three-dimensional microstructure shown in FIGS. 5 (a) to 5 (f). . Although the irradiation electron beam diameters are equal, the mask width d2 in the case of FIG. 6F irradiated with the drawing line interval of the minimum 1.4 μm is the same as that of FIG. ) Is clearly recognized (d2 <d1), and the knowledge that the mask width after the formation of the depression is inversely proportional to the depth of the preferential peeling is obtained.

また、図7(a)〜図7(c)には、描画ライン間隔を1.4μmから3.0μmまで3段階に変化させながら電子ビームで格子状に描画し、自然酸化膜の脱離及び優先剥離を行ったネガ型三次元微細構造の表面AFM写真及び断面AFM写真を示している。この図7によっても、描画ライン間隔が広いと浅い窪みが形成され、描画ライン間隔が狭いと窪みが深くなることが判る。   7A to 7C, the drawing line interval is changed in three steps from 1.4 μm to 3.0 μm and drawn in a lattice shape with an electron beam. The surface AFM photograph and the cross-sectional AFM photograph of the negative type three-dimensional microstructure which performed priority peeling are shown. FIG. 7 also shows that a shallow depression is formed when the drawing line interval is wide, and a depression becomes deep when the drawing line interval is narrow.

このように電子ビームの描画間隔を大きくすると非照射領域の剥離が浅くなる原因としては、Ga原子の表面拡散原子の拡散長(ミューフリーパス)が描画ライン間隔に対して小さくなる結果、Ga原子がマスクとしてのGa23表面をホッピング運動するように移動しにくくなって、加工領域外に運ばれにくくなるためと考えられる。 When the electron beam writing interval is increased in this way, the non-irradiated region is shallowly peeled because the diffusion length (mu free path) of the surface diffusion atoms of Ga atoms becomes smaller than the drawing line interval. This is considered to be because it becomes difficult to move like a hopping motion on the surface of Ga 2 O 3 as a mask and difficult to be carried out of the processing region.

一方、従来のエッチング(例えば臭素化物を用いたドライエッチング)の場合、マスクの間隔が広い場合は深くエッチングでき、マスクの間隔が狭い場合はエッチングも浅くなる。従って、本発明の三次元微細加工方法は従来のエッチングとは正反対の特徴を有しているのであって、従来では作製できなかった複雑かつ多様な形状を有する三次元微細構造の作製を可能にする。   On the other hand, in the case of conventional etching (for example, dry etching using bromide), when the mask interval is wide, the etching can be deep, and when the mask interval is narrow, the etching is shallow. Therefore, the three-dimensional microfabrication method of the present invention has characteristics opposite to those of conventional etching, and enables the production of three-dimensional micro structures having complicated and various shapes that could not be produced conventionally. To do.

図8(a)は、上記の優先剥離によりネガ型の三次元微細構造を形成した様子を示す表面AFM写真である。また、図8(b)は、図8(a)と同様の三次元微細構造を作製した後、MBE法によりポジ型三次元微細構造を形成した様子を示す表面AFM写真である。なお、図9(a)は、図8(a)の形状の窪みの深さを示す断面モデル図であり、図9(b)は、図8(b)の形状の結晶成長高さを示す断面モデル図である。このように、ネガ型の三次元微細微細構造の窪みにMBE法でIII−V族化合物結晶を選択成長させることで、高密度で、かつ結晶成長方向の結晶膜厚を一定に揃えられる微細構造を形成することができる。   FIG. 8A is a surface AFM photograph showing a state in which a negative three-dimensional microstructure is formed by the above-described preferential peeling. FIG. 8B is a surface AFM photograph showing a state in which a positive three-dimensional microstructure is formed by MBE after a three-dimensional microstructure similar to that in FIG. 8A is fabricated. 9A is a cross-sectional model diagram showing the depth of the recess having the shape of FIG. 8A, and FIG. 9B shows the crystal growth height of the shape of FIG. 8B. It is a section model figure. In this way, by selectively growing a III-V compound crystal by MBE method in a depression of a negative type three-dimensional fine structure, a fine structure with a high density and a uniform crystal film thickness in the crystal growth direction can be obtained. Can be formed.

図10(a)〜図10(d)は、優先剥離によりネガ型の三次元微細構造を形成した後、MBE法によりポジ型三次元微細構造を形成した様子を示す表面SEM写真及び断面SEM写真である。なお、図10(a)及び図10(b)はGaAs基板にGaAs結晶を選択成長させた場合であり、図10(c)及び図10(d)はGaAs基板にInAs結晶を選択成長させた場合である。   FIGS. 10A to 10D are a surface SEM photograph and a cross-sectional SEM photograph showing a state in which a positive three-dimensional microstructure is formed by MBE after forming a negative three-dimensional microstructure by preferential peeling. It is. 10A and 10B show the case where a GaAs crystal is selectively grown on a GaAs substrate, and FIGS. 10C and 10D show the case where an InAs crystal is selectively grown on a GaAs substrate. Is the case.

上述したように、本実施形態の方法により作製されるポジ型三次元微細構造は、いったん窪みを形成してそこからMBE法によりIII−V族化合物結晶を選択成長させる。従って、例えば図10(b)及び図10(c)に示すように、成長結晶の根元部において壁の立ち上がりが極めて良好であり、高精度の微細構造を形成することができる。   As described above, in the positive three-dimensional microstructure manufactured by the method of the present embodiment, a depression is once formed, and a III-V group compound crystal is selectively grown therefrom by the MBE method. Therefore, for example, as shown in FIGS. 10B and 10C, the rise of the wall is very good at the base of the grown crystal, and a highly accurate fine structure can be formed.

また、図5、図7、図8及び図10に示すように、基板表面への電子ビーム照射時の幾何学的配置(描画ライン間隔、及び、平行ライン又は交差ライン)に依存して優先剥離とMBE法の成長条件を変化させることで、GaAs基板表面に形成されている各パターンが成長に対してネガ型マスクとして機能し、電子ビームの非照射領域において選択的な優先剥離が行われて三次元構造が成長作製されているのが判る。1つの三次元構造単位は安定な結晶面ファセットから構成され、原子レベルで平坦である。また、電子線のビーム描画によるGa23への改質領域のうち半影部分を優先剥離でトリミングすることで、電子ビーム径に対して無視できるほど描画の実効サイズが小さくなっていることが判る。これにより、高密度の微細構造、例えば隣り合う単位構造同士の間隔がサブミクロン以下であるような微細構造も容易に作製することができる。 In addition, as shown in FIGS. 5, 7, 8, and 10, priority peeling is performed depending on the geometrical arrangement (drawing line interval and parallel lines or intersecting lines) at the time of electron beam irradiation on the substrate surface. By changing the growth conditions of the MBE method, each pattern formed on the surface of the GaAs substrate functions as a negative mask for growth, and selective preferential peeling is performed in the non-irradiated region of the electron beam. It can be seen that a three-dimensional structure has been grown. One three-dimensional structural unit is composed of stable crystal facets and is flat at the atomic level. In addition, by trimming the penumbra part of the modified region to Ga 2 O 3 by electron beam beam drawing with priority peeling, the effective size of drawing is reduced to a negligible amount relative to the electron beam diameter. I understand. Thereby, a high-density fine structure, for example, a fine structure in which the interval between adjacent unit structures is submicron or less can be easily produced.

以上に示すように、本実施形態の三次元微細加工方法によると、GaAs基板1の表面に自然に形成されている自然酸化膜2を除去することなく、この自然酸化膜2に電子ビームを照射することで、化学的に安定なGa23(改質部3)を形成することが可能になる。そして、回路パターンが高密度配列であっても、優先剥離によるネガ型回路パターンを精度良く作製でき、このネガ型回路パターンの部分にのみGaAs結晶を成長させるので、結晶成長方向の結晶膜厚を一定に揃えると同時に回路形状を精度良く形成することができる。しかも、ナノオーダーの高密度回路でありながら、その作製コストを低減することができる。 As described above, according to the three-dimensional microfabrication method of this embodiment, the natural oxide film 2 is irradiated with an electron beam without removing the natural oxide film 2 naturally formed on the surface of the GaAs substrate 1. This makes it possible to form chemically stable Ga 2 O 3 (modified portion 3). And even if the circuit pattern is a high-density array, a negative circuit pattern by preferential peeling can be accurately produced, and a GaAs crystal is grown only on this negative circuit pattern portion. At the same time, the circuit shape can be accurately formed. In addition, the fabrication cost can be reduced while being a nano-order high-density circuit.

また、本実施形態での電子ビーム描画により改質される自然酸化膜を一種の無機レジストと考えた場合、後に行われる優先剥離工程、及びMBE工程に対するレジスト感度は、高解像度リソグラフィーとして一般に用いられる有機レジストであるPMMAと同等の感度であり、無機レジストの中では最も感度が高く解像度も優れている(図1を参照)。従って、無機レジストを用いた場合の問題点とされているスループットも大きく改善できる。   Further, when the natural oxide film modified by electron beam writing in this embodiment is considered as a kind of inorganic resist, the resist sensitivity with respect to the preferential peeling process and the MBE process performed later is generally used as high resolution lithography. It has the same sensitivity as PMMA, which is an organic resist, and has the highest sensitivity and excellent resolution among inorganic resists (see FIG. 1). Therefore, the throughput, which is a problem when using an inorganic resist, can be greatly improved.

なお、本実施形態の三次元微細加工方法では、上述のように、電子ビームの描画間隔を大きくすると剥離効果が減じられることになる。これを解決するために、図3(c)の優先剥離工程で臭素化物を導入し、優先剥離と、一原子層単位のドライエッチングとを併用することが考えられる。このドライエッチングは、優先剥離工程と同時に行っても良いし、優先剥離工程の前又は後に行っても良い。   In the three-dimensional microfabrication method of this embodiment, as described above, the peeling effect is reduced when the drawing interval of the electron beam is increased. In order to solve this, it is conceivable that bromide is introduced in the preferential peeling step of FIG. 3C to use preferential peeling and dry etching in units of one atomic layer. This dry etching may be performed simultaneously with the preferential peeling process, or may be performed before or after the preferential peeling process.

臭素化物によるドライエッチングでは、電子ビームの描画間隔の大きな部分のGaAs基板1表面を深くエッチングできる一方、描画間隔の狭い部分はエッチングが浅くなる。従って、このドライエッチングと優先剥離を両方行うことで、形状の深さ制御の自由度を増大でき、より複雑な形状の回路パターンを形成することが可能になる。更に、その後にMBE法を用いる場合でも、MBE成長条件を変化させることで、自由な形状パターンを容易に形成することができる。   In dry etching with bromide, the surface of the GaAs substrate 1 where the electron beam writing interval is large can be etched deeply, while the portion where the writing interval is narrow becomes shallow. Therefore, by performing both this dry etching and preferential peeling, the degree of freedom of shape depth control can be increased, and a circuit pattern having a more complicated shape can be formed. Furthermore, even when the MBE method is subsequently used, a free shape pattern can be easily formed by changing the MBE growth conditions.

上記の三次元微細加工方法は、単一の超高真空環境内で一括して(一連の工程で)行うと、製造コストを低減でき、好ましい。また、前述のように電子ビームの描画ラインを前記基板上で格子状に複数交差させて、描画ラインで囲まれた基板上の微少区域内にGaAs結晶を選択成長させると、微細構造単位が縦横に並ぶ三次元微細構造を形成することができる。この場合、GaAs成長結晶は、当該区域の面積、基板の結晶方位、及び結晶成長膜厚に依存することになる。   The above three-dimensional microfabrication method is preferably carried out in a single ultra-high vacuum environment (in a series of steps) because the manufacturing cost can be reduced. Further, as described above, when a plurality of electron beam drawing lines are crossed in a lattice pattern on the substrate and a GaAs crystal is selectively grown in a minute area on the substrate surrounded by the drawing lines, the fine structure unit is vertically and horizontally. A three-dimensional microstructure can be formed. In this case, the GaAs growth crystal depends on the area of the area, the crystal orientation of the substrate, and the crystal growth film thickness.

以下、実施例によって本発明を更に具体的に説明する。なお、以下の各実施例ではGaAs基板表面を加工することとし、その表面の自然酸化膜(As23等)に対しては、電子ビーム径を0.5μmに絞った電子ビームを、真空中で、加速電圧5kV、電流量1.0×10-9A、線ドーズ量0.2μC/cmの条件で照射した。また、各実施例において、MBE法における結晶成長速度はRHEEDを用いて測定及び制御した。 Hereinafter, the present invention will be described more specifically with reference to examples. In each of the following examples, the surface of the GaAs substrate is processed, and an electron beam whose electron beam diameter is reduced to 0.5 μm is applied to a natural oxide film (As 2 O 3 or the like) on the surface. In particular, irradiation was performed under the conditions of an acceleration voltage of 5 kV, a current amount of 1.0 × 10 −9 A, and a line dose amount of 0.2 μC / cm. In each example, the crystal growth rate in the MBE method was measured and controlled using RHEED.

(実施例1)
本実施例においては、GaAs基板の面方位(100)の面に対して電子ビームを照射し、自然酸化膜を選択的にGa23に置換した。電子ビームは複数本の平行ラインを描画するように照射し、この描画ラインの方向は、GaAs基板1の[−110]方向及び[110]方向に一致させた。電子ビームの描画ラインの間隔は1.4μmとし、複数本の平行ライン同士が交互に垂直に交差するように照射した。次に、基板を真空中で630℃に加熱し、Ga23に置換した部分以外の自然酸化膜を剥離させた。次に、基板を610℃で20分間加熱することで、GaAs基板1の自然酸化膜が剥離した部分の表面を優先剥離した。この結果、ネガ型微細加工が行われ、図7(a)に示すように溝幅300nm、深さ70nmの三次元微細構造が形成された。
Example 1
In this example, the surface of the GaAs substrate with the plane orientation (100) was irradiated with an electron beam, and the natural oxide film was selectively replaced with Ga 2 O 3 . The electron beam was irradiated so as to draw a plurality of parallel lines, and the directions of the drawing lines were matched with the [−110] direction and the [110] direction of the GaAs substrate 1. The interval between drawing lines of the electron beam was 1.4 μm, and irradiation was performed so that a plurality of parallel lines alternately intersected vertically. Next, the substrate was heated to 630 ° C. in a vacuum, and the natural oxide film other than the portion replaced with Ga 2 O 3 was peeled off. Next, the substrate was heated at 610 ° C. for 20 minutes to preferentially peel the surface of the portion of the GaAs substrate 1 where the natural oxide film was peeled off. As a result, negative microfabrication was performed, and a three-dimensional microstructure having a groove width of 300 nm and a depth of 70 nm was formed as shown in FIG.

次に、MBE法によってGaAs結晶を成長させた。結晶成長温度は580℃とし、As4分子とGa原子とのフラックス比(FAs/FGa)を4とし、GaAs結晶成長速度を0.5ML/sec(分子層/秒:二次元薄膜に対する成長速度換算)とし、結晶成長時間を20minとした。この結果、ポジ型微細加工が行われ、図10(a)に示すような表面構造を有する基板が得られた。 Next, a GaAs crystal was grown by the MBE method. The crystal growth temperature is 580 ° C., the flux ratio of As 4 molecules and Ga atoms (F As / F Ga ) is 4, and the GaAs crystal growth rate is 0.5 ML / sec (molecular layer / second: growth on a two-dimensional thin film. The crystal growth time was 20 min. As a result, positive microfabrication was performed, and a substrate having a surface structure as shown in FIG. 10A was obtained.

(実施例2)
本実施例においては、GaAs基板の面方位(100)の面に対して電子ビームを照射し、自然酸化膜を選択的にGa23に置換した。電子ビームは複数本の平行ラインを描画するように照射し、この描画ラインの方向は、GaAs基板の[−110]方向に一致させた。電子ビームの描画ラインの間隔は0.6μmとした。次に、基板を真空中で630℃に加熱し、Ga23に置換した部分以外の自然酸化膜を剥離させた。次に、基板を610℃で20分間加熱することで、GaAs基板の自然酸化膜が剥離した部分の表面を優先剥離した。
(Example 2)
In this example, the surface of the GaAs substrate with the plane orientation (100) was irradiated with an electron beam, and the natural oxide film was selectively replaced with Ga 2 O 3 . The electron beam was irradiated so as to draw a plurality of parallel lines, and the direction of the drawing lines was matched with the [−110] direction of the GaAs substrate. The interval between the electron beam drawing lines was 0.6 μm. Next, the substrate was heated to 630 ° C. in a vacuum, and the natural oxide film other than the portion replaced with Ga 2 O 3 was peeled off. Next, the substrate was heated at 610 ° C. for 20 minutes to preferentially peel the surface of the portion of the GaAs substrate where the natural oxide film was peeled off.

次に、MBE法によってGaAs結晶を成長させた。結晶成長温度は520℃とし、As4分子とGa原子とのフラックス比(FAs/FGa)を100とし、GaAs結晶成長速度を0.02ML/sec(分子層/秒:二次元薄膜に対する成長速度換算)とし、結晶成長時間を300minとした。この結果、ポジ型微細加工が行われ、図10(b)に示すような表面構造を有する基板が得られた。この表面構造のGaAs成長結晶は、その根本部の幅が500nm、高さが500nmであった。 Next, a GaAs crystal was grown by the MBE method. The crystal growth temperature is 520 ° C., the flux ratio of As 4 molecules and Ga atoms (F As / F Ga ) is 100, and the GaAs crystal growth rate is 0.02 ML / sec (molecular layer / second: growth on a two-dimensional thin film. The crystal growth time was 300 min. As a result, positive microfabrication was performed, and a substrate having a surface structure as shown in FIG. 10B was obtained. The surface-grown GaAs grown crystal had a width of 500 nm at the root and a height of 500 nm.

(実施例3)
本実施例では、GaAs基板の面方位(100)の面に対して電子ビームを照射し、自然酸化膜を選択的にGa23に置換した。電子ビームは複数本の平行ラインを描画するように照射し、この描画ラインの方向は、GaAs基板の[−110]方向に一致させた。電子ビームの描画ラインの間隔は1.8μmとした。次に、基板を真空中で630℃に加熱し、Ga23に置換した部分以外の自然酸化膜を剥離させた。次に、基板を610℃で20分間加熱することで、GaAs基板の自然酸化膜が剥離した部分の表面を優先剥離した。これにより、溝幅540nm、深さ35nmのネガ型三次元微細構造が形成された。
(Example 3)
In this example, the surface of the GaAs substrate with the plane orientation (100) was irradiated with an electron beam, and the natural oxide film was selectively replaced with Ga 2 O 3 . The electron beam was irradiated so as to draw a plurality of parallel lines, and the direction of the drawing lines was matched with the [−110] direction of the GaAs substrate. The interval between the electron beam drawing lines was 1.8 μm. Next, the substrate was heated to 630 ° C. in a vacuum, and the natural oxide film other than the portion replaced with Ga 2 O 3 was peeled off. Next, the substrate was heated at 610 ° C. for 20 minutes to preferentially peel the surface of the portion of the GaAs substrate where the natural oxide film was peeled off. As a result, a negative three-dimensional microstructure having a groove width of 540 nm and a depth of 35 nm was formed.

次に、MBE法によってInAs結晶を成長させた。結晶成長温度は500℃とし、As4分子とIn原子とのフラックス比(FAs/FIn)を7とし、InAs結晶成長速度を0.3ML/sec(分子層/秒:二次元薄膜に対する成長速度換算)とし、結晶成長時間を40minとした。この結果、ポジ型微細加工が行われ、図10(c)に示すような表面構造を有する基板が得られた。この表面構造のInAs成長結晶は、その根本部の幅が500nm、高さが600nmであった。 Next, an InAs crystal was grown by the MBE method. The crystal growth temperature is 500 ° C., the flux ratio of As 4 molecules and In atoms (F As / F In ) is 7, and the InAs crystal growth rate is 0.3 ML / sec (molecular layer / second: growth on a two-dimensional thin film. The crystal growth time was 40 min. As a result, positive microfabrication was performed, and a substrate having a surface structure as shown in FIG. 10C was obtained. The InAs grown crystal having this surface structure had a width of 500 nm and a height of 600 nm at the root.

以上のように、GaAs基板表面に形成されている自然酸化膜に電子ビームを注入することにより、化学的に安定なGa23を形成することができる。そして、このGa23をマスクとして利用して優先剥離を行い(必要に応じて臭素化物ドライエッチングを併用し)、更にMBE法による結晶成長を行うことで、GaAs基板表面に自由度の高い形状パターンを加工することができる。また、MBE法の成長条件を変化させることで、形状パターンをナノオーダー単位で制御して加工することができる。また、上記の電子ビームの注入、優先剥離、MBE法プロセスを同一の装置で一連の工程によって行うことも可能であり、製造コストを大幅に低減できる。 As described above, chemically stable Ga 2 O 3 can be formed by injecting an electron beam into the natural oxide film formed on the surface of the GaAs substrate. Then, preferential peeling is performed using this Ga 2 O 3 as a mask (with bromide dry etching if necessary), and further crystal growth by MBE is performed, so that the surface of the GaAs substrate has a high degree of freedom. The shape pattern can be processed. Further, by changing the growth conditions of the MBE method, the shape pattern can be controlled and processed in nano-order units. In addition, the above-described electron beam injection, preferential peeling, and MBE process can be performed by a series of steps in the same apparatus, and the manufacturing cost can be greatly reduced.

本発明は、上述のとおり、基板上に任意の回路パターンを容易に再現性良く加工することができる。これによって、半導体デバイスは勿論、多様な量子デバイス特性を生かした有用な素子、例えば、波長弁別デバイス、フォトニクス結晶、量子細線、量子箱、回折格子、半導体レーザー構造、マイクロマシン、マイクロコンポーネント等への応用も可能になる。   As described above, the present invention can easily process an arbitrary circuit pattern on a substrate with good reproducibility. As a result, not only semiconductor devices, but also useful elements utilizing various quantum device characteristics, such as wavelength discrimination devices, photonic crystals, quantum wires, quantum boxes, diffraction gratings, semiconductor laser structures, micromachines, microcomponents, etc. Is also possible.

次に、従来用いられていた厚膜の酸化物によるマスクとの比較による本実施形態の有利な点を、図11の従来技術と図2とを適宜比較参照しながら説明する。図11は、基板表面の自然酸化膜を剥離した後に酸化物マスクを形成し、その上でMBE法により結晶を成長させる従来技術の三次元微細加工方法の各工程を示す概略図である。   Next, advantages of the present embodiment by comparison with a conventionally used thick oxide mask will be described with reference to the prior art of FIG. 11 and FIG. 2 as appropriate. FIG. 11 is a schematic view showing each step of a conventional three-dimensional microfabrication method in which an oxide mask is formed after peeling a natural oxide film on a substrate surface and a crystal is grown thereon by MBE.

即ち、上述したように、本実施形態では自然酸化膜2に電子ビームで描画を行うことで、図2(a)及び図2(b)で示すように硬い安定な酸化物マスク(改質部3)を作成できる。一方、従来技術では、図11(a)に示すように基板上の自然酸化膜を剥離して取り除き、その上で図11(b)のように、新たに酸化物マスク13をCVD等の方法で形成させる。従って、従来技術ではマスクの厚みが大きくなるとともに基板との親和性に乏しく、マスクとの境界領域が原子レベルでは不均一になって、境界にボケが生じて輪郭が不鮮明になってしまう。   That is, as described above, in this embodiment, the natural oxide film 2 is drawn with an electron beam, so that a hard and stable oxide mask (modified portion) is formed as shown in FIGS. 2 (a) and 2 (b). 3) can be created. On the other hand, in the prior art, as shown in FIG. 11A, the natural oxide film on the substrate is peeled off and removed, and then the oxide mask 13 is newly formed by a method such as CVD as shown in FIG. To form. Therefore, in the prior art, the thickness of the mask is increased and the affinity with the substrate is poor, and the boundary area with the mask becomes non-uniform at the atomic level, resulting in blurring at the boundary and unclear outlines.

また、本実施形態では、As4供給下の真空加熱によって自然酸化膜が剥離され、自然酸化膜の存在しないGaAs基板表面のGa原子は基板から剥離されて、周期的なマスク上をホッピング運動し、基板の終端(周期的なマスク形成領域の端部)まで移動する。この表面Ga原子の集団移動効果により、図2(c)で示すように、酸化物マスクの間の基板表面が露出した領域に窪みを形成することができる。なお、この窪み形成に関しては、表面原子の熱的な昇華によるエッチングが支配要因ではないことが重要である。一方、従来技術は、基板1の表面をAs4供給下で真空加熱した場合、GaAs基板表面のGa原子は基板から剥離されるものの、酸化物マスクが厚いことと、マスクの境界がボケた状態で輪郭が不鮮明であるために、表面Ga原子の移動が阻止され、ホッピング運動を行うことができない。このため、図11(c)に示すように、マスク間の基板表面が露出した領域に窪みを形成することができない。 Further, in this embodiment, the natural oxide film is peeled off by vacuum heating with As 4 supplied, and Ga atoms on the surface of the GaAs substrate without the natural oxide film are peeled off from the substrate to perform a hopping motion on the periodic mask. Then, it moves to the end of the substrate (end of the periodic mask formation region). Due to the collective movement effect of the surface Ga atoms, as shown in FIG. 2C, a depression can be formed in a region where the substrate surface is exposed between the oxide masks. It is important for the formation of the recess that etching by thermal sublimation of surface atoms is not a dominant factor. On the other hand, in the conventional technique, when the surface of the substrate 1 is heated under vacuum while supplying As 4 , Ga atoms on the surface of the GaAs substrate are peeled off from the substrate, but the oxide mask is thick and the boundary of the mask is blurred. Since the outline is unclear, the movement of the surface Ga atoms is prevented and the hopping motion cannot be performed. For this reason, as shown in FIG.11 (c), a hollow cannot be formed in the area | region where the board | substrate surface between masks was exposed.

更に、本実施形態では、GaとAs4供給下の真空加熱によってMBE法によりGaAs成長を行うと、図2(d)で示すように前記基板表面の窪み4にGaAsが成長し、当該窪み4の構造的特徴を反映したGaAs成長結晶5の三次元構造が正確に積層していく。一方、従来技術は、同様のMBE法を行うことにより、酸化物マスク13の存在しない基板表面にGaAsが成長するものの、酸化物マスク13のエッジがボケた状態で輪郭が不鮮明であるために、基板上に正確にGaAsを積層することが困難である。 Furthermore, in this embodiment, when GaAs growth is performed by MBE method by vacuum heating under the supply of Ga and As 4, GaAs grows in the depression 4 on the substrate surface as shown in FIG. The three-dimensional structure of the GaAs growth crystal 5 reflecting the structural features of the above is accurately laminated. On the other hand, in the related art, GaAs grows on the substrate surface where the oxide mask 13 does not exist by performing the same MBE method, but the outline is unclear with the edge of the oxide mask 13 blurred. It is difficult to accurately stack GaAs on the substrate.

図12には、本発明と従来技術で用いられるマスクの特徴の比較が示されている。この図12の表に示すように、本発明は、基板との密着性及び親和性が高いとともに極めて薄く形成できる自然酸化膜の改質マスクを用いることで、マスク上でのGa原子の拡散長を大きくでき、図2(c)に示すようなホッピング運動を実現できている。   FIG. 12 shows a comparison of the features of the mask used in the present invention and the prior art. As shown in the table of FIG. 12, the present invention uses a modified mask of a natural oxide film that has high adhesion and affinity with the substrate and can be formed extremely thin, so that the diffusion length of Ga atoms on the mask is increased. And a hopping motion as shown in FIG. 2C can be realized.

また、本実施形態で開示した三次元微細加工方法に基づく優先剥離及び選択成長について、描画マスク間のピッチの大小による形状の比較を図13に示す。この図13の表の上側に示すように、ホッピングによる優先剥離の場合、マスク間ピッチが大きいときよりも小さいときの方がGa原子のホッピングが頻繁に起こるので、基板に形成される窪みが深くなる。このように、本発明は、優先剥離の深さがマスク間の開口領域の大きさに依存するという性質を用いて、ネガ型三次元微細加工の深さ制御が可能になる。   FIG. 13 shows a comparison of shapes depending on the pitch between the drawing masks for the preferential peeling and selective growth based on the three-dimensional microfabrication method disclosed in this embodiment. As shown in the upper side of the table of FIG. 13, in the case of preferential separation by hopping, Ga atoms hop more frequently when the mask pitch is smaller than when the pitch between masks is large. Become. As described above, the present invention makes it possible to control the depth of negative three-dimensional microfabrication by using the property that the depth of preferential peeling depends on the size of the opening region between the masks.

また、図13の表の下側に示すように、MBE法による選択成長の場合、結晶の成長高さは、入射原料フラックスに依存する高さhcと、マスク間ピッチ(開口領域の大きさ)に依存する高さh1,h2とを加算した高さとなる。このうち、マスク間ピッチに依存する部分については、当該マスク間ピッチが大きい場合よりも小さい場合の方が大きくなる(h1<h2)。このように、本発明は、結晶成長高さがマスク間の開口領域の大きさに依存するという性質を用いて、ポジ型三次元微細加工の高さ制御が可能になる。   Further, as shown in the lower side of the table of FIG. 13, in the case of selective growth by the MBE method, the growth height of the crystal depends on the height hc depending on the incident material flux and the pitch between masks (size of the opening region). The heights h1 and h2 depending on are added. Among these, the portion depending on the inter-mask pitch is larger when the inter-mask pitch is smaller than when the inter-mask pitch is large (h1 <h2). As described above, the present invention makes it possible to control the height of positive three-dimensional microfabrication using the property that the crystal growth height depends on the size of the opening region between the masks.

以上に本発明の好適な実施形態を説明したが、上記の構成は例えば以下のように変更することができる。   Although the preferred embodiment of the present invention has been described above, the above configuration can be changed as follows, for example.

上記実施形態ではGaAs基板について説明したが、GaAs以外のIII−V族化合物からなる基板を用いるように変更することができる。例えば、AlxGayIn1-x-yAsz1-z(0≦x<1、0≦y、z≦1)からなる基板を用いることが考えられる。また、適宜の基板の表面にIII−V族化合物の薄膜(III−V族化合物層)を適宜の方法で形成し、その上で上記の三次元微細加工方法を実施するように変更することができる。この薄膜は、例えば、AlxGayIn1-x-yAsz1-z(0≦x<1、0≦y、z≦1)からなる薄膜とすることが考えられる。 Although the GaAs substrate has been described in the above embodiment, the substrate can be changed to use a substrate made of a III-V group compound other than GaAs. For example, it is conceivable to use a substrate made of Al x Ga y In 1-xy As z P 1-z (0 ≦ x <1, 0 ≦ y, z ≦ 1). Further, a thin film of III-V compound (III-V compound layer) may be formed on the surface of an appropriate substrate by an appropriate method, and then the above-described three-dimensional microfabrication method may be implemented. it can. This thin film may be a thin film made of, for example, Al x Ga y In 1-xy As z P 1-z (0 ≦ x <1, 0 ≦ y, z ≦ 1).

上記実施形態ではMBE法でGaAs又はInAsを結晶成長させる場合を説明したが、それ以外の様々なIII−V族化合物(例えば、InP)を結晶成長させることも可能である。例えば、電子ビームの照射方向を基板の結晶方位[100]、[110]、[−110]の何れかに一致させるとともに、III−V族化合物結晶の成長温度を300℃以上650℃以下とし、固体成長原料のV族原子とIII族原子とのフラックス比(FV/FIII)を1以上100以下とし、結晶成長速度を0.01ML/sec以上2ML/sec以下(分子層/秒:二次元薄膜に対する成長速度換算)とし、結晶成長層の膜厚は、前記改質マスク部とその隣の改質マスク部との間に形成される開口部の大きさに反比例するIII−V族化合物結晶を選択成長させることができる。 In the above embodiment, the case where GaAs or InAs is crystal-grown by the MBE method has been described, but various other III-V group compounds (for example, InP) can be crystal-grown. For example, the irradiation direction of the electron beam is made to coincide with any of the crystal orientations [100], [110], and [−110] of the substrate, and the growth temperature of the group III-V compound crystal is set to 300 ° C. or more and 650 ° C. or less. The flux ratio (F V / F III ) between group V atoms and group III atoms of the solid growth raw material is 1 or more and 100 or less, and the crystal growth rate is 0.01 ML / sec or more and 2 ML / sec or less (molecular layer / second: 2 III-V group compound in which the thickness of the crystal growth layer is inversely proportional to the size of the opening formed between the modified mask portion and the adjacent modified mask portion. Crystals can be selectively grown.

上記実施形態では、優先剥離によるネガ型の三次元微細加工と、MBE法によるポジ型の三次元微細加工とを組み合わせて行う場合を説明したが、工程の加工条件を変えることにより、ネガ型、ポジ型何れか一方のみの微細加工を行うこともできる。   In the above embodiment, the case where negative three-dimensional microfabrication by preferential peeling and positive three-dimensional micromachining by MBE are combined has been described. By changing the processing conditions of the process, Only one of the positive molds can be finely processed.

代表的な有機レジスト及び無機レジストのレジスト感度と平均分子量(分解能)の比較を示すグラフ。The graph which shows the comparison of the resist sensitivity and average molecular weight (resolution) of typical organic resist and inorganic resist. 本発明の一実施形態に係る三次元微細加工方法の各工程を示す概略図。図2(a)は基板表面の自然酸化膜に電子ビームを照射する第1工程を示し、図2(b)は基板の加熱により電子ビームの非照射領域の自然酸化膜を脱離させる第2工程を示し、図2(c)は基板の加熱により自然酸化膜の脱離部分を優先剥離してネガ型の三次元微細構造を形成する第3工程を示し、図2(d)は固体成長原料を用いた分子線エピタキシャル成長法(MBE)により結晶を選択成長させる第4工程を示す。Schematic which shows each process of the three-dimensional microfabrication method which concerns on one Embodiment of this invention. FIG. 2A shows a first step of irradiating a natural oxide film on the surface of the substrate with an electron beam, and FIG. 2B shows a second step of detaching the natural oxide film in the non-irradiated region of the electron beam by heating the substrate. FIG. 2 (c) shows a third step of forming a negative three-dimensional microstructure by preferentially peeling the desorbed portion of the natural oxide film by heating the substrate, and FIG. 2 (d) shows solid growth. A fourth step of selectively growing a crystal by molecular beam epitaxy (MBE) using a raw material will be described. 本実施形態の三次元微細加工方法における各工程の温度推移の一例を示すグラフ。The graph which shows an example of the temperature transition of each process in the three-dimensional microfabrication method of this embodiment. 電子ビームの描画間隔を図2の場合よりも大きくして、図2(a)〜図2(d)と同様の工程を行う場合を示す概略図。Schematic which shows the case where the drawing interval of an electron beam is made larger than the case of FIG. 2, and the process similar to FIG. 2 (a)-FIG.2 (d) is performed. 電子ビームの描画間隔を種々異ならせて形成したネガ型の三次元微細構造の表面AFM写真。Surface AFM photographs of negative three-dimensional microstructures formed with various electron beam writing intervals. 図5(a)〜図5(f)で示すネガ型の三次元微細構造について、窪み部の形成深さを示す断面モデル図。Sectional model figure which shows the formation depth of a hollow part about the negative type three-dimensional fine structure shown to Fig.5 (a)-FIG.5 (f). 電子ビームの描画間隔を種々異ならせて形成したネガ型の三次元微細構造の表面AFM写真及び断面AFM写真。FIG. 6 is a surface AFM photograph and a cross-sectional AFM photograph of a negative three-dimensional microstructure formed with various electron beam drawing intervals. FIG. 図8(a)は、優先剥離によりネガ型の三次元微細構造を形成した様子を示す表面AFM写真。図8(b)は、図8(a)と同様の三次元微細構造を作製した後、MBE法によりポジ型高密度三次元微細構造を形成した様子を示す表面AFM写真。FIG. 8A is a surface AFM photograph showing a negative three-dimensional microstructure formed by preferential peeling. FIG. 8B is a surface AFM photograph showing a state in which a positive-type high-density three-dimensional microstructure is formed by MBE after a three-dimensional microstructure similar to that shown in FIG. 図8(a)及び図8(b)で示す三次元微細構造について、窪み部の形成深さ又は結晶成長高さを示す断面モデル図。Sectional model figure which shows the formation depth or crystal growth height of a hollow part about the three-dimensional fine structure shown to Fig.8 (a) and FIG.8 (b). 各種条件を変化させながら、MBE法によりIII−V族化合物半導体結晶を選択成長させてポジ型高密度三次元微細構造を形成した様子を示す表面SEM写真及び断面SEM写真。The surface SEM photograph and cross-sectional SEM photograph which show a mode that the III-V group compound semiconductor crystal was selectively grown by MBE method while changing various conditions, and the positive type high-density three-dimensional fine structure was formed. 基板表面の自然酸化膜を剥離した後に酸化物マスクを形成し、その上でMBE法により結晶を成長させる従来技術の三次元微細加工方法の各工程を示す概略図。The schematic diagram which shows each process of the three-dimensional microfabrication method of the prior art which forms an oxide mask after peeling the natural oxide film of the board | substrate surface, and grows a crystal | crystallization by MBE method on it. 従来技術のマスクと本発明のマスクの特徴を比較した図。The figure which compared the characteristic of the mask of a prior art, and the mask of this invention. 本実施形態で行われる優先剥離時及び選択成長時において、マスク間ピッチの大小による形状の変化を比較して示す図。The figure which shows the comparison of the shape change by the magnitude of the pitch between masks at the time of the priority peeling and selective growth which are performed by this embodiment.

符号の説明Explanation of symbols

1 GaAs基板(III−V族化合物基板)
2 自然酸化膜
3 改質部
4 窪み
5 GaAs結晶(III−V族化合物結晶)
1 GaAs substrate (III-V group compound substrate)
2 Natural oxide film 3 Modified part 4 Dimple 5 GaAs crystal (III-V compound crystal)

Claims (8)

基板の表面に形成されたIII−V族化合物層の表面微細構造を形成する三次元微細加工方法において、
真空中で前記III−V族化合物層の表面に電子ビームを照射することにより、当該III−V族化合物層の表面の自然酸化膜III族酸化物に置換させ、前記III−V族化合物層上に改質マスク部を周期的に形成する第1工程と、
真空中で前記基板を昇温させることにより、前記改質マスク部以外の部分の前記自然酸化膜を脱離させてIII−V族化合物層表面を露出させる第2工程と、
真空にV族原料を供給した環境下で前記基板を所定温度で加熱することで、前記III−V族化合物層表面の露出部分からIII族原子を優先的に剥離させて前記改質マスク部上をホッピングさせることにより、当該露出部分に窪みを形成する第3工程と、
固体成長原料を用いた分子線エピタキシャル成長法を行うことで、前記窪みの部分にIII−V族化合物結晶を選択成長させる第4工程と、
を含み、
前記第1工程における前記電子ビームの加速電圧は1kV以上50kV以下であり、線ドーズ量の範囲は10nC/cm以上1μC/cm以下であり、当該電子ビームの照射は単一ラインモードで行い、
前記第1工程において、電子ビームは、前記III−V族化合物層の結晶方位[100]、[110]、[−110]の何れかに一致するラインを描画するように照射され、
前記第2工程において、前記基板は300℃以上650℃以下の温度に昇温されるものとし、
前記第3工程において、前記基板は300℃以上650℃以下の温度に加熱されるものとし、前記III−V族化合物層に形成される窪みの深さは、前記改質マスク部とその隣の改質マスク部との間に形成されるIII−V族化合物層表面の開口部が大きいときよりも小さいときの方が深くなり、前記開口部の大きさが1000nm以上の場合は前記窪みの深さは当該開口部の大きさの1/100以下であり、前記開口部の大きさが300nm以下の場合は前記窪みの深さは当該開口部の大きさの1/4以上であり、
前記第1工程において電子ビームの描画ラインを複数交差させることで、前記第4工程において、前記描画ラインに囲まれた区域内にIII−V族化合物結晶を選択成長させることを特徴とする三次元微細加工方法。
In the three-dimensional microfabrication method of forming a fine structure on the surface of the III-V compound layer formed on the surface of the substrate,
By irradiating the surface of the III-V group compound layer with an electron beam in a vacuum, the natural oxide film on the surface of the III-V group compound layer is replaced with a group III oxide, and the III-V group compound layer A first step of periodically forming a modified mask portion thereon;
A second step in which the surface of the III-V group compound layer is exposed by desorbing the natural oxide film in a portion other than the modified mask portion by raising the temperature of the substrate in a vacuum;
By heating the substrate at a predetermined temperature in an environment in which a group V raw material is supplied to a vacuum, group III atoms are preferentially separated from the exposed portion of the surface of the group III-V compound layer, so that the modified mask portion is exposed. A third step of forming a depression in the exposed portion by hopping
A fourth step of selectively growing a group III-V compound crystal in the depression by performing a molecular beam epitaxial growth method using a solid growth raw material;
Only including,
The acceleration voltage of the electron beam in the first step is 1 kV or more and 50 kV or less, the range of the line dose is 10 nC / cm or more and 1 μC / cm or less, and the electron beam irradiation is performed in a single line mode,
In the first step, the electron beam is irradiated so as to draw a line that coincides with any of the crystal orientations [100], [110], and [−110] of the III-V compound layer,
In the second step, the substrate is heated to a temperature of 300 ° C. or higher and 650 ° C. or lower,
In the third step, the substrate is heated to a temperature of 300 ° C. or more and 650 ° C. or less, and the depth of the recess formed in the III-V group compound layer is determined by the modified mask portion and the adjacent one. When the opening on the surface of the III-V group compound layer formed between the modified mask portion is smaller than when it is large, the depth of the depression is increased when the size of the opening is 1000 nm or more. The depth is 1/100 or less of the size of the opening, and when the size of the opening is 300 nm or less, the depth of the recess is 1/4 or more of the size of the opening,
A three-dimensional III-V compound crystal is selectively grown in an area surrounded by the drawing lines in the fourth step by crossing a plurality of electron beam drawing lines in the first step. Fine processing method.
請求項に記載の三次元微細加工方法であって、
前記第3工程の前若しくは後、又は第3工程と同時に、臭素化物によるドライエッチングを行うことを特徴とする三次元微細加工方法。
The three-dimensional microfabrication method according to claim 1 ,
A three-dimensional microfabrication method comprising performing dry etching with a bromide before or after the third step or simultaneously with the third step.
請求項1又は2に記載の三次元微細加工方法であって、
前記第1工程から第3工程までを単一の超高真空環境内で行うことを特徴とする三次元微細加工方法。
The three-dimensional microfabrication method according to claim 1 or 2 ,
A three-dimensional micromachining method, wherein the first to third steps are performed in a single ultra-high vacuum environment.
請求項1から3までの何れか一項に記載の三次元微細加工方法であって、
前記第4工程において、前記基板は300℃以上650℃以下の温度に加熱されるものとし、固体成長原料のV族とIII族のフラックス比FV/FIIIは1以上100以下であり、結晶成長速度は0.01ML/sec以上2ML/sec以下であり、結晶成長層の膜厚は、前記改質マスク部とその隣の改質マスク部との間に形成される開口部が大きいときよりも小さいときの方が大きくなることを特徴とする三次元微細加工方法。
A three-dimensional microfabrication method according to any one of claims 1 to 3 ,
In the fourth step, the substrate is heated to a temperature of 300 ° C. or more and 650 ° C. or less, and a solid growth raw material group V / III group flux ratio F V / F III is 1 or more and 100 or less. The growth rate is 0.01 ML / sec or more and 2 ML / sec or less, and the film thickness of the crystal growth layer is larger than that when the opening formed between the modified mask portion and the adjacent modified mask portion is large. A three-dimensional microfabrication method characterized in that the smaller is smaller, the larger .
請求項1から4までの何れか一項に記載の三次元微細加工方法であって、
前記第4工程において、電子線回折法を用いて、分子線エピタキシャル成長法によるIII−V族化合物結晶の成長途中の前記III−V族化合物層表面をその場観察することにより、前記III−V族化合物結晶の成長を制御可能であることを特徴とする三次元微細加工方法。
A three-dimensional microfabrication method according to any one of claims 1 to 4 ,
In the fourth step, the group III-V group is observed by in-situ observation of the surface of the group III-V compound layer during the growth of the group III-V compound crystal by molecular beam epitaxy using an electron diffraction method. A three-dimensional microfabrication method characterized in that the growth of a compound crystal can be controlled.
請求項1から5までの何れか一項に記載の三次元微細加工方法であって、
前記第1工程から前記第4工程までを単一の超高真空環境内で行うことを特徴とする三次元微細加工方法。
A three-dimensional microfabrication method according to any one of claims 1 to 5 ,
A three-dimensional microfabrication method comprising performing the first step to the fourth step in a single ultra-high vacuum environment.
請求項1からまでの何れか一項に記載の三次元微細加工方法であって、
前記第2工程において自然酸化膜が脱離した後のIII族酸化物の幅が、照射した電子ビーム径よりも小さいことを特徴とする三次元微細加工方法。
A three-dimensional micromachining method according to any one of claims 1 to 6 ,
A three-dimensional microfabrication method, wherein the width of the group III oxide after the natural oxide film is detached in the second step is smaller than the irradiated electron beam diameter.
請求項1からまでの何れか一項に記載の三次元微細加工方法であって、
前記電子ビームの照射間隔を変化させることにより、複数の種類の立体形状を有する三次元微細構造を形成することを特徴とする三次元微細加工方法。
A three-dimensional microfabrication method according to any one of claims 1 to 7 ,
A three-dimensional microfabrication method, wherein a three-dimensional microstructure having a plurality of types of three-dimensional shapes is formed by changing an irradiation interval of the electron beam.
JP2007246322A 2007-09-22 2007-09-22 Three-dimensional fine processing method and three-dimensional fine structure Active JP5152715B2 (en)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP2007246322A JP5152715B2 (en) 2007-09-22 2007-09-22 Three-dimensional fine processing method and three-dimensional fine structure

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP2007246322A JP5152715B2 (en) 2007-09-22 2007-09-22 Three-dimensional fine processing method and three-dimensional fine structure

Related Child Applications (1)

Application Number Title Priority Date Filing Date
JP2012232319A Division JP5494992B2 (en) 2012-10-19 2012-10-19 3D microfabricated substrate

Publications (2)

Publication Number Publication Date
JP2009076795A JP2009076795A (en) 2009-04-09
JP5152715B2 true JP5152715B2 (en) 2013-02-27

Family

ID=40611461

Family Applications (1)

Application Number Title Priority Date Filing Date
JP2007246322A Active JP5152715B2 (en) 2007-09-22 2007-09-22 Three-dimensional fine processing method and three-dimensional fine structure

Country Status (1)

Country Link
JP (1) JP5152715B2 (en)

Families Citing this family (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
FR3037341A1 (en) 2015-06-10 2016-12-16 Centre Nat Rech Scient METHOD FOR MANUFACTURING AT LEAST ONE TYPE OF NANOSTRUCTURES AND STRUCTURES COMPRISING A PLURALITY OF SUCH NANOSTRUCTURES

Family Cites Families (8)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2681118B2 (en) * 1989-12-18 1997-11-26 光技術研究開発株式会社 Method for forming fine pattern of semiconductor
JPH0594976A (en) * 1991-03-08 1993-04-16 Hikari Gijutsu Kenkyu Kaihatsu Kk Micro-processing method of semiconductor
JPH05109670A (en) * 1991-10-17 1993-04-30 Nec Corp Dry etching method
JP2757642B2 (en) * 1991-12-20 1998-05-25 日本電気株式会社 Dry etching method
JPH05175173A (en) * 1991-12-24 1993-07-13 Res Dev Corp Of Japan Method for precisely working on compound semiconductor
JP2822737B2 (en) * 1991-12-26 1998-11-11 日本電気株式会社 Method and apparatus for oxidizing solid surface
JP3763021B2 (en) * 2003-05-26 2006-04-05 学校法人関西学院 Electron beam micromachining method
JP4755643B2 (en) * 2005-04-25 2011-08-24 リベル Mask forming method and three-dimensional fine processing method

Also Published As

Publication number Publication date
JP2009076795A (en) 2009-04-09

Similar Documents

Publication Publication Date Title
KR100744884B1 (en) Nanoscale patterning for the formation of extensive wires
US7368395B2 (en) Method for fabricating a nano-imprinting mold
KR101169307B1 (en) Nanostructures and method of making the same
KR101209151B1 (en) Method for fabricating quantum dot and semiconductor structure containing quantum dot
US7704861B2 (en) Electron beam microprocessing method
JP5267945B2 (en) Three-dimensional fine processing method and three-dimensional fine structure
JP5152715B2 (en) Three-dimensional fine processing method and three-dimensional fine structure
JP5494992B2 (en) 3D microfabricated substrate
KR101256757B1 (en) Method of fabricating zno nanostructure by using multi seed layers
JP2007273665A (en) Mold and method of manufacturing same
KR101026507B1 (en) Method of three-dimensional microfabrication and high-density three-dimensional fine structure
JP4803513B2 (en) Ion beam micromachining method
JP4052430B2 (en) Ion beam microfabrication method of inorganic multilayer resist and semiconductor device, quantum device, micromachine component and microstructure by this method
WO2003054973A1 (en) Light receiving element and light receiving device incorporating circuit and optical disc drive
JP2004281954A (en) Method of manufacturing quantum dot
KR20230078473A (en) 2D Lateral Superlattice Template and Method for Deposition using the same
JP2004281953A (en) Method of manufacturing microstructure
Zacharias et al. From Ordered Arrays of Nanowires to Controlled Solid State Reactions
WO2003054945A1 (en) Method for ion beam fine patterning of inorganic multilayer resist, and semiconductor device, quantum device, micromachine component and fine structure manufactured by the method
JP2006108440A (en) Semiconductor device and its manufacturing method

Legal Events

Date Code Title Description
A621 Written request for application examination

Free format text: JAPANESE INTERMEDIATE CODE: A621

Effective date: 20100514

A977 Report on retrieval

Free format text: JAPANESE INTERMEDIATE CODE: A971007

Effective date: 20100802

A131 Notification of reasons for refusal

Free format text: JAPANESE INTERMEDIATE CODE: A131

Effective date: 20120824

A521 Request for written amendment filed

Free format text: JAPANESE INTERMEDIATE CODE: A523

Effective date: 20121019

TRDD Decision of grant or rejection written
A01 Written decision to grant a patent or to grant a registration (utility model)

Free format text: JAPANESE INTERMEDIATE CODE: A01

Effective date: 20121109

A61 First payment of annual fees (during grant procedure)

Free format text: JAPANESE INTERMEDIATE CODE: A61

Effective date: 20121126

FPAY Renewal fee payment (event date is renewal date of database)

Free format text: PAYMENT UNTIL: 20151214

Year of fee payment: 3

R150 Certificate of patent or registration of utility model

Free format text: JAPANESE INTERMEDIATE CODE: R150

Ref document number: 5152715

Country of ref document: JP

Free format text: JAPANESE INTERMEDIATE CODE: R150

R250 Receipt of annual fees

Free format text: JAPANESE INTERMEDIATE CODE: R250

R250 Receipt of annual fees

Free format text: JAPANESE INTERMEDIATE CODE: R250

R250 Receipt of annual fees

Free format text: JAPANESE INTERMEDIATE CODE: R250

R250 Receipt of annual fees

Free format text: JAPANESE INTERMEDIATE CODE: R250

R250 Receipt of annual fees

Free format text: JAPANESE INTERMEDIATE CODE: R250

R250 Receipt of annual fees

Free format text: JAPANESE INTERMEDIATE CODE: R250