JP5004430B2 - Method for manufacturing light emitting device - Google Patents

Method for manufacturing light emitting device Download PDF

Info

Publication number
JP5004430B2
JP5004430B2 JP2005081271A JP2005081271A JP5004430B2 JP 5004430 B2 JP5004430 B2 JP 5004430B2 JP 2005081271 A JP2005081271 A JP 2005081271A JP 2005081271 A JP2005081271 A JP 2005081271A JP 5004430 B2 JP5004430 B2 JP 5004430B2
Authority
JP
Japan
Prior art keywords
layer
light
semiconductor layer
light emitting
transistor
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Expired - Fee Related
Application number
JP2005081271A
Other languages
Japanese (ja)
Other versions
JP2005311328A5 (en
JP2005311328A (en
Inventor
智史 村上
真之 坂倉
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Semiconductor Energy Laboratory Co Ltd
Original Assignee
Semiconductor Energy Laboratory Co Ltd
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Semiconductor Energy Laboratory Co Ltd filed Critical Semiconductor Energy Laboratory Co Ltd
Priority to JP2005081271A priority Critical patent/JP5004430B2/en
Publication of JP2005311328A publication Critical patent/JP2005311328A/en
Publication of JP2005311328A5 publication Critical patent/JP2005311328A5/ja
Application granted granted Critical
Publication of JP5004430B2 publication Critical patent/JP5004430B2/en
Expired - Fee Related legal-status Critical Current
Anticipated expiration legal-status Critical

Links

Images

Classifications

    • Y02B20/341

Description

本発明は、大型基板を用いて製造する発光装置およびその発光装置の製造方法に関する。   The present invention relates to a light emitting device manufactured using a large substrate and a method for manufacturing the light emitting device.

エレクトロルミネッセンス素子(発光素子)からの発光を利用した発光装置は、高視野角、低消費電力の表示用装置として注目されている装置であり、近年、発光装置の量産化を目的とした開発が進められている。   A light-emitting device using light emitted from an electroluminescence element (light-emitting element) has been attracting attention as a display device with a high viewing angle and low power consumption, and has recently been developed for mass production of light-emitting devices. It is being advanced.

発光装置の量産化における課題のひとつに、大型基板を用いた発光装置の製造技術の開発がある。大型基板を用いることによって、大型テレビ受像機等の生産が可能になる他、携帯電話機等の小型の電子機器に実装される小型の発光装置を一基板で大量に生産することが可能になる。   One of the challenges in mass production of light emitting devices is the development of manufacturing technology for light emitting devices using large substrates. By using a large substrate, it is possible to produce a large television receiver and the like, and it is possible to produce a large number of small light emitting devices mounted on a small electronic device such as a cellular phone on a single substrate.

しかし、大型基板を用いた発光装置の製造には、大型の処理装置を用いて基板を処理する必要があり、その為、基板全面に対し均一な条件で処理することが困難である。ところが、例えばガラスのような帯電しやすい材料から成る基板を用いる場合、基板全面に対して均一な条件で処理しないと、プラズマ処理を行ったときに基板の一部に電荷が溜まり易い。溜まった電荷が作製中の素子を介して移動すると、移動経路となった部分に大電流が流れ、結果として素子の損傷が生じることがある。   However, in manufacturing a light-emitting device using a large substrate, it is necessary to process the substrate using a large processing apparatus, and thus it is difficult to process the entire surface of the substrate under uniform conditions. However, when a substrate made of a material that is easily charged, such as glass, is used, charges are likely to accumulate in a part of the substrate when plasma processing is performed unless the entire surface of the substrate is processed under uniform conditions. When the accumulated electric charge moves through the element being manufactured, a large current flows through the part that becomes the movement path, and as a result, the element may be damaged.

以上のような静電気に起因した損傷を低減するために、例えば、表示部へ信号を送るための入力端子を導電膜によって接続して成るショートリングを設ける等の工夫がされている。また、特許文献1では、静電気に起因した損傷を低減するために、配線層の膜からなる静電気吸収パターンや静電容量を設ける方法が提案されている。   In order to reduce the damage caused by static electricity as described above, for example, a contrivance is provided such as providing a short ring in which an input terminal for sending a signal to the display unit is connected by a conductive film. Patent Document 1 proposes a method of providing an electrostatic absorption pattern or capacitance made of a wiring layer film in order to reduce damage caused by static electricity.

しかし、ショートリングを用いる場合、ショートリングが形成される迄の工程において生じ得る静電気による素子の損傷を抑制することが困難である。また、特許文献1に開示されている方法では素子作製後不要となる部分が生じ、基板面を有効に活用することができない。   However, when a short ring is used, it is difficult to suppress damage to the element due to static electricity that may occur in the process until the short ring is formed. Further, in the method disclosed in Patent Document 1, a portion that becomes unnecessary after device fabrication occurs, and the substrate surface cannot be used effectively.

特開平6−75246号公報JP-A-6-75246

本発明は、発光装置を製造するときに生じ得る静電気に起因した素子の損傷を低減することのできる発光装置の製造方法について提供することを課題とする。また、静電気に起因した素子の損傷による不良が低減された発光装置を提供することを課題とする。   It is an object of the present invention to provide a method for manufacturing a light-emitting device that can reduce element damage due to static electricity that may occur when the light-emitting device is manufactured. It is another object of the present invention to provide a light-emitting device in which defects due to element damage caused by static electricity are reduced.

本発明の発光装置の製造方法は、発光素子を駆動するためのプレーナ型のトランジスタ、特にトップゲート型のトランジスタを作製する工程を有する。そして、トランジスタを作製する工程において、活性層として機能する半導体層を形成するときに、行方向及び列方向に延びた格子状の第1の半導体層を基板上に形成すると共に、前記第1の半導体層の間に、島状に分離した第2の半導体層を複数形成することを特徴としている。ここで、第2の半導体層は、トランジスタの活性層として機能する層である。   The manufacturing method of a light emitting device of the present invention includes a step of manufacturing a planar type transistor for driving a light emitting element, particularly a top gate type transistor. When forming a semiconductor layer functioning as an active layer in a process for manufacturing a transistor, a lattice-shaped first semiconductor layer extending in a row direction and a column direction is formed over a substrate, and the first A plurality of second semiconductor layers separated into island shapes are formed between the semiconductor layers. Here, the second semiconductor layer is a layer functioning as an active layer of the transistor.

本発明の発光装置の製造方法は、発光素子を駆動するためのトランジスタを作製する工程を有する。ここで、トランジスタは、半導体層と、絶縁層と、導電層とが順に積層して成る。そして、トランジスタを作製する工程において、活性層として機能する半導体層を形成するときに、行方向及び列方向に延びた格子状の第1の半導体層を基板上に形成すると共に、前記第1の半導体層の間に、島状に分離した第2の半導体層を複数形成することを特徴としている。ここで、第2の半導体層は、トランジスタの活性層として機能する層である。   The method for manufacturing a light emitting device of the present invention includes a step of manufacturing a transistor for driving a light emitting element. Here, the transistor is formed by sequentially stacking a semiconductor layer, an insulating layer, and a conductive layer. When forming a semiconductor layer functioning as an active layer in a process for manufacturing a transistor, a lattice-shaped first semiconductor layer extending in a row direction and a column direction is formed over a substrate, and the first A plurality of second semiconductor layers separated into island shapes are formed between the semiconductor layers. Here, the second semiconductor layer is a layer functioning as an active layer of the transistor.

本発明の発光装置の製造方法は、発光素子を駆動するためのプレーナ型のトランジスタ、特にトップゲート型のトランジスタを作製する工程を有する。そして、トランジスタを作製する工程において、活性層として機能する半導体層を形成するときに、島状に分離した複数の第1の半導体層から成る群を一基板上に複数形成すると共に、前記群のそれぞれを囲むように行方向及び列方向に延びた格子状の第2の半導体層を形成することを特徴としている。ここで、第1の半導体層は、トランジスタの活性層として機能する層である。   The manufacturing method of a light emitting device of the present invention includes a step of manufacturing a planar type transistor for driving a light emitting element, particularly a top gate type transistor. In the process of manufacturing the transistor, when forming the semiconductor layer functioning as the active layer, a plurality of groups formed of a plurality of first semiconductor layers separated into island shapes are formed on one substrate, and the group A lattice-shaped second semiconductor layer extending in the row direction and the column direction is formed so as to surround each of them. Here, the first semiconductor layer is a layer functioning as an active layer of the transistor.

本発明の発光装置の製造方法は、発光素子を駆動するためのトランジスタを作製する工程を有する。ここで、トランジスタは、半導体層と、絶縁層と、導電層とが順に積層して成る。そして、トランジスタを作製する工程において、活性層として機能する半導体層を形成するときに、島状に分離した複数の第1の半導体層から成る群を一基板上に複数作製すると共に、前記群のそれぞれを囲むように行方向及び列方向に延びた格子状の第2の半導体層を形成することを特徴としている。ここで、第2の半導体層は、トランジスタの活性層として機能する層である。   The method for manufacturing a light emitting device of the present invention includes a step of manufacturing a transistor for driving a light emitting element. Here, the transistor is formed by sequentially stacking a semiconductor layer, an insulating layer, and a conductive layer. In the process of manufacturing the transistor, when forming the semiconductor layer functioning as the active layer, a plurality of groups each including a plurality of first semiconductor layers separated into island shapes are formed over one substrate, and A lattice-shaped second semiconductor layer extending in the row direction and the column direction is formed so as to surround each of them. Here, the second semiconductor layer is a layer functioning as an active layer of the transistor.

以上に示した本発明の発光装置の製造方法において、トップゲート型のトランジスタとはトランジスタの活性層を形成した後にゲート電極が形成されるように作製されたトランジスタをいう。また、以上に示した本発明の発光装置の製造方法において、前記第1の半導体層に不純物を添加する工程をさらに含んでいてもよい。なお、n型またはp型のいずれか一または両方を添加してもよい。   In the method for manufacturing a light-emitting device of the present invention described above, a top-gate transistor refers to a transistor manufactured so that a gate electrode is formed after an active layer of the transistor is formed. Moreover, in the manufacturing method of the light-emitting device of this invention shown above, the process of adding an impurity to the said 1st semiconductor layer may be further included. One or both of n-type and p-type may be added.

本発明の発光装置は、発光素子とトランジスタとを含んで成る素子群を有する第1の基板と、前記素子群を封じ込めるように、シール材によって前記第1の基板と貼り合わせられた第2の基板とを有する。前記第1の基板において、前記素子群は、開口部を有する絶縁層によって覆われ、前記開口部は、前記素子群を囲む半導体層の上方に設けられ、前記シール材は前記開口部を埋めるように設けられていることを特徴としている。   The light-emitting device of the present invention includes a first substrate having an element group including a light-emitting element and a transistor, and a second substrate bonded to the first substrate with a sealant so as to enclose the element group. A substrate. In the first substrate, the element group is covered with an insulating layer having an opening, the opening is provided above a semiconductor layer surrounding the element group, and the sealing material fills the opening. It is characterized by being provided.

本発明の発光装置は、発光素子とトランジスタとを含んで成る素子群を有する第1の基板と、前記素子群を封じ込めるように、シール材によって前記第1の基板と貼り合わせられた第2の基板とを有する。前記第1の基板において、前記素子群は、前記素子群を囲む半導体層の上方に、前記半導体層と重畳する導電層が露出するように設けられた開口部を有する絶縁層によって覆われ、前記シール材は前記開口部を埋めるように設けられていることを特徴としている。   The light-emitting device of the present invention includes a first substrate having an element group including a light-emitting element and a transistor, and a second substrate bonded to the first substrate with a sealant so as to enclose the element group. A substrate. In the first substrate, the element group is covered with an insulating layer having an opening provided so that a conductive layer overlapping the semiconductor layer is exposed above a semiconductor layer surrounding the element group, The sealing material is provided so as to fill the opening.

本発明の発光装置は、発光素子とトランジスタとを含んで成る素子群を有する第1の基板と、前記素子群を封じ込めるように、シール材によって前記第1の基板と貼り合わせられた第2の基板とを有する。前記第1の基板において、前記素子群は、半導体層に囲まれると共に、絶縁層によって覆われ、前記絶縁層の端部から、前記半導体層と重畳する導電層が露出し、前記シール材は前記導電層と前記絶縁層の端部とを覆うように設けられていることを特徴としている。   The light-emitting device of the present invention includes a first substrate having an element group including a light-emitting element and a transistor, and a second substrate bonded to the first substrate with a sealant so as to enclose the element group. A substrate. In the first substrate, the element group is surrounded by a semiconductor layer and covered with an insulating layer, and a conductive layer overlapping the semiconductor layer is exposed from an end of the insulating layer, and the sealing material is The conductive layer is provided so as to cover the end portion of the insulating layer.

以上に示した本発明の発光装置において、前記半導体層にはn型またはp型のいずれか一または両方の不純物が添加されていることが好ましい。また、前記絶縁層は、表面が平坦な層、例えばアクリル、シロキサン(シリコン(Si)と酸素(O)との結合で骨格構造が構成され、有機基に少なくとも水素を含む物質)またはポリイミド等の自己平坦性を有する物質からなる層、または酸化珪素等から成る層を形成後CMP(Chemical and Mechanical Polishing)法等によって平坦化して形成した層であることが好ましい。また、前記シール材は、ビスフェノールA型液状樹脂、ビスフェノールA型固形樹脂、含ブロムエポキシ樹脂、ビスフェノールF型樹脂、ビスフェノールAD型樹脂、フェノール型樹脂、クレゾール型樹脂、ノボラック型樹脂、環状脂肪族エポキシ樹脂、エピビス型エポキシ樹脂、グリシジルエステル樹脂、グリジシルアミン系樹脂、複素環式エポキシ樹脂、変性エポキシ樹脂等のエポキシ樹脂等の透湿性の低い物質を含むものであることが好ましい。   In the light-emitting device of the present invention described above, it is preferable that one or both of n-type and p-type impurities be added to the semiconductor layer. The insulating layer is a layer having a flat surface, such as acrylic, siloxane (a substance having a skeletal structure composed of a bond of silicon (Si) and oxygen (O) and containing at least hydrogen in an organic group), polyimide, or the like. A layer formed by forming a layer made of a substance having self-flatness or a layer made of silicon oxide or the like and then flattening by a CMP (Chemical and Mechanical Polishing) method or the like is preferable. The sealing material is bisphenol A type liquid resin, bisphenol A type solid resin, bromine-containing epoxy resin, bisphenol F type resin, bisphenol AD type resin, phenol type resin, cresol type resin, novolak type resin, cyclic aliphatic epoxy. It is preferable to include a material having low moisture permeability such as an epoxy resin such as a resin, an epibis type epoxy resin, a glycidyl ester resin, a glycidylamine resin, a heterocyclic epoxy resin, and a modified epoxy resin.

本発明によって、静電気に起因した不良を低減し、さらに基板面を有効に活用できるような発光装置の製造技術を得ることができる。また、本発明によって、静電気に起因した不良が低減された良品の発光装置を得ることができる。   According to the present invention, it is possible to obtain a manufacturing technique of a light-emitting device that can reduce defects caused by static electricity and that can effectively utilize a substrate surface. In addition, according to the present invention, a non-defective light emitting device in which defects due to static electricity are reduced can be obtained.

以下、本発明の一態様について説明する。但し、本発明は多くの異なる態様で実施することが可能であり、本発明の趣旨及びその範囲から 逸脱することなくその形態及び詳細を様々に変更し得ることは当業者であれば容易に理解される。従って、本形態の記載内容に限定して解釈されるものではない。   Hereinafter, one embodiment of the present invention will be described. However, the present invention can be implemented in many different modes, and those skilled in the art can easily understand that the modes and details can be variously changed without departing from the spirit and scope of the present invention. Is done. Therefore, the present invention is not construed as being limited to the description of the embodiment.

(実施の形態1)
本実施の形態では、一つの基板上に複数の発光装置をまとめて作製した後、当該基板を切り分け(つまり分断し、)、個々の発光装置とする発光装置の作製方法について説明する。
(Embodiment 1)
In this embodiment, after manufacturing a plurality of light-emitting devices over one substrate, the substrate is cut (that is, divided), and a method for manufacturing a light-emitting device using each light-emitting device is described.

図1(A)は、本発明の発光装置について説明するための上面図、図2、3は、本発明の発光装置の作製方法について説明するための断面図である。図2(A)は、図1(A)における破線A−A’における断面図である。   FIG. 1A is a top view for explaining the light-emitting device of the present invention, and FIGS. 2 and 3 are cross-sectional views for explaining a method for manufacturing the light-emitting device of the present invention. FIG. 2A is a cross-sectional view taken along broken line A-A ′ in FIG.

先ず、図1(A)に示すように、基板101上に、行方向及び列方向に延びた格子状の第1の半導体層102を形成する。第1の半導体層102が形成すると共に、第1の半導体層102に囲まれた領域130内には、図2(A)に示すように島状に分離した第2の半導体層103が複数形成する。ここで、第2の半導体層103は、トランジスタを作製するために形成される層である。そして、後述の工程を経ることにより、第1の半導体層102に囲まれた領域130を一単位とした発光装置が基板201上に複数形成される。なお、本形態では、領域130内に画素部131、駆動回路部132a、132b等を作製するため、図2、3の断面図では、各々の部分について模式的に表している。   First, as shown in FIG. 1A, a lattice-shaped first semiconductor layer 102 extending in a row direction and a column direction is formed over a substrate 101. In addition to the formation of the first semiconductor layer 102, a plurality of second semiconductor layers 103 separated in an island shape are formed in a region 130 surrounded by the first semiconductor layer 102 as shown in FIG. To do. Here, the second semiconductor layer 103 is a layer formed in order to manufacture a transistor. Then, a plurality of light-emitting devices each including the region 130 surrounded by the first semiconductor layer 102 as a unit are formed on the substrate 201 through a process described later. Note that in this embodiment mode, the pixel portion 131, the drive circuit portions 132a and 132b, and the like are formed in the region 130, and therefore each portion is schematically illustrated in the cross-sectional views of FIGS.

ここで、基板101について特に限定はないが、ガラスや石英等から成る基板を用いることができる。また、基板101上には、基板101を覆う絶縁層104が形成されていてもよい。絶縁層104は単層または複数の層のいずれから成るものであってもよい。なお、絶縁層104に窒化珪素(数%の酸素を含んでいてもよい)から成る層を含むことにより、基板101から後の工程で作製するトランジスタへの不純物の拡散を阻止することができる。   Here, the substrate 101 is not particularly limited, but a substrate made of glass, quartz, or the like can be used. Further, an insulating layer 104 that covers the substrate 101 may be formed over the substrate 101. The insulating layer 104 may be either a single layer or a plurality of layers. Note that when the insulating layer 104 includes a layer formed using silicon nitride (which may contain several percent of oxygen), diffusion of impurities from the substrate 101 to a transistor formed in a later step can be prevented.

また、第1の半導体層102及び第2の半導体層103は、基板101を覆う半導体層を形成した後、当該半導体層をエッチングによって加工して形成すればよい。ここで、半導体層について特に限定はなく、珪素等を用いて形成することができる。また半導体層の結晶性についても特に限定はなく、結晶質成分を含む半導体層を用いることができる。   The first semiconductor layer 102 and the second semiconductor layer 103 may be formed by forming a semiconductor layer that covers the substrate 101 and then processing the semiconductor layer by etching. Here, there is no particular limitation on the semiconductor layer, and the semiconductor layer can be formed using silicon or the like. There is no particular limitation on the crystallinity of the semiconductor layer, and a semiconductor layer containing a crystalline component can be used.

次に、第1の半導体層102及び第2の半導体層103を覆う絶縁層105を形成する。なお絶縁層105は単層又は複数の層のいずれから成るものであってもよく、例えば酸化珪素、または窒化珪素を用いて形成することができる。   Next, an insulating layer 105 that covers the first semiconductor layer 102 and the second semiconductor layer 103 is formed. Note that the insulating layer 105 may be either a single layer or a plurality of layers, and can be formed using, for example, silicon oxide or silicon nitride.

なお、絶縁層105の形成前または形成後に、トランジスタの閾値を調節するために、第2の半導体層103にn型又はp型の不純物の添加をしてもよい。n型不純物としては、例えば燐等を用いることができ、p型不純物としては、例えばボロン等を用いることができる。また、第2の半導体層103に不純物を添加するとき、第1の半導体層102にも不純物を添加してもよい。   Note that an n-type or p-type impurity may be added to the second semiconductor layer 103 in order to adjust the threshold value of the transistor before or after the insulating layer 105 is formed. For example, phosphorus or the like can be used as the n-type impurity, and boron or the like can be used as the p-type impurity, for example. Further, when an impurity is added to the second semiconductor layer 103, the impurity may also be added to the first semiconductor layer 102.

次に、絶縁層105上であって、第2の半導体層103と絶縁層105とが重畳する部分の上方に、ゲート電極として機能する導電層106を形成する。導電層106は、先ず絶縁層105を覆うように導電層を形成した後、当該導電層をエッチングによって加工し、形成すればよい。このとき、基板101は、第1の半導体層102が形成されていることによって基板全体がほぼ等電位に保たれている。従って、ドライエッチング等のプラズマ励起を利用したエッチング方法を用いたときでも、基板内での電位の偏りが生じにくく、静電気に起因した素子の破壊が生じにくい。ここで、導電層106は単層又は複数の層のいずれから成るものであってもよく、例えば、絶縁層105と密着性のよい導電層を絶縁層105と接するように設け、その導電層上に抵抗の低い導電層が積層されたようなものであってもよい。導電層106の形状についても特に限定はなく、例えば側壁に傾斜を有する形状であってもよい。   Next, a conductive layer 106 that functions as a gate electrode is formed over the insulating layer 105 and above a portion where the second semiconductor layer 103 and the insulating layer 105 overlap with each other. The conductive layer 106 may be formed by first forming a conductive layer so as to cover the insulating layer 105 and then processing the conductive layer by etching. At this time, the entire substrate 101 is maintained at substantially the same potential because the first semiconductor layer 102 is formed. Therefore, even when an etching method using plasma excitation such as dry etching is used, the potential in the substrate is less likely to be biased and the element is less likely to be damaged due to static electricity. Here, the conductive layer 106 may be either a single layer or a plurality of layers. For example, a conductive layer having good adhesion with the insulating layer 105 is provided so as to be in contact with the insulating layer 105, and the conductive layer 106 is formed on the conductive layer. Alternatively, a conductive layer having a low resistance may be stacked. There is no particular limitation on the shape of the conductive layer 106, and for example, a shape having an inclined side wall may be used.

次に、導電層106をマスクとして、第2の半導体層103に不純物を添加する。ここで、n型のトランジスタを作製するときは燐等のn型を付与する不純物を添加すればよく、p型のトランジスタを作製するときは、ボロン等のp型を付与する不純物を添加すればよい。また、n型の不純物を添加するとき、p型のトランジスタの構成要素となる半導体層については、レジスト等のマスクを用いて不純物が添加されないように保護すればよい。p型の不純物を添加するときも、n型のトランジスタの構成要素となる半導体層については、レジスト等のマスクを用いて不純物が添加されないように保護すればよい。また、例えば、レジスト等のマスクを用いずに基板101上の半導体層全てにn型不純物を添加した後、n型を打ち消してp型を付与できるように添加量を調節して、p型のトランジスタの構成要素である半導体層に対してp型の不純物を添加してもよい。   Next, an impurity is added to the second semiconductor layer 103 using the conductive layer 106 as a mask. Here, an n-type transistor such as phosphorus may be added when an n-type transistor is manufactured, and a p-type impurity such as boron may be added when a p-type transistor is manufactured. Good. In addition, when an n-type impurity is added, a semiconductor layer which is a component of the p-type transistor may be protected using a mask such as a resist so that the impurity is not added. Even when a p-type impurity is added, the semiconductor layer which is a constituent element of the n-type transistor may be protected by using a mask such as a resist so that the impurity is not added. Further, for example, after adding an n-type impurity to all the semiconductor layers on the substrate 101 without using a mask such as a resist, the addition amount is adjusted so that the n-type can be canceled and a p-type can be imparted. A p-type impurity may be added to the semiconductor layer which is a component of the transistor.

ここで、不純物の添加法について特に限定はなく、例えばドーピング法等を用いることができる。また、第2の半導体層103に不純物を添加すると共に、第1の半導体層102にも不純物を添加しても構わない。第1の半導体層102にも不純物を添加することによって、基板101の全面を等電位となるように保つ効果がより高まる。   Here, the method for adding impurities is not particularly limited, and for example, a doping method or the like can be used. Further, impurities may be added to the second semiconductor layer 103 and impurities may be added to the first semiconductor layer 102. By adding an impurity also to the first semiconductor layer 102, the effect of keeping the entire surface of the substrate 101 to be equipotential is further increased.

以上のような工程によって、半導体層と絶縁層と導電層とが積層して成るトランジスタ121a、121b、121c、121dを作製することができる。ここで、トランジスタ121a、121bは、画素部131に含まれ、発光素子と接続している。また、トランジスタ121cは駆動回路部132aに含まれ、トランジスタ121dは駆動回路部132bに含まれる。また、画素部131、駆動回路部132a、132bにはそれぞれ、トランジスタ121a、121b、121c、121d以外のトランジスタが含まれていてもよい。なお、トランジスタ121a、121b、121c、121dの構造について特に限定はなく、シングルドレイン構造またはLDD構造、またはLDDとゲート電極として機能する導電層とがオーバーラップしたLDD構造等、いずれの構造のものであってもよい。また、第1の半導体層102が設けられた状態で作製するのであれば、トランジスタ121a、121b、121c、121dを作製する工程について特に限定はなく、所望の構造のトランジスタ121a、121b、121c、121dが形成できるように、適宜工程を決めればよい。また、発光装置に設けられる全てのトランジスタを同じ構造で作製する必要はなく、トランジスタの用途によって適宜作り分ければよい。   Through the above steps, transistors 121a, 121b, 121c, and 121d each including a semiconductor layer, an insulating layer, and a conductive layer can be manufactured. Here, the transistors 121a and 121b are included in the pixel portion 131 and connected to the light emitting element. The transistor 121c is included in the drive circuit portion 132a, and the transistor 121d is included in the drive circuit portion 132b. Further, the pixel portion 131 and the drive circuit portions 132a and 132b may include transistors other than the transistors 121a, 121b, 121c, and 121d, respectively. Note that there is no particular limitation on the structure of the transistors 121a, 121b, 121c, and 121d, which may be any structure such as a single drain structure or an LDD structure, or an LDD structure in which an LDD and a conductive layer functioning as a gate electrode overlap. There may be. Further, there is no particular limitation on a process for manufacturing the transistors 121a, 121b, 121c, and 121d as long as the first semiconductor layer 102 is provided, and the transistors 121a, 121b, 121c, and 121d having a desired structure are not limited. The process may be determined as appropriate so that can be formed. Further, it is not necessary to manufacture all the transistors provided in the light-emitting device with the same structure, and they may be appropriately formed depending on the use of the transistor.

次に、導電層106等を覆う絶縁層107を形成する。絶縁層107は単層又は複数の層のいずれから成るものであってもよい。本形態では、絶縁層107は絶縁層107aと絶縁層107bの二層から成る。まず、絶縁層107aを形成した後、熱処理をし、さらに絶縁層107aを覆う絶縁層107bを形成する。絶縁層107aについて特に限定はないが、350℃以上の耐熱性を有するような物質、例えば酸化珪素、窒化珪素、数%の酸素を含む窒化珪素、または数%の窒素を含む酸化珪素等の無機物から成ることが好ましい。また、絶縁層107bについて特に限定はないが、表面が平坦な層、例えばアクリル、シロキサンまたはポリイミド等の自己平坦性を有する物質からなる層、または酸化珪素等から成る層を形成後CMP(Chemical and Mechanical Polishing)法等によって平坦化して形成した層であることが好ましい。なお、熱処理の処理条件について特に限定はないが、350〜600℃の温度下で、窒素または水素等のガスが充填された雰囲気で行うことが好ましい。また、熱処理の工程部位についても特に限定はなく、本形態のように一層目の絶縁層107aの形成後でもよいし、または二層目の絶縁層107bの形成後、または絶縁層107aの形成後及び絶縁層107bの形成後でもよい。   Next, an insulating layer 107 that covers the conductive layer 106 and the like is formed. The insulating layer 107 may be either a single layer or a plurality of layers. In this embodiment mode, the insulating layer 107 includes two layers, an insulating layer 107a and an insulating layer 107b. First, after the insulating layer 107a is formed, heat treatment is performed, and an insulating layer 107b that covers the insulating layer 107a is formed. Although there is no particular limitation on the insulating layer 107a, a substance having heat resistance of 350 ° C. or higher, for example, an inorganic substance such as silicon oxide, silicon nitride, silicon nitride containing several percent oxygen, or silicon oxide containing several percent nitrogen Preferably it consists of. Although there is no particular limitation on the insulating layer 107b, a CMP (Chemical and Chemical) layer is formed after forming a layer having a flat surface, for example, a layer made of a material having self-flatness such as acrylic, siloxane, or polyimide, or a layer made of silicon oxide or the like. A layer formed by planarization by a mechanical polishing method or the like is preferable. Note that although there are no particular limitations on the heat treatment conditions, it is preferably performed in an atmosphere filled with a gas such as nitrogen or hydrogen at a temperature of 350 to 600 ° C. Further, there is no particular limitation on the process part of the heat treatment, which may be performed after the formation of the first insulating layer 107a as in this embodiment, or after the formation of the second insulating layer 107b or after the formation of the insulating layer 107a. And after the formation of the insulating layer 107b.

次に、絶縁層107を貫通して第2の半導体層に至るコンタクトホールを形成する。コンタクトホールは、絶縁層107をエッチングして形成すればよい。このとき、エッチングとしては、ドライエッチングまたはウェットエッチングのいずれの方法を用いてもよいし、両方を組み合わせて用いてもよい。例えば、絶縁層107bをドライエッチングして開孔した後、絶縁層107aをウェットエッチングして開孔し、コンタクトホールを形成してもよい。また、絶縁層107a、107bのいずれもドライエッチングによって開孔してもよい。   Next, a contact hole that penetrates the insulating layer 107 and reaches the second semiconductor layer is formed. The contact hole may be formed by etching the insulating layer 107. At this time, as the etching, either dry etching or wet etching may be used, or both may be used in combination. For example, the contact hole may be formed by opening the insulating layer 107b by dry etching and then opening the insulating layer 107a by wet etching. Further, both of the insulating layers 107a and 107b may be opened by dry etching.

なお、コンタクトホールの形成時、基板101は、第1の半導体層102が形成されていることによって基板全体がほぼ等電位に保たれている。従って、ドライエッチング等のプラズマ励起を利用したエッチング方法を用いてコンタクトホールを開孔するときでも、基板内での電位の偏りが生じにくく、静電気に起因した素子の破壊が生じにくい。   Note that when the contact hole is formed, the substrate 101 is maintained at substantially the same potential because the first semiconductor layer 102 is formed. Therefore, even when the contact hole is opened using an etching method using plasma excitation such as dry etching, the potential in the substrate is less likely to be biased, and the element is less likely to be damaged due to static electricity.

次に、配線108、109等を形成する。配線108、109は、導電層を形成した後、当該導電層をエッチングによって加工し、形成すればよい。なお、導電層について特に限定はなく、単層または複数の層のいずれから成るものでもよい。但し、アルミニウムのような低抵抗な物質から成る層を含むように形成することが好ましい。なお、配線108,109を窒化チタン等から成る層によってアルミニウムから成る層を挟むような積層構造にすると、第2の半導体層103と接する部分において第2の半導体層103とアルミニウムから成る層とが接触することを防止でき、また後の工程において発光素子の電極を形成するために酸性の溶液を用いるときにアルミニウムから成る層が腐食されるのを防止できる。本形態のように、配線108と第1の半導体層102とは重畳し、さらに配線108と第1の半導体層102とが接しているとき、配線108をエッチングする工程において、第1の半導体層102もエッチングすればよい。なお、配線108は発光素子に電流を供給するための配線である。本形態のように、第1の半導体層102の上方は、配線109を引き回すための領域として有効に活用することができる。なお、配線108と第1の半導体層102とは必ずしも本形態のように接している必要はなく、間に絶縁層を挟んでいてもよい。また、配線108は、第1の半導体層102に囲まれた領域130内において、各トランジスタに信号を伝達するための配線である。配線108は、先に形成したコンタクトホールを通って、第2の半導体層103に接続している。   Next, wirings 108 and 109 are formed. The wirings 108 and 109 may be formed by forming a conductive layer and then processing the conductive layer by etching. In addition, there is no limitation in particular about an electroconductive layer, You may consist of either a single layer or several layers. However, it is preferably formed so as to include a layer made of a low resistance material such as aluminum. Note that when the wirings 108 and 109 have a stacked structure in which a layer made of aluminum is sandwiched between layers made of titanium nitride or the like, the second semiconductor layer 103 and the layer made of aluminum are formed in a portion in contact with the second semiconductor layer 103. It is possible to prevent contact, and it is possible to prevent the layer made of aluminum from being corroded when an acidic solution is used to form an electrode of a light emitting element in a later step. As in this embodiment, when the wiring 108 and the first semiconductor layer 102 overlap each other and the wiring 108 and the first semiconductor layer 102 are in contact with each other, the first semiconductor layer is etched in the step of etching the wiring 108. 102 may also be etched. Note that the wiring 108 is a wiring for supplying a current to the light emitting element. As in this embodiment mode, the upper portion of the first semiconductor layer 102 can be effectively used as a region for routing the wiring 109. Note that the wiring 108 and the first semiconductor layer 102 are not necessarily in contact with each other as in this embodiment mode, and an insulating layer may be interposed therebetween. The wiring 108 is a wiring for transmitting a signal to each transistor in the region 130 surrounded by the first semiconductor layer 102. The wiring 108 is connected to the second semiconductor layer 103 through the previously formed contact hole.

また、絶縁層107が透湿性の高い物質で形成されているときは、配線108,109を形成すると共に、絶縁層107の側壁を覆う導電層を設けることが好ましい。これによって、絶縁層107を通って発光装置外部から発光素子への水分混入を阻止することができる。   In addition, when the insulating layer 107 is formed using a highly moisture-permeable material, it is preferable to form the wirings 108 and 109 and provide a conductive layer that covers the sidewall of the insulating layer 107. Accordingly, moisture can be prevented from entering the light emitting element from the outside of the light emitting device through the insulating layer 107.

次に、発光素子の電極110を形成する。このとき、発光素子の電極110の一部が、配線109の少なくとも一部と重畳するように形成することによって、発光素子の電極110と配線109とを電気的に接続することができる。発光素子の電極110について特に限定はなく、例えば、可視光を透過できる導電物によって導電層を形成した後、当該導電層をエッチングして加工し、形成することができる。また、可視光を透過できる導電物について特に限定はないが、インジウム錫酸化物(ITO)、酸化珪素を含有するITO、酸化インジウムに2〜20%の酸化亜鉛(ZnO)を混合して成るIZO(Indium Zinc Oxide)等を用いることができる。なお、エッチングはウェットエッチングまたはドライエッチングのいずれの方法を用いて行ってもよく、例えばITO等のエッチングには弱酸性の溶液を用いことができる。また、可視光を透過できる導電物の他、アルミニウム等を用いて形成することもできる。なお、アルミニウムにはリチウム(Li)等のアルカリ金属またはマグネシウム等のアルカリ土類金属が含まれていてもよい。   Next, the electrode 110 of the light emitting element is formed. At this time, by forming part of the electrode 110 of the light-emitting element so as to overlap with at least part of the wiring 109, the electrode 110 of the light-emitting element and the wiring 109 can be electrically connected. There is no particular limitation on the electrode 110 of the light-emitting element, and for example, a conductive layer can be formed using a conductive material that can transmit visible light, and then the conductive layer can be etched and processed. Further, there is no particular limitation on the conductive material that can transmit visible light, but indium tin oxide (ITO), ITO containing silicon oxide, IZO formed by mixing indium oxide with 2 to 20% zinc oxide (ZnO). (Indium Zinc Oxide) or the like can be used. Etching may be performed using either wet etching or dry etching. For example, a weakly acidic solution may be used for etching ITO or the like. In addition to a conductive material that can transmit visible light, aluminum or the like can be used. Aluminum may contain an alkali metal such as lithium (Li) or an alkaline earth metal such as magnesium.

次に、開口部を有する隔壁層111を形成する。隔壁層111は、曲率半径が連続的に変化する形状となるように形成することが好ましい。また、開口部からは発光素子の電極110が露出するようにする。なお、隔壁層111を構成する物質について特に限定はなく、例えば、アクリル、ポリイミド、シロキサン(シリコン(Si)と酸素(O)との結合で骨格構造が構成され、置換基に少なくとも水素を含む有機物)、レジスト等を用いることができる。ここで、アクリル、ポリイミド、レジストは、感光性を有するものであってもよい。なお、隔壁層111は絶縁層107の側壁を必ずしも覆わなくてもよい。   Next, a partition layer 111 having an opening is formed. The partition layer 111 is preferably formed so as to have a shape in which the radius of curvature continuously changes. Further, the electrode 110 of the light emitting element is exposed from the opening. Note that there is no particular limitation on the substance forming the partition layer 111. For example, acrylic, polyimide, siloxane (an organic substance in which a skeleton structure is formed by a bond of silicon (Si) and oxygen (O), and a substituent includes at least hydrogen) ), A resist or the like can be used. Here, the acrylic, polyimide, and resist may have photosensitivity. Note that the partition wall layer 111 does not necessarily cover the sidewall of the insulating layer 107.

次に、発光素子の電極110を覆うように発光層112を形成する。発光層112について特に限定はなく、発光物質を含んで成る層であればよい。例えば、発光性が高くキャリア輸送性が高い物質から成る単層のものでもよいし、または発光性が高い物質とキャリア輸送性が高い物質とを含む単層または複数の層から成るものであってもよい。発光層112を構成する物質についても特に限定はなく、有機物または無機物のいずれか一方若しくは両方を用いることができる。   Next, the light emitting layer 112 is formed so as to cover the electrode 110 of the light emitting element. There is no particular limitation on the light-emitting layer 112, and any layer containing a light-emitting substance may be used. For example, it may be a single layer made of a substance having a high light-emitting property and a high carrier-transport property, or a single layer or a plurality of layers containing a material having a high light-emitting property and a substance having a high carrier-transport property. Also good. There is no particular limitation on a substance included in the light-emitting layer 112, and either one or both of an organic substance and an inorganic substance can be used.

次に、発光素子の電極113を形成する。発光素子の電極113について特に限定はなく、アルミニウムまたは先に記載したような可視光を透過できる導電物を用いて形成することができる。なお、アルミニウムにはリチウム(Li)やマグネシウム等のアルカリ金属またはアルカリ土類金属が含まれていてもよい。   Next, an electrode 113 of the light emitting element is formed. There is no particular limitation on the electrode 113 of the light-emitting element, and the electrode 113 can be formed using aluminum or a conductive material that can transmit visible light as described above. Note that aluminum may contain an alkali metal such as lithium (Li) or magnesium or an alkaline earth metal.

なお、発光素子の電極110、113の少なくとも一方は可視光を透過できるように膜厚、材料、積層構造等を調節することが好ましい。   Note that it is preferable to adjust the film thickness, material, stacked structure, and the like so that at least one of the electrodes 110 and 113 of the light-emitting element can transmit visible light.

以上のような工程によって、発光素子の電極110と発光素子の電極113との間に発光層112を挟んで成る発光素子114が作製される。   Through the above-described process, the light-emitting element 114 in which the light-emitting layer 112 is sandwiched between the electrode 110 of the light-emitting element and the electrode 113 of the light-emitting element is manufactured.

発光素子114を作製した後、発光素子に水分等が混入するのを阻止するための保護層115を設けてもよい。保護層115は、単層又は複数の層のいずれから成るものであってもよく、窒化珪素等によって形成することができる。   After the light-emitting element 114 is manufactured, a protective layer 115 may be provided to prevent moisture or the like from entering the light-emitting element. The protective layer 115 may be formed of either a single layer or a plurality of layers, and can be formed of silicon nitride or the like.

以上の工程を経ることによって、図1(B)に表されるように、画素部131、駆動回路部132a、132b、133、画素部および駆動回路部の周辺に設けられた配線109、接続端子134等を含んで成る発光装置が、基板101上に複数作製される。画素部131には、トランジスタと発光素子とを含んで成る画素が行方向及び列方向に複数配列している。なお、図1(B)では、発光装置に含まれる構成要素(画素部131、駆動回路部132a、132b、133、画素部および駆動回路部の周辺に設けられた配線108、接続端子134等)と、第1の半導体層102との位置関係を示すために、第1の半導体層102についても図示している。また、図1(B)には、二つのトランジスタと発光素子とを含んで成る一つの画素について示されているが、画素の構成は、これに限定されるものではない。   Through the above steps, as shown in FIG. 1B, the pixel portion 131, the driver circuit portions 132a, 132b, and 133, the wiring 109 provided around the pixel portion and the driver circuit portion, and connection terminals A plurality of light emitting devices including 134 and the like are manufactured over the substrate 101. In the pixel portion 131, a plurality of pixels each including a transistor and a light emitting element are arranged in the row direction and the column direction. Note that in FIG. 1B, components included in the light-emitting device (the pixel portion 131, the driver circuit portions 132a, 132b, and 133, the wiring 108 provided around the pixel portion and the driver circuit portion, the connection terminal 134, and the like) In order to show the positional relationship between the first semiconductor layer 102 and the first semiconductor layer 102, the first semiconductor layer 102 is also illustrated. Further, FIG. 1B illustrates one pixel including two transistors and a light-emitting element; however, the structure of the pixel is not limited to this.

なお、以上のような発光装置の製造方法において、配線108、109形成後に生じ得る静電気に起因した素子の損傷を低減するために、ショートリングを利用してもよい。   Note that in the method for manufacturing a light-emitting device as described above, a short ring may be used in order to reduce element damage due to static electricity that may occur after the wirings 108 and 109 are formed.

次に、基板101を発光装置ごとに切り分ける(つまり分断する。)。このとき、切り込みが入る部分の基板上には、層が積層されていないことが好ましく、特に導電層、有機物から成る層等が積層されていないことが好ましい。   Next, the substrate 101 is cut (that is, divided) for each light emitting device. At this time, it is preferable that no layer is stacked on the substrate where the cut is made, and it is particularly preferable that a conductive layer, a layer made of an organic material, or the like is not stacked.

次に、発光層が内側に閉じこめられるように、分断後の基板101と基板140とをシール材141を用いて貼り合わせて封止する。このとき、絶縁層107を覆う配線108をさらにシール材141が覆うようにすることが好ましい。また、シール材141は、例えばビスフェノールA型液状樹脂、ビスフェノールA型固形樹脂、含ブロムエポキシ樹脂、ビスフェノールF型樹脂、ビスフェノールAD型樹脂、フェノール型樹脂、クレゾール型樹脂、ノボラック型樹脂、環状脂肪族エポキシ樹脂、エピビス型エポキシ樹脂、グリシジルエステル樹脂、グリジシルアミン系樹脂、複素環式エポキシ樹脂、変性エポキシ樹脂等のエポキシ樹脂等の透湿性の低い物質を含むものであることが好ましい。これによって、絶縁層107または隔壁層111が透湿性の高い物質で形成されているときに、絶縁層107を介して発光素子に水分が拡散することを防止できる。なお、封止後の発光装置内部、つまり基板101と基板140とシール材141とに囲まれた内部は、窒素等の不活性気体、または透湿性の低い樹脂材料等で充填されていてもよいし、または真空になっていてもよい。また、封止後の発光装置内部に吸湿性を有する物質を固定して当該内部に混入した水分などを吸収できるようにし、発光素子が水分等によって劣化するのを防止してもよい。吸湿性を有する物質について特に限定はないが、例えば酸化カルシウムを用いることができる。また当該物質の固定法についても特に限定はなく、例えば基板140の一部に凹部を設け、粒状の酸化カルシウムと固定剤とを含む組成物を当該凹部に注入した後、当該組成物を固化することによって固定することができる。なお固定剤についても特に限定はなく、例えばエステルアクリレート等を用いることができる。また、基板140について特に限定はなく、ガラスや石英、またはプラスチック等から成る基板を用いることができる。   Next, the divided substrate 101 and the substrate 140 are bonded using a sealant 141 and sealed so that the light emitting layer is confined inside. At this time, it is preferable that the sealant 141 further covers the wiring 108 covering the insulating layer 107. The sealing material 141 is, for example, a bisphenol A liquid resin, a bisphenol A solid resin, a bromine-containing epoxy resin, a bisphenol F resin, a bisphenol AD resin, a phenol resin, a cresol resin, a novolac resin, a cyclic aliphatic. It is preferable to include a material having low moisture permeability such as an epoxy resin such as an epoxy resin, an epibis type epoxy resin, a glycidyl ester resin, a glycidylamine resin, a heterocyclic epoxy resin, or a modified epoxy resin. Accordingly, moisture can be prevented from diffusing into the light-emitting element through the insulating layer 107 when the insulating layer 107 or the partition wall layer 111 is formed using a highly moisture-permeable material. Note that the inside of the light emitting device after sealing, that is, the inside surrounded by the substrate 101, the substrate 140, and the sealant 141 may be filled with an inert gas such as nitrogen or a resin material with low moisture permeability. Or it may be in a vacuum. Alternatively, a hygroscopic substance may be fixed inside the light-emitting device after sealing so that moisture mixed in the inside can be absorbed, and the light-emitting element can be prevented from being deteriorated by moisture or the like. There is no particular limitation on the hygroscopic substance, and for example, calcium oxide can be used. There is no particular limitation on the method for fixing the substance. For example, a recess is provided in a part of the substrate 140, and a composition containing granular calcium oxide and a fixing agent is injected into the recess, and then the composition is solidified. Can be fixed. The fixing agent is not particularly limited, and for example, ester acrylate can be used. The substrate 140 is not particularly limited, and a substrate made of glass, quartz, plastic, or the like can be used.

以上のようにして作製した発光装置は、トランジスタ121a、121b、121c、121dの作製時から配線108、109を形成するに至るまでの間、基板101上に行方向及び列方向に延びた格子状の第1の半導体層102を有し、基板101が等電位となるように保たれ状態で作製されている。従って、当該発光装置では、プラズマ励起を利用した処理等で生じやすい静電気に起因した素子の損傷が低減される。なお、本発明は、大型の基板、特に600mm×720mm以上である大型の基板を用いて一基板から複数の発光装置を形成するときに非常に有効である。   The light-emitting device manufactured as described above has a lattice shape extending in the row direction and the column direction over the substrate 101 from the time of manufacturing the transistors 121a, 121b, 121c, and 121d to the formation of the wirings 108 and 109. The first semiconductor layer 102 is included, and the substrate 101 is manufactured so as to be at an equipotential. Therefore, in the light-emitting device, damage to elements due to static electricity that easily occurs in processing using plasma excitation or the like is reduced. Note that the present invention is very effective when a plurality of light-emitting devices are formed from one substrate using a large substrate, particularly a large substrate of 600 mm × 720 mm or more.

(実施の形態2)
本実施の形態では、実施の形態1で説明した製造方法と本発明の態様について、図4、5を用いて説明する。
(Embodiment 2)
In this embodiment mode, the manufacturing method described in Embodiment Mode 1 and aspects of the present invention will be described with reference to FIGS.

先ず、基板201上に、実施の形態1で示した第1の半導体層102と同様にして、行方向及び列方向に延びた格子状の第1の半導体層202を形成する。第1の半導体層202を形成すると共に、第1の半導体層202に囲まれた領域230内には、実施の形態1で示した第2の半導体層103と同様にして、島状に分離した第2の半導体層203が複数形成される。ここで、第2の半導体層203は、トランジスタを作製するために形成される層である。そして、後述の工程を経ることにより、第1の半導体層202に囲まれた領域230を一単位とした発光装置が基板201上に複数形成される。なお、本形態では、領域230内に画素部231、駆動回路部232a、232b等を作製するため、図4、5の断面図では、各々の部分について模式的に表している。   First, in the same manner as the first semiconductor layer 102 described in Embodiment Mode 1, a lattice-shaped first semiconductor layer 202 extending in the row direction and the column direction is formed over the substrate 201. In addition to the formation of the first semiconductor layer 202, the region 230 surrounded by the first semiconductor layer 202 is separated into island shapes in the same manner as the second semiconductor layer 103 described in Embodiment 1. A plurality of second semiconductor layers 203 are formed. Here, the second semiconductor layer 203 is a layer formed in order to manufacture a transistor. Then, a plurality of light-emitting devices each including the region 230 surrounded by the first semiconductor layer 202 as a unit are formed on the substrate 201 through a process described later. Note that in this embodiment mode, the pixel portion 231, the driver circuit portions 232 a and 232 b, and the like are formed in the region 230, and thus each portion is schematically illustrated in the cross-sectional views of FIGS.

ここで、基板201について特に限定はなく、実施の形態1で示した基板101と同様のものを用いることができる。また、基板201上には、基板201を覆う絶縁層204が形成されていてもよい。絶縁層204についても、特に限定はなく、実施の形態1で示した絶縁層104と同様のものを用いればよい。   Here, there is no particular limitation on the substrate 201, and a substrate similar to the substrate 101 described in Embodiment 1 can be used. An insulating layer 204 that covers the substrate 201 may be formed over the substrate 201. There is no particular limitation on the insulating layer 204, and the same material as the insulating layer 104 described in Embodiment 1 may be used.

また、第1の半導体層202及び第2の半導体層203は、基板201を覆う半導体層を形成した後、当該半導体層をエッチングによって加工し、形成すればよい。半導体層について特に限定はなく、珪素等を用いて形成することができる。また半導体層の結晶性についても特に限定はなく、結晶質成分を含む半導体層を用いることができる。   The first semiconductor layer 202 and the second semiconductor layer 203 may be formed by forming a semiconductor layer that covers the substrate 201 and then processing the semiconductor layer by etching. There is no particular limitation on the semiconductor layer, and the semiconductor layer can be formed using silicon or the like. There is no particular limitation on the crystallinity of the semiconductor layer, and a semiconductor layer containing a crystalline component can be used.

次に、第1の半導体層202及び第2の半導体層203を覆う絶縁層205を形成する。絶縁層205について特に限定はなく、実施の形態1で示した絶縁層105と同様にして形成すればよい。   Next, an insulating layer 205 that covers the first semiconductor layer 202 and the second semiconductor layer 203 is formed. The insulating layer 205 is not particularly limited and may be formed in a manner similar to that of the insulating layer 105 described in Embodiment 1.

なお、絶縁層205の形成前または形成後に、トランジスタの閾値を調節するために、第2の半導体層203にn型又はp型の不純物の添加をしてもよい。n型不純物としては、例えば燐等を用いることができ、p型不純物としては、例えばボロン等を用いることができる。また、第2の半導体層203に不純物を添加するとき、第1の半導体層202にも不純物を添加してもよい。   Note that an n-type or p-type impurity may be added to the second semiconductor layer 203 in order to adjust the threshold value of the transistor before or after the insulating layer 205 is formed. For example, phosphorus or the like can be used as the n-type impurity, and boron or the like can be used as the p-type impurity, for example. Further, when an impurity is added to the second semiconductor layer 203, the impurity may be added to the first semiconductor layer 202.

次に、絶縁層205上であって、第2の半導体層203と絶縁層205とが重畳する部分の上方に、ゲート電極として機能する導電層206を形成する。導電層206は、先ず絶縁層205を覆うように導電層を形成した後、当該導電層をエッチングによって加工し、形成すればよい。このとき、基板201は、第1の半導体層202が形成されていることによって基板面全体がほぼ等電位に保たれている。従って、ドライエッチング等のプラズマ励起を利用したエッチング方法を用いたときでも、基板内での電位の偏りが生じにくく、静電気に起因した素子の破壊が生じにくい。ここで、導電層206は単層又は複数の層のいずれから成るものであってもよく、例えば、絶縁層205と密着性のよい導電層を絶縁層205と接するように設け、その導電層上に抵抗の低い導電層が積層されたようなものであってもよい。導電層206の形状についても特に限定はなく、例えば側壁に傾斜を有する形状であってもよい。   Next, a conductive layer 206 serving as a gate electrode is formed over the insulating layer 205 and above a portion where the second semiconductor layer 203 and the insulating layer 205 overlap with each other. The conductive layer 206 may be formed by first forming a conductive layer so as to cover the insulating layer 205 and then processing the conductive layer by etching. At this time, the entire surface of the substrate 201 is maintained at substantially the same potential because the first semiconductor layer 202 is formed. Therefore, even when an etching method using plasma excitation such as dry etching is used, the potential in the substrate is less likely to be biased and the element is less likely to be damaged due to static electricity. Here, the conductive layer 206 may be either a single layer or a plurality of layers. For example, a conductive layer having good adhesion with the insulating layer 205 is provided so as to be in contact with the insulating layer 205, and the conductive layer 206 is formed on the conductive layer. Alternatively, a conductive layer having a low resistance may be stacked. The shape of the conductive layer 206 is not particularly limited, and may be a shape having an inclination on the side wall, for example.

次に、導電層206をマスクとして、第2の半導体層203に不純物を添加する。ここで、n型のトランジスタを作製するときは燐等のn型を付与する不純物を添加すればよく、p型のトランジスタを作製するときは、ボロン等のp型を付与する不純物を添加すればよい。また、n型の不純物を添加するとき、p型のトランジスタの構成要素となる半導体層については、レジスト等のマスクを用いて不純物が添加されないように保護すればよい。p型の不純物を添加するときも、n型のトランジスタの構成要素となる半導体層については、レジスト等のマスクを用いて不純物が添加されないように保護すればよい。また、例えば、レジスト等のマスクを用いずに基板201上の半導体層全てにn型不純物を添加した後、n型を打ち消してp型を付与できるように添加量を調節して、p型のトランジスタの構成要素である半導体層に対してp型の不純物を添加してもよい。   Next, an impurity is added to the second semiconductor layer 203 using the conductive layer 206 as a mask. Here, an n-type transistor such as phosphorus may be added when an n-type transistor is manufactured, and a p-type impurity such as boron may be added when a p-type transistor is manufactured. Good. In addition, when an n-type impurity is added, a semiconductor layer which is a component of the p-type transistor may be protected using a mask such as a resist so that the impurity is not added. Even when a p-type impurity is added, the semiconductor layer which is a constituent element of the n-type transistor may be protected by using a mask such as a resist so that the impurity is not added. Further, for example, after adding an n-type impurity to all the semiconductor layers on the substrate 201 without using a mask such as a resist, the addition amount is adjusted so that the n-type can be canceled and a p-type can be imparted. A p-type impurity may be added to the semiconductor layer which is a component of the transistor.

ここで、不純物の添加法について特に限定はなく、例えばドーピング法等を用いることができる。また、第2の半導体層203に不純物を添加すると共に、第1の半導体層202にも不純物を添加しても構わない。第1の半導体層202にも不純物を添加することによって、基板201を等電位となるように保つ効果がより高まる。   Here, the method for adding impurities is not particularly limited, and for example, a doping method or the like can be used. Further, an impurity may be added to the second semiconductor layer 203 and an impurity may be added to the first semiconductor layer 202 as well. By adding an impurity also to the first semiconductor layer 202, the effect of keeping the substrate 201 at an equipotential is further increased.

以上のような工程によって、半導体層と絶縁層と導電層とが積層して成るトランジスタ221a、221b、221c、221dを作製することができる。ここで、トランジスタ221a、221bは、画素部231に含まれ、発光素子と接続している。また、トランジスタ221cは駆動回路部232aに含まれ、トランジスタ221dは駆動回路部232bに含まれる。また、画素部231、駆動回路部232a、232bにはそれぞれ、トランジスタ221a、221b、221c、221d以外のトランジスタが含まれていてもよい。なお、トランジスタ221a、221b、221c、221dの構造について特に限定はなく、シングルドレイン構造またはLDD構造、またはLDDとゲート電極として機能する導電層とがオーバーラップしたLDD構造等、いずれの構造のものであってもよい。また、第1の半導体層202が設けられた状態で作製するのであれば、トランジスタ221a、221b、221c、221dを作製する工程について特に限定はなく、所望の構造のトランジスタ221a、221b、221c、221dが形成できるように、適宜工程を決めればよい。また、発光装置に設けられる全てのトランジスタを同じ構造で作製する必要はなく、トランジスタの用途によって適宜作り分ければよい。   Through the above steps, the transistors 221a, 221b, 221c, and 221d in which the semiconductor layer, the insulating layer, and the conductive layer are stacked can be manufactured. Here, the transistors 221a and 221b are included in the pixel portion 231 and connected to the light emitting element. The transistor 221c is included in the driver circuit portion 232a, and the transistor 221d is included in the driver circuit portion 232b. Further, the pixel portion 231 and the driver circuit portions 232a and 232b may include transistors other than the transistors 221a, 221b, 221c, and 221d, respectively. Note that there is no particular limitation on the structure of the transistors 221a, 221b, 221c, and 221d, which may be any structure such as a single drain structure or an LDD structure, or an LDD structure in which an LDD and a conductive layer functioning as a gate electrode overlap. There may be. Further, there is no particular limitation on a process for manufacturing the transistors 221a, 221b, 221c, and 221d as long as the first semiconductor layer 202 is provided, and the transistors 221a, 221b, 221c, and 221d having a desired structure are not particularly limited. The process may be determined as appropriate so that can be formed. Further, it is not necessary to manufacture all the transistors provided in the light-emitting device with the same structure, and they may be appropriately formed depending on the use of the transistor.

次に、導電層206等を覆う絶縁層207を形成する。絶縁層207は単層又は複数の層のいずれから成るものであってもよい。本形態では、絶縁層207は絶縁層207aと絶縁層207bの二層から成るものを形成する。まず、絶縁層207aを形成した後、さらに絶縁層207aを覆う絶縁層207bを形成した後、熱処理する。絶縁層207a、207bについて特に限定はないが、350℃以上の耐熱性を有するような物質、例えば酸化珪素、窒化珪素、数%の酸素を含む窒化珪素、または数%の窒素を含む酸化珪素等の無機物から成ることが好ましい。なお、熱処理の処理条件について特に限定はないが、350〜600℃の温度下で、窒素または水素等のガスが充填された雰囲気で行うことが好ましい。また、熱処理の工程部位についても特に限定はなく、本形態のように一層目の絶縁層207aの形成後でもよいし、または二層目の絶縁層207bの形成後、または絶縁層207aの形成後及び絶縁層207bの形成後でもよい。   Next, an insulating layer 207 is formed to cover the conductive layer 206 and the like. The insulating layer 207 may be a single layer or a plurality of layers. In this embodiment mode, the insulating layer 207 is formed of two layers of an insulating layer 207a and an insulating layer 207b. First, after the insulating layer 207a is formed, an insulating layer 207b that covers the insulating layer 207a is formed, and then heat treatment is performed. There is no particular limitation on the insulating layers 207a and 207b, but a material having heat resistance of 350 ° C. or higher, such as silicon oxide, silicon nitride, silicon nitride containing several percent oxygen, or silicon oxide containing several percent nitrogen, etc. It is preferable to consist of these inorganic substances. Note that although there are no particular limitations on the heat treatment conditions, it is preferably performed in an atmosphere filled with a gas such as nitrogen or hydrogen at a temperature of 350 to 600 ° C. Further, there is no particular limitation on the process part of the heat treatment, which may be performed after the formation of the first insulating layer 207a as in this embodiment, or after the formation of the second insulating layer 207b or after the formation of the insulating layer 207a. And after the formation of the insulating layer 207b.

次に、絶縁層207を貫通して第2の半導体層203に至るコンタクトホールを形成する。コンタクトホールは、絶縁層207をエッチングして形成すればよい。このとき、エッチングとしては、ドライエッチングまたはウェットエッチングのいずれの方法を用いてもよいし、両方を組み合わせて用いてもよい。例えば、絶縁層207bをウエットエッチングして開孔した後、絶縁層207aをドライエッチングして開孔し、コンタクトホールを形成してもよい。また、絶縁層207a、207bのいずれもドライエッチングによって開孔してもよい。   Next, a contact hole that penetrates the insulating layer 207 and reaches the second semiconductor layer 203 is formed. The contact hole may be formed by etching the insulating layer 207. At this time, as the etching, either dry etching or wet etching may be used, or both may be used in combination. For example, the insulating layer 207b may be opened by wet etching, and then the insulating layer 207a may be dry-etched to form a contact hole. Further, both of the insulating layers 207a and 207b may be opened by dry etching.

なお、コンタクトホールの形成時、基板201は、第1の半導体層202が形成されていることによって基板面全体がほぼ等電位に保たれている。従って、ドライエッチング等のプラズマ励起を利用したエッチング方法を用いてコンタクトホールを開孔するときでも、基板面内での電位の偏りが生じにくく、静電気に起因した素子の破壊が生じにくい。   Note that when the contact hole is formed, the entire surface of the substrate 201 is kept substantially equipotential because the first semiconductor layer 202 is formed. Therefore, even when the contact hole is opened using an etching method utilizing plasma excitation such as dry etching, the potential in the substrate surface is less likely to be biased, and the element is not easily damaged due to static electricity.

次に、配線208、209等を形成する。配線208、209は、導電層を形成した後、当該導電層をエッチングによって加工し、形成すればよい。なお、導電層形成後に、熱処理を行い、シンタリングしてもよい。導電層について特に限定はなく、単層または複数の層のいずれから成るものでもよい。但し、アルミニウムのような低抵抗な物質から成る層を含むように形成することが好ましい。なお、配線208,209を窒化チタン等から成る層によってアルミニウムから成る層を挟むような積層構造にすると、第2の半導体層203と接する部分において第2の半導体層203とアルミニウムから成る層とが接触することを防止でき、また後の工程において発光素子の電極を形成するために酸性の溶液を用いるときにアルミニウムから成る層が腐食されるのを防止できる。なお、配線208は発光素子に電流を供給するための配線である。配線208と第1の半導体層202とは重畳している。このように、第1の半導体層202の上方は配線208を引き回すための領域として有効に活用することができる。なお、配線209は、第1の半導体層202に囲まれた領域230内において、各トランジスタに信号を伝達するための配線である。配線209は、先に形成したコンタクトホールを通って、第2の半導体層203に接続している。   Next, wirings 208, 209 and the like are formed. The wirings 208 and 209 may be formed by forming a conductive layer and then processing the conductive layer by etching. Note that after the conductive layer is formed, heat treatment may be performed for sintering. There is no particular limitation on the conductive layer, and it may be a single layer or a plurality of layers. However, it is preferably formed so as to include a layer made of a low resistance material such as aluminum. Note that when the wirings 208 and 209 have a stacked structure in which a layer made of aluminum is sandwiched between layers made of titanium nitride or the like, the second semiconductor layer 203 and the layer made of aluminum are formed in a portion in contact with the second semiconductor layer 203. It is possible to prevent contact, and it is possible to prevent the layer made of aluminum from being corroded when an acidic solution is used to form an electrode of a light emitting element in a later step. Note that the wiring 208 is a wiring for supplying current to the light-emitting element. The wiring 208 and the first semiconductor layer 202 overlap with each other. As described above, the region above the first semiconductor layer 202 can be effectively used as a region for routing the wiring 208. Note that the wiring 209 is a wiring for transmitting a signal to each transistor in the region 230 surrounded by the first semiconductor layer 202. The wiring 209 is connected to the second semiconductor layer 203 through the contact hole formed earlier.

次に、配線209を覆う絶縁層210を形成する。絶縁層210について特に限定はないが、表面が平坦な層、例えばアクリル、シロキサンまたはポリイミド等の自己平坦性を有する物質からなる層、または酸化珪素等から成る層を形成後CMP(Chemical and Mechanical Polishing)法等によって平坦化して形成した層であることが好ましい。また、絶縁層210がシロキサンから成る場合は、絶縁層210を焼成するための熱処理を行ってもよい。   Next, an insulating layer 210 that covers the wiring 209 is formed. There is no particular limitation on the insulating layer 210, but a CMP (Chemical and Mechanical Polishing) layer is formed after forming a layer having a flat surface, for example, a layer made of a material having self-flatness such as acrylic, siloxane, or polyimide, or a layer made of silicon oxide or the like. It is preferable that the layer be flattened by a method or the like. In the case where the insulating layer 210 is made of siloxane, heat treatment for baking the insulating layer 210 may be performed.

次に、絶縁層210を貫通して配線209に至るコンタクトホールを形成する。また、コンタクトホールを形成すると共に、配線208の一部が露出するように開口部を形成する。コンタクトホール等は、絶縁層210をエッチングして形成すればよい。このとき、エッチングとしては、ドライエッチングまたはウェットエッチングのいずれの方法を用いてもよいし、両方を組み合わせて用いてもよい。   Next, a contact hole that penetrates the insulating layer 210 and reaches the wiring 209 is formed. In addition, a contact hole is formed and an opening is formed so that a part of the wiring 208 is exposed. Contact holes and the like may be formed by etching the insulating layer 210. At this time, as the etching, either dry etching or wet etching may be used, or both may be used in combination.

なお、コンタクトホールの形成時、基板201は、第1の半導体層202が形成されていることによって基板全体がほぼ等電位に保たれる。従って、ドライエッチング等のプラズマ励起を利用したエッチング方法を用いてコンタクトホールを開孔するときでも、基板内での電位の偏りが生じにくく、静電気に起因した素子の破壊が生じにくい。   Note that when the contact hole is formed, the substrate 201 is maintained at substantially the same potential because the first semiconductor layer 202 is formed. Therefore, even when the contact hole is opened using an etching method using plasma excitation such as dry etching, the potential in the substrate is less likely to be biased, and the element is less likely to be damaged due to static electricity.

次に、絶縁層210を貫通するコンタクトホールを通って配線209に至る発光素子の電極211を形成する。発光素子の電極211について特に限定はなく、例えば、可視光を透過できる導電物によって導電層を形成した後、当該導電層をエッチングして加工し、形成することができる。また、可視光を透過できる導電物について特に限定はないが、インジウム錫酸化物(ITO)、酸化珪素を含有するITO、酸化インジウムに2〜20%の酸化亜鉛(ZnO)を混合して成るIZO(Indium Zinc Oxide)等を用いることができる。なお、エッチングはウェットエッチングまたはドライエッチングのいずれの方法を用いて行ってもよく、例えばITO等のエッチングには弱酸性の溶液を用いことができる。また、可視光を透過できる導電物の他、アルミニウム等を用いて形成することもできる。なお、アルミニウムにはリチウム(Li)等のアルカリ金属またはマグネシウム等のアルカリ土類金属が含まれていてもよい。   Next, an electrode 211 of the light-emitting element that reaches the wiring 209 through a contact hole that penetrates the insulating layer 210 is formed. There is no particular limitation on the electrode 211 of the light-emitting element, and for example, a conductive layer can be formed using a conductive material that can transmit visible light, and then the conductive layer can be etched and processed. Further, there is no particular limitation on the conductive material that can transmit visible light, but indium tin oxide (ITO), ITO containing silicon oxide, IZO formed by mixing indium oxide with 2 to 20% zinc oxide (ZnO). (Indium Zinc Oxide) or the like can be used. Etching may be performed using either wet etching or dry etching. For example, a weakly acidic solution may be used for etching ITO or the like. In addition to a conductive material that can transmit visible light, aluminum or the like can be used. Aluminum may contain an alkali metal such as lithium (Li) or an alkaline earth metal such as magnesium.

次に、開口部を有する隔壁層212を形成する。隔壁層212は、曲率半径が連続的に変化する形状となるように形成することが好ましい。また、開口部からは発光素子の電極211が露出するようにする。なお、隔壁層212を構成する物質について特に限定はなく、例えば、アクリル、ポリイミド、シロキサン(シリコン(Si)と酸素(O)との結合で骨格構造が構成され、置換基に少なくとも水素を含む物質)、レジスト等を用いることができる。ここで、アクリル、ポリイミド、レジストは、感光性を有するものであってもよい。なお、図3(B)と同様に隔壁層212は、絶縁層210の側壁を覆っていてもよい。   Next, the partition layer 212 having openings is formed. The partition layer 212 is preferably formed so as to have a shape in which the radius of curvature continuously changes. Further, the electrode 211 of the light emitting element is exposed from the opening. Note that there is no particular limitation on the substance forming the partition layer 212. For example, acrylic, polyimide, siloxane (a substance in which a skeleton structure is formed by a bond of silicon (Si) and oxygen (O), and the substituent includes at least hydrogen) ), A resist or the like can be used. Here, the acrylic, polyimide, and resist may have photosensitivity. Note that as in FIG. 3B, the partition layer 212 may cover a sidewall of the insulating layer 210.

次に、発光素子の電極211を覆うように発光層213を形成する。発光層213について特に限定はなく、実施の形態1で示した発光層112と同様のものでよい。   Next, the light emitting layer 213 is formed so as to cover the electrode 211 of the light emitting element. There is no particular limitation on the light-emitting layer 213, and the light-emitting layer 213 may be the same as the light-emitting layer 112 described in Embodiment 1.

次に、発光素子の電極214を形成する。発光素子の電極214について特に限定はなく、アルミニウムまたは先に記載したような可視光を透過できる導電物を用いて形成することができる。なお、アルミニウムにはリチウム(Li)やマグネシウム等のアルカリ金属またはアルカリ土類金属が含まれていてもよい。   Next, an electrode 214 of the light emitting element is formed. There is no particular limitation on the electrode 214 of the light-emitting element, and the electrode 214 can be formed using aluminum or a conductive material that transmits visible light as described above. Note that aluminum may contain an alkali metal such as lithium (Li) or magnesium or an alkaline earth metal.

なお、発光素子の電極211、214の少なくとも一方は可視光を透過できるように膜厚、材料、積層構造等を調節することが好ましい。   Note that it is preferable to adjust the film thickness, material, stacked structure, and the like so that at least one of the electrodes 211 and 214 of the light-emitting element can transmit visible light.

以上のような工程によって、発光素子の電極211と発光素子の電極214との間に発光層213を挟んで成る発光素子215が作製される。   Through the above-described process, the light-emitting element 215 in which the light-emitting layer 213 is sandwiched between the electrode 211 of the light-emitting element and the electrode 214 of the light-emitting element is manufactured.

発光素子215を作製した後、発光素子に水分等が混入するのを阻止するための保護層216を設けてもよい。保護層216は、単層又は複数の層のいずれから成るものであってもよく、窒化珪素等によって形成することができる。   After the light-emitting element 215 is manufactured, a protective layer 216 for preventing moisture or the like from entering the light-emitting element may be provided. The protective layer 216 may be either a single layer or a plurality of layers, and can be formed of silicon nitride or the like.

以上の工程を経ることによって、画素部231、駆動回路部232a、232b、画素部および駆動回路部の周辺に設けられた配線208、接続端子等を含んで成る発光装置が、基板201上に複数作製される。画素部231には、トランジスタと発光素子とを含んで成る画素が行方向及び列方向に複数配列している。なお、発光装置に含まれる構成要素(画素部231、駆動回路部232a、232b、画素部および駆動回路部の周辺に設けられた配線208、接続端子等)と、第1の半導体層202との位置関係は、実施の形態1において図1(B)に示したものと同様である。但し、発光装置の構成は、図1(B)に示したものには限定されない。   Through the above steps, a plurality of light-emitting devices including the pixel portion 231, the driver circuit portions 232a and 232b, the wiring 208 provided around the pixel portion and the driver circuit portion, connection terminals, and the like are formed over the substrate 201. Produced. In the pixel portion 231, a plurality of pixels each including a transistor and a light emitting element are arranged in the row direction and the column direction. Note that components included in the light-emitting device (the pixel portion 231, the driver circuit portions 232 a and 232 b, the wiring 208 provided around the pixel portion and the driver circuit portion, connection terminals, and the like) and the first semiconductor layer 202 The positional relationship is the same as that shown in FIG. Note that the structure of the light-emitting device is not limited to that illustrated in FIG.

次に、基板201を発光装置ごとに切り分ける(つまり分断する。)。このとき、基板上の分断部には、層が積層されていないことが好ましく、特に導電層、有機物から成る層等が積層されていないことが好ましい。   Next, the substrate 201 is cut (that is, divided) for each light emitting device. At this time, it is preferable that no layer is stacked on the dividing portion on the substrate, and it is particularly preferable that a conductive layer, a layer made of an organic material, or the like is not stacked.

次に、発光層が内側に閉じこめられるように、分断後の基板201と基板240とをシール材241を用いて貼り合わせて封止する。このとき、絶縁層210に形成された開口部がシール材241によって埋め込まれるようにすることが好ましい。また、シール材241は、例えばビスフェノールA型液状樹脂、ビスフェノールA型固形樹脂、含ブロムエポキシ樹脂、ビスフェノールF型樹脂、ビスフェノールAD型樹脂、フェノール型樹脂、クレゾール型樹脂、ノボラック型樹脂、環状脂肪族エポキシ樹脂、エピビス型エポキシ樹脂、グリシジルエステル樹脂、グリジシルアミン系樹脂、複素環式エポキシ樹脂、変性エポキシ樹脂等のエポキシ樹脂等の透湿性の低い物質を含むものであることが好ましい。これによって、絶縁層210または隔壁層212が透湿性の高い物質で形成されているときに、絶縁層210を介して発光素子215へ水分が拡散することを防止できる。なお、封止後の発光装置内部、つまり基板201と基板240とシール材241とに囲まれた内部は、窒素等の不活性気体、または透湿性の低い樹脂材料等で充填されていてもよいし、または真空になっていてもよい。また、封止後の発光装置内部に吸湿性を有する物質を固定して当該内部に混入した水分などを吸収できるようにし、発光素子が水分等によって劣化するのを防止してもよい。吸湿性を有する物質について特に限定はないが、例えば酸化カルシウムを用いることができる。また当該物質の固定法についても特に限定はなく、例えば基板240の一部に凹部を設け、粒状の酸化カルシウムと固定剤とを含む組成物を当該凹部に注入した後、当該組成物を固化することによって固定することができる。なお固定剤についても特に限定はなく、例えばエステルアクリレート等を用いることができる。また、基板240について特に限定はなく、ガラスや石英、またはプラスチック等から成る基板を用いることができる。   Next, the separated substrate 201 and the substrate 240 are attached and sealed using a sealant 241 so that the light emitting layer is confined inside. At this time, the opening formed in the insulating layer 210 is preferably filled with the sealant 241. The sealing material 241 is, for example, a bisphenol A liquid resin, a bisphenol A solid resin, a bromine-containing epoxy resin, a bisphenol F resin, a bisphenol AD resin, a phenol resin, a cresol resin, a novolac resin, or a cyclic aliphatic. It is preferable to include a material having low moisture permeability such as an epoxy resin such as an epoxy resin, an epibis type epoxy resin, a glycidyl ester resin, a glycidylamine resin, a heterocyclic epoxy resin, or a modified epoxy resin. Accordingly, moisture can be prevented from diffusing to the light emitting element 215 through the insulating layer 210 when the insulating layer 210 or the partition wall layer 212 is formed using a highly moisture permeable material. Note that the inside of the light-emitting device after sealing, that is, the inside surrounded by the substrate 201, the substrate 240, and the sealant 241 may be filled with an inert gas such as nitrogen or a resin material with low moisture permeability. Or it may be in a vacuum. Alternatively, a hygroscopic substance may be fixed inside the light-emitting device after sealing so that moisture mixed in the inside can be absorbed, and the light-emitting element can be prevented from being deteriorated by moisture or the like. There is no particular limitation on the hygroscopic substance, and for example, calcium oxide can be used. Also, there is no particular limitation on the fixing method of the substance. For example, a recess is provided in a part of the substrate 240, and a composition containing granular calcium oxide and a fixing agent is injected into the recess, and then the composition is solidified. Can be fixed. The fixing agent is not particularly limited, and for example, ester acrylate can be used. The substrate 240 is not particularly limited, and a substrate made of glass, quartz, plastic, or the like can be used.

以上のようにして作製した発光装置は、発光装置を製造する間、基板201上に行方向及び列方向に延びた格子状の第1の半導体層202を有し、基板201が等電位となるように保たれ状態で作製されている。従って、当該発光装置では、プラズマ励起を利用した処理等で生じやすい静電気に起因した素子の損傷が低減される。なお、本発明は、大型の基板、特に600mm×720mm以上である大型の基板を用いて一基板から複数の発光装置を形成するときに非常に有効である。   The light-emitting device manufactured as described above includes the first semiconductor layer 202 in a lattice shape extending in the row direction and the column direction on the substrate 201 during manufacturing of the light-emitting device, and the substrate 201 becomes equipotential. It is produced in such a state. Therefore, in the light-emitting device, damage to elements due to static electricity that easily occurs in processing using plasma excitation or the like is reduced. Note that the present invention is very effective when a plurality of light-emitting devices are formed from one substrate using a large substrate, particularly a large substrate of 600 mm × 720 mm or more.

(実施の形態3)
本実施の形態では、実施の形態1、2に示したような本発明を適用して製造した発光装置について説明する。
(Embodiment 3)
In this embodiment mode, a light-emitting device manufactured by applying the present invention as shown in Embodiment Modes 1 and 2 will be described.

本形態では、本発明を適用した発光装置の態様について説明する。但し、本発明の発光装置の構造および発光装置を構成する物質等は、本形態に示すものに限定されない。   In this embodiment mode, a mode of a light-emitting device to which the present invention is applied will be described. However, the structure of the light-emitting device of the present invention and the substances constituting the light-emitting device are not limited to those shown in this embodiment mode.

図3(c)または図5(C)で表されるような発光装置において、発光素子114の構成要素である発光層112、および発光素子215の構成要素である発光層213は、複数の層から成る。複数の層は、キャリア輸送性の高い物質とキャリア注入性の高い物質とから選ばれた物質から成る層を組み合わせて構成されたものであり、一部に発光性の高い物質を含むものである。発光層112を構成する物質は無機物でも有機物でも構わない。また、有機物の場合、低分子でも高分子でも構わない。   In the light-emitting device as illustrated in FIG. 3C or FIG. 5C, the light-emitting layer 112 that is a component of the light-emitting element 114 and the light-emitting layer 213 that is a component of the light-emitting element 215 include a plurality of layers. Consists of. The plurality of layers are formed by combining layers made of a substance selected from a substance having a high carrier transporting property and a substance having a high carrier injecting property, and partly contains a substance having a high light emitting property. The substance constituting the light emitting layer 112 may be inorganic or organic. In the case of an organic substance, it may be a low molecule or a polymer.

ここで、発光物質としては、4−ジシアノメチレン−2−メチル−6−[2−(1,1,7,7−テトラメチルジュロリジン−9−イル)エテニル] −4H−ピラン(略称:DCJT)、4−ジシアノメチレン−2−tert−ブチル−6−[2−(1,1,7,7−テトラメチルジュロリジン−9−イル)エテニル ]−4H−ピラン(略称:DCJTB)、ペリフランテン、2,5−ジシアノ−1,4−ビス[2−(10−メトキシ−1,1,7,7−テトラメチルジュロリジン−9−イル)エテニル]ベンゼン、N,N’−ジメチルキナクリドン(略称:DMQd)、クマリン6、クマリン545T、トリス(8−キノリノラト)アルミニウム(略称:Alq3)、9,9’−ビアントリル、9,10−ジフェニルアントラセン(略称:DPA)や9,10−ビス(2−ナフチル)アントラセン(略称:DNA)等を用いることができる。また、この他の物質でもよい。 Here, as the light-emitting substance, 4-dicyanomethylene-2-methyl-6- [2- (1,1,7,7-tetramethyljulolidin-9-yl) ethenyl] -4H-pyran (abbreviation: DCJT) ), 4-dicyanomethylene-2-tert-butyl-6- [2- (1,1,7,7-tetramethyljulolidin-9-yl) ethenyl] -4H-pyran (abbreviation: DCJTB), periflanthene, 2,5-dicyano-1,4-bis [2- (10-methoxy-1,1,7,7-tetramethyljulolidin-9-yl) ethenyl] benzene, N, N′-dimethylquinacridone (abbreviation: DMQd), coumarin 6, coumarin 545T, tris (8-quinolinolato) aluminum (abbreviation: Alq 3 ), 9,9′-bianthryl, 9,10-diphenylanthracene (abbreviation: DPA) and 9,10-bis (2- Naf Chill) anthracene (abbreviation: DNA) or the like can be used. Other substances may also be used.

なお、以上のような一重項励起発光物質の他、金属錯体などを含む三重項励起物質を用いても良い。例えば、赤色の発光性の画素、緑色の発光性の画素及び青色の発光性の画素のうち、輝度半減時間が比較的短い赤色の発光性の画素を三重項励起発光物質で形成し、他を一重項励起発光物質で形成する。三重項励起発光物質は発光効率が良いので、同じ輝度を得るのに消費電力が少なくて済むという特徴がある。すなわち、赤色画素に適用した場合、発光素子に流す電流量が少なくて済むので、信頼性を向上させることができる。低消費電力化として、赤色の発光性の画素と緑色の発光性の画素とを三重項励起発光物質で形成し、青色の発光性の画素を一重項励起発光物質で形成しても良い。人間の視感度が高い緑色の発光素子も三重項励起発光物質で形成することで、より低消費電力化を図ることができる。   In addition to the singlet excited luminescent material as described above, a triplet excited material containing a metal complex or the like may be used. For example, among red light emitting pixels, green light emitting pixels, and blue light emitting pixels, a red light emitting pixel having a relatively short luminance half time is formed of a triplet excitation light emitting material, and the other It is formed of a singlet excited luminescent material. A triplet excited luminescent substance has a feature that it has a high luminous efficiency, so that less power is required to obtain the same luminance. That is, when applied to a red pixel, the amount of current flowing through the light emitting element can be reduced, so that reliability can be improved. As a reduction in power consumption, a red light-emitting pixel and a green light-emitting pixel may be formed using a triplet excitation light-emitting material, and a blue light-emitting pixel may be formed using a singlet excitation light-emitting material. By forming a green light-emitting element having high human visibility with a triplet-excited light-emitting substance, power consumption can be further reduced.

三重項励起発光物質の一例としては、金属錯体をドーパントとして用いたものがあり、第三遷移系列元素である白金を中心金属とする金属錯体、イリジウムを中心金属とする金属錯体などが知られている。三重項励起発光物質としては、これらの化合物に限られることはなく、上記構造を有し、且つ中心金属に周期表の8〜10属に属する元素を有する化合物を用いることも可能である。   Examples of triplet excited luminescent materials include those using metal complexes as dopants, and metal complexes having a third transition series element platinum as the central metal and metal complexes having iridium as the central metal are known. Yes. The triplet excited light-emitting substance is not limited to these compounds, and it is also possible to use a compound having the above structure and having an element belonging to Group 8 to 10 in the periodic table as a central metal.

キャリア輸送性の高い物質のうち、特に電子輸送性の高い物質としては、例えばトリス(8−キノリノラト)アルミニウム(略称:Alq3)、トリス(5−メチル−8−キノリノラト)アルミニウム(略称:Almq3)、ビス(10−ヒドロキシベンゾ[h]−キノリナト)ベリリウム(略称:BeBq2)、ビス(2−メチル−8−キノリノラト)−4−フェニルフェノラト−アルミニウム(略称:BAlq)など、キノリン骨格またはベンゾキノリン骨格を有する金属錯体等が挙げられる。また正孔輸送性の高い物質としては、例えば4,4'−ビス[N−(1−ナフチル)−N−フェニル−アミノ]−ビフェニル(略称:α−NPD)や4,4'−ビス[N−(3−メチルフェニル)−N−フェニル−アミノ]−ビフェニル(略称:TPD)や4,4',4''−トリス(N,N−ジフェニル−アミノ)−トリフェニルアミン(略称:TDATA)、4,4',4''−トリス[N−(3−メチルフェニル)−N−フェニル−アミノ]−トリフェニルアミン(略称:MTDATA)などの芳香族アミン系(即ち、ベンゼン環−窒素の結合を有する)の化合物が挙げられる。また、キャリア注入性の高い物質のうち、特に電子注入性の高い物質としては、フッ化リチウム(LiF)、フッ化セシウム(CsF)、フッ化カルシウム(CaF2)等のようなアルカリ金属又はアルカリ土類金属の化合物が挙げられる。また、この他、Alq3のような電子輸送性の高い物質とマグネシウム(Mg)のようなアルカリ土類金属との混合物であってもよい。また、正孔注入性の高い物質としては、例えば、モリブデン酸化物(MoOx)やバナジウム酸化物(VOx)、ルテニウム酸化物(RuOx)、タングステン酸化物(WOx)、マンガン酸化物(MnOx)等の金属酸化物が挙げられる。また、この他、フタロシアニン(略称:H2Pc)や銅フタロシアニン(CuPC)等のフタロシアニン系の化合物が挙げられる。また、正孔注入性が高く正孔輸送性も高い物質であるポリスチレンスルフォン酸(PSS)とポリエチレンジオキシチオフェン(PEDOT)とを混合した高分子材料等を用いてもよい。 Among substances having a high carrier transport property, examples of the substance having a particularly high electron transport property include, for example, tris (8-quinolinolato) aluminum (abbreviation: Alq 3 ), tris (5-methyl-8-quinolinolato) aluminum (abbreviation: Almq 3). ), Bis (10-hydroxybenzo [h] -quinolinato) beryllium (abbreviation: BeBq 2 ), bis (2-methyl-8-quinolinolato) -4-phenylphenolato-aluminum (abbreviation: BAlq), or the like, And metal complexes having a benzoquinoline skeleton. As a substance having a high hole-transport property, for example, 4,4′-bis [N- (1-naphthyl) -N-phenyl-amino] -biphenyl (abbreviation: α-NPD), 4,4′-bis [ N- (3-methylphenyl) -N-phenyl-amino] -biphenyl (abbreviation: TPD) or 4,4 ′, 4 ″ -tris (N, N-diphenyl-amino) -triphenylamine (abbreviation: TDATA) ), 4,4 ′, 4 ″ -tris [N- (3-methylphenyl) -N-phenyl-amino] -triphenylamine (abbreviation: MTDATA) (ie, benzene ring-nitrogen) And a compound having a bond of In addition, among substances having a high carrier-injecting property, substances having a particularly high electron-injecting property include alkali metals or alkalis such as lithium fluoride (LiF), cesium fluoride (CsF), and calcium fluoride (CaF 2 ). Examples include earth metal compounds. In addition, a mixture of a substance having a high electron transport property such as Alq 3 and an alkaline earth metal such as magnesium (Mg) may be used. Examples of the material having a high hole injection property include molybdenum oxide (MoOx), vanadium oxide (VOx), ruthenium oxide (RuOx), tungsten oxide (WOx), and manganese oxide (MnOx). A metal oxide is mentioned. In addition, phthalocyanine compounds such as phthalocyanine (abbreviation: H 2 Pc) and copper phthalocyanine (CuPC) can be given. Alternatively, a polymer material obtained by mixing polystyrene sulfonic acid (PSS) and polyethylenedioxythiophene (PEDOT), which are substances having a high hole injecting property and a high hole transporting property, may be used.

なお、高分子系有機発光材料は低分子系に比べて物理的強度が高く、素子の耐久性が高い。また塗布により成膜することが可能であるので、素子の作製が比較的容易である。   The high molecular weight organic light emitting material has higher physical strength than the low molecular weight material, and the durability of the device is high. In addition, since the film can be formed by coating, the device can be manufactured relatively easily.

また、第2の半導体層103または第2の半導体層203として用いることのできる結晶質成分を含む半導体層の具体例としては、単結晶または多結晶性の珪素、或いはシリコンゲルマニウム等から成るものが挙げられる。これらはレーザ結晶化によって形成されたものでもよいし、例えばニッケル等を用いた固相成長法による結晶化によって形成されたものでもよい。また、レーザ結晶化と固相成長法とを組み合わせて形成されたものでもよい。この他、セミアモルファス半導体も、第2の半導体層203として用いることができる。   As a specific example of a semiconductor layer containing a crystalline component that can be used as the second semiconductor layer 103 or the second semiconductor layer 203, a semiconductor layer made of single crystal or polycrystalline silicon, silicon germanium, or the like can be used. Can be mentioned. These may be formed by laser crystallization, or may be formed by crystallization by a solid phase growth method using nickel or the like, for example. Further, it may be formed by combining laser crystallization and solid phase growth. In addition, a semi-amorphous semiconductor can also be used as the second semiconductor layer 203.

なお、セミアモルファスな半導体とは、次のようなものである。非晶質と結晶構造(単結晶、多結晶を含む)の中間的な構造を有し、自由エネルギー的に安定な第3の状態を有する半導体であって、短距離秩序を持ち格子歪みを有する結晶質な領域を含んでいるものである。また少なくとも膜中の一部の領域には、0.5〜20nmの結晶粒を含んでいる。L−Oフォノンに由来するラマンスペクトルが520cm-1よりも低波数側にシフトしている。X線回折ではSi結晶格子に由来するとされる(111)、(220)の回折ピークが観測される。未結合手(ダングリングボンド)を終端するために水素またはハロゲンを少なくとも1原子%またはそれ以上含ませている。所謂微結晶半導体(マイクロクリスタル半導体)とも言われている。珪化物気体をグロー放電分解(プラズマCVD)して形成する。珪化物気体としては、SiH4、その他にもSi26、SiH2Cl2、SiHCl3、SiCl4、SiF4などを用いることができる。この珪化物気体をH2、又は、H2とHe、Ar、Kr、Neから選ばれた一種または複数種の希ガス元素で希釈しても良い。希釈率は2〜1000倍の範囲。圧力は概略0.1Pa〜133Paの範囲、電源周波数は1MHz〜120MHz、好ましくは13MHz〜60MHz。基板加熱温度は300℃以下でよく、好ましくは100〜250℃、膜中の不純物元素として、酸素、窒素、炭素などの大気成分の不純物は1×1020atoms/cm3以下とすることが望ましく、特に、酸素濃度は5×1019atoms/cm3以下、好ましくは1×1019atoms/cm3以下とする。なお、セミアモルファスなものを有する半導体を用いたTFT(薄膜トランジスタ)の移動度はおよそ1〜10m2/Vsecとなる。 The semi-amorphous semiconductor is as follows. A semiconductor having an intermediate structure between amorphous and crystalline (including single crystal and polycrystal) and having a third state that is stable in terms of free energy, has a short-range order, and has a lattice distortion. It contains a crystalline region. Further, at least a partial region in the film contains crystal grains of 0.5 to 20 nm. The Raman spectrum derived from the L—O phonon is shifted to the lower wavenumber side than 520 cm −1 . In X-ray diffraction, diffraction peaks of (111) and (220) that are derived from the Si crystal lattice are observed. In order to terminate dangling bonds (dangling bonds), hydrogen or halogen is contained at least 1 atomic% or more. It is also called a so-called microcrystalline semiconductor (microcrystal semiconductor). A silicide gas is formed by glow discharge decomposition (plasma CVD). As the silicide gas, SiH 4 , Si 2 H 6 , SiH 2 Cl 2 , SiHCl 3 , SiCl 4 , SiF 4 or the like can be used. This silicide gas may be diluted with H 2 , or H 2 and one or more kinds of rare gas elements selected from He, Ar, Kr, and Ne. The dilution rate is in the range of 2 to 1000 times. The pressure is generally in the range of 0.1 Pa to 133 Pa, and the power supply frequency is 1 MHz to 120 MHz, preferably 13 MHz to 60 MHz. The substrate heating temperature may be 300 ° C. or less, preferably 100 to 250 ° C. As an impurity element in the film, impurities of atmospheric components such as oxygen, nitrogen, and carbon are desirably 1 × 10 20 atoms / cm 3 or less. In particular, the oxygen concentration is 5 × 10 19 atoms / cm 3 or less, preferably 1 × 10 19 atoms / cm 3 or less. Note that the mobility of a TFT (thin film transistor) using a semi-amorphous semiconductor is approximately 1 to 10 m 2 / Vsec.

また、発光素子114、215は、発光素子の電極110、211が陽極として機能し、発光素子の電極113、214が陰極として機能する構成であってもよいし、或いは発光素子の電極110、211が陰極として機能し、発光素子の電極113、214が陽極として機能する構成であってもよい。但し、前者の場合、発光素子と接続しているトランジスタはPチャネル型トランジスタであり、後者の場合、トランジスタはNチャネル型トランジスタである。   The light emitting elements 114 and 215 may be configured such that the electrodes 110 and 211 of the light emitting element function as anodes and the electrodes 113 and 214 of the light emitting elements function as cathodes, or the electrodes 110 and 211 of the light emitting elements. May function as the cathode, and the electrodes 113 and 214 of the light-emitting element may function as the anode. However, in the former case, the transistor connected to the light emitting element is a P-channel transistor, and in the latter case, the transistor is an N-channel transistor.

本発明の発光装置の画素部は、以上に述べたような発光素子114、215とそれを駆動するためのトランジスタとが含まれる画素が複数、マトリクス状に配列して成る。なお、発光層は、発光波長帯の異なる発光層を画素毎に形成して、カラー表示を行う構成としても良い。典型的には、R(赤)、G(緑)、B(青)の各色に対応した発光層を形成する。この場合にも、画素の光放射側にその発光波長帯の光を透過するフィルター(着色層)を設けた構成とすることで、色純度の向上や、画素部の鏡面化(映り込み)の防止を図ることができる。フィルター(着色層)を設けることで、従来必要であるとされていた円偏光板などを省略することが可能となり、発光層から放射される光の損失を無くすことができる。さらに、斜方から画素部(表示画面)を見た場合に起こる色調の変化を一層低減することができる。   The pixel portion of the light emitting device of the present invention includes a plurality of pixels including the light emitting elements 114 and 215 and the transistors for driving the light emitting elements 114 and 215 as described above arranged in a matrix. Note that the light-emitting layer may be configured to perform color display by forming light-emitting layers having different emission wavelength bands for each pixel. Typically, a light emitting layer corresponding to each color of R (red), G (green), and B (blue) is formed. In this case as well, by providing a filter (colored layer) that transmits light in the emission wavelength band on the light emission side of the pixel, the color purity is improved and the pixel portion is mirrored (reflected). Prevention can be achieved. By providing the filter (colored layer), it is possible to omit a circularly polarizing plate that has been conventionally required, and it is possible to eliminate the loss of light emitted from the light emitting layer. Furthermore, a change in color tone that occurs when the pixel portion (display screen) is viewed obliquely can be further reduced.

また、上記のように各色に対応した発光層を設けて、カラー表示を行う以外に、発光層は単色、例えば白色の発光を呈する構成とすることもできる。白色発光材料を用いる場合には、画素の光放射側に特定の波長の光を透過するフィルター(着色層)を設けた構成としてカラー表示を可能にすることができる。   In addition to providing a light emitting layer corresponding to each color and performing color display as described above, the light emitting layer can be configured to emit a single color, for example, white light. In the case of using a white light emitting material, color display can be made possible by providing a filter (colored layer) that transmits light of a specific wavelength on the light emission side of the pixel.

なお、 白色に発光する発光層を形成するには、例えば、Alq3、部分的にナイルレッドをドープしたAlq3、p−EtTAZ、TPD(芳香族ジアミン)を蒸着法により順次積層することで白色を得ることができる。また、スピンコートを用いた塗布法により発光層を形成する場合には、塗布した後、真空加熱で焼成することが好ましい。例えば、ポリ(エチレンジオキシチオフェン)/ポリ(スチレンスルホン酸)水溶液(PEDOT/PSS)を全面に塗布、焼成し、その後、色素(1,1,4,4−テトラフェニル−1,3−ブタジエン(TPB)、4−ジシアノメチレン−2−メチル−6−(p−ジメチルアミノ−スチリル)−4H−ピラン(DCM1)、ナイルレッド、クマリン6など)ドープしたポリビニルカルバゾール(PVK)溶液を全面に塗布、焼成すればよい。 In order to form a light emitting layer that emits white light, for example, Alq 3, partially Alq doped with Nile Red 3, p-EtTAZ, TPD white by sequentially laminated by an evaporation method (aromatic diamine) Can be obtained. Moreover, when forming a light emitting layer by the apply | coating method using spin coating, after apply | coating, it is preferable to bake by vacuum heating. For example, a poly (ethylenedioxythiophene) / poly (styrenesulfonic acid) aqueous solution (PEDOT / PSS) is applied to the entire surface and fired, and then a dye (1,1,4,4-tetraphenyl-1,3-butadiene (TPB), 4-dicyanomethylene-2-methyl-6- (p-dimethylamino-styryl) -4H-pyran (DCM1), Nile Red, Coumarin 6 etc.) doped polyvinylcarbazole (PVK) solution is applied over the entire surface What is necessary is just to bake.

発光層は上記のように多層から成るもの以外に単層で形成することもできる。この場合、ポリビニルカルバゾール(PVK)に1,3,4−オキサジアゾール誘導体(PBD)を分散させてもよい。また、30wt%のPBDを分散し、4種類の色素(TPB、クマリン6、DCM1、ナイルレッド)を適当量分散することで白色発光が得られる。   The light emitting layer can be formed as a single layer in addition to the multilayer as described above. In this case, a 1,3,4-oxadiazole derivative (PBD) may be dispersed in polyvinyl carbazole (PVK). Further, white light emission can be obtained by dispersing 30 wt% PBD and dispersing an appropriate amount of four kinds of dyes (TPB, coumarin 6, DCM1, Nile red).

本発明の発光装置の構成要素である発光素子は、順方向にバイアスすることで発光する。発光素子を用いて形成する表示装置の画素は、アクティブマトリクス方式で駆動することができる。いずれにしても、個々の画素は、ある特定のタイミングで順方向バイアスを印加して発光させることとなるが、ある一定期間は非発光状態となっている。この非発光時間に逆方向のバイアスを印加することで発光素子の信頼性を向上させることができる。発光素子では、一定駆動条件下で発光強度が低下する劣化や、画素内で非発光領域が拡大して見かけ上輝度が低下する劣化モードがあるが、順方向及び逆方向にバイアスを印加する交流的な駆動を行うことで、劣化の進行を遅くすることができ、発光装置の信頼性を向上させることができる。   The light emitting element which is a component of the light emitting device of the present invention emits light by being forward biased. A pixel of a display device formed using a light-emitting element can be driven by an active matrix method. In any case, each pixel emits light by applying a forward bias at a specific timing, but is in a non-light emitting state for a certain period. By applying a reverse bias during this non-light emitting time, the reliability of the light emitting element can be improved. The light emitting element has a degradation mode in which the light emission intensity decreases under a constant driving condition and a degradation mode in which the non-light emitting area is enlarged in the pixel and the luminance is apparently decreased. However, alternating current that applies a bias in the forward and reverse directions. By performing a typical drive, the progress of deterioration can be slowed and the reliability of the light emitting device can be improved.

なお、以上に述べたような構成は、図3(C)または図5(C)に示したような本発明の発光装置に限らず、その他の本発明の発光装置に適用しても構わない。   Note that the structure described above is not limited to the light emitting device of the present invention as shown in FIG. 3C or FIG. 5C, and may be applied to other light emitting devices of the present invention. .

(実施の形態4)
本実施例では、本発明の発光装置において発光素子を駆動するために画素部に設けられている回路について説明する。但し、発光装置を駆動するための回路は、本実施例で示すものには限定されない。
(Embodiment 4)
In this embodiment, a circuit provided in a pixel portion in order to drive a light emitting element in a light emitting device of the present invention will be described. However, the circuit for driving the light emitting device is not limited to that shown in this embodiment.

図6(A)に示すように、発光素子301には、各々の発光素子を駆動するための回路が接続されている。当該回路は、それぞれ、映像信号によって発光素子301の発光・非発光を決定する駆動用トランジスタ321と、前記映像信号の入力を制御するスイッチング用トランジスタ322と、前記映像信号に関わらず発光素子301を非発光状態にする消去用トランジスタ323とを有する。ここで、スイッチング用トランジスタ322のソース(又はドレイン)はソース信号線331と接続し、駆動用トランジスタ321のソース及び消去用トランジスタ323のソースはソース信号線331と並列するように延びた電流供給線332と接続し、スイッチング用トランジスタ322のゲートは第1の走査線333と接続し消去用トランジスタ323のゲートは、第1の走査線333と並列に延びた第2の走査線334と接続している。また、駆動用トランジスタ321と発光素子301とは直列に接続している。   As shown in FIG. 6A, the light emitting element 301 is connected to a circuit for driving each light emitting element. The circuit includes a driving transistor 321 that determines light emission / non-light emission of the light emitting element 301 based on a video signal, a switching transistor 322 that controls input of the video signal, and a light emitting element 301 regardless of the video signal. And an erasing transistor 323 which is brought into a non-light-emitting state. Here, the source (or drain) of the switching transistor 322 is connected to the source signal line 331, and the source of the driving transistor 321 and the source of the erasing transistor 323 are extended in parallel with the source signal line 331. 332, the gate of the switching transistor 322 is connected to the first scanning line 333, and the gate of the erasing transistor 323 is connected to the second scanning line 334 extending in parallel with the first scanning line 333. Yes. Further, the driving transistor 321 and the light emitting element 301 are connected in series.

発光素子301が発光するときの駆動方法について説明する。書き込み期間において第1の走査線333が選択されると、第1の走査線333にゲートが接続されているスイッチング用トランジスタ322がオンになる。そして、ソース信号線331に入力された映像信号が、スイッチング用トランジスタ322を介して駆動用トランジスタ321のゲートに入力さることによって電流供給線332から発光素子301へ電流が流れ発光する。この時、発光素子301へ流れる電流の大きさによって発光の輝度が決まる。   A driving method when the light emitting element 301 emits light will be described. When the first scan line 333 is selected in the writing period, the switching transistor 322 whose gate is connected to the first scan line 333 is turned on. Then, when a video signal input to the source signal line 331 is input to the gate of the driving transistor 321 through the switching transistor 322, a current flows from the current supply line 332 to the light emitting element 301, and light is emitted. At this time, the luminance of light emission is determined by the magnitude of the current flowing to the light emitting element 301.

図9は、図6(A)に示すような回路を有する発光装置の画素部の上面図である。図9に付した数値は、それぞれ図6(A)と同じものを表す。また、図9では、発光素子301の電極84を図示している。   FIG. 9 is a top view of a pixel portion of a light emitting device having a circuit as shown in FIG. The numerical values given in FIG. 9 represent the same as those in FIG. In FIG. 9, the electrode 84 of the light emitting element 301 is illustrated.

また、各々の発光素子に接続する回路の構成は、ここで述べたものに限定されず、例えば後述する図6(B)、または図6(C)等と同様の構成であっても構わない。   Further, the structure of a circuit connected to each light-emitting element is not limited to that described here, and may be a structure similar to, for example, FIG. 6B or FIG. .

次に、図6(B)で表される回路について説明する。図6(B)に示すように、発光素子801には、各々の発光素子を駆動するための回路が接続されている。当該回路は、映像信号によって発光素子801の発光・非発光を決定する駆動用トランジスタ821と、前記映像信号の入力を制御するスイッチング用トランジスタ822と、前記映像信号に関わらず発光素子801を非発光状態にする消去用トランジスタ823と、発光素子801に供給される電流の大きさを制御するための電流制御用トランジスタ824とを有する。ここで、スイッチング用トランジスタ822のソース(又はドレイン)はソース信号線831と接続し、駆動用トランジスタ821のソース及び消去用トランジスタ823のソースはソース信号線831と並列するように延びた電流供給線832と接続し、スイッチング用トランジスタ822のゲートは第1の走査線833と接続し、消去用トランジスタ823のゲートは第1の走査線833と並列に延びた第2の走査線834と接続している。また、駆動用トランジスタ821と発光素子801と間に電流制御用トランジスタ824を挟み、直列に接続している。電流制御用トランジスタ824のゲートは、電源線835に接続している。なお、電流制御用トランジスタ824は、電圧−電流(Vd−Id)特性における飽和領域において電流が流れるように構成、制御されたものであり、これによって、電流制御用トランジスタ824に流れる電流値の大きさを決定することができる。   Next, the circuit shown in FIG. 6B will be described. As shown in FIG. 6B, the light-emitting element 801 is connected to a circuit for driving each light-emitting element. The circuit includes a driving transistor 821 that determines light emission / non-light emission of the light emitting element 801 according to a video signal, a switching transistor 822 that controls input of the video signal, and a light emitting element 801 that does not emit light regardless of the video signal. It has an erasing transistor 823 for making a state and a current control transistor 824 for controlling the magnitude of the current supplied to the light emitting element 801. Here, the source (or drain) of the switching transistor 822 is connected to the source signal line 831, and the source of the driving transistor 821 and the source of the erasing transistor 823 extend in parallel with the source signal line 831. 832, the gate of the switching transistor 822 is connected to the first scanning line 833, and the gate of the erasing transistor 823 is connected to the second scanning line 834 extending in parallel with the first scanning line 833. Yes. In addition, a current control transistor 824 is sandwiched between the driving transistor 821 and the light emitting element 801 and connected in series. The gate of the current control transistor 824 is connected to the power supply line 835. Note that the current control transistor 824 is configured and controlled so that a current flows in a saturation region in the voltage-current (Vd-Id) characteristics, and thus, a current value flowing through the current control transistor 824 is large. Can be determined.

発光素子801が発光するときの駆動方法について説明する。書き込み期間において第1の走査線833が選択されると、第1の走査線833にゲートが接続されているスイッチング用トランジスタ822がオンになる。そして、ソース信号線831に入力された映像信号が、スイッチング用トランジスタ822を介して駆動用トランジスタ821のゲートに入力される。さらに、駆動用トランジスタ821と、電源線835からの信号を受けてオン状態になった電流制御用トランジスタ824とを介して電流供給線832から発光素子801へ電流が流れ、発光に至る。このとき、発光素子801へ流れる電流の大きさは、電流制御用トランジスタ824によって決まる。   A driving method when the light-emitting element 801 emits light will be described. When the first scan line 833 is selected in the writing period, the switching transistor 822 whose gate is connected to the first scan line 833 is turned on. Then, the video signal input to the source signal line 831 is input to the gate of the driving transistor 821 through the switching transistor 822. Further, current flows from the current supply line 832 to the light-emitting element 801 through the driving transistor 821 and the current control transistor 824 that is turned on in response to a signal from the power supply line 835, and thus light emission is performed. At this time, the magnitude of the current flowing to the light emitting element 801 is determined by the current control transistor 824.

図8は、図6(B)に示すような回路を有する発光装置の画素部の上面図である。図8に付した数値は、それぞれ図6(B)と同じものを表す。また、図8では、発光素子801は図示しておらず、発光素子801の電極94を図示している。   FIG. 8 is a top view of a pixel portion of a light emitting device having a circuit as shown in FIG. The numerical value attached | subjected to FIG. 8 represents the same thing as FIG. 6 (B), respectively. In FIG. 8, the light emitting element 801 is not illustrated, and the electrode 94 of the light emitting element 801 is illustrated.

次に、図6(C)で表される回路について説明する。発光素子401には、各々の発光素子を駆動するための回路が接続されている。当該回路は、それぞれ、映像信号によって発光素子401の発光・非発光を決定する駆動用トランジスタ421と、前記映像信号の入力を制御するスイッチング用トランジスタ422とを有する。ここで、スイッチング用トランジスタ422のソース(又はドレイン)はソース信号線431と接続し、駆動用トランジスタ421のソースはソース信号線431と並列するように延びた電流供給線432と接続し、スイッチング用トランジスタ422のゲートは走査線433と接続している。また、駆動用トランジスタ421と発光素子401とは直列に接続している。   Next, the circuit shown in FIG. 6C will be described. A circuit for driving each light emitting element is connected to the light emitting element 401. Each of the circuits includes a driving transistor 421 that determines light emission / non-light emission of the light-emitting element 401 based on a video signal, and a switching transistor 422 that controls input of the video signal. Here, the source (or drain) of the switching transistor 422 is connected to the source signal line 431, and the source of the driving transistor 421 is connected to the current supply line 432 extending in parallel with the source signal line 431. The gate of the transistor 422 is connected to the scan line 433. Further, the driving transistor 421 and the light emitting element 401 are connected in series.

発光素子401が発光するときの駆動方法について説明する。書き込み期間において走査線433が選択されると、走査線433にゲートが接続されているスイッチング用トランジスタ422がオンになる。そして、ソース信号線431に入力された映像信号が、スイッチング用トランジスタ422を介して駆動用トランジスタ421のゲートに入力さることによって電流供給線432から発光素子401へ電流が流れ発光する。この時、発光素子401へ流れる電流の大きさによって発光の輝度が決まる。   A driving method when the light-emitting element 401 emits light will be described. When the scan line 433 is selected in the writing period, the switching transistor 422 whose gate is connected to the scan line 433 is turned on. Then, when a video signal input to the source signal line 431 is input to the gate of the driving transistor 421 through the switching transistor 422, a current flows from the current supply line 432 to the light emitting element 401, and light is emitted. At this time, the luminance of light emission is determined by the magnitude of the current flowing to the light emitting element 401.

(実施の形態5)
図9は、本発明の発光装置の製造方法を適用して製造した発光装置を封止し、さらに外部入力端子を装着したときの発光装置の上面図である。
(Embodiment 5)
FIG. 9 is a top view of the light emitting device when the light emitting device manufactured by applying the method for manufacturing the light emitting device of the present invention is sealed and the external input terminal is mounted.

第1の基板1001と第2の基板1021とは、対向するように貼り合わせられており、重畳している。第1の基板1001には画素部1011、第1の走査線を駆動するための駆動回路部1012、第2の走査線を駆動するための駆動回路部1013、ソース信号線を駆動するための駆動回路部1014、接続配線群1015(点線で囲まれている。)が設けられている。駆動回路部1012,1013、1014には、シフトレジスタやバッファ、スイッチ等が設けられている。また接続配線群1015と外部入力端子であるFPC(フレキシブルプリントサーキット)1031とは、異方導電性接着剤によって接続している。また、画素部1011には、発光素子とそれを駆動するための回路とを含んで成る画素が複数配列されている。FPC1031を介してコントローラから駆動回路部1012,1013、1014、電流供給線1016等へビデオ信号、クロック信号、スタート信号、リセット信号等の信号が送られる。そして、駆動回路部1012,1013、1014、電流供給線1016から画素部に信号が送られる。   The first substrate 1001 and the second substrate 1021 are bonded so as to face each other and overlap each other. The first substrate 1001 includes a pixel portion 1011, a drive circuit portion 1012 for driving the first scan line, a drive circuit portion 1013 for driving the second scan line, and a drive for driving the source signal line. A circuit portion 1014 and a connection wiring group 1015 (enclosed by a dotted line) are provided. The driver circuit portions 1012, 1013, and 1014 are provided with shift registers, buffers, switches, and the like. Further, the connection wiring group 1015 and an FPC (flexible printed circuit) 1031 which is an external input terminal are connected by an anisotropic conductive adhesive. In the pixel portion 1011, a plurality of pixels each including a light emitting element and a circuit for driving the light emitting element are arranged. Signals such as a video signal, a clock signal, a start signal, and a reset signal are sent from the controller to the drive circuit units 1012, 1013, and 1014, the current supply line 1016, and the like via the FPC 1031. Then, signals are sent from the drive circuit portions 1012, 1013, and 1014 and the current supply line 1016 to the pixel portion.

なお、駆動回路部は、上記のように必ずしも画素部1011と同一基板上に設けられている必要はなく、例えば、配線パターンが形成されたFPC上にICチップを実装したもの(TCP)等を利用し、基板外部に設けられていてもよい。   Note that the driver circuit portion is not necessarily provided on the same substrate as the pixel portion 1011 as described above. For example, a driver circuit portion (TCP) mounted on an FPC on which a wiring pattern is formed (TCP) or the like is used. It may be used and provided outside the substrate.

以上のような発光装置は、静電気に起因した不良を低減し、さらに基板面を有効に活用できるような製造方法によって製造されたものである。つまり、一基板上により多くの発光装置をまとめて製造されたものであり、低い製造コストで製造された発光装置である。   The light emitting device as described above is manufactured by a manufacturing method capable of reducing defects caused by static electricity and further effectively utilizing the substrate surface. That is, a light emitting device is manufactured at a low manufacturing cost, in which more light emitting devices are manufactured together on one substrate.

図10に、本発明を適用した発光装置を実装した電子機器の一実施例を示す。図10は、本発明を適用して作製した携帯電話機であり、本体5552には表示部5551と、音声出力部5554、音声入力部5555、操作スイッチ5556、5557、アンテナ5553等によって構成されている。本発明の発光装置を表示部として組み込むことで、製造工程中に生じる静電気に起因した表示不良が低減され、良好な画像を提供できる携帯電話機を完成できる。また、携帯電話機の他、デジタル式の写真機、カーナビゲーション装置または表示装置等に本発明の発光装置を表示部として組み込むことで、製造工程中に生じる静電気に起因した表示不良が低減され、良好な画像を提供できるデジタル式の写真機、カーナビゲーション装置、または表示装置等を完成できる。   FIG. 10 illustrates an embodiment of an electronic device in which the light-emitting device to which the present invention is applied is mounted. FIG. 10 illustrates a cellular phone manufactured by applying the present invention. The main body 5552 includes a display portion 5551, an audio output portion 5554, an audio input portion 5555, operation switches 5556 and 5557, an antenna 5553, and the like. . By incorporating the light-emitting device of the present invention as a display portion, a display failure due to static electricity generated during the manufacturing process is reduced, and a mobile phone capable of providing a good image can be completed. Moreover, by incorporating the light emitting device of the present invention as a display unit in a digital camera, car navigation device, display device, etc. in addition to a mobile phone, display defects due to static electricity generated during the manufacturing process are reduced, which is favorable. A digital camera, a car navigation device, a display device, or the like that can provide a simple image can be completed.

以上のように本発明の発光装置は、各種電子機器の表示部として用いるのに非常に適している。   As described above, the light-emitting device of the present invention is very suitable for use as a display portion of various electronic devices.

本発明の発光装置の製造方法について説明するための上面図。FIG. 6 is a top view for explaining the method for manufacturing the light emitting device of the present invention. 本発明の発光装置の製造方法について説明するための断面図。Sectional drawing for demonstrating the manufacturing method of the light-emitting device of this invention. 本発明の発光装置の製造方法について説明するための断面図。Sectional drawing for demonstrating the manufacturing method of the light-emitting device of this invention. 本発明の発光装置の製造方法について説明するための断面図。Sectional drawing for demonstrating the manufacturing method of the light-emitting device of this invention. 本発明の発光装置の製造方法について説明するための断面図。Sectional drawing for demonstrating the manufacturing method of the light-emitting device of this invention. 本発明の発光装置に含まれる画素を動作するための回路図。FIG. 3 is a circuit diagram for operating a pixel included in the light emitting device of the present invention. 本発明の発光装置の画素部の上面図。FIG. 6 is a top view of a pixel portion of a light emitting device of the present invention. 本発明の発光装置の画素部の上面図。FIG. 6 is a top view of a pixel portion of a light emitting device of the present invention. 本発明の発光装置の上面図。The top view of the light-emitting device of this invention. 本発明を適用した電子機器の図。The figure of the electronic device to which this invention is applied.

符号の説明Explanation of symbols

94 電極
101 基板
102 第1の半導体層
103 第2の半導体層
104 絶縁層
105 絶縁層
106 導電層
107 絶縁層
107a 絶縁層
107b 絶縁層
108 配線
109 配線
110 電極
111 隔壁層
112 発光層
113 電極
114 発光素子
115 保護層
121a トランジスタ
121b トランジスタ
121c トランジスタ
121d トランジスタ
130 領域
131 画素部
132a 駆動回路部
132b 駆動回路部
133 駆動回路部
134 接続端子
140 基板
141 シール材
150 発光装置
201 基板
202 第1の半導体層
203 第2の半導体層
204 絶縁層
205 絶縁層
206 導電層
207 絶縁層
207a 絶縁層
207b 絶縁層
208 配線
209 配線
210 絶縁層
211 電極
212 隔壁層
213 発光層
214 電極
215 発光素子
216 保護層
221a トランジスタ
221b トランジスタ
221c トランジスタ
221d トランジスタ
230 領域
231 画素部
232a 駆動回路部
232b 駆動回路部
240 基板
241 シール材
301 発光素子
321 駆動用トランジスタ
322 スイッチング用トランジスタ
323 消去用トランジスタ
331 ソース信号線
332 電流供給線
333 第1の走査線
334 第2の走査線
401 発光素子
421 駆動用トランジスタ
422 スイッチング用トランジスタ
431 ソース信号線
432 電流供給線
433 走査線
801 発光素子
821 駆動用トランジスタ
822 スイッチング用トランジスタ
823 消去用トランジスタ
824 電流制御用トランジスタ
831 ソース信号線
832 電流供給線
833 第1の走査線
834 電流供給線
835 電源線
1001 第1の基板
1011 画素部
1012a
1013 駆動回路部
1014 駆動回路部
1015 接続配線群
1021 第2の基板
1031 FPC
5551 表示部
5552 本体
5553 アンテナ
5554 音声出力部
5555 音声入力部
5556 操作スイッチ
5557 操作スイッチ
94 electrode 101 substrate 102 first semiconductor layer 103 second semiconductor layer 104 insulating layer 105 insulating layer 106 conductive layer 107 insulating layer 107a insulating layer 107b insulating layer 108 wiring 109 wiring 110 electrode 111 partition layer 112 light emitting layer 113 electrode 114 light emission Element 115 Protective layer 121a Transistor 121b Transistor 121c Transistor 121d Transistor 130 Region 131 Pixel portion 132a Drive circuit portion 132b Drive circuit portion 133 Drive circuit portion 134 Connection terminal 140 Substrate 141 Sealing material 150 Light emitting device 201 Substrate 202 First semiconductor layer 203 First 2 semiconductor layer 204 insulating layer 205 insulating layer 206 conductive layer 207 insulating layer 207a insulating layer 207b insulating layer 208 wiring 209 wiring 210 insulating layer 211 electrode 212 partition wall layer 213 light emitting layer 214 electrode 2 5 Light-Emitting Element 216 Protective Layer 221a Transistor 221b Transistor 221c Transistor 221d Transistor 230 Region 231 Pixel Unit 232a Drive Circuit Unit 232b Drive Circuit Unit 240 Substrate 241 Sealing Material 301 Light-Emitting Element 321 Driving Transistor 322 Switching Transistor 323 Erasing Transistor 331 Source Signal Line 332 Current supply line 333 First scanning line 334 Second scanning line 401 Light emitting element 421 Driving transistor 422 Switching transistor 431 Source signal line 432 Current supply line 433 Scanning line 801 Light emitting element 821 Driving transistor 822 Switching transistor 823 Erase transistor 824 Current control transistor 831 Source signal line 832 Current supply line 833 First scan line 834 Current supply line 835 Power supply line 1001 First substrate 1011 Pixel portion 1012a
1013 Drive circuit portion 1014 Drive circuit portion 1015 Connection wiring group 1021 Second substrate 1031 FPC
5551 Display unit 5552 Main unit 5553 Antenna 5554 Audio output unit 5555 Audio input unit 5556 Operation switch 5557 Operation switch

Claims (4)

基板上に発光装置を複数形成する発光装置の製造方法において、
発光素子を駆動するためのトランジスタを形成するトランジスタ形成工程を有し、
前記トランジスタ形成工程は、
第1の半導体層を形成する第1の工程と、
ゲート絶縁層を形成する第2の工程と、
ゲート電極を形成する第3の工程と、
層間絶縁膜を形成する第4の工程と、
前記層間絶縁膜にコンタクトホールを開口する第5の工程と、
前記層間絶縁膜上の配線層を形成する第6の工程と、を有し、
前記第1の工程において、島状に分離した前記第1の半導体層を有する素子群を複数形成すると共に、前記複数の素子群をそれぞれ囲むように一続きの第2の半導体層を形成し、
前記第5の工程、または前記第6の工程において、プラズマ励起を利用したエッチング方法を用い、
前記第5の工程において、前記コンタクトホールを開口するエッチングと同時に、前記複数の素子群をそれぞれ囲むように前記層間絶縁膜に前記第2の半導体層上で格子状の開口部を形成し、
前記第6の工程において、前記配線層を形成するエッチングと同時に、前記第2の半導体層を前記格子状の開口部において前記複数の素子群をそれぞれ囲むように分離し、
前記トランジスタ形成工程において、ショートリングを形成せず、
前記基板を、前記格子状の開口部で、且つ前記第2の半導体層が分離された領域で分断することで、前記素子群の一から前記発光装置の一つを形成することを特徴とする発光装置の製造方法。
In a method for manufacturing a light emitting device in which a plurality of light emitting devices are formed on a substrate,
A transistor forming step of forming a transistor for driving the light emitting element;
The transistor forming step includes
A first step of forming a first semiconductor layer;
A second step of forming a gate insulating layer;
A third step of forming a gate electrode;
A fourth step of forming an interlayer insulating film;
A fifth step of opening a contact hole in the interlayer insulating film;
A sixth step of forming a wiring layer on the interlayer insulating film,
In the first step, a plurality of element groups having the first semiconductor layers separated into island shapes are formed, and a continuous second semiconductor layer is formed so as to surround each of the plurality of element groups.
In the fifth step or the sixth step, an etching method using plasma excitation is used.
In the fifth step, simultaneously with the etching for opening the contact hole, a lattice-like opening is formed on the second semiconductor layer in the interlayer insulating film so as to surround each of the plurality of element groups,
In the sixth step, simultaneously with the etching for forming the wiring layer, the second semiconductor layer is separated so as to surround the plurality of element groups in the lattice-shaped openings,
In the transistor formation step, without forming a short ring,
One of the light emitting devices is formed from one of the element groups by dividing the substrate at the lattice-shaped opening and a region where the second semiconductor layer is separated. Manufacturing method of light-emitting device.
基板上に発光装置を複数形成する発光装置の製造方法において、
発光素子を駆動するためのトランジスタを形成するトランジスタ形成工程を有し、
前記トランジスタ形成工程は、
第1の半導体層を形成する第1の工程と、
ゲート絶縁層を形成する第2の工程と、
ゲート電極を形成する第3の工程と、
層間絶縁膜を形成する第4の工程と、
前記層間絶縁膜にコンタクトホールを開口する第5の工程と、
前記層間絶縁膜上の配線層を形成する第6の工程と、を有し、
前記第1の工程において、格子状の第2の半導体層を形成すると共に、前記第2の半導体層に囲まれた領域それぞれに、島状に分離した前記第1の半導体層を複数形成し、
前記第5の工程、または前記第6の工程において、プラズマ励起を利用したエッチング方法を用い、
前記第5の工程において、コンタクトホールを開口するエッチングと同時に、前記層間絶縁膜に前記第2の半導体層上で格子状の開口部を形成し、
前記第6の工程において、前記配線層を形成するエッチングと同時に、前記第2の半導体層を前記格子状の開口部において枠状に分離し、
前記トランジスタ形成工程において、ショートリングを形成せず、
前記基板を、前記格子状の開口部で、且つ前記第2の半導体層が分離された領域で分断することで、前記第2の半導体層に囲まれた領域の一から前記発光装置の一つを形成することを特徴とする発光装置の製造方法。
In a method for manufacturing a light emitting device in which a plurality of light emitting devices are formed on a substrate,
A transistor forming step of forming a transistor for driving the light emitting element;
The transistor forming step includes
A first step of forming a first semiconductor layer;
A second step of forming a gate insulating layer;
A third step of forming a gate electrode;
A fourth step of forming an interlayer insulating film;
A fifth step of opening a contact hole in the interlayer insulating film;
A sixth step of forming a wiring layer on the interlayer insulating film,
In the first step, a lattice-shaped second semiconductor layer is formed, and a plurality of the first semiconductor layers separated in an island shape are formed in each region surrounded by the second semiconductor layer,
In the fifth step or the sixth step, an etching method using plasma excitation is used.
In the fifth step, simultaneously with the etching for opening the contact hole, a lattice-like opening is formed on the second semiconductor layer in the interlayer insulating film,
In the sixth step, simultaneously with the etching for forming the wiring layer, the second semiconductor layer is separated into a frame shape at the lattice-shaped openings,
In the transistor formation step, without forming a short ring,
One of the light emitting devices is selected from one of the regions surrounded by the second semiconductor layer by dividing the substrate at the lattice-shaped opening and the region where the second semiconductor layer is separated. Forming a light emitting device.
請求項1または請求項2において、
前記第6の工程において、前記第2の半導体層の上方に前記発光素子に電流を供給するための引き回し配線を形成することを特徴とする発光装置の製造方法。
In claim 1 or claim 2,
In the sixth step, a wiring for supplying a current to the light emitting element is formed above the second semiconductor layer.
請求項1乃至請求項3のいずれか一において、
前記トランジスタ形成工程は、前記第2の半導体層に不純物を添加する工程を有することを特徴とする発光装置の製造方法。
In any one of Claim 1 thru | or 3,
The method for manufacturing a light-emitting device, wherein the transistor forming step includes a step of adding an impurity to the second semiconductor layer.
JP2005081271A 2004-03-25 2005-03-22 Method for manufacturing light emitting device Expired - Fee Related JP5004430B2 (en)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP2005081271A JP5004430B2 (en) 2004-03-25 2005-03-22 Method for manufacturing light emitting device

Applications Claiming Priority (3)

Application Number Priority Date Filing Date Title
JP2004089213 2004-03-25
JP2004089213 2004-03-25
JP2005081271A JP5004430B2 (en) 2004-03-25 2005-03-22 Method for manufacturing light emitting device

Related Child Applications (1)

Application Number Title Priority Date Filing Date
JP2012088650A Division JP5244994B2 (en) 2004-03-25 2012-04-09 Method for manufacturing light emitting device

Publications (3)

Publication Number Publication Date
JP2005311328A JP2005311328A (en) 2005-11-04
JP2005311328A5 JP2005311328A5 (en) 2008-05-01
JP5004430B2 true JP5004430B2 (en) 2012-08-22

Family

ID=35439676

Family Applications (1)

Application Number Title Priority Date Filing Date
JP2005081271A Expired - Fee Related JP5004430B2 (en) 2004-03-25 2005-03-22 Method for manufacturing light emitting device

Country Status (1)

Country Link
JP (1) JP5004430B2 (en)

Families Citing this family (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
TWI291310B (en) * 2005-12-01 2007-12-11 Au Optronics Corp Organic light emitting diode (OLED) display panel and method of forming polysilicon channel layer thereof
JP4752818B2 (en) 2007-07-06 2011-08-17 ソニー株式会社 Organic EL display device, electronic device, substrate for organic EL display device, and method for manufacturing organic EL display device

Family Cites Families (4)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH1168110A (en) * 1997-08-13 1999-03-09 Semiconductor Energy Lab Co Ltd Manufacture of display
JP2000349301A (en) * 1999-04-01 2000-12-15 Semiconductor Energy Lab Co Ltd Semiconductor device and its manufacture
JP3799915B2 (en) * 1999-12-08 2006-07-19 セイコーエプソン株式会社 Electro-optical device manufacturing method, semiconductor substrate, and electro-optical device
JP2002072232A (en) * 2000-08-24 2002-03-12 Sharp Corp Liquid crystal display apparatus and method of manufacturing liquid crystal display apparatus

Also Published As

Publication number Publication date
JP2005311328A (en) 2005-11-04

Similar Documents

Publication Publication Date Title
JP5244994B2 (en) Method for manufacturing light emitting device
US7274044B2 (en) Light emitting device
US7315047B2 (en) Light-emitting device
US9214493B2 (en) Light emitting device
KR101152935B1 (en) Light emitting element and light emitting device
US7791571B2 (en) Light emitting device and driving method of the same
US9196638B2 (en) Light emitting device
US20060292726A1 (en) Method of manufacturing a semiconductor device
EP1782487A1 (en) Light-emitting element and light-emitting device
JP4801407B2 (en) Method for manufacturing display device
JP2005242339A (en) Light emitting device
JP5004430B2 (en) Method for manufacturing light emitting device
JP2005242338A (en) Light emitting device
US20050212000A1 (en) Method for manufacturing light emitting device, and electronic device
JP2005208603A (en) Light emitting device
JP2006032735A (en) Forming method of semiconductor device
JP2005310758A (en) Manufacturing method of light emission device, and electronic device

Legal Events

Date Code Title Description
A521 Request for written amendment filed

Free format text: JAPANESE INTERMEDIATE CODE: A523

Effective date: 20080313

A621 Written request for application examination

Free format text: JAPANESE INTERMEDIATE CODE: A621

Effective date: 20080313

A977 Report on retrieval

Free format text: JAPANESE INTERMEDIATE CODE: A971007

Effective date: 20110714

A131 Notification of reasons for refusal

Free format text: JAPANESE INTERMEDIATE CODE: A131

Effective date: 20110802

A521 Request for written amendment filed

Free format text: JAPANESE INTERMEDIATE CODE: A523

Effective date: 20110913

A02 Decision of refusal

Free format text: JAPANESE INTERMEDIATE CODE: A02

Effective date: 20120214

A521 Request for written amendment filed

Free format text: JAPANESE INTERMEDIATE CODE: A523

Effective date: 20120409

A911 Transfer to examiner for re-examination before appeal (zenchi)

Free format text: JAPANESE INTERMEDIATE CODE: A911

Effective date: 20120416

TRDD Decision of grant or rejection written
A01 Written decision to grant a patent or to grant a registration (utility model)

Free format text: JAPANESE INTERMEDIATE CODE: A01

Effective date: 20120515

A01 Written decision to grant a patent or to grant a registration (utility model)

Free format text: JAPANESE INTERMEDIATE CODE: A01

A61 First payment of annual fees (during grant procedure)

Free format text: JAPANESE INTERMEDIATE CODE: A61

Effective date: 20120522

FPAY Renewal fee payment (event date is renewal date of database)

Free format text: PAYMENT UNTIL: 20150601

Year of fee payment: 3

R150 Certificate of patent or registration of utility model

Free format text: JAPANESE INTERMEDIATE CODE: R150

FPAY Renewal fee payment (event date is renewal date of database)

Free format text: PAYMENT UNTIL: 20150601

Year of fee payment: 3

R250 Receipt of annual fees

Free format text: JAPANESE INTERMEDIATE CODE: R250

R250 Receipt of annual fees

Free format text: JAPANESE INTERMEDIATE CODE: R250

R250 Receipt of annual fees

Free format text: JAPANESE INTERMEDIATE CODE: R250

LAPS Cancellation because of no payment of annual fees