JP4958273B2 - Light emitting device and manufacturing method thereof - Google Patents

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Abstract

<P>PROBLEM TO BE SOLVED: To provide a light-emitting apparatus which has high reliability and is smaller, and a manufacturing method thereof. <P>SOLUTION: A light-emitting device (LED) made of an N-type semiconductor layer 2, a P-type semiconductor layer 3 and pad electrodes 4a, 4b, etc., is formed on the surface of a first semiconductor substrate 1 made of gallium arsenide (GaAs), etc. Insulating films 5 such as a silicon nitride film are formed on the side and rear surfaces of the first semiconductor substrate 1. Wiring layers 6 connected to the pad electrodes 4a, 4b are formed on the insulating films 5 along one part of the side and rear surfaces of the first semiconductor substrate 1. A protective layer 7 is formed so as to cover the insulating films 5 and the wiring layers 6. An opening is formed on a predetermined region of the protective layer 7, and ball-like conductive terminals 8 are formed on the wiring layer 6 in the opening. A second semiconductor substrate 11 having an opening 10 penetrating from the front surface to the rear surface is stuck on the first semiconductor substrate 1 via an adhesive 12 such as an epoxy resin, etc. <P>COPYRIGHT: (C)2008,JPO&amp;INPIT

Description

本発明は、発光装置に関し、特にチップサイズパッケージ型の発光装置及びその製造方法に関するものである。   The present invention relates to a light emitting device, and more particularly to a chip size package type light emitting device and a manufacturing method thereof.

発光ダイオード(LED:Light Emitting Diode)は、比較的小さな電力で長時間安定して光を発生できるため、発光素子として広く利用されている。発光素子を備える装置(以下、発光装置と称する)について、図20を参照して説明する。   A light emitting diode (LED) is widely used as a light emitting element because it can stably generate light with a relatively small electric power for a long time. An apparatus including a light emitting element (hereinafter referred to as a light emitting apparatus) will be described with reference to FIG.

従来の発光装置100は、第1のリード101(カソード)上に配置された表面電極及び裏面電極を有するLEDチップ102と、ボンディングワイヤ103を介してLEDチップ102の表面電極と電気的に接続される第2のリード104(アノード)とを備えている。第1のリード101のLEDチップ102が配置される部分は、凹面形状に加工されている。この凹面部105には、例えば銀メッキが施されている。そのため、凹面部105は光の反射面として機能し、集光効果を有するためLEDの輝度の向上が図られている。また、上述した各構成は透明樹脂層106で封止されている。   The conventional light emitting device 100 is electrically connected to the front surface electrode of the LED chip 102 via the bonding wire 103 and the LED chip 102 having the front surface electrode and the back surface electrode disposed on the first lead 101 (cathode). Second lead 104 (anode). The portion of the first lead 101 where the LED chip 102 is disposed is processed into a concave shape. For example, silver plating is applied to the concave surface portion 105. Therefore, the concave surface portion 105 functions as a light reflecting surface and has a light collecting effect, so that the brightness of the LED is improved. In addition, each configuration described above is sealed with a transparent resin layer 106.

このような発光装置100の発光及び消灯の制御は、発光装置100とは別の駆動装置(不図示)から第1のリード101及び第2のリード104に所定の電圧が供給されることで行われる。   Such light emission and turn-off control of the light emitting device 100 is performed by supplying a predetermined voltage to the first lead 101 and the second lead 104 from a driving device (not shown) different from the light emitting device 100. Is called.

本発明に関連した技術は、例えば以下の特許文献に記載されている。
特開2003−318447号公報 特開2003−347583号公報
Techniques related to the present invention are described in, for example, the following patent documents.
JP 2003-318447 A Japanese Patent Laid-Open No. 2003-347583

しかしながら、上述した従来構造では、凹面部105を有する第1のリード101やボンディングワイヤ103等の構成部品を微細にすることが困難であり、なお且つそれら全体を透明樹脂層106で封止する必要もある。また、発光装置100を駆動させるための装置が別途必要である。これらの理由から、従来構造では装置全体の小型化・薄型化が図れないという問題があった。   However, in the above-described conventional structure, it is difficult to make the components such as the first lead 101 and the bonding wire 103 having the concave surface portion 105 fine, and it is necessary to seal them entirely with the transparent resin layer 106. There is also. In addition, a device for driving the light emitting device 100 is required separately. For these reasons, the conventional structure has a problem that the entire apparatus cannot be reduced in size and thickness.

また、それぞれの部品を別々に完成した後に組立作業(例えばLEDチップ102を第1のリード101上に配置する工程や、ボンディングワイヤ103でLEDチップ102と第2のリード104とを接続する工程や、透明樹脂106で全体を封止する工程等)が必要であるため、製造工程が複雑でコストが大きくなるという問題があった。   Also, after completing each component separately, assembly work (for example, a step of placing the LED chip 102 on the first lead 101, a step of connecting the LED chip 102 and the second lead 104 with the bonding wire 103, And the like, a process of sealing the whole with the transparent resin 106, etc.) is necessary, so that the manufacturing process is complicated and the cost is increased.

そこで本発明は、信頼性が高く、より小型の発光装置及びその製造方法を提供することを目的とする。   Accordingly, an object of the present invention is to provide a light-emitting device with high reliability and a smaller size, and a method for manufacturing the same.

本発明は上記課題に鑑みてなされたものであり、その主な特徴は以下のとおりである。すなわち、本発明の発光装置は、表面上に発光素子が形成された第1の基板と、表面から裏面にかけて貫通する開口部を有する第2の基板とを備え、前記第1の基板の表面側と前記第2の基板の表面側とが向かい合って、接着層を介して貼り合わされ、前記開口部を介して前記発光素子の光が外部に放射されることを特徴とする。   The present invention has been made in view of the above problems, and its main features are as follows. That is, the light emitting device of the present invention includes a first substrate having a light emitting element formed on the front surface, and a second substrate having an opening penetrating from the front surface to the back surface, and the surface side of the first substrate. And the surface side of the second substrate face each other and are bonded together through an adhesive layer, and light of the light emitting element is radiated to the outside through the opening.

また、本発明の発光装置は、前記第2の基板の表面上にデバイス素子が形成されていることを特徴とする。   The light emitting device of the present invention is characterized in that a device element is formed on the surface of the second substrate.

また、本発明の発光装置の製造方法は、表面上に発光素子が形成された第1の基板と、
第2の基板とを準備し、前記第1の基板の表面側と前記第2の基板の表面側とを向かい合わせ、接着層を介して両者を貼り合わせる工程と、前記貼り合わせ工程の前または後に、前記第2の基板に、表面側から裏面側にかけて貫通し、前記発光素子から放射される光が透過する開口部を形成する工程を有し、所定のダイシングラインに沿って前記第1及び前記第2の基板を切削し、個々のチップに分割する工程を備えることを特徴とする。
Further, the method for manufacturing a light emitting device of the present invention includes a first substrate having a light emitting element formed on a surface,
Preparing a second substrate, facing the surface side of the first substrate and the surface side of the second substrate, and bonding them together via an adhesive layer, before the bonding step or A step of forming an opening through the second substrate from the front surface side to the rear surface side and transmitting light emitted from the light emitting element, the first substrate and the second substrate along a predetermined dicing line; The method includes cutting the second substrate and dividing it into individual chips.

また、前記第2の基板の表面上にデバイス素子を形成する工程を有することを特徴とする。   Further, the method includes a step of forming a device element on the surface of the second substrate.

本発明の発光装置は、表面上に発光素子が形成された第1の基板と、開口部を有する第2の基板とが貼り合わされ、前記開口部を介して発光素子の光が外部に放射される構成になっている。そのため、個々の装置に分割する以前のウェハー状態のときから一体化したチップとして発光装置を構成することが可能となり、より薄く,より小型の発光装置を実現することができる。   In the light-emitting device of the present invention, a first substrate having a light-emitting element formed on a surface and a second substrate having an opening are bonded to each other, and light from the light-emitting element is emitted to the outside through the opening. It is the composition which becomes. Therefore, the light emitting device can be configured as an integrated chip from the state of the wafer before being divided into individual devices, and a thinner and smaller light emitting device can be realized.

また、本発明の製造方法によれば、複数の部品が別々に完成し、その後の組み立て作業を経ていた構成が一体化したチップで完成する。そのため、後の組み立て作業等の工程を省き、発光装置の作業性や生産性を向上させることができる。   Further, according to the manufacturing method of the present invention, a plurality of parts are completed separately, and the chip that has undergone subsequent assembly work is completed with an integrated chip. Therefore, steps such as subsequent assembly work can be omitted, and workability and productivity of the light emitting device can be improved.

本発明の第1の実施形態について図面を参照しながら説明する。図1は、本発明の第1の実施形態に係る発光装置の断面図である。   A first embodiment of the present invention will be described with reference to the drawings. FIG. 1 is a cross-sectional view of a light emitting device according to a first embodiment of the present invention.

例えばガリウムヒ素(GaAs)や窒化ガリウム(GaN)等から成るN型の第1の半導体基板1の表面上に、N型半導体層2とP型半導体層3とが形成されている。これらの層によるPN接合領域が発光領域である。また、N型半導体層2上にはパッド電極4a(カソード電極)が形成され、P型半導体層3上にはパッド電極4b(アノード電極)が形成されている。   For example, an N-type semiconductor layer 2 and a P-type semiconductor layer 3 are formed on the surface of an N-type first semiconductor substrate 1 made of gallium arsenide (GaAs) or gallium nitride (GaN). A PN junction region formed by these layers is a light emitting region. A pad electrode 4 a (cathode electrode) is formed on the N-type semiconductor layer 2, and a pad electrode 4 b (anode electrode) is formed on the P-type semiconductor layer 3.

第1の半導体基板1の側面及び裏面には、シリコン酸化膜やシリコン窒化膜等の絶縁膜5が形成されている。絶縁膜5上には、第1の半導体基板1の側面と裏面の一部に沿って、パッド電極4a,4bと接続された配線層6が形成されている。また、絶縁膜5及び配線層6を被覆して、ソルダーレジスト等から成る保護層7が形成されている。保護層7の所定領域には開口部が形成され、この開口部内の配線層6上にはボール状の導電端子8が形成されている。   An insulating film 5 such as a silicon oxide film or a silicon nitride film is formed on the side surface and the back surface of the first semiconductor substrate 1. On the insulating film 5, a wiring layer 6 connected to the pad electrodes 4 a and 4 b is formed along a part of the side surface and the back surface of the first semiconductor substrate 1. A protective layer 7 made of a solder resist or the like is formed so as to cover the insulating film 5 and the wiring layer 6. An opening is formed in a predetermined region of the protective layer 7, and a ball-like conductive terminal 8 is formed on the wiring layer 6 in the opening.

また、第1の半導体基板1上には、表面から裏面にかけて貫通する開口部10を有する第2の半導体基板11(例えば、シリコン(Si)等から成る)が、エポキシ樹脂等の接着層12を介して貼り合わされている。なお、第2の半導体基板11の表面側の外周は第1の半導体基板1側から斜めに面取りされ、切り欠き部13が形成されている。なお、第1の実施形態に係る発光装置の製造方法は、後述する第2の実施形態の製造方法に含まれるため、説明を省略する。   On the first semiconductor substrate 1, a second semiconductor substrate 11 (for example, made of silicon (Si) or the like) having an opening 10 penetrating from the front surface to the back surface has an adhesive layer 12 such as an epoxy resin. Are pasted together. Note that the outer periphery on the front surface side of the second semiconductor substrate 11 is chamfered obliquely from the first semiconductor substrate 1 side, and a notch 13 is formed. In addition, since the manufacturing method of the light-emitting device which concerns on 1st Embodiment is contained in the manufacturing method of 2nd Embodiment mentioned later, description is abbreviate | omitted.

第1の実施形態に係る発光装置は、従来構造(図20参照)のように、LEDチップやリードやボンディングワイヤ等の複数の部品が個別に形成され、その後組み合わされて構成されておらず、チップとして一体化された構成となっている。また、当該発光装置の構成要素はウェハープロセスで形成されるため、各要素を微細に形成することができる。そのため、従来に比して発光装置の小型化を図ることができる。   In the light emitting device according to the first embodiment, a plurality of components such as an LED chip, a lead, and a bonding wire are individually formed and then combined, as in the conventional structure (see FIG. 20), The structure is integrated as a chip. In addition, since the constituent elements of the light emitting device are formed by a wafer process, each element can be formed finely. Therefore, it is possible to reduce the size of the light emitting device as compared with the conventional case.

また、従来複数の部品を別々に製造し、その後の組立作業を経て発光装置として完成していたものが、本実施形態によれば個々のチップに分割した時点で一つのチップに一体化して完成する。そのため、後の組み立て作業等の工程を省き、発光装置の生産性を向上させることができる。   In addition, according to the present embodiment, a plurality of components that have been manufactured separately and completed as a light emitting device through subsequent assembly work are integrated into one chip when divided into individual chips. To do. Therefore, steps such as subsequent assembly work can be omitted, and the productivity of the light emitting device can be improved.

また、本実施形態のように開口部10が形成された側の基板(第2の半導体基板11)の材質がシリコンであれば、従来例のようにメッキ等の加工処理がされた凹面部105(図20参照)がなくても、開口部10の内周部が反射面として機能するため、発光素子から放射される光の指向性や輝度を向上させることができる。従って、従来あった凹面部105の形成工程を不要とし、製造工程を簡素にすることができる。なお、第2の半導体基板11に換えて反射効率の良くない材質から成る基板を用いた場合でも、開口部10の内周部に金メッキや銀メッキ等の金属メッキ等の処理を施すことで十分な反射効率を得ることが出来、輝度を向上させることができる。   Further, if the material of the substrate (second semiconductor substrate 11) on the side where the opening 10 is formed as in the present embodiment is silicon, the concave surface portion 105 subjected to processing such as plating as in the conventional example. Even without (see FIG. 20), since the inner peripheral portion of the opening 10 functions as a reflecting surface, the directivity and brightness of light emitted from the light emitting element can be improved. Therefore, the conventional process of forming the concave surface portion 105 is not required, and the manufacturing process can be simplified. Even when a substrate made of a material with poor reflection efficiency is used in place of the second semiconductor substrate 11, it is sufficient to perform a treatment such as metal plating such as gold plating or silver plating on the inner periphery of the opening 10. Reflection efficiency can be obtained and the luminance can be improved.

次に、本発明の第2の実施形態について説明する。図2乃至図14は、それぞれ製造工程順に示した断面図あるいは平面図である。   Next, a second embodiment of the present invention will be described. 2 to 14 are sectional views or plan views respectively shown in the order of the manufacturing process.

まず、図2に示すように、表面上にデバイス素子40が形成された例えばシリコン(Si)等から成る第2の半導体基板41を準備する。デバイス素子40は、素子の種類や機能に限定がなく、例えば後述する第1の半導体基板21上に形成される発光素子の発光及び消灯を制御する駆動素子を含むものである。第2の半導体基板41の厚さは、例えば300μm〜700μm程度である。   First, as shown in FIG. 2, a second semiconductor substrate 41 made of, for example, silicon (Si) having a device element 40 formed on the surface is prepared. The device element 40 has no limitation on the type and function of the element, and includes, for example, a drive element that controls light emission and extinction of a light emitting element formed on the first semiconductor substrate 21 described later. The thickness of the second semiconductor substrate 41 is, for example, about 300 μm to 700 μm.

次に、第2の半導体基板41の表面に第1の絶縁膜42(例えば、熱酸化法やCVD法等によって形成されたシリコン酸化膜)を例えば2μmの膜厚に形成する。次に、スパッタリング法やメッキ法、その他の成膜方法によりアルミニウム(Al)やアルミニウム合金や銅(Cu)等の金属層を形成し、その後当該金属層を選択的にエッチングし、第1の絶縁膜42上にパッド電極43を例えば1μmの膜厚に形成する。パッド電極43は、デバイス素子40やその周辺素子と不図示の配線を介して電気的に接続された電極である。なお、パッド電極43の位置に限定はなく、デバイス素子40上に配置することもできる。また、最終的に完成する装置の外周を囲むようにパッド電極43を配置することもできる。   Next, a first insulating film 42 (for example, a silicon oxide film formed by a thermal oxidation method, a CVD method, or the like) is formed on the surface of the second semiconductor substrate 41 to a thickness of 2 μm, for example. Next, a metal layer such as aluminum (Al), an aluminum alloy, or copper (Cu) is formed by a sputtering method, a plating method, or another film formation method, and then the metal layer is selectively etched to form a first insulating layer. A pad electrode 43 is formed on the film 42 to a thickness of 1 μm, for example. The pad electrode 43 is an electrode electrically connected to the device element 40 and its peripheral elements via a wiring (not shown). The position of the pad electrode 43 is not limited and can be disposed on the device element 40. Further, the pad electrode 43 can also be arranged so as to surround the outer periphery of the finally completed device.

次に、必要に応じて第2の半導体基板41の表面上にパッド電極43の一部上あるいは全部を被覆する不図示のパッシベーション膜(例えば、CVD法により形成されたシリコン窒化膜)を形成する。   Next, a passivation film (not shown) (for example, a silicon nitride film formed by a CVD method) that covers part or all of the pad electrode 43 is formed on the surface of the second semiconductor substrate 41 as necessary. .

次に、図3に示すように、第2の半導体基板41の所定の領域を、例えばドライエッチング法で選択的に除去し、基板を貫通する開口部44を形成する。開口部44は、後述する第1の半導体基板21側から発光される光の経路となる部位である。また、第2の半導体基板41の表面側から裏面側にかけてその開口径が拡がるように斜めにエッチングして開口部44を形成することが、光の反射効率を上げ、指向性や輝度を向上させる上で好ましい。なお、この時点で開口部44を形成せずに、後述する第1の半導体基板21と第2の半導体基板41との貼り合わせ工程の後に形成してもよい。   Next, as shown in FIG. 3, a predetermined region of the second semiconductor substrate 41 is selectively removed by, for example, a dry etching method to form an opening 44 penetrating the substrate. The opening 44 is a part serving as a path of light emitted from the first semiconductor substrate 21 side described later. In addition, the opening 44 is formed by oblique etching so that the opening diameter increases from the front surface side to the back surface side of the second semiconductor substrate 41, thereby improving light reflection efficiency and improving directivity and luminance. Preferred above. In addition, you may form after the bonding process of the 1st semiconductor substrate 21 mentioned later and the 2nd semiconductor substrate 41, without forming the opening part 44 at this time.

次に、発光素子を形成する。本実施形態では、第1の半導体基板21上に発光ダイオード(LED)を形成する。まず、図4に示すように、例えばガリウムヒ素(GaAs)や窒化ガリウム(GaN)等から成るN型の第1の半導体基板21を準備する。第1の半導体基板21の厚さは、例えば300μm〜700μm程度である。なお、第1の半導体基板21の材質は、目的とする発光の色に応じて適宜変更できる。次に、第1の半導体基板21の表面上に公知のエピタキシャル結晶成長法にてN型半導体層22と、P型半導体層23を順に形成する。これらによるPN接合領域が発光領域となる。なお、第1の半導体基板21及びN型半導体層22に添加されるN型不純物は例えば硫黄(S)やセレン(Se)やテルル(Te)等である。また、P型半導体層23に添加されるP型不純物は例えば亜鉛(Zn)である。   Next, a light emitting element is formed. In the present embodiment, a light emitting diode (LED) is formed on the first semiconductor substrate 21. First, as shown in FIG. 4, an N-type first semiconductor substrate 21 made of, for example, gallium arsenide (GaAs) or gallium nitride (GaN) is prepared. The thickness of the first semiconductor substrate 21 is, for example, about 300 μm to 700 μm. The material of the first semiconductor substrate 21 can be changed as appropriate according to the intended color of light emission. Next, an N-type semiconductor layer 22 and a P-type semiconductor layer 23 are sequentially formed on the surface of the first semiconductor substrate 21 by a known epitaxial crystal growth method. The PN junction region by these becomes a light emission region. The N-type impurity added to the first semiconductor substrate 21 and the N-type semiconductor layer 22 is, for example, sulfur (S), selenium (Se), tellurium (Te), or the like. The P-type impurity added to the P-type semiconductor layer 23 is, for example, zinc (Zn).

次に、P型半導体層23の一部を例えばドライエッチング法で選択的に除去し、図5に示すようにN型半導体層22の一部を露出させる。次に、当該露出したN型半導体層22と、P型半導体層23上のそれぞれにパッド電極24a(カソード電極)、24b(アノード電極)を形成する。パッド電極24a,24bは、例えばスパッタリング法等の薄膜形成技術によりアルミニウム(Al)や銅(Cu)等の金属層を形成し、その後レジスト層(不図示)をマスクとして当該金属層を選択的にエッチングすることによって形成される。   Next, a part of the P-type semiconductor layer 23 is selectively removed by, for example, a dry etching method to expose a part of the N-type semiconductor layer 22 as shown in FIG. Next, pad electrodes 24 a (cathode electrodes) and 24 b (anode electrodes) are formed on the exposed N-type semiconductor layer 22 and P-type semiconductor layer 23, respectively. For the pad electrodes 24a and 24b, a metal layer such as aluminum (Al) or copper (Cu) is formed by a thin film formation technique such as sputtering, and then the metal layer is selectively used using a resist layer (not shown) as a mask. It is formed by etching.

次に、必要に応じて例えばCVD法で第1の半導体基板21上の全面を被覆する絶縁膜を形成し、フォトリソ技術によりパッド電極24a,24b上の絶縁膜を除去してもよい。つまり、N型半導体層22やP型半導体層23の表面は絶縁膜で被覆されていても良いし、露出されていても良い。こうして、第1の半導体基板21の表面上には発光素子が形成される。なお、図4及び図5を用いた以上の説明は発光素子の製造方法の一例であって、求められる特性(発光の色等)に応じて製造プロセスは異なる。また、発光素子とは光を発する素子であればよく、レーザーダイオードでもよい。   Next, if necessary, an insulating film that covers the entire surface of the first semiconductor substrate 21 may be formed by, for example, a CVD method, and the insulating films on the pad electrodes 24a and 24b may be removed by photolithography. That is, the surfaces of the N-type semiconductor layer 22 and the P-type semiconductor layer 23 may be covered with an insulating film or may be exposed. Thus, a light emitting element is formed on the surface of the first semiconductor substrate 21. Note that the above description using FIGS. 4 and 5 is an example of a method for manufacturing a light-emitting element, and the manufacturing process differs depending on required characteristics (emission color, etc.). The light emitting element may be any element that emits light, and may be a laser diode.

次に、図6(A),(B)に示すようにエポキシ樹脂,ポリイミド(例えば感光性ポリイミド),レジスト,アクリル等の接着層25を介して、第1の半導体基板21の表面側(素子面側)と第2の半導体基板41の表面側(素子面側)とを貼り合わせる。接着層25の厚みは、数μm〜数十μm程度である。従って、第1の半導体基板21上の素子(発光素子)と第2の半導体基板41上の素子(デバイス素子40)とは近接している。なお、接着層25は透明であって光が透過できる性状を有するものとする。本実施形態における第1の半導体基板21と第2の半導体基板41とは、図7で示すように、パッド電極24a,24bとパッド電極43とが重ならないように貼り合わされる。図7は、貼り合わせ面の一部を示す平面図の概略であり、図6(A)は図7のX−X線に沿った断面図に相当し、図6(B)はY−Y線に沿った断面図に相当するものである。これ以後、図6(A)(B)と同様にそれぞれの断面図を用いて説明する。   Next, as shown in FIGS. 6A and 6B, the surface side of the first semiconductor substrate 21 (elements) via an adhesive layer 25 such as epoxy resin, polyimide (for example, photosensitive polyimide), resist, acrylic, or the like. The surface side) and the surface side (element surface side) of the second semiconductor substrate 41 are bonded together. The thickness of the adhesive layer 25 is about several μm to several tens of μm. Therefore, the element (light emitting element) on the first semiconductor substrate 21 and the element (device element 40) on the second semiconductor substrate 41 are close to each other. The adhesive layer 25 is transparent and has a property that allows light to pass therethrough. As shown in FIG. 7, the first semiconductor substrate 21 and the second semiconductor substrate 41 in the present embodiment are bonded so that the pad electrodes 24 a and 24 b and the pad electrode 43 do not overlap. FIG. 7 is a schematic plan view showing a part of the bonding surface, FIG. 6A corresponds to a cross-sectional view taken along line XX in FIG. 7, and FIG. 6B shows YY. It corresponds to a cross-sectional view along the line. In the following, description will be made using respective cross-sectional views as in FIGS.

次に、第1の半導体基板21の裏面に対して裏面研削装置(グラインダー)を用いてバックグラインドを行い、第1の半導体基板21の厚さを所定の厚さ(例えば50〜100μm程度)に薄くする。当該研削工程はエッチング処理でもよいし、グラインダーとエッチング処理の併用でもよい。なお、最終製品の用途や仕様,準備した第1の半導体基板21の当初の厚みによっては、当該研削工程を行う必要がない場合もある。また、当該研削工程を行うと研削面が荒れる場合があるため、研削工程後に平らな面を得るための工程として例えばウェットエッチング処理を行ってもよい。   Next, back grinding is performed on the back surface of the first semiconductor substrate 21 using a back surface grinding device (grinder), and the thickness of the first semiconductor substrate 21 is set to a predetermined thickness (for example, about 50 to 100 μm). make it thin. The grinding process may be an etching process, or a combination of a grinder and an etching process. Depending on the use and specifications of the final product and the initial thickness of the prepared first semiconductor substrate 21, the grinding step may not be necessary. Moreover, since a grinding surface may be roughened when the said grinding process is performed, you may perform a wet etching process as a process for obtaining a flat surface after a grinding process, for example.

次に、図8(A)(B)に示すように、第1の半導体基板21のうちパッド電極24a,24bに対応する所定の領域を、第1の半導体基板21の裏面側から選択的にエッチングし、パッド電極24a,24b及び接着層25の一部を露出させる。以下、この露出部分を開口部26とする。   Next, as shown in FIGS. 8A and 8B, predetermined regions corresponding to the pad electrodes 24 a and 24 b in the first semiconductor substrate 21 are selectively selected from the back surface side of the first semiconductor substrate 21. Etching is performed to expose part of the pad electrodes 24 a and 24 b and the adhesive layer 25. Hereinafter, this exposed portion is referred to as an opening 26.

第1の半導体基板21の選択的なエッチングについて、図9(A),(B)を参照して説明する。図9(A),(B)は、ウェハー状態の構成の一部を第1の半導体基板21側から見た概略平面図であり、図8(A)は、図9(A)(B)のX−X線に沿った断面図であり、図8(B)はY−Y線に沿った断面図に対応するものである。   The selective etching of the first semiconductor substrate 21 will be described with reference to FIGS. 9A and 9B are schematic plan views of a part of the wafer state configuration as viewed from the first semiconductor substrate 21 side, and FIG. 8A is a view of FIGS. 9A and 9B. FIG. 8B corresponds to the cross-sectional view along the YY line.

図9(A)に示すように、第1の半導体基板21を第2の半導体基板41の幅よりも狭い、略長方形の形状にエッチングすることもできる。また、図9(B)に示すように、パッド電極24a,24b,43が形成された領域のみをエッチングすることで、第1の半導体基板21の外周が凹凸状になるように構成することもできる。後者の方が、第1の半導体基板21と第2の半導体基板41の重畳する面積が大きく、第2の半導体基板41の外周近くまで第1の半導体基板21が残る。そのため、第1の半導体基板21と第2の半導体基板41との接着強度を向上させる観点からは、後者の構成が好ましい。なお、図9(A),(B)で示した平面形状とは別の形状に第1の半導体基板21をデザインすることも可能である。   As shown in FIG. 9A, the first semiconductor substrate 21 can be etched into a substantially rectangular shape that is narrower than the width of the second semiconductor substrate 41. Further, as shown in FIG. 9B, only the region where the pad electrodes 24a, 24b, and 43 are formed is etched so that the outer periphery of the first semiconductor substrate 21 becomes uneven. it can. In the latter case, the overlapping area of the first semiconductor substrate 21 and the second semiconductor substrate 41 is larger, and the first semiconductor substrate 21 remains close to the outer periphery of the second semiconductor substrate 41. Therefore, from the viewpoint of improving the adhesive strength between the first semiconductor substrate 21 and the second semiconductor substrate 41, the latter configuration is preferable. Note that the first semiconductor substrate 21 can be designed in a shape different from the planar shape shown in FIGS.

また、本実施形態では、図8(A)(B)に示すように、第1の半導体基板21の横幅が表面側に行くほど広がるように、側壁が斜めにエッチングされている。なお、第1の半導体基板21の側壁が第2の半導体基板41の主面に対して垂直となるようにエッチングすることもできる。   In the present embodiment, as shown in FIGS. 8A and 8B, the side walls are etched obliquely so that the lateral width of the first semiconductor substrate 21 increases toward the surface side. Note that etching can be performed so that the side wall of the first semiconductor substrate 21 is perpendicular to the main surface of the second semiconductor substrate 41.

次に、図10(A)(B)に示すように、開口部26内及び第1の半導体基板21の裏面上に第2の絶縁膜27を形成する。この第2の絶縁膜27は、例えばプラズマCVD法によって形成されたシリコン酸化膜やシリコン窒化膜等の絶縁膜である。   Next, as shown in FIGS. 10A and 10B, a second insulating film 27 is formed in the opening 26 and on the back surface of the first semiconductor substrate 21. The second insulating film 27 is an insulating film such as a silicon oxide film or a silicon nitride film formed by a plasma CVD method, for example.

次に、図11(A)に示すように、不図示のレジスト層をマスクとして、第2の絶縁膜27を選択的にエッチングする。このエッチングにより、パッド電極24a,24bから個々のチップの境界(いわゆるダイシングラインDL)に至る領域にかけて形成された第2の絶縁膜27が除去され、開口部26の底部においてパッド電極24a,24bの少なくとも一部が露出される。なお、第2の絶縁膜27は無機膜であり、接着層25は有機膜である。このような膜の違いを利用して、この時点では接着層25が除去されないようにする。   Next, as shown in FIG. 11A, the second insulating film 27 is selectively etched using a resist layer (not shown) as a mask. By this etching, the second insulating film 27 formed from the pad electrodes 24 a and 24 b to the region from the individual chip boundary (so-called dicing line DL) is removed, and the pad electrodes 24 a and 24 b are formed at the bottom of the opening 26. At least a portion is exposed. The second insulating film 27 is an inorganic film, and the adhesive layer 25 is an organic film. By utilizing such a film difference, the adhesive layer 25 is not removed at this point.

次に、図11(B)に示すように、不図示のレジスト層をマスクとして、開口部26の底部の接着層25の一部を選択的にエッチングする。このエッチングにより、開口部26の底部において一部の接着層25が除去され、パッド電極43の少なくとも一部が露出される。こうして、第1の半導体基板21側のパッド電極24a,24bと、第2の半導体基板41側のパッド電極43のいずれもが露出される。   Next, as shown in FIG. 11B, a part of the adhesive layer 25 at the bottom of the opening 26 is selectively etched using a resist layer (not shown) as a mask. By this etching, a part of the adhesive layer 25 is removed at the bottom of the opening 26 and at least a part of the pad electrode 43 is exposed. Thus, both the pad electrodes 24a and 24b on the first semiconductor substrate 21 side and the pad electrode 43 on the second semiconductor substrate 41 side are exposed.

次に、スパッタリング法やメッキ法、その他の成膜方法により、配線層28,29となるアルミニウム(Al)や銅(Cu)等の導電層を例えば1μmの膜厚で形成する。その後、不図示のレジスト層をマスクとして当該導電層を選択的にエッチングする。このエッチングによって導電層は、図12(A)(B)に示すように、第2の絶縁膜27を介して第1の半導体基板21の側面に沿って形成された配線層28,29となる。配線層28は、図12(A)に示すようにパッド電極24a,24bの少なくとも一部と接続されて、第1の半導体基板21の裏面の一部上に延在している。配線層29は、図12(B)に示すようにパッド電極43の少なくとも一部と接続されて、第1の半導体基板21の裏面の一部上に延在している。   Next, a conductive layer such as aluminum (Al) or copper (Cu) to be the wiring layers 28 and 29 is formed with a film thickness of 1 μm, for example, by sputtering, plating, or other film forming methods. Thereafter, the conductive layer is selectively etched using a resist layer (not shown) as a mask. By this etching, the conductive layers become wiring layers 28 and 29 formed along the side surfaces of the first semiconductor substrate 21 with the second insulating film 27 interposed therebetween, as shown in FIGS. . As shown in FIG. 12A, the wiring layer 28 is connected to at least a part of the pad electrodes 24 a and 24 b and extends on a part of the back surface of the first semiconductor substrate 21. As shown in FIG. 12B, the wiring layer 29 is connected to at least a part of the pad electrode 43 and extends on a part of the back surface of the first semiconductor substrate 21.

また、配線層28,29の形成工程とともに、図14に示すようにパッド電極24a,24bとパッド電極43とを相互に接続するための配線層36を形成する。これにより、第1の半導体基板21の表面上に形成されたN型半導体層22やP型半導体層23等から構成される発光素子と第2の半導体基板41の表面上に形成されたデバイス素子40とが電気的に接続される。なお、発光素子とデバイス素子40との電気的接続は、配線層36を形成せずに、実装基板側の配線で行ってもよい。   In addition to the formation process of the wiring layers 28 and 29, as shown in FIG. 14, a wiring layer 36 for connecting the pad electrodes 24a and 24b and the pad electrode 43 to each other is formed. As a result, a light emitting element composed of the N-type semiconductor layer 22 and the P-type semiconductor layer 23 formed on the surface of the first semiconductor substrate 21 and a device element formed on the surface of the second semiconductor substrate 41. 40 is electrically connected. Note that the electrical connection between the light emitting element and the device element 40 may be performed by wiring on the mounting substrate side without forming the wiring layer 36.

次に、ダイシングブレードやエッチングによって、第1の半導体基板21側から接着層25及び第2の半導体基板41の一部を除去することで、切り欠き部30を形成することが好ましい。なお、切り欠き部30の断面形状は、第2の半導体基板41に切り欠き部30が到達するのであれば図12(A)(B)に示すようなV字形状に限定されず、楕円形状や略長方形等でも構わない。   Next, it is preferable to form the cutout portion 30 by removing a part of the adhesive layer 25 and the second semiconductor substrate 41 from the first semiconductor substrate 21 side by a dicing blade or etching. Note that the cross-sectional shape of the notch 30 is not limited to the V shape as shown in FIGS. 12A and 12B as long as the notch 30 reaches the second semiconductor substrate 41, and an elliptical shape. Or a substantially rectangular shape.

次に、配線層28,29を被覆する電極接続層(不図示)を形成することが好ましい。電極接続層を形成するのは、アルミニウム等から成る配線層28,29と、後述するハンダ等から成る導電端子32は接合しにくいという理由や、導電端子32の材料が配線層28,29側に流入してくることを防止するという理由による。電極接続層は、例えばレジスト層をマスクとしてニッケル(Ni)層と金(Au)層等の金属層を順次スパッタリングし、その後レジスト層を除去するというリフトオフ法や、メッキ法によって形成することができる。   Next, it is preferable to form an electrode connection layer (not shown) that covers the wiring layers 28 and 29. The electrode connection layer is formed because the wiring layers 28 and 29 made of aluminum or the like and the conductive terminals 32 made of solder or the like, which will be described later, are difficult to join, and the material of the conductive terminals 32 is on the wiring layers 28 and 29 side. This is because the inflow is prevented. The electrode connection layer can be formed by, for example, a lift-off method or a plating method in which a metal layer such as a nickel (Ni) layer and a gold (Au) layer is sequentially sputtered using the resist layer as a mask and then the resist layer is removed. .

次に、図13(A)(B)に示すように、後述する導電端子32の形成領域に開口を有する保護層31を、例えば10μmの厚みで形成する。保護層31の形成は例えば以下のように行う。まず、塗布・コーティング法によりポリイミド系樹脂、ソルダーレジスト等の有機系材料を全面に塗布し、熱処理(プリベーク)を施す。次に、塗布された有機系材料を露光・現像して所定領域を露出させる開口を形成し、その後これに熱処理(ポストベーク)を施す。これにより、導電端子32の形成領域に開口を有する保護層31を得る。本実施形態では、切り欠き部30を形成しているため、接着層25の側面が保護層31で完全に被覆される。そのため、接着層25が外気に触れることを抑えるとともに、デバイス素子40や接着層25への腐食物質(例えば水分)の浸入を防止することができる。   Next, as shown in FIGS. 13A and 13B, a protective layer 31 having an opening in a formation region of a conductive terminal 32 described later is formed with a thickness of, for example, 10 μm. The protective layer 31 is formed as follows, for example. First, an organic material such as polyimide resin or solder resist is applied to the entire surface by a coating / coating method, and heat treatment (pre-baking) is performed. Next, the applied organic material is exposed and developed to form an opening that exposes a predetermined region, and then a heat treatment (post-bake) is applied thereto. Thereby, the protective layer 31 having an opening in the formation region of the conductive terminal 32 is obtained. In this embodiment, since the notch 30 is formed, the side surface of the adhesive layer 25 is completely covered with the protective layer 31. For this reason, it is possible to prevent the adhesive layer 25 from coming into contact with the outside air and to prevent the entry of corrosive substances (for example, moisture) into the device element 40 and the adhesive layer 25.

次に、保護層31の開口から露出した電極接続層(不図示)上に導電材料(例えばハンダ)をスクリーン印刷し、この導電材料を熱処理でリフローさせる。こうして、図13(A)(B)に示すように配線層28,29を介してパッド電極24a,24b,43と電気的に接続された導電端子32が第1の半導体基板21の裏面上に形成される。なお、導電端子32の形成方法は上記に限定されることはなく、電解メッキ法や、ディスペンサを用いてハンダ等を所定領域に塗布するいわゆるディスペンス法(塗布法)等で形成することもできる。導電端子32は、金や銅,ニッケルを材料としたものでもよく、その材料は特に限定されない。また、電極接続層(不図示)の形成工程は、保護層31の形成後に行ってもよい。   Next, a conductive material (for example, solder) is screen-printed on an electrode connection layer (not shown) exposed from the opening of the protective layer 31, and the conductive material is reflowed by heat treatment. Thus, as shown in FIGS. 13A and 13B, the conductive terminals 32 electrically connected to the pad electrodes 24a, 24b, 43 via the wiring layers 28, 29 are formed on the back surface of the first semiconductor substrate 21. It is formed. The method for forming the conductive terminal 32 is not limited to the above, and it may be formed by an electrolytic plating method or a so-called dispensing method (coating method) in which solder or the like is applied to a predetermined region using a dispenser. The conductive terminal 32 may be made of gold, copper, or nickel, and the material is not particularly limited. Further, the step of forming the electrode connection layer (not shown) may be performed after the formation of the protective layer 31.

次に、所定のダイシングラインDLに沿って切断し、個々の発光装置35に分割する。個々の発光装置35に分割する方法としては、ダイシング法,エッチング法,レーザーカット法等がある。図14は発光装置35の裏面側(第1の半導体基板21側)から見た平面図の概略である。なお、図13(A)(B)の発光装置35は、図14のX−X線,Y−Y線に沿った断面図に対応する。   Next, it is cut along a predetermined dicing line DL and divided into individual light emitting devices 35. As a method of dividing into individual light emitting devices 35, there are a dicing method, an etching method, a laser cut method, and the like. FIG. 14 is a schematic plan view of the light emitting device 35 as viewed from the back side (first semiconductor substrate 21 side). Note that the light emitting device 35 in FIGS. 13A and 13B corresponds to a cross-sectional view taken along lines XX and YY in FIG.

以上の工程により、第1の半導体基板21と第2の半導体基板41との貼り合わせ面に、発光素子(LED)及びデバイス素子40の両者を備えるチップサイズパッケージ型の発光装置35が完成する。発光装置35は、導電端子32を介してプリント基板等に実装される。発光装置35からの光は、図13(A)(B)の矢印で示されるように、開口部44の内周面で反射されて第2の半導体基板41側に放射される。   Through the above steps, a chip size package type light emitting device 35 having both the light emitting element (LED) and the device element 40 on the bonding surface of the first semiconductor substrate 21 and the second semiconductor substrate 41 is completed. The light emitting device 35 is mounted on a printed circuit board or the like via the conductive terminal 32. The light from the light emitting device 35 is reflected by the inner peripheral surface of the opening 44 and radiated to the second semiconductor substrate 41 side, as indicated by arrows in FIGS.

第2の実施形態では、従来構造(図20参照)のように複数の部品(LEDチップ,リード,ボンディングワイヤ)が個別に形成され、その後組み合わせて構成されておらず、個々の装置に分割される以前、つまりウェハー状態のときから接着層を介してチップとして一体化されている。さらに、発光素子を備える第1の半導体基板21と、デバイス素子40を備える第2の半導体基板41とが一体化されている。そのため、従来に比して発光装置の小型化を図ることができるとともに、1チップ内に多数の素子を効率よく混載することができ、多機能な発光装置を得ることができる。例えば、本実施形態のように、第1の基板側に発光素子を形成し、第2の基板側に当該発光素子を制御する駆動素子を設けることで、発光機能とその制御機能の両者を1チップで実現することができる。従って、従来(図20)のように発光装置と別に駆動装置を形成する必要はない。   In the second embodiment, a plurality of components (LED chips, leads, bonding wires) are individually formed as in the conventional structure (see FIG. 20), and are not configured afterward, but are divided into individual devices. It is integrated as a chip through an adhesive layer from before the wafer state, that is, from the wafer state. Furthermore, the 1st semiconductor substrate 21 provided with a light emitting element and the 2nd semiconductor substrate 41 provided with the device element 40 are integrated. Therefore, it is possible to reduce the size of the light emitting device as compared with the conventional case, and it is possible to efficiently mount many elements in one chip, and to obtain a multifunctional light emitting device. For example, as in this embodiment, a light emitting element is formed on the first substrate side, and a driving element for controlling the light emitting element is provided on the second substrate side. It can be realized with a chip. Therefore, it is not necessary to form a driving device separately from the light emitting device as in the conventional case (FIG. 20).

さらにまた、本実施形態によれば、従来1チップに混載して封止していなかったもの、あるいは1チップに混載して封止することが製造プロセス上等の理由から困難であったものでも、第1の基板上と第2の基板上に分けて素子を形成し、それらを1チップで封止することができる。そのため、従来に比して装置全体の小型化を図ることができる。例えば、MEMS(Micro Electro Mechanical Systems)は一般的に高温処理で形成されるため、CMOSプロセス等と整合性が良好でない。MEMSとは、機械要素部品、センサー、アクチュエーター、電子回路等を半導体基板上に集積化したデバイスのことである。そのため、MEMSと他の素子(例えばMEMS用の駆動素子)とを1チップ内に混載して形成することが従来の製造プロセスでは困難であった。しかし、第2の実施形態のようにMEMSを一方の基板上に形成し、他方の基板上に当該MEMSの駆動素子や発光素子を形成することで1チップでMEMSを備えた発光装置を形成することができる。   Furthermore, according to the present embodiment, even if it is conventionally not mixed and sealed on one chip, or it is difficult to mount and seal on one chip for reasons such as a manufacturing process. The elements can be formed separately on the first substrate and the second substrate and sealed with one chip. Therefore, it is possible to reduce the size of the entire apparatus as compared with the conventional case. For example, since MEMS (Micro Electro Mechanical Systems) is generally formed by high-temperature processing, the compatibility with a CMOS process or the like is not good. MEMS is a device in which mechanical element parts, sensors, actuators, electronic circuits and the like are integrated on a semiconductor substrate. For this reason, it has been difficult in the conventional manufacturing process to form the MEMS and other elements (for example, a driving element for MEMS) in a single chip. However, as in the second embodiment, a MEMS is formed on one substrate, and a driving element and a light emitting element of the MEMS are formed on the other substrate, thereby forming a light emitting device including the MEMS on a single chip. be able to.

また、従来複数の部品を別々に製造し、組立作業を行って完成していたものが、本実施形態によればウェハー状の基板を個々のチップに分割した時点で一体化して完成する。そのため、後の組み立て作業等を省き、作業性を向上させることができる。   Also, according to the present embodiment, a plurality of parts that have been conventionally manufactured separately and assembled are integrated and completed when the wafer-like substrate is divided into individual chips. Therefore, subsequent assembly work and the like can be omitted, and workability can be improved.

次に、本発明の第3の実施形態について説明する。図15(A),(B)は、第3の実施形態に係る発光装置50の断面図である。また、図16は発光装置50を第2の半導体基板41側から見た平面図の概略である。なお、図15(A)(B)の発光装置50は、図16のA−A線,B−B線に沿った断面図に対応する。なお、第3の実施形態も第2の実施形態と同様に2つの断面図を用いて説明し、上記第1及び第2の実施形態と同様の構成についてはその説明を省略するか簡略する。   Next, a third embodiment of the present invention will be described. FIGS. 15A and 15B are cross-sectional views of the light emitting device 50 according to the third embodiment. FIG. 16 is a schematic plan view of the light emitting device 50 as viewed from the second semiconductor substrate 41 side. 15A and 15B corresponds to a cross-sectional view taken along lines AA and BB in FIG. Note that the third embodiment will be described using two cross-sectional views similarly to the second embodiment, and the description of the same configuration as the first and second embodiments will be omitted or simplified.

第3の実施形態の発光装置50は、図15(A)(B)及び図16に示すようにN型半導体層22上に複数のP型半導体層51が例えば行列状に配列されている。各P型半導体層51は、N型半導体層22上に形成された絶縁層52で区画されている。このような複数のP型半導体層51は、例えばP型半導体層を一様に形成した後に公知のフォトリソ工程を経ることで形成することができる。   In the light emitting device 50 according to the third embodiment, a plurality of P-type semiconductor layers 51 are arranged on the N-type semiconductor layer 22 in, for example, a matrix as shown in FIGS. Each P-type semiconductor layer 51 is partitioned by an insulating layer 52 formed on the N-type semiconductor layer 22. Such a plurality of P-type semiconductor layers 51 can be formed, for example, by forming a P-type semiconductor layer uniformly and then performing a known photolithography process.

各P型半導体層51の上部は、アルミニウム等から成る導電層53(アノード電極)と接続されている。各導電層53は、第1の半導体基板21の側面及び裏面に沿って形成された配線層28と導電端子32に電気的に接続されている。このように構成することで、各P型半導体層51の形成部はそれぞれ独立して発光する。換言すれば、第1の半導体基板21上には複数の発光部が形成されている。   The upper part of each P-type semiconductor layer 51 is connected to a conductive layer 53 (anode electrode) made of aluminum or the like. Each conductive layer 53 is electrically connected to the wiring layer 28 formed along the side surface and the back surface of the first semiconductor substrate 21 and the conductive terminal 32. With this configuration, each P-type semiconductor layer 51 forming portion emits light independently. In other words, a plurality of light emitting portions are formed on the first semiconductor substrate 21.

また、第2の半導体基板41は複数の開口部54を有し、当該開口部54は上述した複数の発光部に対応した位置に形成されている。開口部54は、発光部から放射される光の経路となるものである。   The second semiconductor substrate 41 has a plurality of openings 54, and the openings 54 are formed at positions corresponding to the plurality of light emitting portions described above. The opening 54 serves as a path for light emitted from the light emitting unit.

また、第1の半導体基板21の裏面上には電極接続層55(例えば、アルミニウム層とニッケル層や金層の積層)を介して導電端子56(カソード電極)が形成されている。このようにカソード電極は、第1の半導体基板21の裏面上に形成してもよい。このように発光装置50は、P型領域(P型半導体層51)に導電端子32から導電層53を介して電圧を供給し、N型領域(第1の半導体基板21とN型半導体層22)に導電端子56を介して電圧を供給したときに、PN接合面が発光する構成になっている。   A conductive terminal 56 (cathode electrode) is formed on the back surface of the first semiconductor substrate 21 via an electrode connection layer 55 (for example, a laminate of an aluminum layer, a nickel layer, and a gold layer). As described above, the cathode electrode may be formed on the back surface of the first semiconductor substrate 21. As described above, the light emitting device 50 supplies a voltage to the P-type region (P-type semiconductor layer 51) from the conductive terminal 32 via the conductive layer 53, and thus the N-type region (the first semiconductor substrate 21 and the N-type semiconductor layer 22). ), When a voltage is supplied via the conductive terminal 56, the PN junction surface emits light.

また、第2の半導体基板41の表面上にはデバイス素子40が形成されている。デバイス素子40は、パッド電極43を介して導電層53や導電端子56と接続されており、例えば上述した複数の発光部を選択的に発光及び消灯させる信号を出力する駆動素子を含むものである。   A device element 40 is formed on the surface of the second semiconductor substrate 41. The device element 40 is connected to the conductive layer 53 and the conductive terminal 56 through the pad electrode 43, and includes, for example, a drive element that outputs a signal for selectively emitting and turning off the plurality of light emitting units described above.

第1及び第2の実施形態では、P型半導体層3,23が第1の半導体基板1,21の表面上にほぼ一様に形成され、また、第2の半導体基板16,41には一つの開口部10,44のみが形成されていた。これに対して、第3の実施形態では、第1の半導体基板21上に複数の発光部が形成され、それぞれの発光部の発光及び消灯を選択的に制御できる構成になっている。そのため、第1及び第2の実施形態で得られる効果に加えて、数字(アラビア数字や漢数字やローマ数字など)や文字(平仮名、カタカナ、漢字など)を含め様々な画像(静止画及び動画も含む)を1チップで表示することができる。また、複数の開口部54の形成によって、隣接する発光部が仕切られていることが好ましい。そのため、光の指向性が良く、発光モジュールに適している。   In the first and second embodiments, the P-type semiconductor layers 3, 23 are formed substantially uniformly on the surfaces of the first semiconductor substrates 1, 21, and the second semiconductor substrates 16, 41 have one Only one opening 10, 44 was formed. On the other hand, in the third embodiment, a plurality of light emitting units are formed on the first semiconductor substrate 21, and light emission and extinction of each light emitting unit can be selectively controlled. Therefore, in addition to the effects obtained in the first and second embodiments, various images (still images and moving images) including numerals (Arabic numerals, Chinese numerals, Roman numerals, etc.) and letters (Hiragana, Katakana, Kanji, etc.) Can be displayed on a single chip. Further, it is preferable that adjacent light emitting portions are partitioned by the formation of the plurality of openings 54. Therefore, the directivity of light is good and suitable for a light emitting module.

なお、本発明は上述した実施形態に限定されることはなく、その要旨を逸脱しない範囲で変更が可能なことは言うまでも無い。例えば、図17に示すように開口部10内に、エポキシやシリコーン等の樹脂やガラス等から成る所定のレンズ60を配置し、光の指向性や輝度を更に向上させることができる。また、開口部10内をレンズ60の配置用の空間としているため、レンズの配置による装置の大型化が抑えられている。なお、第3の実施形態のように、複数の開口部54のそれぞれにレンズを配置することもできる。また、開口部内に配置されるレンズは、できるだけ開口部内の空間に収まることが小型化の観点から好ましい。   Needless to say, the present invention is not limited to the above-described embodiment, and can be changed without departing from the gist thereof. For example, as shown in FIG. 17, a predetermined lens 60 made of a resin such as epoxy or silicone, glass or the like can be disposed in the opening 10 to further improve the light directivity and brightness. Further, since the opening 10 is used as a space for arranging the lens 60, an increase in size of the apparatus due to the lens arrangement is suppressed. In addition, as in the third embodiment, a lens can be disposed in each of the plurality of openings 54. Moreover, it is preferable from a viewpoint of size reduction that the lens arrange | positioned in an opening part fits in the space in an opening part as much as possible.

また、図18(A)(B)に示すように発光装置を構成することもできる。なお、第2及び第3の実施形態と同様に2つの断面図を用いて説明し、既に説明したものと同様の構成については同一符号を示し、その説明を省略する。図18(A),(B)に示す発光装置65は、パッド電極24a,24b,43に対応する位置が開口し、かつ第1の半導体基板21の側面及び裏面を被覆する保護層66が形成されている。そして、保護層66の開口位置のパッド電極24a,24b,43上に電極接続層67が形成されている。電極接続層67は、例えばニッケル(Ni)層と金(Au)層を順に積層した層であり、レジスト層をマスクとしてこれらの金属を順にスパッタリングし、その後レジストを除去するというリフトオフ法や、メッキ法によって形成できる。そして、パッド電極24a,24b,43上には、電極接続層67を介してハンダ等から成る導電端子68が形成されている。このように、第1の半導体基板21の側面及び裏面に絶縁膜(第2の実施形態の第2の絶縁膜27)や配線層(第2の実施形態の配線層28,29)を形成することなく、第1の半導体基板21の側壁に隣接するように導電端子68を形成することもできる。   In addition, a light-emitting device can be formed as shown in FIGS. In addition, it demonstrates using two sectional drawings similarly to 2nd and 3rd embodiment, the same code | symbol is shown about the structure similar to what was already demonstrated, and the description is abbreviate | omitted. In the light emitting device 65 shown in FIGS. 18A and 18B, positions corresponding to the pad electrodes 24a, 24b, and 43 are opened, and a protective layer 66 that covers the side surface and the back surface of the first semiconductor substrate 21 is formed. Has been. An electrode connection layer 67 is formed on the pad electrodes 24 a, 24 b, 43 at the opening positions of the protective layer 66. The electrode connection layer 67 is a layer in which, for example, a nickel (Ni) layer and a gold (Au) layer are sequentially laminated, and a lift-off method in which these metals are sequentially sputtered using a resist layer as a mask, and then the resist is removed, or plating Can be formed by law. A conductive terminal 68 made of solder or the like is formed on the pad electrodes 24 a, 24 b, 43 via an electrode connection layer 67. As described above, the insulating film (the second insulating film 27 in the second embodiment) and the wiring layers (the wiring layers 28 and 29 in the second embodiment) are formed on the side surface and the back surface of the first semiconductor substrate 21. Alternatively, the conductive terminal 68 can be formed so as to be adjacent to the side wall of the first semiconductor substrate 21.

かかる構成によれば、第1乃至第3の実施形態の発光装置で示した絶縁膜や配線層を形成する工程が不要である。そのため、製造工程が簡素化され、製造コストを低く抑えることができる。また、導電端子68が第1の半導体基板21の裏面上に形成されず、第1の半導体基板21の側壁に隣接するように形成されているため、発光装置を薄くすることができる。なお、開口部26の形成の際に半導体基板21のエッチングする部分は適宜変更できる。そのため、第1の半導体基板21の側壁内に埋設されるように導電端子68を形成し、発光装置の側面から導電端子68を露出させないことも可能である。   According to such a configuration, the step of forming the insulating film and the wiring layer shown in the light emitting devices of the first to third embodiments is unnecessary. Therefore, the manufacturing process is simplified and the manufacturing cost can be kept low. Further, since the conductive terminal 68 is not formed on the back surface of the first semiconductor substrate 21 but is formed adjacent to the side wall of the first semiconductor substrate 21, the light emitting device can be thinned. Note that the portion of the semiconductor substrate 21 to be etched can be changed as appropriate when the opening 26 is formed. Therefore, it is possible to form the conductive terminal 68 so as to be embedded in the side wall of the first semiconductor substrate 21 and not expose the conductive terminal 68 from the side surface of the light emitting device.

また、上述した実施形態では半導体基板が用いられていたが、半導体ではなくガラスや石英のような絶縁性の材料から成る基板を用いることも可能である。また、装置の用途に応じて、透明であって光を透過させる性状を有する基板を用いてもよい。   In the above-described embodiment, the semiconductor substrate is used. However, it is possible to use a substrate made of an insulating material such as glass or quartz instead of the semiconductor. Further, a substrate that is transparent and has a property of transmitting light may be used depending on the application of the apparatus.

また、上述した第2及び第3の実施形態では、一方の基板(発光素子が形成された側の基板)に発光素子及びデバイス素子に電圧を供給するための導電端子や配線層が形成されていた。第2の実施形態であれば、第1の半導体基板21側に開口部26を形成し、その後配線層28,29や導電端子32が形成されている。しかし、本発明はこれに限定されない。従って、必要に応じて他方の基板(発光素子が形成されていない側の基板)に配線層や導電端子を形成してもよい。   In the second and third embodiments described above, a conductive terminal and a wiring layer for supplying a voltage to the light emitting element and the device element are formed on one substrate (the substrate on which the light emitting element is formed). It was. In the second embodiment, the opening 26 is formed on the first semiconductor substrate 21 side, and then the wiring layers 28 and 29 and the conductive terminal 32 are formed. However, the present invention is not limited to this. Therefore, a wiring layer or a conductive terminal may be formed on the other substrate (the substrate on which the light emitting element is not formed) as necessary.

また、上述した実施形態では、2つの基板上に形成されたパッド電極(第2の実施形態であればパッド電極24a,24bとパッド電極43)が重なり合わないように貼り合わされていたが、両方のパッド電極が重なり合ったとしても、開口部や配線層や導電端子をそれぞれのパッド電極が形成された側の基板に対して形成することで、両方向から各パッド電極に電圧を供給することも可能である。また、図19に示すように両方のパッド電極が重なり合ったとしても、いずれか(図19ではパッド電極43)の面積を他方(図19ではパッド電極24a,24b)よりも大きくすることで、重なり合っていない領域を利用して各パッド電極と配線層を接続することができる。このように、素子への電圧の供給の仕方は適宜変更できる。   In the above-described embodiment, the pad electrodes formed on the two substrates (in the second embodiment, the pad electrodes 24a and 24b and the pad electrode 43) are bonded so as not to overlap. Even if the pad electrodes overlap, it is possible to supply voltage to each pad electrode from both directions by forming openings, wiring layers and conductive terminals on the substrate on which the respective pad electrodes are formed. It is. Moreover, even if both pad electrodes overlap as shown in FIG. 19, the area of either (pad electrode 43 in FIG. 19) is made larger than the other (pad electrodes 24a and 24b in FIG. 19) to overlap. Each pad electrode and the wiring layer can be connected by using a region that is not provided. Thus, the way of supplying voltage to the element can be changed as appropriate.

また、以上の実施形態では、ボール状の導電端子(8,32,68)を有するBGA型の発光装置について説明したが、本発明はLGA(Land Grid Array)型の発光装置に適用するものであっても構わない。本発明は、発光素子を小型に封止する技術として広く適用できるものである。   In the above embodiment, the BGA type light emitting device having the ball-like conductive terminals (8, 32, 68) has been described. However, the present invention is applied to an LGA (Land Grid Array) type light emitting device. It does not matter. The present invention can be widely applied as a technique for sealing a light emitting element in a small size.

本発明の第1の実施形態に係る発光装置及びその製造方法を説明する断面図である。It is sectional drawing explaining the light-emitting device which concerns on the 1st Embodiment of this invention, and its manufacturing method. 本発明の第2の実施形態に係る発光装置及びその製造方法を説明する断面図である。It is sectional drawing explaining the light-emitting device which concerns on the 2nd Embodiment of this invention, and its manufacturing method. 本発明の第2の実施形態に係る発光装置及びその製造方法を説明する断面図である。It is sectional drawing explaining the light-emitting device which concerns on the 2nd Embodiment of this invention, and its manufacturing method. 本発明の第2の実施形態に係る発光装置及びその製造方法を説明する断面図である。It is sectional drawing explaining the light-emitting device which concerns on the 2nd Embodiment of this invention, and its manufacturing method. 本発明の第2の実施形態に係る発光装置及びその製造方法を説明する断面図である。It is sectional drawing explaining the light-emitting device which concerns on the 2nd Embodiment of this invention, and its manufacturing method. 本発明の第2の実施形態に係る発光装置及びその製造方法を説明する断面図である。It is sectional drawing explaining the light-emitting device which concerns on the 2nd Embodiment of this invention, and its manufacturing method. 本発明の第2の実施形態に係る発光装置及びその製造方法を説明する平面図である。It is a top view explaining the light-emitting device which concerns on the 2nd Embodiment of this invention, and its manufacturing method. 本発明の第2の実施形態に係る発光装置及びその製造方法を説明する断面図である。It is sectional drawing explaining the light-emitting device which concerns on the 2nd Embodiment of this invention, and its manufacturing method. 本発明の第2の実施形態に係る発光装置及びその製造方法を説明する平面図である。It is a top view explaining the light-emitting device which concerns on the 2nd Embodiment of this invention, and its manufacturing method. 本発明の第2の実施形態に係る発光装置及びその製造方法を説明する断面図である。It is sectional drawing explaining the light-emitting device which concerns on the 2nd Embodiment of this invention, and its manufacturing method. 本発明の第2の実施形態に係る発光装置及びその製造方法を説明する断面図である。It is sectional drawing explaining the light-emitting device which concerns on the 2nd Embodiment of this invention, and its manufacturing method. 本発明の第2の実施形態に係る発光装置及びその製造方法を説明する断面図である。It is sectional drawing explaining the light-emitting device which concerns on the 2nd Embodiment of this invention, and its manufacturing method. 本発明の第2の実施形態に係る発光装置及びその製造方法を説明する断面図である。It is sectional drawing explaining the light-emitting device which concerns on the 2nd Embodiment of this invention, and its manufacturing method. 本発明の第2の実施形態に係る発光装置及びその製造方法を説明する平面図である。It is a top view explaining the light-emitting device which concerns on the 2nd Embodiment of this invention, and its manufacturing method. 本発明の第3の実施形態に係る発光装置及びその製造方法を説明する断面図である。It is sectional drawing explaining the light-emitting device which concerns on the 3rd Embodiment of this invention, and its manufacturing method. 本発明の第3の実施形態に係る発光装置及びその製造方法を説明する平面図である。It is a top view explaining the light-emitting device which concerns on the 3rd Embodiment of this invention, and its manufacturing method. 本発明の変更例に係る発光装置を説明する断面図である。It is sectional drawing explaining the light-emitting device which concerns on the example of a change of this invention. 本発明の変更例に係る発光装置を説明する断面図である。It is sectional drawing explaining the light-emitting device which concerns on the example of a change of this invention. 本発明の変更例に係る発光装置を説明する平面図である。It is a top view explaining the light-emitting device which concerns on the example of a change of this invention. 従来の発光装置を説明する断面図である。It is sectional drawing explaining the conventional light-emitting device.

符号の説明Explanation of symbols

1 第1の半導体基板 2 N型半導体層 3 P型半導体層
4a,4b パッド電極 5 絶縁膜 6 配線層 7 保護層
8 導電端子 10 開口部 11 第2の半導体基板 12 接着層
13 切り欠き部 21 第1の半導体基板 22 N型半導体層
23 P型半導体層 24a,24b パッド電極 25 接着層
26 開口部 27 第2の絶縁膜 28 配線層 29 配線層
30 切り欠き部 31 保護層 32 導電端子 35 発光装置
36 配線層 40 デバイス素子 41 第2の半導体基板
42 第1の絶縁膜 43 パッド電極 44 開口部 50 発光装置
51 P型半導体層 52 絶縁層 53 導電層 54 開口部
55 金属層 56 導電端子 60 レンズ 65 発光装置
66 保護層 67 電極接続層 68 導電端子 100 LED装置
101 第1のリード 102 LEDチップ 103 ボンディングワイヤ
104 第2のリード 105 凹面部 106 透明樹脂層
DESCRIPTION OF SYMBOLS 1 1st semiconductor substrate 2 N type semiconductor layer 3 P type semiconductor layer
4a, 4b Pad electrode 5 Insulating film 6 Wiring layer 7 Protective layer
DESCRIPTION OF SYMBOLS 8 Conductive terminal 10 Opening part 11 2nd semiconductor substrate 12 Adhesion layer 13 Notch part 21 1st semiconductor substrate 22 N type semiconductor layer 23 P type semiconductor layer 24a, 24b Pad electrode 25 Adhesion layer 26 Opening part 27 2nd Insulating film 28 Wiring layer 29 Wiring layer 30 Notch 31 Protective layer 32 Conductive terminal 35 Light emitting device 36 Light emitting device 36 Wiring layer 40 Device element 41 Second semiconductor substrate 42 First insulating film 43 Pad electrode 44 Opening 50 Light emitting device 51 P Type semiconductor layer 52 insulating layer 53 conductive layer 54 opening 55 metal layer 56 conductive terminal 60 lens 65 light emitting device 66 protective layer 67 electrode connection layer 68 conductive terminal 100 LED device 101 first lead 102 LED chip 103 bonding wire 104 second Lead 105 Concave surface 106 Transparent resin layer

Claims (18)

表面上に発光素子が形成された第1の基板と、
表面から裏面にかけて貫通する開口部を有する第2の基板とを備え、
前記第1の基板の表面側と前記第2の基板の表面側とが向かい合って、接着層を介して貼り合わされ、
前記開口部が開口されたままで、その底面に前記発光素子が前記接着層を介して露出されることを特徴とする発光装置。
A first substrate having a light emitting element formed on the surface;
A second substrate having an opening penetrating from the front surface to the back surface,
The surface side of the first substrate and the surface side of the second substrate face each other and are bonded together through an adhesive layer,
The light-emitting device, wherein the light-emitting element is exposed to the bottom surface of the opening through the adhesive layer while the opening is left open .
前記第2の基板の表面上にデバイス素子が形成されていることを特徴とする請求項1に記載の発光装置。   The light emitting device according to claim 1, wherein a device element is formed on a surface of the second substrate. 前記デバイス素子は、前記発光素子の発光及び消灯を制御する駆動素子を含むことを特徴とする請求項2に記載の発光装置。   The light emitting apparatus according to claim 2, wherein the device element includes a drive element that controls light emission and extinction of the light emitting element. 前記第1の基板の表面上に、前記発光素子と電気的に接続された第1のパッド電極と、前記第2の基板の表面上に、前記デバイス素子と電気的に接続された第2のパッド電極とを備えることを特徴とする請求項2または請求項3に記載の発光素子。   A first pad electrode electrically connected to the light emitting element on the surface of the first substrate, and a second electrode electrically connected to the device element on the surface of the second substrate. The light emitting device according to claim 2, further comprising a pad electrode. 前記第1のパッド電極と前記第2のパッド電極とが重なり合わないように貼り合わされていることを特徴とする請求項4に記載の発光装置。   The light emitting device according to claim 4, wherein the first pad electrode and the second pad electrode are bonded so as not to overlap each other. 前記接着層は、前記第1の基板の表面から前記第2のパッド電極に至る部分が除去されており、当該接着層の除去部分に前記第2のパッド電極と接続された導電材料が形成されていることを特徴とする請求項4または請求項5に記載の発光装置。   A portion of the adhesive layer from the surface of the first substrate to the second pad electrode is removed, and a conductive material connected to the second pad electrode is formed on the removed portion of the adhesive layer. The light emitting device according to claim 4, wherein the light emitting device is provided. 前記開口部内の側壁は、前記第2の基板の表面側から裏面側にかけてその開口径が拡がるように傾斜していることを特徴とする請求項1乃至請求項3のいずれかに記載の発光装置。   4. The light emitting device according to claim 1, wherein a side wall in the opening portion is inclined so that an opening diameter thereof increases from a front surface side to a back surface side of the second substrate. . 前記発光素子は、前記第1の基板の表面上に複数の発光部を有し、
前記開口部が前記複数の発光部に対応した位置に形成されていることを特徴とする請求項1乃至請求項3のいずれかに記載の発光装置。
The light emitting element has a plurality of light emitting portions on the surface of the first substrate,
The light-emitting device according to claim 1, wherein the opening is formed at a position corresponding to the plurality of light-emitting portions.
前記発光部は、前記第1の基板の表面上に行列状に形成されていることを特徴とする請求項8に記載の発光装置。   The light emitting device according to claim 8, wherein the light emitting units are formed in a matrix on the surface of the first substrate. 前記第1または第2のパッド電極と電気的に接続され、前記第1または前記第2の基板の厚み方向に突出した導電端子を備えることを特徴とする請求項4に記載の発光装置。   The light emitting device according to claim 4, further comprising a conductive terminal electrically connected to the first or second pad electrode and protruding in a thickness direction of the first or second substrate. 前記第1または第2のパッド電極と電気的に接続され、前記第1の基板の側面に沿って形成された配線層を備えることを特徴とする請求項4に記載の発光装置。   5. The light emitting device according to claim 4, further comprising a wiring layer that is electrically connected to the first or second pad electrode and is formed along a side surface of the first substrate. 表面上に発光素子が形成された第1の基板と、
第2の基板とを準備し、
前記第1の基板の表面側と前記第2の基板の表面側とを向かい合わせ、接着層を介して両者を貼り合わせる工程と、
前記貼り合わせ工程の前または後に、前記第2の基板に、表面側から裏面側にかけて貫通し、その底面に前記接着層を介して前記発光素子が露出する開口部を形成する工程と、
所定のダイシングラインに沿って前記第1及び前記第2の基板を切削し、個々のチップに分割する工程と、を備え、前記開口部が開口されたままであることを特徴とする発光装置の製造方法。
A first substrate having a light emitting element formed on the surface;
Preparing a second substrate;
Facing the surface side of the first substrate and the surface side of the second substrate, and bonding them together via an adhesive layer;
Before or after the bonding step , a step of forming an opening through the second substrate from the front surface side to the back surface side and exposing the light emitting element through the adhesive layer on the bottom surface ;
A step of cutting the first and second substrates along a predetermined dicing line and dividing them into individual chips , wherein the opening remains open. Method.
前記第2の基板の表面上にデバイス素子を形成する工程を有することを特徴とする請求項12に記載の発光装置の製造方法。   13. The method for manufacturing a light emitting device according to claim 12, further comprising a step of forming a device element on the surface of the second substrate. 前記第1の基板の表面上に、前記発光素子と電気的に接続された第1のパッド電極を備え、
前記第2の基板の表面上に、前記デバイス素子と電気的に接続された第2のパッド電極とを備えることを特徴とする請求項13に記載の発光装置の製造方法。
A first pad electrode electrically connected to the light emitting element on the surface of the first substrate;
The method for manufacturing a light-emitting device according to claim 13, further comprising a second pad electrode electrically connected to the device element on a surface of the second substrate.
前記第1の基板と前記第2の基板とを貼り合わせる工程は、前記第1のパッド電極と前記第2のパッド電極とが重なり合わないように行うことを特徴とする請求項14に記載の発光装置の製造方法。   15. The step of bonding the first substrate and the second substrate is performed so that the first pad electrode and the second pad electrode do not overlap each other. Manufacturing method of light-emitting device. 前記第1の基板の裏面側から前記第1の基板の一部を除去して、前記第1のパッド電極の少なくとも一部を露出させる工程と、
前記第1の基板の裏面側から前記接着層の一部を除去して、前記第2のパッド電極の少なくとも一部を露出させる工程とを有することを特徴とする請求項14または請求項15に記載の発光装置の製造方法。
Removing a portion of the first substrate from the back side of the first substrate to expose at least a portion of the first pad electrode;
16. The method of claim 14, further comprising: removing a part of the adhesive layer from the back surface side of the first substrate to expose at least a part of the second pad electrode. The manufacturing method of the light-emitting device of description.
前記第1または第2のパッド電極と電気的に接続された配線層を、前記第1の基板の側面に沿って形成する工程を有することを特徴とする請求項14または請求項15に記載の発光装置の製造方法。   16. The method according to claim 14, further comprising a step of forming a wiring layer electrically connected to the first or second pad electrode along a side surface of the first substrate. Manufacturing method of light-emitting device. 前記第1または第2のパッド電極と電気的に接続され、前記第1または第2の基板の厚み方向に突出した導電端子を形成する工程を備えることを特徴とする請求項14または請求項15に記載の発光装置の製造方法。   16. The method according to claim 14, further comprising a step of forming a conductive terminal electrically connected to the first or second pad electrode and protruding in a thickness direction of the first or second substrate. The manufacturing method of the light-emitting device as described in any one of.
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* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP5247417B2 (en) * 2008-12-25 2013-07-24 京セラ株式会社 LIGHT EMITTING ELEMENT AND LIGHT EMITTING ELEMENT ARRAY HAVING THE SAME
JP6303344B2 (en) * 2013-09-05 2018-04-04 日亜化学工業株式会社 Light emitting device
JP2015153793A (en) * 2014-02-11 2015-08-24 豊田合成株式会社 Semiconductor light emitting element and manufacturing method of the same, and light emitting device
JP6319026B2 (en) 2014-09-29 2018-05-09 日亜化学工業株式会社 Light emitting device and manufacturing method thereof
WO2017208326A1 (en) * 2016-05-31 2017-12-07 サンケン電気株式会社 Light-emitting device
WO2017208321A1 (en) * 2016-05-31 2017-12-07 サンケン電気株式会社 Light-emitting device
JP6455495B2 (en) 2016-09-28 2019-01-23 日亜化学工業株式会社 Light emitting device and manufacturing method thereof
CN108877663B (en) * 2017-05-10 2020-07-10 矽照光电(厦门)有限公司 Display screen, manufacturing method thereof and display structure

Family Cites Families (9)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH077184A (en) * 1993-06-14 1995-01-10 Omron Corp Semiconductor light emitting element, projector, optical detector and information processor employing it
JPH08148714A (en) * 1994-11-25 1996-06-07 Hitachi Cable Ltd Light-emitting diode and its manufacture
JPH11154774A (en) * 1997-08-05 1999-06-08 Canon Inc Surface light emission type semiconductor device, manufacture thereof, and display device using the same
JP3728147B2 (en) * 1999-07-16 2005-12-21 キヤノン株式会社 Opto-electric hybrid wiring board
KR100940943B1 (en) * 2001-08-24 2010-02-08 쇼오트 아게 Method for producing electronics components
CN101714516A (en) * 2001-08-24 2010-05-26 肖特股份公司 Process for making contact with and housing integrated circuits
JP2004363380A (en) * 2003-06-05 2004-12-24 Sanyo Electric Co Ltd Optical semiconductor device and its fabricating process
JP4198072B2 (en) * 2004-01-23 2008-12-17 シャープ株式会社 Semiconductor device, module for optical device, and method for manufacturing semiconductor device
JP4116587B2 (en) * 2004-04-13 2008-07-09 浜松ホトニクス株式会社 Semiconductor light emitting device and manufacturing method thereof

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