JP3770296B2 - Network terminal equipment - Google Patents

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JP3770296B2
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Description

【0001】
【発明の属する技術分野】
この発明は、工場等に敷設される情報伝送ネットワークの最下層に接続されて、スイッチ、ランプ表示などを1点単位で制御する端末装置に関する。
【0002】
【従来の技術】
従来、工場等に敷設される情報伝送ネットワークの1種に、各端末を2本のケーブルからなるバスに並列接続(マルチドロップ形)して、ポーリング・セレクティング方式により、端末間の通信制御をするものがある。
図8はその構成を示すものであり、上位装置5の下位側にマスタ1が接続されており、マスタ1と電源2および複数の端末3が芯線2本の伝送ケーブル4により接続されている。各端末3にはそれぞれアドレスが1つずつ割り当てられている。
【0003】
図9は、図8の端末3の構成を示す図であり、端末制御器10にアドレスメモリ12が接続されており、そこには割り当てられたアドレスが書き込まれている。この端末3は、それぞれ4点の入出力端子13を有しており、4ビットのデータの入出力処理がなされる。これらの端末3は、一般には、工場の製造現場等で使用され、例えばスイッチのON/OFF、ランプの点滅等のビット単位の信号の制御に利用される。
【0004】
【発明が解決しようとする課題】
しかしながら、上述した構成の端末3は、4点の入出力端子13しか備えていないため、データ表示、印刷等のためにそれよりも多量のデータを取扱いたい場合には、複数個の端末3を使用してビット数を増やさなければならず、コストが増大するという課題があった。
【0005】
【課題を解決するための手段】
そこで上記課題を解決するために、請求項1に係る発明は、2線のケーブルによりマルチドロップ形に接続されるとともにポーリング・セレクティング方式により通信制御されるネットワークに接続される端末装置であって、
この端末装置は、
端末に割り付けられたM(Mは2以上の整数)個のアドレスを記憶しておくアドレスメモリと
一のアドレス毎にN(Nは2以上の整数)個を一単位として割り当てられたN×M個の入出力端子と
マスタから送られてきたアドレスが前記アドレスメモリに記憶されているM個のアドレスのいずれかに一致する場合に自端末宛であると判別し、マスタからのポーリングに応じて該当アドレスに対応するN個の入力用の入出力端子に入力されている信号値をマスタへシリアル伝送し、または/およびマスタからのセレクティングによりシリアル伝送されてきたデータを該当アドレスに対応するN個の出力用の入出力端子へ出力する制御部と
備えたことを特徴とする。
【0006】
請求項2の発明は、2線のケーブルによりマルチドロップ形に接続されるとともにポーリング・セレクティング方式により通信制御されるネットワークに接続される端末装置であって
この端末装置は、
アドレスの割付数S(Sは2以上の整数)を設定する数値設定回路と、
端末に割り付けられたS個のアドレスを記憶しておくアドレスメモリと
一のアドレス毎にN(Nは2以上の整数)個を一単位として割り当てられたN×S個の入出力端子と、
マスタから送られてきたアドレスが前記アドレスメモリに記憶されているアドレスを先頭にした連続する割付数Sの範囲のアドレスのいずれかに一致する場合に自端末宛であると判別し、マスタからのポーリングに応じて該当アドレスに対応するN個の入力用の入出力端子に入力されている信号値をマスタへシリアル伝送し、または/およびマスタからのセレクティングによりシリアル伝送されてきたデータを該当アドレスに対応するN個の出力用の入出力端子へ出力する制御部と
備えたことを特徴とする。
【0007】
請求項3の発明は、2線のケーブルによりマルチドロップ形に接続されるとともにポーリング・セレクティング方式により通信制御されるネットワークに接続される端末装置であって
この端末装置は、
モード設定スイッチの開閉信号により全アドレスを割付けるモードに切り換えるモード設定手段と、
端末に割り付けられたアドレスを記憶しておくアドレスメモリと
N(Nは2以上の整数)×(全アドレス数)個の入出力端子と
全アドレスを割付けるモードが設定されている状態で、マスタから送られてきた全てのアドレスを自端末宛であると判別し、マスタからのポーリングに応じて全アドレスに対応する入出力端子に入力されている信号値をマスタへシリアル伝送し、または/およびマスタからのセレクティングによりシリアル伝送されてきたデータを全アドレスに対応する入出力端子へ出力する制御部と
備えたことを特徴とする。
【0008】
【発明の実施の形態】
以下、図に沿って本発明の実施形態を説明する。
図1は請求項1の発明に係る端末装置の構成を示すブロック図であり、この端末装置は、図8に示したネットワークに接続される端末3に相当する。図1において、10は制御器であり、1対の分岐ライン11を介して、伝送ケーブル4に並列に接続されている。制御器10に接続されているアドレスメモリ12には、M(Mは2以上の整数)個のアドレスが記憶されている。また、制御器10には、アドレス選択線14と4本のデータ線18を介して入出力データ処理部15が接続されており、さらに入出力データ処理部15には、複数の入出力端子13が接続されている。通常、この入出力端子13の数は、4×M個とし、入出力端子13は4個単位で各アドレスに対応する。
【0009】
この端末装置では、分岐ライン11から取り込まれた信号が制御器10により受信され、まず最初にアドレスの照合が行われる。具体的には、マスタからのアドレス呼び出しに応じて、自身のアドレスメモリ12に設定されているM個のアドレスとの一致を判定し、そのうちのいずれかのアドレスと一致すると、入出力データ処理部15が、ポーリングの場合はそのアドレスに対応する入出力端子13に入力されているデータをそのアドレスに続くタイミングでマスタへ送信する。
【0010】
セレクティングの場合は、アドレスに続いて送られてきたデータをそのアドレスに対応する入出力端子13に出力する。入出力データ処理部15が、この動作を繰り返すことにより自身のアドレスメモリ12に設定されたアドレスの個数Mと同数の端末分のデータすなわち4×Mビットのデータの入出力が実行される。
【0011】
図2は請求項2の発明に係る端末装置の構成を示すブロック図であり、この端末装置は、図8に示したネットワークに接続される端末3に相当する。図2において、10は制御器であり、1対の分岐ライン11を介して、伝送ケーブル4に並列に接続されている。制御器10に接続されているアドレスメモリ12には、1個のアドレスが記憶されている。また、制御器10には、アドレス選択線14と4本のデータ線18を介して入出力データ処理部15が接続されている。
【0012】
また、制御器10には、数値設定回路を構成する複数のスイッチ16が接続されており、これらスイッチ16の開閉の組み合わせで、アドレスの割付数S(Sは2以上の整数)が設定される。この割付数Sが、この端末装置に割り付けられるアドレスの個数をあらわし、具体的には、アドレスメモリ12に記憶されたアドレスを先頭にした連続するS個のアドレスとなる。
また、入出力データ処理部15には、4×S個の入出力端子13が接続されている。これら入出力端子13は4個単位で各アドレスに対応する。
なお、アドレスの割付数Sの設定は、スイッチ16を用いずに、予めメモリに割付数Sを記憶させておく構成とすることも可能である。
【0013】
この端末装置では、分岐ライン11から取り込まれた信号が制御器10により受信され、まず最初にアドレスの照合が行われる。具体的には、マスタからのアドレス呼び出しに応じて、自身のアドレスメモリ12に設定されたアドレスを先頭としたS個の連続アドレスと一致するか否かを判定し、そのうちのいずれかのアドレスと一致すると、入出力データ処理部15が、ポーリングの場合はそのアドレスに対応する入出力端子13に入力されているデータをそのアドレスに続くタイミングでマスタへ送信する。
【0014】
セレクティングの場合は、データに続いて送られてきたデータをそのアドレスに対応する入出力端子13に出力する。入出力データ処理部15が、この動作を繰り返すことにより自身のアドレスメモリ12に設定されたアドレスを先頭としたS個の連続アドレスに対応する端末分のデータすなわち4×Sビットのデータの入出力が実行される。
【0015】
図3は図1の実施形態の動作を示し、図の上段の軸は、ネットワーク上でのマスタ1と端末3間のデータの送信と応答のタイミングを示し、マスタ1から定期的に指令30が送信され、その後に端末3から応答31が送信される。
下段はアドレスメモリ12に「アドレス10」が記憶されかつスイッチ16の設定数が「3」である端末装置におけるデータの入出力の関係を示し、図ではマスタ1からアドレスを順に代えて指令30が送信されると、照合期間32においてそのアドレスを照合するが、最初の指令30はアドレス9を指定しているため、照合の結果、不一致となる。
【0016】
次の指令30はアドレス10を指定しているため、照合の結果、一致するので、次のデータ受信期間33でマスタからのデータを受信し、さらにその後の応答データ出力期間34でマスタへデータを送信する。次のアドレス11、アドレス12を指定した指令30までは、同様に照合が一致し、データ受信とデータ送信を実行する。次のアドレス13はアドレス不一致でデータの送受信は行われない。
【0017】
図4は請求項3の発明に係る端末装置の構成を示すブロック図であり、この端末装置は、図8に示したネットワークに接続される端末3に相当する。図4において、10は制御器であり、1対の分岐ライン11を介して、伝送ケーブル4に並列に接続されている。制御器10には全アドレス設定モードを切換えるためのモード設定スイッチ17が接続されている。また、制御器10には、アドレス選択線14と4本のデータ線18を介して入出力データ処理部15が接続されており、さらに入出力データ処理部15には、複数の入出力端子13が接続されている。通常、この入出力端子13の数は、4×(全アドレス数)個とし、入出力端子13は4個単位で各アドレスに対応する。
【0018】
この端末装置では、スイッチ17が閉じられると全アドレス設定モードとなり、マスタから送信された全アドレスを自端末宛として、データ送受信処理を実行する。なおこのスイッチ17が開かれると通常のモードとなり、従来例で説明したように指定された単一のアドレスにのみ応答してデータ送受信処理を実行する。
【0019】
図5は図4の実施形態の動作を示し、図の上段の軸は、ネットワーク上でのマスタ1と端末3の間のデータの送信と応答のタイミングを示し、マスタ1から定期的に指令30が送信され、その後に端末3から応答31が送信される。
中段はスイッチ17が閉じられて全アドレス設定モードが設定された端末装置におけるデータの入出力の関係を示し、図ではマスタ1からアドレスを順に代えて指令30が送信されると、照合期間32においてそのアドレスを照合する。
【0020】
ここでは、全アドレス設定モードであるため、照合結果は常に一致となり、次のデータ受信期間33でマスタ1からのデータを受信し、さらのその後の応答データ出力期間34でマスタ1へデータを送信する。次に下段で示されるタイミング35でアドレスが更新され、マスタ1からは次のアドレスが送信される。以後、全てのアドレスについても同様に、自端末宛と判別されてデータ送受信の処理が実行される。
【0021】
図6は、上述した各実施形態の入出力データ処理部15およびその出力部の構成の具体例を示し、入出力データ処理部15はラッチ24a〜24dと、それらの動作タイミングを制御するアドレスデコーダ25とから構成される。制御器10から複数の端末分のデータが順次入力されてくると、それらは各端末に対応するラッチ24a〜24dに保持される。
【0022】
ラッチ24a、24bに保持されたデータは、外部に設けられた表示用ドライバー20a,20bに送られて7セグメント表示素子からなる表示器21a,21bにその値が表示される。ラッチ24cに保持されたデータはデータ信号22として外部へ出力される。同じく、ラッチ24dに保持されたデータはデータストローブ信号23に変換されて外部へ出力される。
図7は、図6で外部出力されるデータ信号22と、データストローブ信号23の出力タイミングを示す。
【0023】
これらの実施形態では、複数個のアドレスが設定された端末3が、図6に示すように送受信データをアドレス毎に管理して配置し、表示、並列データ出力等の利用目的に応じて信号処理する。この制御を実現するための回路は単純なロジック回路、CPU、ゲートアレー等を用途に応じて選択して構成することができる。
また、端末装置の入出力点数を増大させる場合は、すべての信号をデータとして取り扱うのではなく、表示用のデータ以外に多桁表示での表示桁制御、表示モードの切り替え(点滅、複数データの切り替え表示、小数点制御など)制御信号にも利用できる。
【0024】
また、同様にプリンタ用のパラレルデータ+データストローブ信号を作成することにより、プリンタへの印字出力等も可能になる。
この他、多点入力にも利用できる。マトリックス状のスイッチボードの状態読み込み、多点数の表示出力に対してその各々に対するACK応答としても活用できる。
さらに、端末から入出力される受信4ビットデータと、それに同期して得られるアドレス情報を入力し、その信号を内部記憶素子に蓄え、このデータをべースにしてデータを加工することで、多点入出力端末として利用できる。
【0025】
また、伝送ケーブル4からなるバス上に全アドレスを割り付けた1台だけの端末を配置することにより、上記機能を実現する他に、伝送ケーブル4を経由して、全端末分のデータを遠方まで伝送する場合にも利用できる。
なお、上述した各実施形態では、1つのアドレスが対応する1つの端末装置の入出力端子数Nを4としたが、当然4以外の端子数にして構成することも可能である。
【0026】
【発明の効果】
以上述べたように本発明によれば、1個の端末装置であっても、複数アドレスまたは全アドレスを自端末装置宛として、ポーリング・セレクティングされることで、大量のデータの入出力が可能になる。その結果、設置される端末装置の数が削減されて安価にネットワークシステムを構成することが可能になる。
【図面の簡単な説明】
【図1】請求項1の発明の実施形態の構成を示すブロック図である。
【図2】請求項2の発明の実施形態の構成を示すブロック図である。
【図3】図2の実施形態の動作を示すタイミング図である。
【図4】請求項3の発明の実施形態の構成を示すブロック図である。
【図5】図4の実施形態の動作を示すタイミング図である。
【図6】各実施形態の入出力データ処理部およびその出力部の構成を示す図である。
【図7】図6の出力部からの出力例を示すタイミング図である。
【図8】本発明が適用されるネットワークの構成を示す図である。
【図9】従来例を示す図である。
【符号の説明】
1 マスタ
2 電源
3 端末
4 伝送ケーブル
5 上位装置
10 端末制御器
11 分岐ライン
12 アドレスメモリ
13 入出力端子
14 アドレス選択線
15 入出力データ処理部
16,17 スイッチ
18 データ線
20a,20b 表示用ドライバー
21a,21b 表示器
22 データ信号
23 データストローブ信号
24a〜24d ラッチ
25 アドレスデコーダ
30 指令
31 応答
32 照合期間
33 データ受信期間
34 応答データ出力期間
[0001]
BACKGROUND OF THE INVENTION
The present invention relates to a terminal device that is connected to the lowest layer of an information transmission network laid in a factory or the like and controls a switch, a lamp display, and the like in units of one point.
[0002]
[Prior art]
Conventionally, one type of information transmission network laid in factories, etc., each terminal is connected in parallel to a bus consisting of two cables (multi-drop type), and communication control between terminals is performed using a polling / selecting method. There is something to do.
FIG. 8 shows the configuration, in which the master 1 is connected to the lower side of the host device 5, and the master 1, the power source 2, and the plurality of terminals 3 are connected by a transmission cable 4 with two core wires. Each terminal 3 is assigned one address.
[0003]
FIG. 9 is a diagram showing the configuration of the terminal 3 of FIG. 8, in which an address memory 12 is connected to the terminal controller 10, and the assigned address is written therein. Each terminal 3 has four input / output terminals 13 and performs input / output processing of 4-bit data. These terminals 3 are generally used at a factory manufacturing site or the like, and are used to control a signal in bit units such as ON / OFF of a switch and blinking of a lamp.
[0004]
[Problems to be solved by the invention]
However, since the terminal 3 having the above-described configuration includes only the four input / output terminals 13, when a larger amount of data is to be handled for data display, printing, etc., a plurality of terminals 3 are provided. There has been a problem that the number of bits must be increased by using it, which increases the cost.
[0005]
[Means for Solving the Problems]
To solve the above problems, the invention according to claim 1 is a connected Ru terminal to a network communicated controlled by polling selecting system is connected to a multi-drop shaped by two-wire cable ,
This terminal device
An address memory for storing M addresses (M is an integer of 2 or more) assigned to the terminal ;
And N × M pieces of the input and output terminals assigned as N (N is an integer not smaller than 2) one unit for every one address,
When the address sent from the master matches any of the M addresses stored in the address memory, it is determined that the address is for the own terminal, and N corresponding to the address is determined according to polling from the master. a signal value input to the input and output terminals for inputs and serial transmission to the master, or / and by selecting operation from the master input and for the N output corresponding data it has been serially transmitted to the corresponding address A control unit that outputs to the power terminal ;
The features and kite provided.
[0006]
A second aspect of the present invention, a connected Ru terminal device to a network communicated controlled by polling selecting system is connected to a multi-drop shaped by two-wire cable,
This terminal device
A numerical value setting circuit for setting an address allocation number S (S is an integer of 2 or more);
An address memory for storing S addresses assigned to the terminal ;
N × S input / output terminals assigned with N (N is an integer of 2 or more) as one unit for each address;
If the address sent from the master matches one of the addresses in the range of consecutive allocation numbers S starting from the address stored in the address memory, it is determined that the address is sent to the own terminal , corresponding address data that has been serially transmitted by the selecting from a signal value input to the input and output terminals for N inputs corresponding to the relevant address and serially transmitted to the master and / or master, in response to the polling a controller for outputting to the input and output terminals for the N output corresponding to,
The features and kite provided.
[0007]
A third aspect of the present invention, a connected Ru terminal device to a network communicated controlled by polling selecting system is connected to a multi-drop shaped by two-wire cable,
This terminal device
Mode setting means for switching to a mode in which all addresses are assigned by an open / close signal of a mode setting switch;
An address memory for storing the address assigned to the terminal ;
N (N is an integer of 2 or more) × (total number of addresses) I / O terminals ,
In a state where the mode assigning the entire address has been set, the input to the input and output terminals of all address sent from the master determines that the addressed to its own terminal, corresponding to all the addresses in response to the polling from the master and a control unit which is being output a signal value serially transmitted to the master, or / and the data that has been serially transmitted by the selecting from the master to the input and output terminals corresponding to all addresses,
The features and kite provided.
[0008]
DETAILED DESCRIPTION OF THE INVENTION
Hereinafter, embodiments of the present invention will be described with reference to the drawings.
FIG. 1 is a block diagram showing the configuration of a terminal device according to the invention of claim 1, and this terminal device corresponds to the terminal 3 connected to the network shown in FIG. In FIG. 1, reference numeral 10 denotes a controller, which is connected in parallel to the transmission cable 4 via a pair of branch lines 11. The address memory 12 connected to the controller 10 stores M (M is an integer of 2 or more) addresses. The controller 10 is connected to an input / output data processing unit 15 via an address selection line 14 and four data lines 18, and the input / output data processing unit 15 includes a plurality of input / output terminals 13. Is connected. Usually, the number of the input / output terminals 13 is 4 × M, and the input / output terminals 13 correspond to each address in units of four.
[0009]
In this terminal device, a signal fetched from the branch line 11 is received by the controller 10, and address verification is first performed. Specifically, in response to an address call from the master, it is determined whether or not it matches with M addresses set in its own address memory 12, and if it matches any of these addresses, the input / output data processing unit In the case of polling 15, data input to the input / output terminal 13 corresponding to the address is transmitted to the master at a timing following the address.
[0010]
In the case of selecting, the data sent following the address is output to the input / output terminal 13 corresponding to the address. By repeating this operation, the input / output data processing section 15 executes input / output of data for the same number of terminals as the number M of addresses set in its own address memory 12, that is, 4 × M bit data.
[0011]
FIG. 2 is a block diagram showing the configuration of the terminal device according to the invention of claim 2, and this terminal device corresponds to the terminal 3 connected to the network shown in FIG. In FIG. 2, reference numeral 10 denotes a controller, which is connected in parallel to the transmission cable 4 via a pair of branch lines 11. One address is stored in the address memory 12 connected to the controller 10. Further, an input / output data processing unit 15 is connected to the controller 10 via an address selection line 14 and four data lines 18.
[0012]
The controller 10 is connected to a plurality of switches 16 constituting a numerical value setting circuit, and an address allocation number S (S is an integer of 2 or more) is set by a combination of opening and closing these switches 16. . This assigned number S represents the number of addresses assigned to this terminal device, and specifically, S consecutive addresses starting from the address stored in the address memory 12.
The input / output data processing unit 15 is connected to 4 × S input / output terminals 13. These input / output terminals 13 correspond to each address in units of four.
The address assignment number S can be set in advance by storing the assignment number S in a memory without using the switch 16.
[0013]
In this terminal device, a signal fetched from the branch line 11 is received by the controller 10, and address verification is first performed. Specifically, in response to an address call from the master, it is determined whether or not it matches the S consecutive addresses starting from the address set in its own address memory 12, and any one of the addresses is determined. If they match, in the case of polling, the input / output data processing unit 15 transmits the data input to the input / output terminal 13 corresponding to the address to the master at the timing following the address.
[0014]
In the case of selecting, the data sent following the data is output to the input / output terminal 13 corresponding to the address. The input / output data processing unit 15 repeats this operation to input / output data corresponding to the terminal corresponding to S consecutive addresses starting from the address set in its address memory 12, that is, 4 × S bit data. Is executed.
[0015]
FIG. 3 shows the operation of the embodiment of FIG. 1, and the upper axis of the figure shows the timing of data transmission and response between the master 1 and the terminal 3 on the network. Then, a response 31 is transmitted from the terminal 3.
The lower row shows the input / output relationship of data in the terminal device in which “address 10” is stored in the address memory 12 and the set number of switches 16 is “3”. In FIG. When transmitted, the address is collated in the collation period 32. However, since the first command 30 designates the address 9, the collation results in a mismatch.
[0016]
Since the next command 30 designates the address 10 and matches as a result of the collation, data is received from the master in the next data reception period 33, and further data is sent to the master in the subsequent response data output period 34. Send. In the same way, until the next command 11 specifying the address 11 and the address 12, the matching is matched, and data reception and data transmission are executed. The next address 13 is an address mismatch and data transmission / reception is not performed.
[0017]
FIG. 4 is a block diagram showing the configuration of a terminal device according to the invention of claim 3. This terminal device corresponds to the terminal 3 connected to the network shown in FIG. In FIG. 4, reference numeral 10 denotes a controller, which is connected in parallel to the transmission cable 4 via a pair of branch lines 11. The controller 10 is connected to a mode setting switch 17 for switching all address setting modes. The controller 10 is connected to an input / output data processing unit 15 via an address selection line 14 and four data lines 18, and the input / output data processing unit 15 includes a plurality of input / output terminals 13. Is connected. Usually, the number of input / output terminals 13 is 4 × (total number of addresses), and the input / output terminals 13 correspond to each address in units of four.
[0018]
In this terminal device, when the switch 17 is closed, the entire address setting mode is set, and data transmission / reception processing is executed with all addresses transmitted from the master addressed to the own terminal. When the switch 17 is opened, a normal mode is set, and data transmission / reception processing is executed in response to only a single address designated as described in the conventional example.
[0019]
FIG. 5 shows the operation of the embodiment of FIG. 4, and the upper axis of the figure shows the timing of data transmission and response between the master 1 and the terminal 3 on the network. Is transmitted, and then the response 31 is transmitted from the terminal 3.
The middle row shows the input / output relationship of data in the terminal device in which the switch 17 is closed and the all address setting mode is set. In the figure, when a command 30 is sent from the master 1 in order of addresses, Check the address.
[0020]
Here, since all addresses are set, the collation result is always the same, the data from the master 1 is received in the next data reception period 33, and the data is transmitted to the master 1 in the subsequent response data output period 34. To do. Next, the address is updated at a timing 35 shown in the lower stage, and the next address is transmitted from the master 1. Thereafter, all addresses are similarly determined to be addressed to the own terminal, and data transmission / reception processing is executed.
[0021]
FIG. 6 shows a specific example of the configuration of the input / output data processing unit 15 and the output unit of each of the above-described embodiments. 25. When data for a plurality of terminals are sequentially input from the controller 10, they are held in latches 24a to 24d corresponding to the terminals.
[0022]
The data held in the latches 24a and 24b is sent to display drivers 20a and 20b provided outside, and the values are displayed on the display devices 21a and 21b formed of 7-segment display elements. The data held in the latch 24c is output to the outside as the data signal 22. Similarly, the data held in the latch 24d is converted into a data strobe signal 23 and output to the outside.
FIG. 7 shows the output timing of the data signal 22 and the data strobe signal 23 output externally in FIG.
[0023]
In these embodiments, the terminal 3 in which a plurality of addresses are set manages and arranges transmission / reception data for each address as shown in FIG. 6, and performs signal processing according to the purpose of use such as display and parallel data output. To do. A circuit for realizing this control can be configured by selecting a simple logic circuit, CPU, gate array or the like according to the application.
In addition, when increasing the number of input / output points of a terminal device, not all signals are handled as data. In addition to display data, display digit control in multi-digit display, display mode switching (flashing, multiple data It can also be used for control signals (switching display, decimal point control, etc.).
[0024]
Similarly, by generating parallel data + data strobe signal for the printer, it is possible to output to the printer.
In addition, it can be used for multipoint input. It can also be used as an ACK response to each of the matrix switch board status reading and multi-point display output.
Furthermore, by receiving the received 4-bit data input / output from the terminal and the address information obtained in synchronization therewith, storing the signal in the internal storage element, and processing the data based on this data, It can be used as a multi-point input / output terminal.
[0025]
In addition to realizing the above function by arranging only one terminal with all addresses assigned on the bus consisting of the transmission cable 4, the data for all terminals can be transmitted far away via the transmission cable 4. It can also be used for transmission.
In each of the above-described embodiments, the number N of input / output terminals of one terminal device corresponding to one address is four, but it is naturally possible to configure the number of terminals other than four.
[0026]
【The invention's effect】
As described above, according to the present invention, even a single terminal device can input and output a large amount of data by polling and selecting multiple addresses or all addresses addressed to the terminal device itself. become. As a result, the number of terminal devices to be installed can be reduced and a network system can be configured at low cost.
[Brief description of the drawings]
FIG. 1 is a block diagram showing the configuration of an embodiment of the invention of claim 1;
FIG. 2 is a block diagram showing a configuration of an embodiment of the invention of claim 2;
FIG. 3 is a timing diagram illustrating the operation of the embodiment of FIG.
FIG. 4 is a block diagram showing a configuration of an embodiment of the invention of claim 3;
FIG. 5 is a timing diagram illustrating the operation of the embodiment of FIG. 4;
FIG. 6 is a diagram illustrating a configuration of an input / output data processing unit and an output unit thereof according to each embodiment.
7 is a timing chart showing an example of output from the output unit of FIG. 6. FIG.
FIG. 8 is a diagram showing a configuration of a network to which the present invention is applied.
FIG. 9 is a diagram showing a conventional example.
[Explanation of symbols]
DESCRIPTION OF SYMBOLS 1 Master 2 Power supply 3 Terminal 4 Transmission cable 5 Host apparatus 10 Terminal controller 11 Branch line 12 Address memory 13 Input / output terminal 14 Address selection line 15 Input / output data processing part 16, 17 Switch 18 Data line 20a, 20b Display driver 21a , 21b Display 22 Data signal 23 Data strobe signals 24a-24d Latch 25 Address decoder 30 Command 31 Response 32 Verification period 33 Data reception period 34 Response data output period

Claims (3)

2線のケーブルによりマルチドロップ形に接続されるとともにポーリング・セレクティング方式により通信制御されるネットワークに接続される端末装置であって、
この端末装置は、
自端末に割り付けられたM(Mは2以上の整数)個のアドレスを記憶しておくアドレスメモリと、
一のアドレス毎にN(Nは2以上の整数)個を一単位として割り当てられたN×M個の入出力端子と、
マスタから送られてきたアドレスが前記アドレスメモリに記憶されているM個のアドレスのいずれかに一致する場合に自端末宛であると判別し、マスタからのポーリングに応じて該当アドレスに対応するN個の入力用の入出力端子に入力されている信号値をマスタへシリアル伝送し、または/およびマスタからのセレクティングによりシリアル伝送されてきたデータを該当アドレスに対応するN個の出力用の入出力端子へ出力する制御部と、
を備えたことを特徴とするネットワークの端末装置。
Is connected to a multi-drop shaped by two-wire cable to a connected Ru terminal device to a network communicated controlled by polling selecting system,
This terminal device
An address memory for storing M addresses (M is an integer of 2 or more) assigned to the terminal;
And N × M pieces of the input and output terminals assigned as N (N is an integer not smaller than 2) one unit for every one address,
When the address sent from the master matches any of the M addresses stored in the address memory, it is determined that the address is for the own terminal, and N corresponding to the address is determined according to polling from the master. a signal value input to the input and output terminals for inputs and serial transmission to the master, or / and by selecting operation from the master input and for the N output corresponding data it has been serially transmitted to the corresponding address A control unit that outputs to the power terminal;
Network terminal device comprising a kite comprising a.
2線のケーブルによりマルチドロップ形に接続されるとともにポーリング・セレクティング方式により通信制御されるネットワークに接続される端末装置であって
この端末装置は、
アドレスの割付数S(Sは2以上の整数)を設定する数値設定回路と、
自端末に割り付けられたS個のアドレスを記憶しておくアドレスメモリと、
一のアドレス毎にN(Nは2以上の整数)個を一単位として割り当てられたN×S個の入出力端子と、
マスタから送られてきたアドレスが前記アドレスメモリに記憶されているアドレスを先頭にした連続する割付数Sの範囲のアドレスのいずれかに一致する場合に自端末宛であると判別し、マスタからのポーリングに応じて該当アドレスに対応するN個の入力用の入出力端子に入力されている信号値をマスタへシリアル伝送し、または/およびマスタからのセレクティングによりシリアル伝送されてきたデータを該当アドレスに対応するN個の出力用の入出力端子へ出力する制御部と、
を備えたことを特徴とするネットワークの端末装置。
Is connected to a multi-drop shaped by two-wire cable to a connected Ru terminal device to a network communicated controlled by polling selecting system,
This terminal device
A numerical value setting circuit for setting an address allocation number S (S is an integer of 2 or more);
An address memory for storing S addresses assigned to the terminal;
N × S input / output terminals assigned with N (N is an integer of 2 or more) as one unit for each address;
It determined to be addressed to its own terminal if the address transmitted from the master matches one of the addresses in the range of the allocation number S of successive to the top address stored in the address memory, from the master corresponding address data that has been serially transmitted by the selecting from a signal value input to the input and output terminals for N inputs corresponding to the relevant address and serially transmitted to the master and / or master, in response to the polling a controller for outputting to the input and output terminals for the N output corresponding to,
Network terminal device comprising a kite comprising a.
2線のケーブルによりマルチドロップ形に接続されるとともにポーリング・セレクティング方式により通信制御されるネットワークに接続される端末装置であって
この端末装置は、
モード設定スイッチの開閉信号により全アドレスを割付けるモードに切り換えるモード設定手段と、
自端末に割り付けられたアドレスを記憶しておくアドレスメモリと、
N(Nは2以上の整数)×(全アドレス数)個の入出力端子と、
全アドレスを割付けるモードが設定されている状態で、マスタから送られてきた全てのアドレスを自端末宛であると判別し、マスタからのポーリングに応じて全アドレスに対応する入出力端子に入力されている信号値をマスタへシリアル伝送し、または/およびマスタからのセレクティングによりシリアル伝送されてきたデータを全アドレスに対応する入出力端子へ出力する制御部と、
を備えたことを特徴とするネットワークの端末装置。
Is connected to a multi-drop shaped by two-wire cable to a connected Ru terminal device to a network communicated controlled by polling selecting system,
This terminal device
Mode setting means for switching to a mode in which all addresses are assigned by an open / close signal of a mode setting switch;
An address memory for storing the address assigned to the terminal;
N (N is an integer of 2 or more) × (total number of addresses) I / O terminals,
In a state where the mode assigning the entire address has been set, the input to the input and output terminals of all address sent from the master determines that the addressed to its own terminal, corresponding to all the addresses in response to the polling from the master and a control unit which is being output a signal value serially transmitted to the master, or / and the data that has been serially transmitted by the selecting from the master to the input and output terminals corresponding to all addresses,
Network terminal device comprising a kite comprising a.
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