JP3425717B2 - 振動ジャイロ - Google Patents

振動ジャイロ

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Description

【発明の詳細な説明】
【0001】
【発明の属する技術分野】本発明は、振動ジャイロに関
し、特に、圧電型の振動ジャイロに関するものである。
【0002】
【従来の技術】圧電型の振動ジャイロとしては、一般的
に振動体が音片形状のタイプと音叉形状のタイプがあ
る。また、圧電型の振動ジャイロに用いられる振動子
は、振動体自体が圧電セラミックスからなり検出部や駆
動部として電極膜を形成してなるタイプと、振動体が恒
弾性金属等の機械的な振動を生ずる部材からなり検出部
や駆動部として圧電素子を形成してなるタイプがある。
【0003】これらの振動ジャイロでは、振動子に回転
角速度が印加された際に発生するコリオリ力に起因した
振動子の屈曲変位を、圧電体で電気信号に変換して、回
路処理により回転角速度に比例した電気出力として得て
いた。
【0004】これらの振動ジャイロにおける、振動子か
ら出力される検出信号の回路処理の従来例を、図2を用
いて説明する。
【0005】図2において、1は振動子を示す。振動子
1は、振動体2と2つの検出手段3a,3bを備える。
2つの検出手段3a,3bは、それぞれ、配線パターン
7a,7bを介してバッファアンプ4a,4bの入力段
と接続される。また、配線パターン7a,7bは、それ
ぞれ、負荷抵抗RL を経て基準電位Vref に接続さ
れる。バッファアンプ4aの出力段は加算回路5と差動
回路6に入力され、同様に、バッファアンプ4bの出力
段は加算回路5と差動回路6に入力される。そして、加
算回路5の出力信号は駆動回路(図示せず)へ帰還さ
れ、差動回路6の出力信号は角速度検出信号として次段
の検出信号処理回路(図示せず)へ出力される。
【0006】
【発明が解決しようとする課題】しかしながら、上記従
来の振動ジャイロには、次のような問題があった。
【0007】即ち、従来の振動ジャイロにおける検出信
号の処理回路においては、振動子1に接続される配線パ
ターン7a,7bとグランド(あるいは基準電位)間に
ストレー容量Csa,Csbがそれぞれ発生している。
【0008】このストレー容量Csa,Csbは、振動
子1の形状が大きく圧電効果により得られる電気信号が
大きい場合は特に影響がなかったが、近年の振動子1の
形状の小型化に伴い、検出手段である圧電素子の容量は
低減し、前記ストレー容量の影響が無視できなくなり、
2つの検出手段3a,3bからの出力信号のレベルのバ
ラツキや位相のバラツキなどが発生していた。
【0009】このようなバラツキは、ストレー容量Cs
a,Csbを等しくすることにより抑制することが可能
であるが、ストレー容量を等しくするためには、2つの
検出手段3a,3bとバッファアンプ4a,4bを接続
する配線パターン7a,7bを、同じ長さ、同じ幅、そ
して、対称な配線パターン形状に形成する必要がある。
【0010】しかしながら、前記条件を満たすパターン
形状を形成するには、パターン設計に制約が多く発生
し、回路基板の形状の小型化を阻害する要因となってい
た。
【0011】また、前記条件を満たす回路パターンが形
成された回路基板を振動ジャイロ装置に組み込んだ場
合、回路パターンと装置の筐体などの回路外の要素との
間で新たにストレー容量が発生し、回路に影響を及ぼし
ていた。
【0012】また、振動ジャイロ装置の動作環境(温度
・湿度など)が変化した場合にもストレー容量が変化
し、振動子からの出力信号が変化してしまっていた。
【0013】したがって、本発明の目的は、上述の問題
点を解消するためになされたもので、ストレー容量バラ
ツキやストレー容量に起因する諸問題の発生を抑制し、
装置の小型化や出力信号の安定化を可能とする振動ジャ
イロを提供することにある。
【0014】
【課題を解決するための手段】上記目的を達成するため
に、本発明者は鋭意研究を重ねた結果、この回路構成に
ドリブンシールド回路技術を適用し、ストレー容量の発
生自体を抑えることにより、振動ジャイロの特性バラツ
キを低減する構成を発明した。
【0015】
【0016】つまり、複数の検出手段を有する振動子、
複数の検出手段で出力される複数の検出信号がそれぞれ
入力される複数の増幅手段、複数の増幅手段から出力さ
れる増幅信号が加算される加算手段を備え、検出手段と
増幅手段とを接続する接続手段が、前記加算手段から出
力される加算信号によりドリブンシールドされることを
特徴とし、特に、加算手段は、加算した信号を、1/
(加算した信号の数)の増幅率で増幅して出力すること
を特徴としている。
【0017】これにより、複数の接続手段のパターン形
状に差があったとしても、増幅手段入力段に接続される
見かけ上のストレー容量はほぼゼロとなる。
【0018】また、加算手段からの出力は、複数の出力
手段のそれぞれとほぼ同一の振幅を有するようになり、
加算手段の出力信号を用いて回路の信号入力部分である
接続手段をドリブンシールドすることが可能となる。
【0019】
【発明の実施の形態】以下、本発明の実施の形態を図面
を参照して詳細に説明する。なお、従来例と同一の構成
については同一番号を付し、その説明を省略する。
【0020】図1に、本発明の第1の実施の形態に係る
振動ジャイロの回路構成説明図を示す。振動ジャイロは
振動子1を含む。振動子1は、振動体2と2つの検出手
段3a,3bを備える。
【0021】振動子1は、従来の技術においても述べた
とおり、音叉形状や音片形状いずれでもよく、振動体2
の材質もエリンバなどの恒弾性金属やチタン酸鉛などを
主成分とする圧電セラミックスなど、機械的振動を発生
するものであればよい。ここで、振動体2を金属で構成
すれば、検出手段3a,3bとしては、厚み方向に分極
された板状の圧電素子が用いられ、振動体2を圧電セラ
ミックスで構成すれば、検出手段3a,3bとしては電
極が用いられる。
【0022】2つの検出手段3a,3bは、それぞれ、
接続手段としての配線パターン7a,7bを介して増幅
手段としてのバッファアンプ4a,4bの入力と接続さ
れる。また、配線パターン7a,7bは、それぞれ、負
荷抵抗RL を経て基準電位Vref に接続される。バ
ッファアンプ4aの出力は加算手段としての加算回路5
と差動回路6に入力され、同様に、バッファアンプ4b
の出力は加算回路5と差動回路6に入力される。そし
て、加算回路5の出力信号は駆動回路(図示せず)へ帰
還され、差動回路6の出力信号は角速度検出信号として
次段の検出信号処理回路(図示せず)へ出力される。
【0023】この回路構成においては、発明が解決しよ
うとする課題でも述べたとおり、振動子1に接続される
配線パターン7a,7bと基準電位Vref 間にスト
レー容量が発生するため、ドリブンシールド回路技術を
備える構成となっている。それを以下に説明する。
【0024】ドリブンシールドとは、高入力インピーダ
ンスを持つオペアンプ等の増幅器の入力安定性を高める
ために、ガード電極として採用される技術であり、増幅
器の入力部と入力部周辺の基準電位との間に発生するス
トレー容量やリーク電流を防止する回路技術である。
【0025】図1に示すように、本発明の振動ジャイロ
の回路構成では、ドリブンシールドの駆動信号源とし
て、2つの検出手段3a,3bの加算信号である加算回
路5の出力を用い、加算回路5の出力段とバッファアン
プ4a,4bの入力段との間にドリブンシールド10が
接続され、破線で囲まれるバッファアンプの入力段4
a,4bがシールドされる構成となっている。
【0026】なお、この加算回路5は、単に2つの検出
手段3a,3bの出力信号の和をとるだけではなく、1
/2の増幅率を有することにより、2つの検出手段3
a,3bからそれぞれ出力される出力信号の振幅とほぼ
同じ振幅を有する加算信号を出力する回路となってい
る。
【0027】このような回路構成とすることにより、加
算回路5の出力段1ヶ所の信号をドリブンシールドの駆
動源として、2つのバッファアンプ4a,4bの入力段
となる2つの配線パターン7a,7bについてドリブン
シールドすることが可能となり、回路の簡略化が達成さ
れる。
【0028】
【0029】
【0030】
【0031】なお、本発明に係る振動ジャイロは前記実
施の形態に限定するものでなく、たとえば、ドリブンシ
ールド10の回路構成も、前記実施の形態に示した構成
に特に限定されるものではない。
【0032】さらに、検出手段が2つ以上備えられる多
軸方向角速度検出用の振動ジャイロにおいては、複数の
検出手段に対応してドリブンシールドが構成され、特
に、加算回路の出力をドリブンシールドの駆動源にする
場合は、加算回路の増幅率は、1/(加算回路が加算す
る信号の数)として構成されればよい。
【0033】
【発明の効果】以上のように、本発明による振動ジャイ
ロでは、ストレー容量はほぼゼロとなるように抑えられ
るため、ストレー容量に起因する諸問題が解消される。
【0034】このため、回路設計において、ストレー容
量差の発生を考慮した回路のパターニングや構造設計が
不要となり、設計の自由度が向上し、振動ジャイロの小
型化も可能となる。
【0035】また、周囲環境の変化が発生しても、スト
レー容量差の変化が発生せず、よっって、振動子の出力
信号の変化も振動子固有の特性による変化のみとなり、
振動ジャイロ出力信号の環境による影響が小さくなると
ともに、振動子固有の特性による変化であることから、
他の回路での補正も容易となり、より安定した信頼性の
高い振動ジャイロの出力信号が得られる。
【0036】さらに、加算手段からの出力を駆動源とし
てドリブンシールドする構成としているので、個々の増
幅手段から出力することが不要となり、これにより、回
路をIC化した場合にピンの数を減らすことが可能とな
り、また、各々のドリブンシールド回路の回路パターン
が同電位であることから、パターン設計の自由度が向上
し、一層の小型化と設計コストの低減が達成される。
【図面の簡単な説明】
【図1】本発明の第1の実施の形態に係る振動ジャイロ
の回路構成説明図である。
【図2】従来の振動ジャイロの回路構成説明図である。
【符号の説明】
1 振動子 2 振動体 3a,3b 検出手段 4a,4b バッファアンプ 5 加算回路 6 差動回路 7a,7b 配線パターン 10 ドリブンシールド
───────────────────────────────────────────────────── フロントページの続き (58)調査した分野(Int.Cl.7,DB名) G01C 19/56 G01P 9/04

Claims (3)

    (57)【特許請求の範囲】
  1. 【請求項1】 複数の検出手段を有する振動子、前記複
    数の検出手段で出力される複数の検出信号がそれぞれ入
    力される複数の増幅手段、前記複数の増幅手段から出力
    される増幅信号が加算される加算手段、を備え、前記検
    出手段と前記増幅手段とを接続する接続手段が、前記加
    算手段から出力される加算信号によりドリブンシールド
    されることを特徴とする、振動ジャイロ。
  2. 【請求項2】 前記加算手段は、加算した信号を、1/
    (加算した信号の数)の増幅率で増幅して出力すること
    を特徴とする、請求項1に記載の振動ジャイロ。
  3. 【請求項3】 前記検出手段は、圧電効果により発生す
    る信号を検出信号として検出し出力することを特徴とす
    請求項1または2に記載の振動ジャイロ。
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