JP3306760B2 - デジタルフィルタを持つ周波数多重化分離回路 - Google Patents

デジタルフィルタを持つ周波数多重化分離回路

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Description

【発明の詳細な説明】
【０００１】
【産業上の利用分野】本発明は、デジタル処理による周
波数多重化／多重化分離に関する。
【０００２】
【従来の技術】デジタル処理による周波数多重化／多重
化分離回路の最初のものはトランスマルチプレクサの心
臓部に使われたが、それは電話網の内部で性質の異なる
多重化回線の間のデータ伝送の問題を解決するためであ
った。例えば、その種のトランスマルチプレクサは、周
波数多重化された帯域幅４KHzのアナログ電話回線６０
本からなる二次群（ＧＳ）の多重送信と、２０４８Mbit
／秒の一次ＭＩＣ（ＴＮ１）多重送信回線２本の間の接
続を確保する。かくして、非常に図式的に言うと、トラ
ンスマルチプレクサは周波数分割多重送信回線（ＦＤ
Ｍ）と時間分割多重送信回線（ＴＤＭ）の間の変換を行
うものである。
【０００３】衛星通信の分野においては、このトランス
マルチプレクサの技術は、衛星通信網の最適利用のため
の２つの条件を満たすために有利である。一つには、地
上局から衛星に向けて設定された上りの接続のための周
波数分割多元アクセス（ＦＤＭＡ）が、地上局の必要と
する送信電力と送信アンテナの大きさを節約させ、これ
によって地上局の設置場所に関する柔軟性をより大きく
する点において有望な技術であることが明らかになって
いる。他方では、衛星から地上局に向けて設定された下
りの接続に関して、送信信号によって変調された複数の
キャリヤが衛星によって送られる時に変調間雑音を発生
させないようにするために、時間分割多重送信（ＴＤＭ
Ａ）技術が推奨されている。この変調間雑音はキャリヤ
の数が増すにつれて大きくなる。唯１個のキャリヤが時
間分割多重送信アクセスの１個のデジタルフレームによ
り変調されるのであれば、この変調間雑音の問題は存在
しない。
【０００４】周波数分割多重送信アクセスと時間分割多
重送信アクセスの間のこの種の変換を実行させるのに使
われる衛星は、一般には再生衛星と呼ばれている。その
理由は、それらの衛星は、多重化された回線の形で受信
した信号を、信号成分の各周波数帯域の関数として“再
生”するからである。
【０００５】小さなアンテナのマイクロ局（ＶＳＡＴ）
から中央局および中央局からマイクロ局の間の接続が時
間分割多元アクセスキャリヤ（ＴＤＭＡ）と時間分割多
重送信回線キャリヤ（ＴＤＭ）で確保される衛星マイク
ロ局通信網（英米語の用法では、超微小開口端末−Very
Small Aperture Terminal(VSAT))と比較して、再生衛
星搭載トランスマルチプレクサの技術は２つの局の間の
送信時間を２分の１にするが、それは局間のデータの伝
達が中央局を経由せずに直接行われるからである。
【０００６】再生衛星の使用から得られる上記の全ての
利点にもかかわらず、衛星の開発者はその利用を多少と
も躊躇する。
【０００７】その理由は、通信網に割当てられた総帯域
幅の最適な活用のためには満足されねばならないが、従
来の技術にあっては互いに全く矛盾する２つの要件があ
ることである：その２つとは、−衛星通信網の中のトラ
ヒックの変動に応じて割当のし直しができるように、ト
ランスマルチプレクサは地上から“簡単な”方式でプロ
グラムできなければならない、また−トランスマルチプ
レクサは、互いに異なる帯域幅を持つ周波数多重化され
た信号を受信しなければならない。
【０００８】トランスマルチプレクサの核心となる部品
は、地上からのプログラミングの対象となる周波数多重
化分離回路である。従来の技術においては、デジタルフ
ィルタを基礎とした様々な構造の多重化分離回路が提案
されてきた。主なものは次のとおりである： −チャンネルの個別の処理による実施方式。これは周波
数多重化されるキャリヤの数が増すにつれて具体的実施
が非常に複雑かつ高価となり、その上、プログラミング
が煩雑となる欠点を持つ； −“高速フーリエ変換器”による実施方式。これが本当
に効率的なのはキャリヤの数が大きい場合だけであり、
そうでない場合にはキャリヤの数と比較して長い処理時
間を要するという欠点を持つ； −遅延線とデジタルフィルタからなる多相網による実施
方式。これは従来の技術においては、周波数多重化され
た信号が互いに異なる帯域幅を持つ場合には処理できな
い。
【０００９】
【発明が解決しようとする課題】本発明は、周波数帯域
幅が互いに異なる、周波数分割多重化されたチャンネル
を再構成するために使用可能な、従って、特に、チャン
ネルの数と帯域幅の両方の変更によるトラヒックの変動
に適応可能な、多相網を利用した多重化分離回路の供給
を目的とする。
【００１０】
【課題を解決するための手段】このために、本発明によ
る回路は、所定の有効周波数帯域幅を持つ多キャリヤの
サンプルされた信号に対し、周波数多重化されたチャン
ネルを多重化分離する。チャンネルは、有効周波数帯の
中に含まれる変調されたキャリヤと、有効周波数帯の中
に配置される周波数帯域幅によって決められる。チャン
ネルの周波数帯域幅はチャンネルの最大周波数帯域幅の
整数分の一になり、後者自体も有効帯域幅の整数分の一
で、かつチャンネルの最小帯域幅の整数倍になる。
【００１１】多重化分離回路は、多相網を持つ既知の回
路と類似の形で、有効帯域幅とチャンネルの最小帯域幅
の比に等しい所定の数の、各々が一個の遅延線と一個の
デジタルフィルタを直列に含む並列に置かれた回路、お
よび、このフィルタの出力につながれて上記のチャンネ
ルを個別に再構成するためのフーリエ変換のデジタル処
理の機構を含んでおり、上記のフィルタの各々は、上記
のチャンネルの最小帯域の中で濾波するデジタル・ロー
パス・フィルタから導かれる。
【００１２】しかし、多相網を持つ既知の回路は同一の
帯域幅を持つチャンネルしか処理できない。言い換えれ
ば、帯域幅の最小値と最大値は全てのチャンネルの帯域
幅に等しく、遅延線とデジタルフィルタの各々の組は、
一つのチャンネルの処理にアサインされている。
【００１３】本発明によると、多重化分離回路は次のも
のを含む： −複数の濾波・周波数逓減の機構で、多キャリヤのサン
プルされた信号の中のチャンネルを所定の数のチャンネ
ル群へ分離するための機構であり、各チャンネル群は、
他の群のチャンネルの帯域幅とは異なる、全てが同じ帯
域幅を持つチャンネルの並置された帯域を含む、 −複数の並列な遅延線で、その数は有効帯域幅とチャン
ネルの最大帯域幅の比に等しい所定の数であり、各チャ
ンネル群は、その群の帯域幅とチャンネルの最大帯域幅
の比より大きくそれに最も近い整数に等しい数のそれぞ
れ並列な遅延線により遅延を受ける、そして −複数の同一の並列な多相網で、遅延線の出力にそれぞ
れ接続され、多相網の各々は上記の複数の並列な遅延線
とデジタルフィルタの組を、チャンネルの最大帯域幅と
最小のそれとの比に等しい所定の数だけ含む。
【００１４】遅延線とデジタルフィルタの組を独立で同
一の多相網の形に配置することによって、多相網は、帯
域幅が互いに異なる、最大と最小の帯域幅の間に分布し
ているチャンネルを処理することが可能となる。これら
の多相網へのチャンネルの指向は、群の中でのチャンネ
ルの特性、即ち各群の中のチャンネルの数と帯域幅の関
数として実現するが、特に多相網に先立つ濾波・周波数
逓減の機構および遅延線の濾波、逓減、および遅れの特
性、更には、フーリエ変換の処理機構の中のマトリクス
の特性が、群の中のチャンネルの特性に適応させられて
いる。
【００１５】本発明による多重化分離回路の中のこれら
の適応化は、次の特性となって現れる： −多キャリヤ信号の中から一つのチャンネル群を分離す
る濾波・周波数逓減の機構は、当該群の帯域幅を持つデ
ジタルフィルタと、その後に、上記当該群の帯域幅と有
効帯域幅の比に等しい逓減比を持つ逓減器を含むこと； −一つのチャンネル群を遅らせる並列な遅延線は、有効
帯域幅と当該群の帯域幅の比に等しい零以上の整数の倍
数にそれぞれ比例して遅延を施すこと； −多相網に含まれる遅延線は、チャンネルの最大帯域幅
と最小のそれとの比に等しい零以上の整数の倍数にそれ
ぞれ比例する遅延を施すこと； −デジタル処理機構は、各チャンネル群について、フー
リエ変換の係数の複数の正方マトリクス機構を、当該群
の帯域幅と最小帯域幅の比に等しい数だけ含み、その当
該群に付属するマトリクス機構の各々の次数は、当該群
の中のチャンネルの数に等しいこと。
【００１６】前記の様々な特性が、多重化分離回路をト
ラヒックの変動に適応させることができる。言い換えれ
ば、多重化分離回路は、プログラム可能である。この場
合、濾波・逓減のデジタル機構、並列な遅延線、および
デジタル処理機構は、有効帯域の中のチャンネル群の所
定の数と分割に関する特性および群内のチャンネル数を
受信する制御機構によってプログラム可能であり、ま
た、多重化分離回路は複数の交換機構を含むが、それら
は、それぞれ濾波・逓減のデジタル機構の出力に接続さ
れ、かつ、これらのデジタル機構を上記の群の分割およ
び上記の群内のチャンネル数に応じて並列な遅延線に選
択的に接続するために制御機構によって制御される。
【００１７】
【実施例】図１は本発明による周波数多重化分離回路の
図式的なブロックダイヤグラム、図２Ａは本発明による
多重化分離回路の第１の実施例、図２Ｂは図２Ａに対応
する上りの接続のトラヒックを周波数で表したものを示
し、図３Ａは本発明による多重化分離回路の第２の実施
例を示し、図３Ｂは図３Ａにおける対応する上りの接続
のトラヒックを周波数で表したものを示す。
【００１８】図２Ａと図２Ｂの実施例はｆ１＝ｆｕ／１
６のチャンネルを８個と、ｆ２＝ｆｕ／４（＝４ｆ１）
のチャンネルを２個有する周波数多重化信号の分離に関
し、図３Ａと図３Ｂの実施例はｆ１＝ｆｕ／１６のチャ
ンネルを４個と、ｆ２＝ｆｕ／４（＝４ｆ１）のチャン
ネルを３個有する周波数多重化信号の分離に関する。な
お、ｆｕは有効周波数帯域幅である。
【００１９】本発明によると、有効周波数帯域幅
（ｆｕ）と各チャンネルの周波数帯域幅（ｆ１、ｆ２）
の間に所定の制限を有する。すなわち周波数多重化され
たチャンネルは、有効周波数帯の中に含まれる変調され
たキャリヤ（Ｐ１ １からＰ４ １、Ｐ１ ２からＰ３ ２）
と、有効周波数帯の中に並置される周波数帯域幅
（ｆ１、ｆ２）によって決められ、各チャンネルの周波
数帯域幅はチャンネルの最大周波数帯域幅（ｆ２）の整
数分の一であり、後者自体も有効帯域幅（ｆｕ）の整数
分の一で、かつチャンネルの最小帯域幅（ｆ１）の整数
倍である。図２Ａと図２Ｂ及び図３Ａと図３Ｂの実施例
では、チャンネルの最小帯域幅はｆ１、チャンネルの最
大帯域幅はｆ２、有効帯域幅（ｆｕ）の間には、ｆ１＝
ｆｕ／１６＝ｆ２／４、ｆ２＝４ｆ１＝ｆｕ／４の関係
がある。
【００２０】本発明による多重化分離回路１０の基本的
な構成は図１に示される。複数の濾波・周波数逓減の手
段１０２（群フィルタ１０２１、１０２２）を有し、該
手段は、チャンネルを所定の数のチャンネル群（群１、
群２）に分離し、ここで、各チャンネル群は他の群のチ
ャンネルの帯域幅とは異なる、全てが同じ帯域幅を持つ
チャンネルの並置された帯域をふくむ。図２Ｂの実施例
では、群１は帯域がｆ１のチャンネルを８個ふくみ、群
２は帯域がｆ２（＝４ｆ１）のチャンネルを２個ふく
む。図３Ｂの実施例では群１は帯域がｆ１のチャンネル
を４個ふくみ、群２は帯域がｆ２（＝４ｆ１）のチャン
ネルを３個ふくむ。チャンネル群を分離するフィルタの
出力にふくまれるチャンネルは全て同じ帯域幅を有す
る。該フィルタは当該群の帯域幅をもつデジタルフィル
タにより構成される。
【００２１】図１の各群フィルタ（１０２１、１０
２２）の出力は多相多重化分離器（１０５）に印加され
る。該多相多重化分離回路（１０５）は、周知のごと
く、遅延線とデジタルフィルタの組を並列に複数有し、
それらの出力がフーリエ変換のデジタル処理機構に接続
されることにより、全てが同じ帯域のチャンネルから構
成される周波数多重化信号が、チャンネル毎に分離され
る。
【００２２】次に本発明の具体的実施例を図２Ａ、図２
Ｂ、図３Ａ、図３Ｂにより説明する。
【００２３】本発明が対象とする周波数多重化された信
号は所定の有効周波数帯域幅（ｆｕ）をもつ多キャリア
のサンプルされた信号（ＳＭ）である。本発明はこの信
号を多重化分離する。
【００２４】該信号は、複数の濾波・周波数逓減の手段
（１０２１、１０２２）に印加され、該手段は、多キャ
リヤのサンプルされた信号（ＳＭ）の中のチャンネルを
所定の数のチャンネル群（群１、群２）へ分離し、各チ
ャンネル群は、他の群のチャンネルの帯域幅とは異な
る、全てが同じ帯域幅（ｆ１又はｆ２）を持つチャンネ
ルの並置された帯域を含む。チャンネル群に分離された
信号は上記当該群の帯域幅と有効帯域幅（ｆｕ）の比に
等しい逓減比を持つ逓減器（１０２１’、１０２２’）
に印加される。
【００２５】逓減比は図２Ａと図２Ｂの実施例では各群
の帯域幅がｆｕ／２なので１／２、図３Ａと図３Ｂの実
施例では、群１に対し１／４、群２に対し３／４であ
る。
【００２６】濾波・周波数逓減の手段（１０２１、１０
２２）の出力は交換機構（１０３１、１０３２）を介し
て複数の並列な遅延線（１０４）に印加される。該遅延
線の数は有効帯域幅とチャンネルの最大帯域幅の比に等
しい。各実施例ではこの数はｆｕ／ｆ２＝４であり、４
つの遅延線（１０４a、１０４b、１０４c、１０４d）が
もうけられる。
【００２７】各チャンネル群（群１、群２）は、当該群
の帯域幅とチャンネルの最大帯域幅の比（ｆ２＝ｆｕ／
４）より大きくそれに最も近い整数に等しい数の並列な
遅延線（１０４a、１０４b、１０４c、１０４d）により
遅延を受ける。この数は、図２Ａと図２Ｂの実施例では
群１、群２共に２（１０４aと１０４b、及び１０４cと
１０４d）、図３Ａと図３Ｂの実施例では群１が１（１
０４a）、群２が３（１０４b、１０４c、１０４d）であ
る。
【００２８】前記遅延線（１０４a、１０４b、１０４
c、１０４d）の出力は複数の同一の並列な多相網（１０
５a、１０５b、１０５c、１０５d）に接続される。各多
相網は遅延線とデジタルフィルタの組をチャンネルの最
大帯域幅と最小帯域幅の比に等しい所定の数だけふく
む。この数は、各実施例ではｆ２／ｆ１＝４である。
【００２９】なお、遅延線とデジタルフィルタの総数は
有効帯域幅とチャンネルの最小帯域幅の比に等しく、該
総数は実施例ではｆｕ／ｆ１＝１６である。ここで上記
のフィルタの各々はチャンネルの最小帯域で濾波するデ
ジタル・ローパス・フィルタを有する。
【００３０】上記のデジタルフィルタ（Ｈp0からＨp1
5）の出力は、各チャンネルを個別に再構成するための
フーリエ変換のデジタル処理機構（１０５５）に接続さ
れる。
【００３１】前記遅延線（１０４）の構成する並列な遅
延線（１０４a、１０４b、１０４c、１０４d）により施
される遅延は、有効帯域幅（実施例ではｆｕ）と、群の
帯域幅（実施例ではｆｕ／２、ｆｕ／４又は３ｆｕ／
４）に等しい零以上の整数の倍数に比例した遅延である
（図２Ａと図２Ｂの実施例では、ｚ−０、ｚ−２、図３
Ａと図３Ｂの実施例では、ｚ−０、又はｚ−０、ｚ
−４／３、ｚ−８／３）。
【００３２】前記各多相網（１０５a、１０５b、１０５
c、１０５d）に含まれる遅延線により施される遅延は、
チャンネルの最大帯域幅（実施例ではｆ２）と最小帯域
幅（ｆ１）の比（ｆ２／ｆ１）に等しい零以上の整数の
倍数に比例する遅延である（実施例では、ｚ−０、ｚ
−４、ｚ−８、ｚ−１２）。
【００３３】前記デジタル処理機構（１０５５）は、各
チャンネル群（群２）について、フーリエ変換の係数の
複数の正方マトリクス機構を、当該群の帯域幅（ｆ２）
と最小帯域幅（ｆ１）の比に等しい数だけ含み、その当
該群に付属する各々のマトリクス機構の次数は、当該群
の中のチャンネルの数に等しい。
【００３４】前記の濾波・逓減デジタル手段（１０
２）、並列な遅延線（１０４）、およびデジタル処理機
構（１０５５）は、有効帯域（ｆｕ）の中のチャンネル
群の数と分割に関する特性および群内のチャンネル数を
受信する制御機構（ＵＣ）によってプログラム可能であ
り、多重化回路が複数の交換機構（１０３１、１０
３２）を含み、それらは、それぞれ濾波・逓減のデジタ
ル手段（１０２）の出力に接続され、かつ、これらのデ
ジタル手段（１０２）を上記の群の分割および上記の群
内のチャンネル数に応じて並列な遅延線に選択的に接続
するために、制御機構（ＵＣ）によって制御される。
【図面の簡単な説明】
【図１】本発明による、プログラム可能な周波数多重化
分離回路の図式的なブロックダイヤラムである。
【図２Ａ】プログラム可能な多重化分離回路の第一の実
施例を示す。
【図２Ｂ】図２Ａにおける対応する上りの接続のトラヒ
ックを周波数で表したものを示す。
【図３Ａ】プログラム可能な多重化分離回路の第二の実
施例を示す。
【図３Ｂ】図３Ａにおける対応する上りの接続のトラヒ
ックを周波数で表したものを示す。
───────────────────────────────────────────────────── フロントページの続き (56)参考文献 特開 昭63−200635（ＪＰ，Ａ) 特開 平４−44432（ＪＰ，Ａ) 特開 平４−117739（ＪＰ，Ａ) ＥＮＲＩＣＯ ＤＥＬ ＲＥ ＆ Ｒ ＯＭＡＮＯ ＦＡＮＴＡＣＣＩ，ＡＬＴ ＥＲＮＡＴＩＶＥＳ ＦＯＲ ＯＮ−Ｂ ＯＡＲＤ ＤＩＧＩＴＡＬ ＭＵＬＴＩ ＣＡＲＲＩＥＲ ＤＥＭＯＤＵＬＡＴＩ ＯＮ，ＩＮＴＥＲＮＡＴＩＯＮＡＬ Ｊ ＯＵＲＮＡＬ ＯＦ ＳＡＴＥＬＬＩＴ Ｅ ＣＯＭＭＵＮＩＣＡＴＩＯＮＳ，Ｊ ｏｈｎ Ｗｉｌｅｙ ＆ Ｓｏｎｓ，Ｌ ｔｄ．，ＶＯＬ．６（1988），267−281 Ｗ．Ｈ．ＹＩＭ ＥＴ．ＡＬ．，ＭＵ ＬＴＩ−ＣＡＲＲＩＥＲ ＤＥＭＯＤＵ ＬＡＴＯＲＳ ＦＯＲ ＯＮ−ＢＯＡＲ Ｄ ＰＲＯＣＥＳＳＩＮＧ ＳＡＴＥＬ ＬＩＴＥＳ，ＩＮＴＥＲＮＡＴＩＯＮＡ Ｌ ＪＯＵＲＮＡＬ ＯＦ ＳＡＴＥＬ ＬＩＴＥ ＣＯＭＭＵＮＩＣＡＴＩＯＮ Ｓ，Ｊｏｈｎ Ｗｉｌｅｙ ＆ Ｓｏｎ ｓ，Ｌｔｄ．，ＶＯＬ．６（1988）, 243−251 (58)調査した分野(Int.Cl.7，ＤＢ名) H04J 3/00 H04B 7/015 H04J 1/00

Claims (6)

    (57)【特許請求の範囲】
  1. 【請求項１】 所定の有効周波数帯域幅（ｆｕ）を持つ
    多キャリヤのサンプルされた信号（ＳＭ）の中で、周波
    数多重化されたチャンネルを多重化分離するための装置
    であり、 上記のチャンネルは、有効周波数帯の中に含まれる変調
    されたキャリヤ（Ｐ１ １からＰ４ １、Ｐ１ ２から
    Ｐ３ ２）と、有効周波数帯の中に並置される周波数帯域
    幅（ｆ１、ｆ２）によって決められ、各チャンネルの周
    波数帯域幅はチャンネルの最大周波数帯域幅（ｆ２）の
    整数分の一であり、後者自体も有効帯域幅（ｆｕ）の整
    数分の一で、かつチャンネルの最小帯域幅（ｆ１）の整
    数倍であり、 前記装置（１０）は、有効帯域幅とチャンネルの最小帯
    域幅の比に等しい所定の数（ｆｕ／ｆ１＝１６）の、一
    個の遅延線と一個のデジタルフィルタの直列回路を並列
    に配置した回路、および、上記のフィルタ（Ｈp0からＨ
    p15）の出力につながれて上記のチャンネルを個別に再
    構成するためのフーリエ変換のデジタル処理機構（１０
    ５５）を含んでおり、上記のフィルタの各々は、上記の
    チャンネルの最小帯域（ｆ１）で濾波するデジタル・ロ
    ーパス・フィルタを有する周波数多重化分離回路におい
    て、 複数の濾波・周波数逓減の手段（１０２）を有し、該手
    段は、多キャリヤのサンプルされた信号（ＳＭ）の中の
    チャンネルを所定の数のチャンネル群（群１、群２）へ
    分離し、各チャンネル群は、他の群のチャンネルの帯域
    幅とは異なる、全てが同じ帯域幅を持つチャンネルの並
    置された帯域を含み、 複数の並列な遅延線（１０４）を有し、その数は有効帯
    域幅とチャンネルの最大帯域幅の比に等しい所定の数
    （ｆｕ／ｆ２＝４）であり、各チャンネル群（群１、群
    ２）は、当該群の帯域幅（ｆｕ／４、３ｆｕ／４）とチ
    ャンネルの最大帯域幅の比（ｆ２＝ｆｕ／４）より大き
    くそれに最も近い整数に等しい数の並列な遅延線（１０
    ４a、１０４b、１０４c、１０４d）により遅延を受け、 複数の同一の並列な多相網（１０５a、１０５b、１０５
    c、１０５d）を有し、前記遅延線（１０４a、１０４b、
    １０４c、１０４d）の出力にそれぞれ接続され、多相網
    の各々は上記の複数の並列な遅延線とデジタルフィルタ
    の組を、チャンネルの最大帯域幅（ｆ２）と最小帯域幅
    （ｆ１）との比に等しい所定の数だけ含むこと、 を特徴とする、デジタルフィルタを持つ周波数多重化分
    離回路。
  2. 【請求項２】 多キャリヤ信号（ＳＭ）の中から一つの
    チャンネル群を分離する濾波・周波数逓減の手段が、当
    該群の帯域幅を持つデジタルフィルタ（１０２１、１０
    ２２）と、その後に、上記当該群の帯域幅（ｆｕ／４、
    ３ｆｕ／４）と有効帯域幅（ｆｕ）の比に等しい逓減比
    を持つ逓減器（１０２１’、１０２２’）を含むこと、 を特徴とする、請求項１に記載の回路。
  3. 【請求項３】 一つのチャンネル群（群２）を遅延させ
    る並列な遅延線（１０４b、１０４c、１０４d）が、有
    効帯域幅（ｆｕ）と当該群の帯域幅（３ｆｕ／４）の比
    （４／３）に等しい零以上の整数の倍数にそれぞれ比例
    して遅延を施すこと、 を特徴とする、請求項１または２に記載の回路。
  4. 【請求項４】 各多相網（１０５a、１０５b、１０５
    c、１０５d）に含まれる遅延線（ｚ−０、ｚ−４、ｚ
    −８、ｚ−１２）が、チャンネルの最大帯域幅と最小の
    それとの比（ｆ２／ｆ１）に等しい零以上の整数の倍数
    にそれぞれ比例する遅延を施すこと、 を特徴とする、請求項１から３のいずれかに記載の回
    路。
  5. 【請求項５】 デジタル処理機構（１０５５）が、各チ
    ャンネル群（群２）について、フーリエ変換の係数の複
    数の正方マトリクス機構を、当該群の帯域幅（ｆ２）と
    最小帯域幅（ｆ１）の比に等しい数だけ含み、その当該
    群に付属する各々のマトリクス機構の次数は、当該群の
    中のチャンネルの数に等しいこと、を特徴とする、請求
    項１から４のいずれかに記載の回路。
  6. 【請求項６】 濾波・逓減のデジタル手段（１０２）、
    並列な遅延線（１０４）、およびデジタル処理機構（１
    ０５５）が、有効帯域（ｆｕ）の中のチャンネル群の数
    と分割に関する特性および群内のチャンネル数を受信す
    る制御機構（ＵＣ）によってプログラム可能であり、多
    重化回路が複数の交換機構（１０３１、１０３２）を含
    み、それらは、それぞれ濾波・逓減のデジタル手段（１
    ０２）の出力に接続され、かつ、これらのデジタル手段
    （１０２）を上記の群の分割および上記の群内のチャン
    ネル数に応じて並列な遅延線に選択的に接続するため
    に、制御機構（ＵＣ）によって制御されること、 を特徴とする、請求項１から５のいずれかに記載の回
    路。
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